JP3914171B2 - Semiconductor device and manufacturing method thereof - Google Patents
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Description
【0001】
【発明の属する技術分野】
本発明は、半導体装置及びその製造方法、特に強誘電体を用いたキャパシタを有する半導体装置及びその製造方法に関する。
【0002】
【従来の技術】
近年、LSI(Large scale integrated circuit)のアプリケーション分野が大きく変貌している。従来の主な応用分野であったスーパーコンピュータ、EWS(Engineering Work Station)、パーソナルコンピュータなどから、現在では、携帯端末、マルチメディアなどへ、アプリケーション分野が移行しつつある。このため、低消費電力化・高速動作化のみならず、不揮発性機能の付加が重要となってきている。また、高性能・多機能化には、新材料の導入が不可欠になってきている。
【0003】
例えば、現在、情報記憶用のキャパシタの絶縁膜として、ペロブスカイト化合物或いはビスマス層状化合物などの強誘電体膜を用いた、不揮発性の強誘電体メモリ(Ferroelectric RAM)が注目されている。この強誘電体メモリは、フラッシュメモリ、SRAM(Static RAM)及びDRAM(Dynamic RAM)との置き換え、ロジック回路混載デバイスへの適用など、次世代のメモリとしての期待が極めて大きい。また、この強誘電体メモリは、バッテリーレスで高速動作が可能であるため、RF-ID (Radio Frequency-Identification)などの非接触カードへの展開が始まっている。
【0004】
上記強誘電体メモリに用いる材料には、揮発性の高い元素或いは、製造過程で拡散して他の材料と反応する元素を含むものが多い。そのため、製造プロセスにおいて大きな支障が生じる。
【0005】
強誘電体膜として用いられる代表的な複合酸化物の一つとして、PZT膜(Pb(Zr,Ti)O3 膜)がある。PZT膜に含有された鉛(Pb)は、他の含有元素に比べて蒸気圧が高い。そのため、PZT膜の形成には、アモルファス膜を低温形成した後、高温加熱処理を行って結晶性を有する膜に変換する方法が、一般的に用いられる。例えば、スパッタリング法などを用いて室温でアモルファスPZT膜を形成した後、酸素雰囲気においてRTA(Rapid Thermal Annealing)により瞬時に結晶化する方法が、広く用いられている。
【0006】
しかしながら、製造工程を通してPb量を制御するのは難しいため、半導体デバイスを高い再現性で歩留まりよく形成することは極めて困難である。また、信頼性を向上させる観点から、キャパシタの電極にはIrO2 、RuO2 、SRO(SrRuO3 )、LSCO((La,Sr)CoO3 )等の酸化物電極が用いられているが、これらの電極材料に含有された元素がPZT膜中に拡散して粒界でPbなどと反応し、I−V特性や強誘電性を劣化させるおそれもある。
【0007】
さらに従来は、アモルファスPZT膜を酸素雰囲気中でアニールして結晶化させていたため、後述するようにPZT膜の結晶が柱状となり、リーク電流の増大や分極疲労特性の悪化等の原因となっていた。
【0008】
公知文献としては、特許文献1及び特許文献2があげられる。いずれも、PZT膜を形成した後、Arガス雰囲気中でアニールを行い、その後に酸素ガス雰囲気中でアニールを行うというものである。しかしながら、これらの公知文献では、アニール後のPZT膜の構造については考慮されておらず、リーク特性に優れた強誘電体キャパシタを得ることが困難であった。
【0009】
【特許文献1】
特開2000−156473号公報
【0010】
【特許文献2】
米国特許第6287637号明細書
【0011】
【発明が解決しようとする課題】
このように、従来の強誘電体キャパシタは、リーク電流の増大や分極疲労特性の悪化等が生じ、I−V特性(電流−電圧特性)や信頼性に優れたキャパシタを得ることが困難であった。
【0012】
本発明は上記従来の課題に対してなされたものであり、特性や信頼性に優れたキャパシタを有する半導体装置及びその製造方法を提供することを目的としている。
【0013】
【課題を解決するための手段】
本発明に係る半導体装置は、下部電極と、上部電極と、前記上部電極と下部電極との間に介在し、Pb、Zr、Ti及びOを含有したペロブスカイト型の強誘電体で形成された誘電体膜と、を備えた半導体装置であって、前記誘電体膜は、複数の方向の粒界で区画された複数の結晶粒で形成された第1の部分を含むことを特徴とする。
【0014】
本発明に係る半導体装置の製造方法は、下部電極上にPb、Zr、Ti及びOを含有したペロブスカイト型の強誘電体で形成された誘電体膜を形成する工程と、前記誘電体膜上に上部電極を形成する工程と、を備えた半導体装置の製造方法であって、前記誘電体膜を形成する工程は、酸素ガス雰囲気中でのアニールによって前記下部電極上に前記誘電体膜の第1の部分を形成する工程と、不活性ガス雰囲気中でのアニールによって前記第1の部分上に前記誘電体膜の第2の部分を形成する工程と、を含むことを特徴とする。
【0015】
【発明の実施の形態】
以下、本発明の実施形態を図面を参照して説明する。
【0016】
(実施形態1)
図1は、本発明の第1の実施形態に係る半導体装置におけるキャパシタの構造を模式的に示したものである。
【0017】
図1に示したキャパシタは、シリコン基板等の半導体基板(図示せず)の上方に形成されており、不揮発性の強誘電体メモリにおける電荷保持用のキャパシタとして用いられる。
【0018】
以下、図1に示したキャパシタの製造方法を説明する。
【0019】
まず、LP-TEOS酸化膜等の下地膜上に、DCマグネトロンスパッタリング法によって、100nm厚のPt膜11を形成する。Ptのスパッタリングは、Arガス雰囲気にて行い、投入電力は3kW、成膜時間は20秒とする。続いて、SRO膜(SrRuO3 膜)12を、DCマグネトロンスパッタリング法により室温で形成する。SROのスパッタリングは、Arガス雰囲気にて行い、投入電力は700W、成膜時間は11.5秒とする。その後、酸素雰囲気中で550〜600℃、30秒の熱処理を行い、SRO膜12を結晶化する。
【0020】
次に、SRO膜12上にPZT膜(Pb(Zr,Ti)O3 膜)13を形成する。PZTは、少なくともPb、Zr、Ti及びOを含有し、ABO3 で表されるペロブスカイト型の強誘電体である。Aサイト元素にはPbが、Bサイト元素にはZr或いはTiが対応する。Aサイト元素或いはBサイト元素として、他の元素が少量、置換されている場合もある。
【0021】
PZT膜13の形成工程を説明する。まず、RFマグネトロンスパッタリングにより、SRO膜12上にアモルファスPZT膜を室温にて堆積する。その後、RTAにより、550〜600℃、30秒の熱処理を行い、アモルファスPZT膜を結晶化する。続いて、結晶化したPZT膜上にさらにアモルファスPZT膜を堆積する。さらに、RTAにより、550〜600℃、30秒の熱処理を行い、アモルファスPZT膜を結晶化する。これにより、合計130nm厚のPZT結晶膜13が形成される。このように、アモルファスPZT膜の堆積/アニール工程を2回繰り返すのは、PZT膜表面のラフネスを改善するため、Pbの分布を均一化させるため、等の理由による。なお、PZTターゲットとしては、例えば、(Pb1.15 , La0.03)(Zr0.4 , Ti0.6)O3 組成の、高密度焼結ターゲットを用いる。また、各アモルファスPZT膜のスパッタリングは、Arガス雰囲気にて行い、投入電力は1.5kW、成膜時間は72秒とする。
【0022】
上記PZT膜13のアニール工程の詳細を説明する。下層PZT膜(PZT膜の下層部)については、最高温度の550〜600℃に到達した後、前半15秒は酸素ガス雰囲気でアニールを行い、後半15秒はArガス雰囲気でアニールを行う。酸素ガスからArガスへの切り替えは連続的に行う。上層PZT膜(PZT膜の上層部)については、550〜600℃の温度に到達した後、前半15秒はArガス雰囲気でアニールを行い、後半15秒は酸素ガス雰囲気でアニールを行う。Arガスから酸素ガスへの切り替えは連続的に行う。下層PZT膜の酸素ガス雰囲気中でのアニール工程により主としてPZT膜13bが得られ、その後の工程により主としてPZT膜13aが得られる。
【0023】
次に、PZT膜13上に、10nm厚のSRO膜14を形成し、さらにその上に50nm厚のPt膜15を形成する。ここでは、SRO膜14及びPt膜15は、例えばシャドーマスクを用いて堆積され、160μm径の円状のパターン形状である。その後、電気炉を用いて、酸素ガス雰囲気下で、550〜600℃の温度にて、1時間の熱処理を行う。
【0024】
以上のようにして、Pt膜11及びSRO膜12からなる下部電極と、SRO膜14及びPt膜15からなる上部電極との間に、PZT膜13からなる強誘電体膜が挟まれたキャパシタ構造が得られる。
【0025】
図2は、本実施形態の比較例に係るキャパシタ構造を模式的に示したものである。Pt膜11、SRO膜12、SRO膜14及びPt膜15の形成方法は図1に示した実施形態と同様であるが、PZT膜13のアニール方法が図1に示した実施形態とは異なっている。比較例においても、アモルファスPZT膜の堆積/アニール工程を2回繰り返すが、いずれのアニール工程(RTA、550〜600℃、30秒)も、酸素ガス雰囲気にて行う。
【0026】
図3は、図1に示した本実施形態のキャパシタの断面構造を、TEM(Transmission Electron Microscopy)によって観察したものである。ここでは、上部電極(SRO膜及びPt膜)を形成する前の構造を示している。
【0027】
本実施形態のアニール方法によって得られたPZT膜13aでは、結晶粒の形状が円錐状或いは卵状となっている。すなわち、図1及び図3に示すように、結晶粒の断面形状は、楔状或いは楕円状となっている。このような結晶粒の形状を有しているため、結晶粒間の粒界の方向が揃っておらず(粒界が複数の方向を有している)、粒界の方向がランダムになっている。言い換えると、PZT膜の下面と上面との間で粒界がジグザグになっている。また、PZT膜13bは、後述する比較例と同様の構造を有しており、PZT膜の結晶粒の形状が柱状となっている。
【0028】
図4は、図2に示した比較例のキャパシタの断面構造を、TEMによって観察したものである。比較例では、PZT膜の結晶粒の形状が柱状となっており、結晶粒の断面形状は長方形状(矩形状)となっている。そして、粒界の方向はPZT膜の下面及び上面に対してほぼ垂直であり、各粒界の方向が揃っている(粒界の方向が一方向である)。
【0029】
次に、本発明の実施形態及び比較例における強誘電体キャパシタの電気的特性について述べる。
【0030】
図5及び図6は、リーク電流特性(I−V特性)の測定結果を示したものである。図5の(O2-Ar/Ar-O2)が本実施形態の特性であり、図6が比較例の特性である。比較例では、+2.5Vの電圧において8.3×10-6A/cm2 のリーク電流密度であるのに対し、本実施形態では、+2.5Vの電圧において5.9×10-7A/cm2 のリーク電流密度であり、リーク電流特性が著しく改善されている。
【0031】
上述した結果の要因を調べるため、PZT膜の粒界に存在する元素をTEM-EDXによって分析した。その結果を図7(本実施形態)及び図8(比較例)に示す。比較例では、PZTの粒界においてRuなどのピークが強く検出されている。これに対して、本実施形態では、PZTにおいてRuのピークが見られない。その理由の一つとして、図3及び図4のTEM像に示されるように、本実施形態と比較例ではグレイン形状が違うため、PZT膜とSRO膜との界面に垂直な方向においてRu拡散の度合いが変わったことがあげられる。すなわち、本実施形態では、粒界がジグザクであるため、実効的な拡散距離が長くなり、PZT膜の表面方向へのRuの拡散が抑えられたものと考えられる。
【0032】
他の理由として、以下の理由が考えられる。図9は、RTAガスの種類を変えて、Pb量の温度依存性をICP分析にて調べた結果を示したものである。図9に示すように、300℃〜700℃において、酸素雰囲気中のRTAではPb量の低下が小さいのに対し、Ar雰囲気中のRTAでは、結晶化温度付近でPb量が急激に低下し、Pbの割合がストイキオメトリに近い値となる。この結果から、比較例では、PZTの粒界に多くのPb或いはPb化合物が残存し、且つRuが拡散及び反応することにより、Pb2Ru2O7-xで表される導電性の酸化物が形成され、この酸化物がリークパスの原因になると考えられる。
【0033】
以上の結果から、リーク電流特性に差が生じたものと思われる。すなわち、本実施形態では、粒界がジグザグで且つグレインが緻密化されているため、PZT膜とSRO膜との界面に垂直な方向でのRu拡散が抑制される。また、Ar雰囲気でのRTAにより、Pb量が低減される。そのため、上記導電性の酸化物の形成が抑制され、リーク電流が低減したと考えられる。
【0034】
図10は、分極疲労特性の測定結果を示したものである。スイッチング時の駆動電圧は±6V、パルス幅は10μ秒、分極測定時の印加電圧は±4Vとした。比較例の場合(O2 /O2 )には、105 〜106 回のスイッチングサイクル付近から、残留分極量が低下し始めている。一方、本実施形態の場合(O2-Ar/Ar-O2)には、1010回の分極反転の後でも残留分極量が低下していない。本実施形態では、膜が緻密化され且つ、Pb量が最適化されているためと考えられる。
【0035】
図11は、インプリント特性の測定結果を示したものである。150℃、600時間以上の加熱後、本実施形態の場合(O2-Ar/Ar-O2)には、比較例の場合(O2 /O2 )に比べて、初期値に対する電圧シフトが0.1V程度減少しており、本実施形態では良好なインプリント特性が得られている。
【0036】
以上のように、本実施形態では、アモルファスPZT膜をArガス雰囲気でアニールすることにより、結晶化後のPZT膜では、緻密で微細な結晶粒が得られるとともに粒界がジグザグになる。また、粒界及び界面のPb量を制御することができる。その結果、PZT膜中に含まれるPb量が低減され、且つ電極に含まれるRuの拡散が抑制されるため、リーク電流を大幅に低減することが可能となる。また、PZT膜と電極との界面のPbの割合が最適化されるため、分極疲労特性の向上等、キャパシタの信頼性を向上させることが可能となる。
【0037】
(実施形態2)
図12は、本発明の第2の実施形態に係る半導体装置におけるキャパシタの構造を模式的に示したものである。基本的な構造は図1に示した第1の実施形態と同様であるが、本実施形態ではPZT膜の構成が第1の実施形態とは異なっている。
【0038】
以下、図12に示したキャパシタの製造方法を説明する。なお、Pt膜11、SRO膜12、SRO膜14及びPt膜15の構成や形成方法は、第1の実施形態と同様であるため、ここではPZT膜13a及び13bの形成方法等について説明する。
【0039】
本実施形態においても、第1の実施形態と同様、アモルファスPZT膜の堆積/アニール工程を2回繰り返す。アモルファスPZT膜の成膜条件等は第1の実施形態と同様であるが、アニール工程(RTA工程)が第1の実施形態とは異なる。1層目のPZT膜13aについては、1層目のアモルファスPZT膜堆積後、Arガス雰囲気中でアニールを行う。2層目のPZT膜13bについては、2層目のアモルファスPZT膜堆積後、酸素ガス雰囲気中でアニールを行う。いずれのアニール工程も、アニール温度550℃〜600℃、アニール時間30秒とする。
【0040】
上述した方法により、1層目のPZT膜13aは、図1に示した第1の実施形態のPZT膜13aと同様の構造になる。2層目のPZT膜13bは、図2に示した第1の実施形態の比較例におけるPZT膜13と同様の構造になる。
【0041】
次に、本実施形態の強誘電体キャパシタの電気的特性について述べる。
【0042】
図5に、リーク電流特性(I−V特性)の測定結果を示す。本実施形態の場合(Ar/O2 )では、+2.5Vの電圧において6.5×10-7A/cm2 程度のリーク電流密度であり、リーク電流特性が著しく改善されている。第1の実施形態で示した効果が改善要因と考えられる。
【0043】
図10に、分極疲労特性の測定結果を示す。スイッチング時の駆動電圧は±6V、パルス幅は10μ秒、分極測定時の印加電圧は±4Vとした。本実施形態の場合(Ar/O2 )では、1010回の分極反転の後でも残留分極量が低下していない。1層目のPZT膜と2層目のPZT膜とでアニール雰囲気を逆にした場合、すなわち1層目を酸素雰囲気で2層目をAr雰囲気でアニールした場合(O2 /Ar)の測定結果も図10に示した。この場合には、分極疲労特性の多少の劣化が生じている。これは、2層目のPZT膜の上面近傍が、Ar雰囲気中でのRTAにより、酸素不十分な状態になったため、その後のSRO膜形成過程において、SRO膜中の酸素がPZT膜に抜き取られ、SRO膜の結晶性が低下したことによると考えられる。ただし、(O2 /Ar)の場合にも、2層目のPZT膜は図1に示した第1の実施形態のPZT膜13aと同様の構造になるため、キャパシタの特性を向上させることが可能である。
【0044】
図11に、インプリント特性の測定結果を示す。150℃、600時間以上の加熱後、本実施形態の場合(Ar/O2 )には、第1の実施形態の比較例の場合(O2 /O2 )に比べて、初期値に対する電圧シフトが0.1V程度減少しており、本実施形態では良好なインプリント特性が得られている。
【0045】
以上のように、本実施形態においても、第1の実施形態と同様、リーク電流が抑制され、キャパシタの強誘電性や信頼性を向上させることが可能となる。
【0046】
(実施形態3)
図13は、本発明の第3の実施形態に係る半導体装置におけるキャパシタの構造を模式的に示したものである。基本的な構造は図1に示した第1の実施形態と同様であるが、本実施形態ではPZT膜の構成が第1の実施形態とは異なっている。
【0047】
以下、図13に示したキャパシタの製造方法を説明する。なお、Pt膜11、SRO膜12、SRO膜14及びPt膜15の構成や形成方法は、第1の実施形態と同様であるため、ここではPZT膜13a、13b1及び13b2の形成方法等について説明する。
【0048】
本実施形態では、アモルファスPZT膜の堆積/アニール工程を3回繰り返す。アモルファスPZT膜の成膜条件等は第1の実施形態と同様であるが、PZT膜の総厚が第1の実施形態と同じになるよう、各アモルファスPZT膜の成膜時間は48秒とした。
【0049】
1層目のPZT膜13b1については、1層目のアモルファスPZT膜堆積後、酸素ガス雰囲気中でアニールを行う。2層目のPZT膜13aについては、2層目のアモルファスPZT膜堆積後、Arガス雰囲気中でアニールを行う。3層目のPZT膜13b2については、3層目のアモルファスPZT膜堆積後、酸素ガス雰囲気中でアニールを行う。いずれのアニール工程も、アニール温度550℃〜600℃、アニール時間20秒とする。
【0050】
上述した方法により、2層目のPZT膜13aは、図1に示した第1の実施形態のPZT膜13aと同様の構造になる。1層目のPZT膜13b1及び3層目のPZT膜13b2は、図2に示した第1の実施形態の比較例におけるPZT膜13と同様の構造になる。
【0051】
本実施形態においても、第1の実施形態と同様、リーク電流特性及び分極疲労特性等を改善することができ、キャパシタの特性や信頼性を向上させることが可能となる。
【0052】
なお、上述した第3の実施形態では、アモルファスPZT膜の堆積/アニール工程を3回繰り返すようにしたが、アモルファスPZT膜を堆積した後、該アモルファスPZT膜に対して、酸素ガス雰囲気中でのアニール、Arガス雰囲気中でのアニール及び酸素ガス雰囲気中でのアニールを順次連続的に行うようにしてもよい。この場合にも、図13で示したような構造を得ることが可能である。また、第1の実施形態の工程を用いた場合にも、アニール条件等を変えることで、図13で示したような構造を得ることが可能である。
【0053】
また、上述した各実施形態では、コンタクト、配線及び層間膜等の形成、エッチング、平坦化ポリッシング等のBEOL(Back End Of the Line)工程は含んでいないが、フルプロセスを経た場合であっても、上述した効果を得ることが可能である。また、上述した各実施形態では、アモルファスPZT膜等をスパッタリングによって形成したが、その他の成膜技術を用いることも可能である。
【0054】
また、プラグ材にポリシリコンやタングステンなどを使用して、COP(Capacitor On Plug)構造を持つメモリデバイスを作製する場合には、上述した各実施形態の方法を用いることにより、酸化剤のプラグ表面への進入を低減することができ、半導体記憶装置の高集積化を実現することが可能である。
【0055】
また、上述した各実施形態において、下層側SRO膜12のアニール温度(T1)、PZT膜13のアニール温度(T2)及び上層側SRO膜14のアニール温度(T3)の関係は、T1≧T2≧T3であることが望ましい。また、PZT膜13についても、上層側のアニール温度が下層側のアニール温度よりも高くならないようにすることが望ましい。
【0056】
さらに、上述した各実施形態において、不活性ガスとして、Arガスの代わりに、Heガス、Neガス、Arガス、Krガス、Xeガス、Rnガス或いは窒素ガスを用いて、アニールを行うことも可能である。
【0057】
以上、本発明の実施形態を説明したが、本発明は上記実施形態に限定されるものではなく、その趣旨を逸脱しない範囲内において種々変形して実施することが可能である。さらに、上記実施形態には種々の段階の発明が含まれており、開示された構成要件を適宜組み合わせることによって種々の発明が抽出され得る。例えば、開示された構成要件からいくつかの構成要件が削除されても、所定の効果が得られるものであれば発明として抽出され得る。
【0058】
【発明の効果】
本発明によれば、リーク電流の低減や分極疲労特性の改善等、キャパシタの特性や信頼性を向上させることが可能となる。
【図面の簡単な説明】
【図1】 本発明の第1の実施形態に係るキャパシタの構造を模式的に示した断面図である。
【図2】 本発明の比較例に係るキャパシタの構造を模式的に示した断面図である。
【図3】 本発明の第1の実施形態に係るキャパシタの断面構造を示した写真である。
【図4】 本発明の比較例に係るキャパシタの断面構造を示した写真である。
【図5】 本発明の実施形態に係るキャパシタのI−V特性を示した図である。
【図6】 本発明の比較例に係るキャパシタのI−V特性を示した図である。
【図7】 本発明の実施形態に係り、PZT膜に含有されたRuをTEM-EDXによって分析した結果を示した図である。
【図8】 本発明の比較例に係り、PZT膜に含有されたRuをTEM-EDXによって分析した結果を示した図である。
【図9】 キャパシタ中のPb量の温度依存性をICP分析にて調べた結果を示した図である。
【図10】 キャパシタの分極疲労特性の測定結果を示した図である。
【図11】 キャパシタのインプリント特性の測定結果を示した図である。
【図12】 本発明の第2の実施形態に係るキャパシタの構造を模式的に示した断面図である。
【図13】 本発明の第3の実施形態に係るキャパシタの構造を模式的に示した断面図である。
【符号の説明】
11、15…Pt膜
12、14…SRO膜
13、13a、13b、13b1、13b2…PZT膜[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a semiconductor device and a manufacturing method thereof, and more particularly to a semiconductor device having a capacitor using a ferroelectric and a manufacturing method thereof.
[0002]
[Prior art]
In recent years, the application field of LSI (Large scale integrated circuit) has changed greatly. Currently, application fields are shifting from supercomputers, EWS (Engineering Work Station), personal computers, and the like, which have been the main application fields, to mobile terminals, multimedia, and the like. For this reason, not only low power consumption and high speed operation but also the addition of a nonvolatile function has become important. In addition, the introduction of new materials has become indispensable for high performance and multi-functionality.
[0003]
For example, a nonvolatile ferroelectric memory (Ferroelectric RAM) that uses a ferroelectric film such as a perovskite compound or a bismuth layered compound as an insulating film of an information storage capacitor is currently attracting attention. This ferroelectric memory has great expectations as a next-generation memory, such as replacement with flash memory, SRAM (Static RAM) and DRAM (Dynamic RAM), and application to a logic circuit mixed device. In addition, since this ferroelectric memory can operate at high speed without a battery, it has been expanded to contactless cards such as RF-ID (Radio Frequency-Identification).
[0004]
Many of the materials used for the ferroelectric memory contain highly volatile elements or elements that diffuse during the manufacturing process and react with other materials. For this reason, a great trouble occurs in the manufacturing process.
[0005]
One typical composite oxide used as a ferroelectric film is a PZT film (Pb (Zr, Ti) O 3 film). Lead (Pb) contained in the PZT film has a higher vapor pressure than other contained elements. Therefore, a method of forming a PZT film by forming an amorphous film at a low temperature and then converting it to a film having crystallinity by performing a high-temperature heat treatment is generally used. For example, a method in which an amorphous PZT film is formed at room temperature using a sputtering method or the like and then instantly crystallized by RTA (Rapid Thermal Annealing) in an oxygen atmosphere is widely used.
[0006]
However, since it is difficult to control the amount of Pb throughout the manufacturing process, it is extremely difficult to form semiconductor devices with high reproducibility and high yield. Further, from the viewpoint of improving reliability, oxide electrodes such as IrO 2 , RuO 2 , SRO (SrRuO 3 ), and LSCO ((La, Sr) CoO 3 ) are used for the capacitor electrodes. The element contained in the electrode material may diffuse into the PZT film and react with Pb or the like at the grain boundary to deteriorate the IV characteristics or the ferroelectricity.
[0007]
Further, since the amorphous PZT film is conventionally crystallized by annealing in an oxygen atmosphere, the crystal of the PZT film becomes columnar as described later, which causes an increase in leakage current and deterioration of polarization fatigue characteristics. .
[0008]
Known documents include
[0009]
[Patent Document 1]
JP 2000-156473 A [0010]
[Patent Document 2]
US Pat. No. 6,287,637 specification
[Problems to be solved by the invention]
As described above, in the conventional ferroelectric capacitor, leakage current increases and polarization fatigue characteristics deteriorate, and it is difficult to obtain a capacitor having excellent IV characteristics (current-voltage characteristics) and reliability. It was.
[0012]
The present invention has been made to solve the above-described conventional problems, and an object thereof is to provide a semiconductor device having a capacitor having excellent characteristics and reliability and a method for manufacturing the same.
[0013]
[Means for Solving the Problems]
The semiconductor device according to the present invention includes a lower electrode, an upper electrode, and a dielectric formed of a perovskite ferroelectric containing Pb, Zr, Ti, and O, interposed between the upper electrode and the lower electrode. A dielectric film including a first portion formed of a plurality of crystal grains partitioned by grain boundaries in a plurality of directions.
[0014]
A method of manufacturing a semiconductor device according to the present invention includes a step of forming a dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti, and O on a lower electrode; A step of forming the dielectric film, wherein the step of forming the dielectric film includes a first step of forming the first dielectric film on the lower electrode by annealing in an oxygen gas atmosphere. And a step of forming a second portion of the dielectric film on the first portion by annealing in an inert gas atmosphere.
[0015]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, embodiments of the present invention will be described with reference to the drawings.
[0016]
(Embodiment 1)
FIG. 1 schematically shows the structure of a capacitor in a semiconductor device according to a first embodiment of the present invention.
[0017]
The capacitor shown in FIG. 1 is formed above a semiconductor substrate (not shown) such as a silicon substrate, and is used as a charge holding capacitor in a nonvolatile ferroelectric memory.
[0018]
Hereinafter, a method of manufacturing the capacitor shown in FIG. 1 will be described.
[0019]
First, a 100 nm
[0020]
Next, a PZT film (Pb (Zr, Ti) O 3 film) 13 is formed on the
[0021]
A process of forming the
[0022]
Details of the annealing process of the
[0023]
Next, an
[0024]
As described above, the capacitor structure in which the ferroelectric film made of the
[0025]
FIG. 2 schematically shows a capacitor structure according to a comparative example of the present embodiment. The formation method of the
[0026]
FIG. 3 shows the cross-sectional structure of the capacitor of this embodiment shown in FIG. 1 observed by TEM (Transmission Electron Microscopy). Here, the structure before forming the upper electrode (SRO film and Pt film) is shown.
[0027]
In the
[0028]
FIG. 4 shows the cross-sectional structure of the capacitor of the comparative example shown in FIG. 2 observed by TEM. In the comparative example, the crystal grain shape of the PZT film is columnar, and the cross-sectional shape of the crystal grain is rectangular (rectangular). The direction of the grain boundary is substantially perpendicular to the lower and upper surfaces of the PZT film, and the direction of each grain boundary is aligned (the direction of the grain boundary is one direction).
[0029]
Next, the electrical characteristics of the ferroelectric capacitor in the embodiment of the present invention and the comparative example will be described.
[0030]
5 and 6 show measurement results of leakage current characteristics (IV characteristics). (O 2 —Ar / Ar—O 2 ) in FIG. 5 is the characteristic of this embodiment, and FIG. 6 is the characteristic of the comparative example. In the comparative example, the leakage current density is 8.3 × 10 −6 A / cm 2 at a voltage of +2.5 V, whereas in the present embodiment, 5.9 × 10 −7 A at a voltage of +2.5 V. The leakage current density is / cm 2 and the leakage current characteristics are remarkably improved.
[0031]
In order to investigate the factors of the above-described results, the elements present at the grain boundaries of the PZT film were analyzed by TEM-EDX. The results are shown in FIG. 7 (this embodiment) and FIG. 8 (comparative example). In the comparative example, a peak such as Ru is strongly detected at the grain boundary of PZT. In contrast, in this embodiment, no Ru peak is observed in PZT. As one of the reasons, as shown in the TEM images of FIGS. 3 and 4, since the grain shape is different between this embodiment and the comparative example, the Ru diffusion is perpendicular to the interface between the PZT film and the SRO film. The degree has changed. That is, in this embodiment, since the grain boundary is zigzag, the effective diffusion distance is increased, and it is considered that the diffusion of Ru toward the surface of the PZT film is suppressed.
[0032]
Other reasons can be considered as follows. FIG. 9 shows the results of examining the temperature dependence of the Pb amount by ICP analysis while changing the type of RTA gas. As shown in FIG. 9, at 300 ° C. to 700 ° C., the decrease in the Pb amount is small in the RTA in the oxygen atmosphere, whereas in the RTA in the Ar atmosphere, the Pb amount rapidly decreases near the crystallization temperature, The ratio of Pb becomes a value close to stoichiometry. From this result, in the comparative example, a large amount of Pb or Pb compound remains at the grain boundary of PZT, and Ru diffuses and reacts, whereby a conductive oxide represented by Pb 2 Ru 2 O 7-x is obtained. It is considered that this oxide causes a leak path.
[0033]
From the above results, it is considered that a difference occurred in the leakage current characteristics. That is, in this embodiment, since the grain boundary is zigzag and the grains are densified, Ru diffusion in the direction perpendicular to the interface between the PZT film and the SRO film is suppressed. Moreover, the amount of Pb is reduced by RTA in an Ar atmosphere. Therefore, it is considered that the formation of the conductive oxide is suppressed and the leakage current is reduced.
[0034]
FIG. 10 shows the measurement results of the polarization fatigue characteristics. The driving voltage during switching was ± 6 V, the pulse width was 10 μs, and the applied voltage during polarization measurement was ± 4 V. In the case of the comparative example (O 2 / O 2 ), the residual polarization amount starts to decrease from around 10 5 to 10 6 switching cycles. On the other hand, in the case of this embodiment (O 2 —Ar / Ar—O 2 ), the amount of remanent polarization does not decrease even after 10 10 times of polarization reversal. In this embodiment, it is considered that the film is densified and the amount of Pb is optimized.
[0035]
FIG. 11 shows measurement results of imprint characteristics. After heating at 150 ° C. for 600 hours or longer, in the case of this embodiment (O 2 —Ar / Ar—O 2 ), the voltage shift with respect to the initial value is larger than in the case of the comparative example (O 2 / O 2 ). The voltage is reduced by about 0.1 V, and good imprint characteristics are obtained in this embodiment.
[0036]
As described above, in this embodiment, by annealing the amorphous PZT film in an Ar gas atmosphere, in the PZT film after crystallization, dense and fine crystal grains are obtained and the grain boundaries become zigzag. Moreover, the amount of Pb at the grain boundary and the interface can be controlled. As a result, the amount of Pb contained in the PZT film is reduced and the diffusion of Ru contained in the electrode is suppressed, so that the leakage current can be greatly reduced. In addition, since the ratio of Pb at the interface between the PZT film and the electrode is optimized, it is possible to improve the reliability of the capacitor, such as improvement in polarization fatigue characteristics.
[0037]
(Embodiment 2)
FIG. 12 schematically shows the structure of a capacitor in a semiconductor device according to the second embodiment of the present invention. The basic structure is the same as that of the first embodiment shown in FIG. 1, but in this embodiment, the configuration of the PZT film is different from that of the first embodiment.
[0038]
Hereinafter, a method of manufacturing the capacitor shown in FIG. 12 will be described. The configuration and formation method of the
[0039]
Also in this embodiment, similarly to the first embodiment, the deposition / annealing process of the amorphous PZT film is repeated twice. The conditions for forming the amorphous PZT film are the same as those in the first embodiment, but the annealing process (RTA process) is different from that in the first embodiment. The
[0040]
By the method described above, the
[0041]
Next, the electrical characteristics of the ferroelectric capacitor of this embodiment will be described.
[0042]
FIG. 5 shows the measurement result of the leakage current characteristic (IV characteristic). In the case of this embodiment (Ar / O 2 ), the leakage current density is about 6.5 × 10 −7 A / cm 2 at a voltage of +2.5 V, and the leakage current characteristics are remarkably improved. The effect shown in the first embodiment is considered as an improvement factor.
[0043]
FIG. 10 shows the measurement results of the polarization fatigue characteristics. The driving voltage during switching was ± 6 V, the pulse width was 10 μs, and the applied voltage during polarization measurement was ± 4 V. In the case of this embodiment (Ar / O 2 ), the amount of remanent polarization does not decrease even after 10 10 times of polarization reversal. Measurement results when the annealing atmosphere is reversed between the first PZT film and the second PZT film, that is, when the first layer is annealed in an oxygen atmosphere and the second layer is annealed in an Ar atmosphere (O 2 / Ar) Is also shown in FIG. In this case, there is some degradation of polarization fatigue characteristics. This is because the oxygen in the vicinity of the upper surface of the second PZT film has become insufficient due to RTA in an Ar atmosphere, so that oxygen in the SRO film is extracted into the PZT film in the subsequent SRO film formation process. This is probably because the crystallinity of the SRO film was lowered. However, even in the case of (O 2 / Ar), the second-layer PZT film has the same structure as the
[0044]
FIG. 11 shows the measurement results of the imprint characteristics. After heating at 150 ° C. for 600 hours or more, in the case of this embodiment (Ar / O 2 ), the voltage shift with respect to the initial value is compared with the case of the comparative example of the first embodiment (O 2 / O 2 ). Is reduced by about 0.1 V, and good imprint characteristics are obtained in this embodiment.
[0045]
As described above, also in the present embodiment, like the first embodiment, the leakage current is suppressed, and the ferroelectricity and reliability of the capacitor can be improved.
[0046]
(Embodiment 3)
FIG. 13 schematically shows a capacitor structure in a semiconductor device according to the third embodiment of the present invention. The basic structure is the same as that of the first embodiment shown in FIG. 1, but in this embodiment, the configuration of the PZT film is different from that of the first embodiment.
[0047]
A method for manufacturing the capacitor shown in FIG. 13 will be described below. The configuration and formation method of the
[0048]
In this embodiment, the amorphous PZT film deposition / annealing process is repeated three times. The deposition conditions of the amorphous PZT film are the same as in the first embodiment, but the deposition time of each amorphous PZT film is 48 seconds so that the total thickness of the PZT film is the same as in the first embodiment. .
[0049]
The first PZT film 13b1 is annealed in an oxygen gas atmosphere after the first amorphous PZT film is deposited. The
[0050]
By the method described above, the second-
[0051]
Also in the present embodiment, like the first embodiment, the leakage current characteristics, the polarization fatigue characteristics, and the like can be improved, and the characteristics and reliability of the capacitor can be improved.
[0052]
In the third embodiment described above, the amorphous PZT film deposition / annealing step is repeated three times. However, after the amorphous PZT film is deposited, the amorphous PZT film is subjected to an oxygen gas atmosphere. Annealing, annealing in an Ar gas atmosphere, and annealing in an oxygen gas atmosphere may be successively performed. Also in this case, the structure as shown in FIG. 13 can be obtained. Even when the steps of the first embodiment are used, it is possible to obtain the structure shown in FIG. 13 by changing the annealing conditions and the like.
[0053]
Further, each of the above-described embodiments does not include a BEOL (Back End Of the Line) process such as formation of contacts, wirings, interlayer films, etc., etching, planarization polishing, etc. The effects described above can be obtained. In each of the above-described embodiments, the amorphous PZT film or the like is formed by sputtering, but other film formation techniques can also be used.
[0054]
Further, when a memory device having a COP (Capacitor On Plug) structure using polysilicon, tungsten, or the like as a plug material, the surface of the oxidant plug is obtained by using the method of each of the above-described embodiments. Entry into the semiconductor memory device can be reduced, and high integration of the semiconductor memory device can be realized.
[0055]
In each of the above-described embodiments, the relationship between the annealing temperature (T1) of the lower layer
[0056]
Furthermore, in each of the embodiments described above, annealing can be performed using He gas, Ne gas, Ar gas, Kr gas, Xe gas, Rn gas, or nitrogen gas instead of Ar gas as the inert gas. It is.
[0057]
Although the embodiments of the present invention have been described above, the present invention is not limited to the above-described embodiments, and various modifications can be made without departing from the spirit of the present invention. Furthermore, the above embodiments include inventions at various stages, and various inventions can be extracted by appropriately combining the disclosed constituent elements. For example, even if several constituent requirements are deleted from the disclosed constituent requirements, the invention can be extracted as an invention as long as a predetermined effect can be obtained.
[0058]
【The invention's effect】
According to the present invention, it is possible to improve capacitor characteristics and reliability, such as reduction of leakage current and improvement of polarization fatigue characteristics.
[Brief description of the drawings]
FIG. 1 is a cross-sectional view schematically showing a structure of a capacitor according to a first embodiment of the present invention.
FIG. 2 is a cross-sectional view schematically showing the structure of a capacitor according to a comparative example of the present invention.
FIG. 3 is a photograph showing a cross-sectional structure of the capacitor according to the first embodiment of the present invention.
FIG. 4 is a photograph showing a cross-sectional structure of a capacitor according to a comparative example of the present invention.
FIG. 5 is a diagram illustrating IV characteristics of a capacitor according to an embodiment of the present invention.
FIG. 6 is a diagram illustrating IV characteristics of a capacitor according to a comparative example of the present invention.
FIG. 7 is a diagram showing a result of analyzing Ru contained in a PZT film by TEM-EDX according to the embodiment of the present invention.
FIG. 8 is a diagram showing a result of analyzing Ru contained in a PZT film by TEM-EDX according to a comparative example of the present invention.
FIG. 9 is a diagram showing the results of examining the temperature dependence of the amount of Pb in a capacitor by ICP analysis.
FIG. 10 is a diagram showing measurement results of polarization fatigue characteristics of capacitors.
FIG. 11 is a diagram showing measurement results of imprint characteristics of a capacitor.
FIG. 12 is a cross-sectional view schematically showing the structure of a capacitor according to a second embodiment of the present invention.
FIG. 13 is a cross-sectional view schematically showing the structure of a capacitor according to a third embodiment of the present invention.
[Explanation of symbols]
11, 15 ...
Claims (13)
上部電極と、
前記上部電極と下部電極との間に介在し、Pb、Zr、Ti及びOを含有したペロブスカイト型の強誘電体で形成された誘電体膜と、
を備えた半導体装置であって、
前記誘電体膜は複数の結晶粒で形成された第1の部分を含み、前記下部電極、前記誘電体膜及び前記上部電極の積層方向に平行な断面において、前記第1の部分に形成された複数の結晶粒の粒界は複数の方向を有しており、
前記第1の部分に含まれる結晶粒は、その形状が円錐状であるか、又は、前記積層方向に平行な断面での形状が楕円状である
ことを特徴とする半導体装置。A lower electrode;
An upper electrode;
A dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti and O, interposed between the upper electrode and the lower electrode;
A semiconductor device comprising:
The dielectric film includes a first portion formed of a plurality of crystal grains, and is formed in the first portion in a cross section parallel to a stacking direction of the lower electrode, the dielectric film, and the upper electrode. The grain boundaries of the plurality of crystal grains have a plurality of directions ,
The crystal grain included in the first portion has a conical shape or an elliptical shape in a cross section parallel to the stacking direction .
ことを特徴とする請求項1に記載の半導体装置。The dielectric film further includes a second portion that is interposed between the lower electrode and the first portion and is formed of a plurality of crystal grains, and in a cross section parallel to the stacking direction, The semiconductor device according to claim 1, wherein grain boundaries of a plurality of crystal grains formed in the portion are aligned in one direction.
ことを特徴とする請求項2に記載の半導体装置。The dielectric film further includes a third portion that is interposed between the upper electrode and the first portion, and is formed of a plurality of crystal grains. 3. The semiconductor device according to claim 2 , wherein grain boundaries of a plurality of crystal grains formed in the portion are aligned in one direction.
ことを特徴とする請求項1に記載の半導体装置。The dielectric film further includes a third portion that is interposed between the upper electrode and the first portion, and is formed of a plurality of crystal grains . The semiconductor device according to claim 1, wherein grain boundaries of a plurality of crystal grains formed in the portion are aligned in one direction.
上部電極と、
前記上部電極と下部電極との間に介在し、Pb、Zr、Ti及びOを含有したペロブスカイト型の強誘電体で形成された誘電体膜と、
を備えた半導体装置であって、
前記誘電体膜は複数の結晶粒で形成された第1の部分を含み、前記下部電極、前記誘電体膜及び前記上部電極の積層方向に平行な断面において、前記第1の部分に形成された複数の結晶粒の粒界は複数の方向を有しており、
前記誘電体膜は、前記下部電極と前記第1の部分との間に介在し、複数の結晶粒で形成された第2の部分をさらに含み、前記積層方向に平行な断面において、前記第2の部分に形成された複数の結晶粒の粒界は一方向に揃っており、
前記誘電体膜は、前記上部電極と前記第1の部分との間に介在し、複数の結晶粒で形成された第3の部分をさらに含み、前記積層方向に平行な断面において、前記第3の部分に形成された複数の結晶粒の粒界は一方向に揃っている
ことを特徴とする半導体装置。A lower electrode;
An upper electrode;
A dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti and O, interposed between the upper electrode and the lower electrode;
A semiconductor device comprising:
The dielectric film includes a first portion formed of a plurality of crystal grains, and is formed in the first portion in a cross section parallel to a stacking direction of the lower electrode, the dielectric film, and the upper electrode. The grain boundaries of the plurality of crystal grains have a plurality of directions ,
The dielectric film further includes a second portion that is interposed between the lower electrode and the first portion and is formed of a plurality of crystal grains, and in a cross section parallel to the stacking direction, The grain boundaries of the plurality of crystal grains formed in this part are aligned in one direction,
The dielectric film further includes a third portion that is interposed between the upper electrode and the first portion, and is formed of a plurality of crystal grains. A semiconductor device, wherein grain boundaries of a plurality of crystal grains formed in the portion are aligned in one direction .
ことを特徴とする請求項2、3又は5に記載の半導体装置。The semiconductor device according to claim 2, 3, or 5 , wherein a shape of a crystal grain included in the second portion is a columnar shape.
ことを特徴とする請求項3、4又は5に記載の半導体装置。6. The semiconductor device according to claim 3, wherein the shape of the crystal grains included in the third portion is a columnar shape.
ことを特徴とする請求項1又は5に記載の半導体装置。6. The semiconductor device according to claim 1, wherein at least one of the lower electrode and the upper electrode includes a film containing Ru.
前記誘電体膜を形成する工程は、酸素ガス雰囲気中でのアニールによって前記下部電極上に前記誘電体膜の第2の部分を形成する工程と、不活性ガス雰囲気中でのアニールによって前記第2の部分上に前記誘電体膜の第1の部分を形成する工程と、を含み、
前記第2の部分を形成する工程は、Pb、Zr、Ti及びOを含有した第1の膜を酸素ガス雰囲気中でアニールする工程を含み、
前記第1の部分を形成する工程は、前記第1の膜上にPb、Zr、Ti及びOを含有した第2の膜を形成する工程と、前記第2の膜を不活性ガス雰囲気中でアニールする工程と、を含む
ことを特徴とする半導体装置の製造方法。Forming a dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti and O on the lower electrode; and forming an upper electrode on the dielectric film. A method for manufacturing a semiconductor device, comprising:
The step of forming the dielectric film includes a step of forming a second portion of the dielectric film on the lower electrode by annealing in an oxygen gas atmosphere, and a step of forming the second portion by annealing in an inert gas atmosphere. seen containing a step of forming a first portion of said dielectric layer over portions of the,
The step of forming the second portion includes a step of annealing the first film containing Pb, Zr, Ti and O in an oxygen gas atmosphere,
The step of forming the first portion includes a step of forming a second film containing Pb, Zr, Ti and O on the first film, and a step of forming the second film in an inert gas atmosphere. And a step of annealing . A method for manufacturing a semiconductor device, comprising:
前記誘電体膜を形成する工程は、酸素ガス雰囲気中でのアニールによって前記下部電極上に前記誘電体膜の第2の部分を形成する工程と、不活性ガス雰囲気中でのアニールによって前記第2の部分上に前記誘電体膜の第1の部分を形成する工程と、を含み、
前記誘電体膜を形成する工程は、酸素ガス雰囲気中でのアニールによって前記第1の部分上に前記誘電体膜の第3の部分を形成する工程を、さらに含む
ことを特徴とする半導体装置の製造方法。Forming a dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti and O on the lower electrode; and forming an upper electrode on the dielectric film. A method for manufacturing a semiconductor device, comprising:
The step of forming the dielectric film includes a step of forming a second portion of the dielectric film on the lower electrode by annealing in an oxygen gas atmosphere, and a step of forming the second portion by annealing in an inert gas atmosphere. seen containing a step of forming a first portion of said dielectric layer over portions of the,
The step of forming the dielectric film further includes a step of forming a third portion of the dielectric film on the first portion by annealing in an oxygen gas atmosphere . Production method.
前記誘電体膜を形成する工程は、酸素ガス雰囲気中でのアニールによって前記下部電極上に前記誘電体膜の第2の部分を形成する工程と、不活性ガス雰囲気中でのアニールによって前記第2の部分上に前記誘電体膜の第1の部分を形成する工程と、を含み、
前記下部電極及び上部電極の少なくとも一方は、Ruを含有した膜を含む
ことを特徴とする半導体装置の製造方法。Forming a dielectric film formed of a perovskite ferroelectric containing Pb, Zr, Ti and O on the lower electrode; and forming an upper electrode on the dielectric film. A method for manufacturing a semiconductor device, comprising:
The step of forming the dielectric film includes a step of forming a second portion of the dielectric film on the lower electrode by annealing in an oxygen gas atmosphere, and a step of forming the second portion by annealing in an inert gas atmosphere. seen containing a step of forming a first portion of said dielectric layer over portions of the,
At least one of the lower electrode and the upper electrode includes a Ru-containing film .
前記第1の部分を形成する工程は、前記酸素ガス雰囲気中でアニールされた第1の膜を不活性ガス雰囲気中でアニールする工程を含む
ことを特徴とする請求項10又は11に記載の半導体装置の製造方法。The step of forming the second portion includes a step of annealing the first film containing Pb, Zr, Ti and O in an oxygen gas atmosphere,
The first step of forming a part, a semiconductor of claim 10 or 11, characterized in that it comprises a step of annealing the first film is annealed in said oxygen gas atmosphere in an inert gas atmosphere Device manufacturing method.
ことを特徴とする請求項9、10又は11に記載の半導体装置の製造方法。12. The semiconductor device according to claim 9 , wherein the inert gas includes at least one of He gas, Ne gas, Ar gas, Kr gas, Xe gas, Rn gas, and nitrogen gas. Production method.
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