KR101098351B1 - 높은 패킷 데이터 레이트 통신을 위한 가변 패킷 길이 - Google Patents

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Abstract

본 발명은 가변 길이 물리 계층(PL) 패킷 생성 방법 및 장치에 관한 것이다. 다중 보안 계층(SL) 패킷들은 효율성을 증가시키기 위하여 단일 PL 패킷으로 다중화될 수 있으며, SL 패킷들은 가변 길이를 가질 수 있다. 일 실시예에서, 다른 사용자들을 위한 다른 포맷 SL 패킷들은 PL 패킷을 형성하는 캡슐들로 결합된다. 패킷들이 짧으면, 사용자들이 불량한 채널조건들을 가지거나 또는 서비스 품질(QoS) 요건들 및 애플리케이션들로 인하여 소량의 데이터를 필요로한다. 일 실시예에서, 유니캐스트 또는 다중-사용자 패킷들에 대하여 수정된 프리앰블 구조가 제공된다. 대인 실시예는 단일-사용자 패킷 또는 다중화된 패킷(지연된 ACK)으로부터 ACK를 식별하기 위한 수정된 레이트 세트 메커니즘을 제공한다. ACK 채널에 대한 ON/OFF 키잉은 IS-856에서 사용된 양극형 키잉 및/또는 DRC의 다중치 해석이다.

Description

높은 패킷 데이터 레이트 통신을 위한 가변 패킷 길이{VARIABLE PACKET LENGTH FOR HIGH PACKET DATA RATE COMMUNICATIONS}
본 발명은 일반적으로 통신 시스템에 관한 것이며, 특히 고속 패킷 데이터 통신에 적용하기 위한 가변 패킷 길이에 관한 것이다.
높은 패킷 데이터 레이트(HPDR) 통신은 벌크 데이터(bulk data) 전송을 위해 최적화된다. HPDR 시스템은 1×EV-DO로 일컬어지며 "cdma2000 High Rate Packet Data Air Interface Specification"으로 명명된 TIA/EIA IS-856에서 설명된 표준인 cdma2000에서 규정된다. 도 1은 1×EV-DO 시스템에 대한 에어 인터페이스 계층 구조를 도시한다. 접속 계층(CL:Connection Layer)은 에어 링크 접속 개설 및 유지 서비스를 제공한다. 보안 계층(SL:Security Layer)은 암호화 및 인증 서비스를 제공한다. 물리 계층(PL: Physical Layer)은 채널 구조, 주파수, 전력 출력, 변조, 및 순방향 및 역방향 채널에 대한 인코딩 규격을 제공한다. 매체 액세스 제어(MAC: Medium Access Control) 계층은 물리 계층을 통한 수신 및 전송을 위한 절차를 정의한다. 도 2는 파일럿, MAC, 제어 및 트래픽 채널을 포함하는 순방향 채널을 도시한다.
데이터는 도 1에 도시된 바와 같이 프로세싱되는데, 접속 계층(CL) 패킷(102)의 프로세싱은 보안 계층 헤더(110) 및 테일(tail)(112)을 우선 보안 계층(SL) 패킷(104)에 부가하는 것을 포함한다. 이어, SL 패킷(104)은 매체 액세스 제어(MAC) 계층 패킷(106), 및 최종적으로 물리 계층(PL) 패킷(108)을 발생시키는데 사용된다. MAC 계층(106) 페이로드는 고정된 수의 비트이다. PL(108) 페이로드는 MAC 계층(106)의 길이의 n 배수에 물리 계층 오버헤드(CRC 테일 비트 등)의 길이를 더한 것이며, 여기서 n은 정수이다.
고정된 MAC 계층(106) 페이로드의 제한은 전송의 비능률 및 결국 대역 낭비를 초래한다. 예를 들어, 소정의 사용자에 대한 채널 조건이 임계치를 초과하는 신호대 간섭 및 잡음비(SINR) 또는 데이터 레이트 제어(DRC) 측정치에 의해 결정된 바와 같이 "양호"하다면, 더 큰 패킷을 전송할 수도 있다. 상기 사용자에 대해, IS-856에서 현재의 순방향 링크 구조 음성 패킷, 보코더 프레임 등과 같은 데이터의 더 작은 블록의 전송과 같은 더 작은 블록의 전송은 MAC 계층(106) 패킷의 공간 낭비를 초래한다. 데이터의 크기가 MAC 계층(106) 패킷의 고정된 길이보다 훨씬 작기 때문에, 잔여 비트들은 패딩으로 채워진다. MAC 계층(106) 패킷이 완전히 사용되지 않기 때문에 결과는 비능률적이다.
따라서, HRD 통신을 위한 가변 패킷 길이가 필요하며, 가변 길이 패킷은 효율성을 제공한다. 또한, 더 작은 MAC 계층(106) 패킷을 다중 사용자들의 데이터가 패킷 단위로 전송되게 하는 단일 물리 계층 패킷으로 결합할 필요성이 있다.
도 1은 고속 패킷 데이터(HRPD) 통신 시스템의 에어 인터페이스 계층 구조의 일부이다.
도 2는 HRPD 통신 시스템을 위한 순방향 채널 구조이다.
도 3은 포맷A 접속 계층 패킷을 위한 보안 계층 구조이다.
도 4는 포맷B 접속 계층 패킷을 위한 보안 계층 구조이다.
도 5 및 6은 보안 계층 패킷으로부터 단신 및 다중 MAC 패킷에 대한 생성을 도시한다.
도 7은 1000비트 미만 길이의 단일 MAC 계층 패킷을 운반하는데 사용되는 물리 계층 패킷 구조이다.
도 8은 1000비트와 동일한 길이의 단일 MAC 계층 패킷을 운반하는데 사용되는 물리 계층 패킷 구조이다.
도 9는 각각 1000비트와 동일한 길이의 다중 MAC 계층 패킷을 운반하는데 사용되는 물리 계층 패킷 구조이다.
도 10은 공칭 데이터 레이트 및 데이터 레이트 요청 번역의 표이다.
도 11은 명시된 데이터 레이트 표시자와 데이터 레이트 요청값 사이의 호환성을 도시한다.
도 12는 짧은 보안 계층 패킷에 기초한 물리 계층 패킷의 생성을 도시한다.
도 13은 두 사용자에 대한 페이로드를 포함하는 512비트 멀티플렉싱된 물리 계층 패킷의 생성을 도시한다.
도 14는 상이한 길이의 보안 계층 패킷을 포함하는 멀티플렉스 물리 계층 패킷이다.
도 15는 다중 매체 액세스 제어 계층 캡슐을 포함하는 물리 계층 패킷이다.
도 16 및 17은 공칭 데이터 레이트 및 최대 데이터 레이트를 달성하기 위한 다중 슬롯의 전송을 도시한다.
도 18은 본 발명의 일 실시예에 따른 액세스 네트워크이다.
도 19는 본 발명의 일 실시예에 따른 액세스 단말이다.
"예시적"이라는 용어는 본 명세서에서 "예로서 알맞은, 예, 또는 설명"의 의미로 사용된다. "예시적"으로 설명된 실시예는 다른 실시예에 비해 반드시 바람직하거나 유리하게 구성된 것은 아니다.
본 명세서에서 액세스 단말(TA)로 일컬어지는 HDR 가입자 국은 이동국 또는 정지국일 수도 있으며, 본 명세서에서 모뎀 풀 트랜시버(MPTs)로 일컬어지는 하나 이상의 HDR 기지국과 통신할 수도 있다. 액세스 단말은 하나 이상의 모뎀 풀 트랜시버를 통해, 본 명세서에서 모뎀 풀 제어기(MPC)로 일컬어지는 HDR 기지국 제어기와의 사이에서 데이터 패킷을 전송 및 수신한다. 모뎀 풀 트랜시버 및 모뎀 풀 제어기는 액세스 네트워크로 일컬어지는 네트워크의 일부이다. 액세스 네트워크(AN)는 다중 액세스 단말(ATs) 사이에서 데이터 패킷을 전송한다. AN은 패킷 스위칭된 데이터 네트워크와 AT 사이에서 접속을 제공하는 네트워크 설비를 포함한다. AN은 기지국(BS)과 유사한 반면, AT는 이동국(MS)과 유사하다.
액세스 네트워크는 사내 인트라넷 또는 인터넷과 같은 액세스 네트워크 외부의 추가 네트워크에 또한 연결될 수도 있으며, 각각의 액세스 단말과 상기 한 외부 네트워크 사이에서 데이터 패킷을 전송할 수도 있다.
하나 이상의 모뎀 풀 트랜시버와 활성 트래픽 채널 연결을 설정한 액세스 단말은 활성 액세스 단말로 지칭되고, 트래픽 상태에 있는 것으로 언급된다. 하나 이상의 모뎀 풀 트랜시버와 활성 트래픽 채널 연결을 설정 중에 있는 액세스 단말은 연결 셋업 상태에 있는 것으로 언급된다. 액세스 단말은 무선 채널 또는 유선 채널(예를 들면, 광섬유 또는 동축 케이블을 사용함)을 통해 통신하는 임의의 데이터 서비스일 수 있다. 액세스 단말은 PC 카드, 컴팩트 플래쉬, 외부 또는 내부 모뎀, 또는 유선/무선 전화를 포함하는 임의의 타입의 장치들일 수 있지만, 이들로 제한되는 것은 아니다. 액세스 단말이 모뎀 풀 트랜시버로 신호들을 전송하는 통신 링크는 역방향 링크로 지칭된다. 모뎀 풀 트랜시버가 액세스 단말로 신호를 전송하는 통신 링크는 순방향 링크로 지칭된다.
다음 설명에서, SL 패킷 크기는 1000비트로 주어진다. SL 패킷은 x 비트로 주어지는 오버헤드를 포함한다. 대안적인 실시예들은 SL 패킷에 대한 대안적인 길이를 제공한다. 도3은 포맷 A 및 포맷 B로 지칭되는 데이터에 대한 2개의 포맷들을 보여주는 도이다. 포맷 A는 CL 패킷과의 일대일 관계를 갖는 SL 패킷으로 정의된다. 즉, CL 패킷의 길이는 1000비트(즉, SL 패킷의 주어진 크기) 마이너스 x 비트이다. 즉, CL 패킷 플러스 SL 오버헤드는 SL 패킷의 주어진 길이와 동일하다. 포맷 B 는 1) 패딩을 포함하는 SL 패킷 또는 2) 패딩이 있거나 패딩이 없는 다수의 CL 패킷들을 포함하는 SL 패킷으로 정의된다.
일 실시예에 따라, SL 패킷의 크기는 가변적이다. 도3은 포맷 A 패킷을 보여주고, 여기서 SL 패킷은 4개의 크기들 중 하나를 갖는다. SL 패킷 크기는 112, 240, 448, 또는 1000 비트 중 하나이다. SL 은 CL 패킷으로 구성된다. 하나의 사용자에 대응하는 하나의 CL 패킷이 존재한다. 데이터는 도1에서 제시된 바와 같이 프로세싱되고, 여기서 연결 계층(CL) 패킷(102)의 프로세싱은 필요하다면 패딩과 함께, 하나 이상의 연결 계층 패킷을 연접(concatenate)시키고, 그리고 나서 보안 계층(SL) 패킷(104)을 형성하기 위해서 보안 계층 헤더(110) 및 테일(112)을 부가하는 것을 포함한다.
도4는 포맷 B 패킷을 보여주며, 여기서 SL 패킷은 가변적이며, SL 페이로드는 하나 이상의 CL 패킷 플러스 패딩을 포함한다. 결과적인 SL 패킷 크기는 112, 240, 488, 또는 1000 비트들 중 하나이다.
도5는 SL 패킷들의 프로세싱을 보여주며, 여기서 SL 패킷들은 1000비트 보다 작은 길이를 갖는다. 2개의 필드들이 SL 패킷에 첨부되고, 이는 6비트 길이를 갖는 부패킷 식별(SPID) 또는 MAC 인덱스 값 및 2 비트인 길이 표시자(LEN)이다. MAC 인덱스는 패킷이 향하는 사용자를 식별한다. MAC 인덱스 필드는 패킷이 예정되는 사용자를 식별하는데 사용된다. LEN 은 포맷을 규정한다. LEN 필드는 SL 패킷이 포맷 A 또는 포맷 B 인지 여부를 규정하는데 사용된다. SL 패킷이 포맷 A 이면, LEN는 또한 112,240,488 중 어느 하나의 값을 가질 수 있는 SL 패킷 길이를 규정한다. 결과적인 MAC 계층 부패킷은 120, 248, 496 비트 길이를 갖는다. 그리고 나서 MAC 계층 부패킷은 다수의 MAC 계층 부패킷들이 결합될 것인지를 결정함으로써 MAC 계층 패킷을 형성하기 위해 프로세싱된다. MAC 계층 패킷은 임의의 필요한 패딩과 함께, 하나 이상의 MAC 계층 부패킷들 플러스 하나의 내부 사이클릭 리던던시 체크(Cyclic Redundancy Check) 값을 포함한다. 가능하게는 상이한 사용자들에 대해서 하나의 SL 패킷보다 많은 수의 SL 패킷을 포함하는 경우에, MAC 계층 패킷은 멀티플렉스로서 지칭된다. CRC 값 및 테일 값은 MAC 계층 패킷에 적용되어 도7에서 제시된 바와 같은 PL 패킷을 형성한다. 그리고 나서, 결과적인 PL 패킷은 152, 280, 또는 528 비트의 길이를 갖는다.
도 6은 SL 패킷들의 프로세싱을 보여주며, 여기서 SL 패킷들은 1000비트의 길이를 갖는다. MAC 계층 페이로드는 SL 패킷이다. MAC 계층 패킷은 심플렉스(Simplex)로 지칭된다.
도 8은 MAC 계층 패킷들의 프로세싱을 보여주는 도면이며, MAC 계층 패킷은 1000비트의 길이를 갖는다. 도 8의 프로세싱은 포맷 A 또는 포맷 B SL 패킷들에 대해서 사용된다. CRC 값 및 테일은 MAC 계층 패킷에 적용된다. 추가적으로, 2비트의 포맷 표시기(FMT)가 또한 적용된다. FMT의 의미는 테이블 1에 제시된다.
테이블 1: 포맷 필드(FMT) 정의
01 = 포맷 A 심플렉스
11 = 포맷 B 심플렉스
00 = 멀티플렉스 MAC 패킷
10 = 무효 MAC 패킷
"심플렉스(Simplex)" 는 하나의 SL 패킷을 갖는 MAC 패킷을 지칭하고, "멀티플렉스(Multiplex)" 는 2 이상의 SL 패킷을 의미한다. 즉, 심플렉스 MAC 패킷은 정확하게 1개의 SL 패킷을 포함하고, 멀티플렉스 MAC 패킷은 2개 이상의 SL 패킷들을 포함한다. 캡슐은 MAC 패킷으로 정의되고, 뒤이어 그 MAC 패킷에 특정한 정보를 전달하는 약간의 오버헤드 비트들이 뒤따른다. 도15는 다수의 MAC 계층 패킷들을 전달하는 하나의 PL 패킷을 보여주는 도면이다. MAC 캡슐은 PL 패킷이 2개 이상의 MAC 패킷들을 전달할 때 사용된다. 캡슐은 개별 캡슐들을 식별하는데 사용되고, 따라서 멀티플렉스 패킷의 경우에만 사용된다.
일 실시예에 따라서, PL 패킷의 크기는 보다 큰 전달들을 수용하기 위해서 증가될 수 있다. 보다 큰 PL 패킷은 또한 다수의 MAC 패킷들이 하나의 PL 패킷 내에서 구현될 수 있도록 하여준다. 특히, 다수의 목적지 어드레스들을 갖는 다수의 MAC 패킷들은 부패킷(sub-packet)에서 각각 구현될 수 있다. 이러한 방식으로, 하나의 PL 패킷이 다수의 사용자들에게 전송된다. 도9에 제시된 바와 같이, 캡슐은 MAC 계층 패킷, FMT, 및 캡슐 어드레스를 포함하여 주어진다. FMT 필드의 해석은 테이블 1에 규정되어 있다. 캡슐 어드레스는 MAC 계층 패킷의 목적지를 제공한다. MAC 계층 패킷이 멀티플렉스 패킷이면, 즉 각각 상이한 목적지 어드레스를 갖는 다수의 CL 계층 패킷들을 포함하면, 캡슐 어드레스는 블랭크(blank)로 남겨질 수 있다. 즉, PL 패킷이 다수의 사용자들에 대한 정보를 포함하면, 캡슐 어드레스는 거의 의미가 없는데, 왜냐하면, 하나의 사용자만을 지정하기 때문이다. 캡슐 어드레스는 본 예에서 6비트이다. MAC 계층 패킷, FMT 및 캡슐 어드레스의 합성은 MAC 계층 캡슐을 형성한다.
도9에서 계속하여, 다수의 MAC 계층 캡슐이 연쇄될 수 있다. CRC 값, 테일, 및 임의의 필요한 패딩이 MAC 계층 캡슐들의 조합에 부가될 수 있다. MAC 계층 캡슐 오버헤드, 즉, 패드, CRC 및 테일이 16*n 비트의 길이를 갖도록 패딩이 포함될 수 있다. 특정 길이는 MAC 캡슐 및 테일 비트들이 포함된 후에 PL 패킷에 남겨진 비트들의 수에 의해 결정되는 설계 선택사항이다. 충분한 비트가 남아있을 때마다, 32 비트 CRC 를 사용하는 것이 바람직하다. 본 예에서, 2048 비트 길이를 갖는 PL 패킷은 24 비트 CRC 를 사용하고, 보다 긴 PL 패킷들은 32 비트 CRC 를 사용한다. 본 예에서, PL 패킷들에 대한 4개의 확장된 길이들(2048, 3072, 4096, 및 5120)이 존재한다.
도10은 확장된 PL 패킷들에 대응하는 공칭(nominal) 데이터 레이트들의 테이블이며, 이러한 확장된 PL 패킷들은 IS-856에서 HRPD에 대해 최근에 정의된다. 도 7에서 주어진 바와 같은 PL 패킷 길이들과 관련하여, 19. 2 kbps의 공칭 전송 데이터 레이트로, 152 비트의 패킷 길이가 전송되고 4 개의 슬롯들을 통해 점진적으로 재전송된다. 일 실시예에 따르면, 데이터 레이트들의 계산은 PL 패킷 길이를 가장 근접한 2의 제곱으로 버림(rounding down)하는 방식을 취함을 유의하도록 한다. 1xEV-DO 시스템의 각각의 슬롯은 1. 666ms의 길이를 갖는다. 양호한 채널 조건들을 위해, 데이터 레이트는 조기 종료(early termination)를 이용하여 76. 8 kbps로 증가될 수 있다. 조기 종료는 데이터가 수신되고 정확하게 디코딩되면 데이터의 수신기가 승인 또는 ACK를 전송하는 시스템과 관련되어 있다. 이러한 방식에서, 모든 네 번의 시도들은 전송을 위해 이용되지 못할 수 있다. 이러한 승인은 임의의 추가적인 패킷 전송을 종료시킨다. 유사하게, 280 및 528 비트들의 패킷 길이들은 각각 6 개의 슬롯들을 통해 전송되며, 각각 25. 6 kbps 및 57. 6 kbps의 공칭 데이터 레이트를 가진다. 유사하게, 각각은 주어진 조기 종료에서, 153. 6 kbps와 307. 2 kbps의 최대 데이터 레이트를 가질 수 있다.
도 16과 관련하여, 19. 2 kbps의 공칭 데이터 레이트를 가지는 슬롯 당 패킷 당 152 비트에 대하여, 제 1 슬롯 이후의 종료는 76. 8 kbps의 최대 데이터 레이트를 가지게 된다. 제 2 슬롯 이후의 조기 종료는 38. 4 kbps의 최대 데이터 레이트, 또는 상기 최대 데이터 레이트의 절반값을 가지게 된다. 모든 네 개의 슬롯들이 전송되면, 19. 2 kbps의 공칭 데이터 레이트가 실현된다.
도 17은 슬롯의 패킷 당 280 비트의 전송을 나타내며, 전송 및 점진적인 재전송은 6 개의 슬롯들을 통해 이루어진다. 여기서 공칭 데이터 레이트는 25. 6 kbps이다. 제 1 슬롯 이후의 종료는 153. 6 kbps의 최대 데이터 레이트를 가지는 반면에, 제 3 슬롯 이후의 종료는 115. 2 kbps의 데이터 레이트, 또는 최대값의 절반에 해당하는 레이트를 가지게 된다. 모든 6 개의 슬롯들이 전송되면, 25. 6 kbps의 공칭 데이터 레이트가 실현된다.
1xEV-DO 시스템에서, AT는 AN으로 데이터 레이트 요청을 제공하며, 상기 데이터 레이트 요청은 역방향 링크(RL), 구체적으로는 데이터 요청 채널(DRC)을 통해 전송된다. 데이터 레이트 요청은 AT에서 수신된 신호 품질에 대한 함수로서 계산될 수 있다. AT는 자신이 데이터를 수신할 수 있는 최대 데이터 레이트를 결정한다. 최대 데이터 레이트는 그 후에 AN으로부터의 데이터 전송들을 위해 AT에 의해 요청된다. 데이터 레이트 요청은 AN에 의해 수신되며, AN은 그 후에 그에 따라 패킷 크기를 선택한다. 주어진 데이터 레이트 요청에 대하여, AN은 더욱 짧은 PL 패킷, 기존의 PL 패킷, 또는 보다 긴 PL 패킷을 생성할 수 있다. 각각의 데이터 레이트 요청은 하나 이상의 패킷 크기들에 대응한다. 이러한 선택은 질의 플로우에 대한 QoS에 의해 좌우된다.
예를 들어, 도 10에서 주어진 대로, "DRC0"으로 지칭되는, 19. 2 kbps의 데이터 레이트 요청에 대하여, AN은 19. 2 kbps를 달성하기 위해 길이가 152 비트인 단일 PL 패킷을 전송할 수 있거나 또는 25. 6 kbps의 유효 데이터 레이트를 위해 길이가 280 비트인 PL 패킷을 전송할 수 있다. AT는 가능한 PL 패킷 크기들과 데이터 레이트들에 대한 정보를 가지고 있는 반면에, 어떤 것이 현재 이용되고 있는지에 대한 특정 정보는 가지고 있지 않다. 일 실시예에서, AT는 각각의 가능성 있는 PL 패킷 크기의 선택을 시도한다. 패킷이 정확하게 수신되지 않으면 보다 적은 정보가 재전송되기 때문에, 패킷 길이들이 짧을수록 손실을 줄이게 된다는 것을 유의하도록 한다. 유사하게, 보다 낮은 데이터 레이트들에서 디코딩하는 좋은 기회가 존재한다. 또한, (조기 종료가 없는 경우에) 더욱 짧은 패킷들을 전송하기 위해 선택된 시간은 주어진 동일한 채널 조건에서 보다 긴 패킷들에 대하여 필요한 시간의 일부분이 된다.
다수-값들을 가진 데이터 레이트 요청들은 DRC 데이터 레이트 요청을 통해 전송되며, 상기 대응은 테이블 II에서 주어진다. 표시 "(L)"은 연장된 PL 패킷 길이를 표시한다. 데이터 레이트 값들 19. 2 kbps, 28. 2 kbps 및 57. 6 kbps, 각각은 도 10에서 주어진 대로 비트 길이와 관련된다. 예를 들어, DRC0는 19. 2 kbps 및 25. 6 kbps에 대응한다. 19. 2 kbps의 공칭 데이터 레이트를 가지는 데이터 전송들에 있어서, PL 패킷은 152 비트를 포함하며 4 개의 슬롯들을 통해 전송된다. 25. 6 kbps의 공칭 데이터 레이트를 가지는 데이터 전송들에 있어서, PL 패킷은 280 비트를 포함하며 6 개의 슬롯들을 통해 전송된다. 전체 길이, 또는 연장된 길이의 패킷이 사용되면, 표시자(L)는 테이블 엔트리에 포함된다. 예를 들어, DRC5는 307. 2 kbps에 대응하고 PL 패킷 길이는 2048 비트이다. 유사하게, DRC7은 614 kbps에 대응하고 PL 패킷 길이는 2048 비트이다.
테이블 II
Figure 112005045456092-pct00001
일반적으로, 패킷 분할 멀티플렉싱은 DRC 데이터 레이트 요청이 153 kbps와 같거나 이보다 큰 데이터 레이트, 또는 다른 미리 결정된 값을 표시하는 경우에 이용가능하다. 멀티플렉싱을 위해, 1024 비트 또는 그 이상의 비트를 가지는 단일 PL 패킷은 하나 이상의 MAC 계층 캡슐(들)을 포함한다. 각각의 캡슐은 그 후에 하나 이상의 사용자들에 대한 MAC 계층 패킷들을 포함한다. HRPD 시스템에서, 각각의 액세스 프로브는 프리앰블로서 기능하는 파일롯(I-채널)을 활성화시킨다. 일 실시예에 따르면, 수정된 프리앰블은 EDRI(Explicit Data Rate Indicator)를 포함한다. 인코더 패킷들은 데이터를 하나의 패킷으로 멀티플렉싱하도록 지원한다. 보다 높은 데이터 레이트들에서, 프리앰블은 변조 위상 Q 브랜치 상에 EDRI 필드를 포함한다. EDRI는 (8,4,4) 배직교(bi-orthogonal) 코딩되고 8번 블록이 반복된다. EDRI는 복수의 레이트들 중 하나를 지정한다. 주어진 사용자에 대한 패킷이 존재하는지 여부를 체크하기 위해, 사용자는 MAC 계층 식별자들을 체크할 것이다. 단일 사용자 패킷에 대하여, 프리앰블은 I-브랜치를 통해 MAC 인덱스를 전송한다. (AN에 의해 주어진 단말로 할당된) MAC 인덱스는 AT가 자신에게 전달되는 패킷들을 식별하는데 도움을 주기 위해 (64진 왈쉬 커버를 이용하여) 패킷을 왈쉬 커버링하도록 AT에 의해 이용되는 6-비트 번호이다. 이러한 메커니즘은 유니캐스트 패킷을 위해 이용된다. 다중-사용자 패킷들에 있어서, 프리앰블은 Q-브랜치를 통해 EDRI를 전송하며, EDRI와 호환되는 DRC를 가진 모든 사용자들은 패킷의 디코딩을 시도한다.
잠재적인 데이터 레이트들 및 상응하는 EDRI 길이(칩 길이)는 다음과 같이 제공되며, 추가로 도 11에 도시된다: 153.6k(256), 307.2k-L(256), 307.2k(128), 614k-L(128), 921k(128), 1.2M-L(128), 614k(64), 1.2M(64), 1.5M(128), 1.8M(64), 2.4M(64), 3.0M(64). 도 11은 각각의 DRC와 호환될 수 있는 데이터 레이트들의 세트를 열거한다. 만약 데이터 레이트에 상응하는 패킷이 상기 DRC를 사용하여 패킷을 (용이하게) 디코딩할 수 있는 임의의 사용자에 의해 용이하게 될 수 있다면, 데이터 레이트는 DRC와 호환가능한 것으로 설명된다. 일반적으로, DRC와 호환가능한 데이터 레이트는 주어진 DRC와 관련된 패킷들의 데이터 레이트와 거의 동일하며, 상기 패킷의 지속기간은 적어도 주어진 DRC와 관련된 패킷의 지속기간만큼 길다. 다시 말해서, 만약 사용자가 상기 DRC에 대한 패킷을 디코딩할 수 있다면, 상기 DRC와 호환가능한 모든 데이터 레이트들을 사용하여 패킷을 디코딩할 수 있다.
멀티플렉싱된 패킷들 및 특히 다중 사용자 패킷들에 대하여, 확인 응답(ACK) 표시자는 D-ARQ라 참조되는 MAC 계층 재전송을 위해 제공된다. ACK는 PL 패킷을 디코딩할 수 있는 사용자들에 의해 역방향 링크를 통해 전송되는데, 상기 패킷은 MAC 계층 패킷 또는 상기 패킷에 어드레싱된 부패킷을 포함한다. ACK 전송은 온-오프 키잉을 허용하도록 3dB만큼 부스트(boost)된다. ACK는 신호의 존재에 의해 표시되고, NAK는 신호의 부재에 의해 표시된다. 바이폴라 키잉에서, ACK 및 NAK는 서로 동일한 세기와 상반되는 부호를 가지는 전송된 서로 다른 신호들에 의해 표시된다. 대조적으로, 온-오프 키잉을 사용하여, 메시지들 중 하나(ACK)는 특정(non-trivial) 신호를 전송함으로써 표시되는 반면, 다른 메시지(NAK)는 어떠한 신호도 전송하지 않음으로써 표시된다. 온-오프 시그널링은 다중 사용자 패킷들의 ARQ를 위해 사용되지만, 바이폴라 시그널링은 단일 사용자 패킷의 ARQ를 위해 사용된다. 단일 사용자 패킷들에 대하여, 즉, 유니캐스트 전송에 대하여, ACK는 패킷의 전송 이후 2개의 슬롯들, 즉 3개의 타임 슬롯내에서 전송된다. 이는 AT에 의한 패킷의 복조 및 디코딩을 위한 시간을 허용하도록 수행된다. 다중 사용자 패킷들에 대하여 ACK는 단일 사용자의 타임 슬롯으로부터 4개의 슬롯만큼 지연된 타임 슬롯에서 전송된다. 다중 사용자 패킷이 제 1 AT로 전송되고, AN이 상기 AT로부터 ACK를 수신하지 못하면, 상기 AN은 동일한 인터페이스 오프셋을 통해 다음 슬롯 동안 상기 AT에 유니캐스트 패킷을 전송하지 않을 것이다. 이는 다중 사용자 패킷의 전송 이후 7번째 슬롯을 통해 전송되는 ACK의 의미를 명확하게 한다. 전술된 패킷 구성 절차들을 다시 참조하여, 도 12에 도시된 패킷 캡슐화의 제 1 예에서, SL 패킷은 240비트이다. SL 패킷은 포맷 A 패킷이고, 타겟 PL 패킷은 280 비트이며, MAC ID=8이다. SL 패킷은 전술된 바와 같이 두 개의 필드들: SPID 및 LEN을 가산하여 프로세싱된다. LEN 필드는 2비트이고, SPID 필드는 6비트이며, 그 결과 수정된 패킷은 248 비트이다. 내부 CRC(8비트)가 추가되면, 부가적으로 16 비트의 CRC와 8비트의 테일 비트가 가산되어 280개의 PL 패킷을 생성한다. 제 2 예에서, 도 13에 도시된 것과 같이, 두 개의 240 비트 SL 패킷들은 528 비트 PL 패킷을 형성하기 위해 멀티플렉싱된다. 제 1 SL 패킷(200)은 240 비트이고, MAC ID=8을 갖는다. SL 패킷(200)은 제 1 사용자로부터의 포맷 A 패킷이다. SL 패킷(220)은 제 2 사용자로부터의 포맷 B 패킷이다. SL 패킷(220)은 240 비트이지만, MAC ID=5를 갖는다. 멀티플렉싱된 패킷은 그 후에 패킷들(200 및 220)의 각각에 대하여 SPID 및 LEN을 포함한다. 내부 CRC(8비트), CRC(16 비트), 및 테일(8비트)이 528 비트의 PL 패킷에서 발생된 멀티플렉싱된 패킷에 가산된다. 제 3 예에서, 각각 서로 다른 사용자들로부터의 4개의 동일한 포맷의 패킷들, 예를 들면, 포맷 A 패킷들은 도 14에 도시된 것과 같이 1024비트의 PL 패킷에 멀티플렉싱된다. 각각의 SL 패킷은 상응하는 MAC ID 값을 갖는다. SL 패킷들은 다양한 길이들을 가지며, 488비트의 제 1 SL 패킷, 240비트의 제 2 SL 패킷, 112비트의 2개의 SL 패킷들을 포함한다. SPID 및 LEN은 멀티플렉싱된 패킷을 형성하기 위해 각각의 SL 패킷에 적용된다. 내부 CRC, CRC 및 테일은 PL 패킷을 형성하기 위해 멀티플렉싱된 패킷에 적용된다. 상기 예에서, 포맷 필드, FMT가 포함된다. 전술된 테이블 1에 표시된 것과 같이, FMT 값은 PL 패킷을 멀티플렉싱된 패킷으로서 식별한다. 제 4 예에서, 도 15에 도시된 것과 같이, 서로 다른 포맷 패킷들, 예를 들어, 포맷 A 및 포맷 B 패킷들은 2048비트의 PL 패킷을 형성하기 위해 멀티플렉싱된다. 제 1 SL 패킷은 1000비트를 가지며, 제 2 및 제 3 SL 패킷들은 각각 488비트이다. 제 1 SL 패킷(300)은 제 1 캡슐을 생성하는데 사용되고, 제 2 및 제 3 패킷들(320, 340)은 제 2 캡슐을 생성하는데 사용된다. SL 패킷(300)은 1000비트이고, 따라서 단일 캡슐을 형성한다. SL 패킷들(320, 340)은 1000비트 미만이며, 따라서 상기 두 개의 패킷들 모두를 포함하는 하나의 캡슐이다. 전술된 것과 같이, FMT 및 캡슐 어드레스는 제 1 캡슐을 형성하기 위해 제 1 SL 패킷(300)에 적용된다. 제 2 캡슐은 SL 패킷들(320, 340)을 포함하는 멀티플렉싱된 캡슐이다. SL 패킷들(320, 340) 각각에는 SPID 및 LEN이 부가된다. 제 2 캡슐 어드레스는 제 2 캡슐을 위해 제공된다. 제 2 캡슐 어드레스는 다수의 수신자들에 대한 데이터가 캡슐 내에 포함되는 것을 표시하도록 소거된다. 두 개의 캡슐들은 그 후에 연접되고, 패드, CRC 및 테일이 2048 비트의 PL 패킷을 형성하도록 부가된다. 도 18은 통신 버스(420)에 접속된 송신 회로(Tx;402) 및 수신 회로(Rx;418)를 포함하는 무선 인프라구조 엘리먼트(400)를 도시한다. DRC 유니트(410)는 AT들로부터 DRC 채널을 통해 수신된 것과 같은 DRC 데이터 레이트 요청을 수신한다. 엘리먼트(400)는 또한 중앙 처리 유니트(CPU;412) 및 메모리(406)를 포함한다. PL 패킷 생성(404)은 DRC 유니트(410)로부터의 DRC 데이터 레이트 요청을 수신하여 PL 패킷을 형성한다. PL 패킷 생성(404)은 단일 패킷 또는 다중 패킷을 생성할 수 있고, 추가로 전술된 방법들 중 임의의 방법을 실행할 수 있다. 도 19는 일 실시예에 따른 AT(500)를 도시한다. AT(500)는 송신 회로(Tx;502) 및 통신 버스(520)에 접속된 수신 회로(Rx;518)를 포함한다. DRC 유니트(510)는 최대 데이터 레이트를 결정하여 AT들로부터 DRC 채널을 통해 상응하는 요청을 전송한다. 엘리먼트(500)는 또한 중앙 처리 유니트(CPU;512) 및 메모리(506)를 포함한다. PL 패킷 해석(504)은 AN으로부터 PL 패킷을 수신하여 임의의 콘텐츠가 AT(500)로 전송되는지를 결정한다. 또한, PL 패킷 해석(504)은 수신된 PL 패킷의 전송 레이트를 결정한다. PL 패킷 해석(504)은 단일 패킷 또는 다중 패킷을 프로세싱할 수 있고, 전술된 임의의 방법들 중 임의의 방법을 수행할 수 있다. 전술된 것과 같이, 상기 방법들 및 장치는 패킷 효율을 개선시키기 위해 순방향 링크를 통해 다중 사용자 패킷들을 제공한다. 일 실시예에서, 더 짧은 패킷들은 더 열악한 채널 조건들에서 사용자들에게 제공되거나 애플리케이션들 및 상응하는 서비스 품질(QoS) 요구조건들로 인해 소량의 데이터를 요구하는 사용자에게 제공된다. 또다른 실시예에서, 1xEVDO 시스템과 관련하여 다중 사용자 패킷들을 지원하기 위한 메카니즘은 수정된 프리앰블 구조(유니캐스트 v/s 다중 사용자 패킷들), 수정된 레이트 세트, 및/또는 단일 사용자 패킷 또는 멀티플렉싱된 패킷으로부터 ACK(지연된 ACK)를 식별하기 위한 수정된 메카니즘을 제공한다. 온/오프 키잉은 IS-856에서 사용된 ACK 채널 v/s 바이폴라 키잉 및/또는 DRC의 다중값 해석을 위한 것이다.
당업자는 정보 및 신호들이 임의의 다수의 상이한 기술들 및 테크닉들을 사용하여 표현될 수 있음을 인식할 것이다. 예를 들어, 상기 설명을 통해 참조될 수 있는 데이터, 지시들, 명령들, 정보, 신호들, 비트들, 심볼들 및 칩들은 전압들, 전류들, 전자기파들, 전자기장들, 또는 전자기 입자들, 광학계들 또는 광학 입자들, 또는 그들의 임의의 조합에 의해 표시될 수 있다.
당업자는 또한 본 명세서에 개시된 실시예들과 관련하여 설명된 논리적인 블럭들, 모듈들, 회로들, 및 알고리즘 단계들이 전자하드웨어, 컴퓨터 소프트웨어, 또는 그들의 조합으로서 실행될 수 있음을 인식할 것이다. 상기 하드웨어 및 소프트웨어의 상호교환가능성을 명백히 설명하기 위해, 다양한 요소들, 블럭들, 모듈들, 회로들, 및 단계들이 그들의 기능성에 관련하여 전술되었다. 상기 기능성이 하드웨어로 실행되는지 또는 소프트웨어로 실행되는지의 여부는 전체 시스템에 부과된 특정 애플리케이션 및 설계 제약에 따라 결정한다. 당업자는 각각의 특정 애플리케이션을 위해 다양한 방식들로 설명된 기능성을 실행할 수 있지만, 상기 실행 결정들은 본 발명의 영역으로부터 벗어나는 것으로 해석될 수 없다.
본 명세서에서 개시된 실시예와 관련하여 다양하게 설명되는 논리 블럭들, 모듈들, 및 회로들은 범용 프로세서, 디지털 신호 처리기(DSP), 응용 집적 회로(ASIC), 현장 프로그램가능한 게이트 어레이(FPGA), 또는 다른 프로그램가능한 로 직 디바이스, 이산 게이트 또는 트랜지스터 로직, 이산 하드웨어 요소들, 또는 본 명세서에 개시된 기능을 수행하도록 설계된 그들의 임의의 조합을 사용하여 실행되거나 수행될 수 있다. 범용 프로세서는 마이크로프로세서가 될 수 있지만, 선택적으로 프로세서는 임의의 종래의 프로세서, 제어기, 마이크로제어기, 또는 상태 기계가 될 수 있다. 프로세서는 또한 예를 들어, DSP 및 마이크로프로세서의 조합, 복수의 마이크로프로세서, DSP 코어와 결합된 하나 또는 그이상의 마이크로프로세서, 또는 임의의 다른 구성과 같은 컴퓨팅 장치들의 조합으로서 실행될 수 있다.
본 명세서에 개시된 실시예와 관련하여 설명되는 방법 또는 알고리즘의 단계는 하드웨어에서, 프로세서에 의해 실행되는 소프트웨어 모듈에서, 또는 그들의 조합에서 즉시 구현될 수 있다. 소프트웨어 모듈은 RAM 메모리, 플래시 메모리, ROM 메모리, EPROM 메모리, EEPROM 메모리, 레지스터들, 하드디스크, 제거가능한 디스크, CD-ROM 또는 임의의 다른 저장 매체 형태로 당업자에게 공지된다. 예시적인 저장 매체는 저장매체로부터 정보를 판독하고 정보를 기록할 수 있는 프로세서에 접속된다. 선택적으로, 저장 매체는 프로세서의 필수 구성요소이다. 프로세서 및 저장 매체는 ASIC 내에 상주할 수 있다. ASIC은 사용자 단말 내에 상주할 수 있다. 선택적으로, 프로세서 및 저장 매체는 사용자 디바이스내에서 이산요소들로서 상주할 수 있다.
개시된 실시예의 전술된 설명은 당업자가 본 발명을 구현하고 이용하기에 용이하도록 하기 위하여 제공되었다. 이들 실시예에 대한 여러 가지 변형은 당업자에게 자명하며, 여기서 한정된 포괄적인 원리는 본 발명의 사용 없이도 다른 실시 예에 적용될 수 있다. 따라서, 본 발명은 설명된 실시예에 한정되는 것이 아니며, 여기에 개시된 원리 및 신규한 특징에 나타낸 가장 넓은 범위에 따른다.

Claims (22)

  1. 액세스 단말을 위한 방법으로서,
    부패킷(sub-packet)을 포함하는 멀티-유저(multi-user) 물리 계층(PL) 데이터 패킷을 수신하는 단계 ― 상기 멀티-유저 PL 데이터 패킷은 적어도 두 개의 액세스 단말들로 어드레스되는 데이터를 포함함 ―;
    데이터 전송 레이트들의 세트를 이용하여 상기 PL 데이터 패킷을 디코딩하도록 시도하는 단계;
    디코딩이 성공적이면, 부패킷 식별자를 추출하는 단계;
    상기 부패킷이 상기 액세스 단말로 지시(direct)되는지 여부를 결정하는 단계;
    상기 부패킷이 상기 액세스 단말로 지시된다면 상기 부패킷을 프로세싱하는 단계; 및
    상기 PL 데이터 패킷에 있는 적어도 하나의 캡슐의 목적지를 표시하는 캡슐 어드레스를 추출하는 단계를 포함하고, 상기 캡슐 어드레스는 캡슐 어드레스 필드에 포함되며, 지정된 캡슐 어드레스는 멀티-유저 PL 데이터 패킷을 표시하고,
    상기 멀티-유저 PL 데이터 패킷의 길이는 길이들의 세트로부터 선택되는, 액세스 단말을 위한 방법.
  2. 제 1항에 있어서,
    상기 PL 데이터 패킷에 대응하는 매체 액세스 제어(MAC) 데이터 패킷의 비트 길이를 표시하는 길이 값을 추출하는 단계를 더 포함하는, 액세스 단말을 위한 방법.
  3. 제 2항에 있어서, 상기 길이 값은 상기 PL 데이터 패킷의 포맷을 식별하는, 액세스 단말을 위한 방법.
  4. 제 1항에 있어서,
    상기 액세스 단말 및 상기 액세스 네트워크 사이의 순방향 채널 조건에 기반하여 액세스 네트워크로 데이터 레이트 요청을 전송하는 단계를 더 포함하고, 상기 데이터 레이트 요청은 상기 액세스 단말로 데이터를 전송하기 위해 상기 액세스 네트워크에 대한 하나 이상의 데이터 레이트들을 규정(specify)하는, 액세스 단말을 위한 방법.
  5. 제 1항에 있어서, 상기 멀티-유저 PL 데이터 패킷을 디코딩하도록 시도하는 단계는 코드 분할 다중 액세스(CDMA)와 연관된 코드들을 사용하는, 액세스 단말을 위한 방법.
  6. 제 1항에 있어서, 상기 PL 패킷에 포함된 상기 부패킷이 상기 액세스 단말로 지시되고 상기 액세스 단말이 상기 PL 패킷을 정확하게 디코딩했다면, 확인 응답(acknowledgement) 표시자를 전송하는 단계를 더 포함하는, 액세스 단말을 위한 방법.
  7. 액세스 단말로서,
    컴퓨터-판독가능 명령들을 실행하기 위한 제어 프로세서;
    상기 컴퓨터-판독가능 명령들을 저장하기 위한 메모리 저장장치;
    부패킷을 포함하는 멀티-유저 물리 계층(PL) 데이터 패킷을 수신하기 위한 수신기 ― 상기 멀티-유저 PL 데이터 패킷은 적어도 두 개의 액세스 단말들로 어드레스되는 데이터를 포함함 ―;
    물리 계층(PL) 패킷 해석 유닛을 포함하고,
    상기 PL 패킷 해석 유닛은,
    데이터 전송 레이트들의 세트를 이용하여 상기 PL 데이터 패킷을 디코딩하도록 시도하고;
    상기 디코딩이 성공적이면, 상기 부패킷이 상기 액세스 단말로 지시되는지 여부를 결정하며;
    상기 부패킷이 상기 액세스 단말로 지시된다면 상기 부패킷을 프로세싱하고; 그리고
    상기 PL 데이터 패킷에 있는 적어도 하나의 캡슐의 목적지를 표시하는 캡슐 어드레스를 추출하도록 적응되고, 상기 캡슐 어드레스는 캡슐 어드레스 필드에 포함되며, 지정된 캡슐 어드레스는 멀티-유저 PL 데이터 패킷을 표시하고,
    상기 멀티-유저 PL 데이터 패킷의 길이는 길이들의 세트로부터 선택되는, 액세스 단말.
  8. 액세스 단말로서,
    부패킷을 포함하는 멀티-유저 물리 계층(PL) 데이터 패킷을 수신하기 위한 수단 ― 상기 멀티-유저 PL 데이터 패킷은 적어도 두 개의 액세스 단말들로 어드레스되는 데이터를 포함함 ―;
    데이터 전송 레이트들의 세트를 이용하여 상기 PL 데이터 패킷을 디코딩하도록 시도하기 위한 수단;
    상기 디코딩이 성공적이면, 상기 PL 데이터 패킷으로부터 부패킷 식별자를 추출하기 위한 수단;
    상기 부패킷이 상기 액세스 단말로 지시되는지를 결정하기 위한 수단;
    상기 부패킷이 상기 액세스 단말로 지시된다면, 상기 부패킷을 프로세싱하기 위한 수단; 및
    상기 PL 데이터 패킷에 있는 적어도 하나의 캡슐의 목적지를 표시하는 캡슐 어드레스를 추출하기 위한 수단을 포함하고, 상기 캡슐 어드레스는 캡슐 어드레스 필드에 포함되고, 지정된 캡슐 어드레스는 멀티-유저 PL 데이터 패킷을 표시하고,
    상기 멀티-유저 PL 데이터 패킷의 길이는 길이들의 세트로부터 선택되는, 액세스 단말.
  9. 액세스 네트워크 장치로서,
    복수의 액세스 단말들로부터 데이터 레이트 요청들을 수신하기 위한 데이터 레이트 제어(DRC) 유닛 ― 각각의 데이터 레이트 요청은, 액세스 단말이 상기 액세스 네트워크 장치로 하여금 상기 액세스 단말로 데이터를 전송하도록 요청하는 적어도 하나의 레이트를 규정함 ―;
    상기 DRC 유닛으로부터 상기 데이터 레이트 요청들을 수신하고, 상기 데이터 레이트 요청들에 기반하여, 멀티-유저 물리 계층(PL) 패킷으로부터 데이터를 수신하기 위해 적어도 두 개의 액세스 단말들을 선택하며, 상기 멀티-유저 PL 패킷에 대한 길이들의 세트로부터 길이를 선택하고, 상기 멀티-유저 PL 패킷을 전송하기 위해 전송 레이트들의 세트로부터 전송 레이트를 선택하며, 그리고 상기 선택된 길이의 멀티-유저 PL 패킷을 생성하도록 적응되는 PL 패킷 생성유닛; 및
    상기 멀티-유저 PL 패킷을 상기 액세스 단말들로 전송하기 위한 송신기를 포함하는, 액세스 네트워크 장치.
  10. 제 9항에 있어서, 상기 PL 패킷 생성 유닛은 가변 길이 보안 계층(SL) 패킷을 생성하도록 적응되는, 액세스 네트워크 장치.
  11. 제 10항에 있어서, 상기 PL 패킷 생성 유닛은 복수의 SL 패킷들을 하나의 PL 패킷으로 결합하도록 적응되는, 액세스 네트워크 장치.
  12. 제 9항에 있어서, 상기 액세스 네트워크(AN) 장치는 제 1 개수의 시간 슬롯들 이후에 가변 길이 PL 패킷을 재전송하며, 상기 AN 장치는 액세스 단말이 수신에 확인 응답할 수 있도록 충분한 시간 슬롯들을 대기하는, 액세스 네트워크 장치.
  13. 제 12항에 있어서, 상기 시간 슬롯들의 제 1 개수는 4인, 액세스 네트워크 장치.
  14. 제 9항에 있어서, 상기 PL 패킷 생성유닛은 상기 액세스 단말들 및 상기 액세스 네트워크 장치 사이의 채널 조건의 함수로서 가변 길이 PL 패킷을 생성하는, 액세스 네트워크 장치.
  15. 제 9항에 있어서, 상기 PL 패킷 생성유닛은 복수의 액세스 단말(AT)들로 지시되는 복수의 보안 계층(SL) 패킷들을 포함하는 캡슐을 생성하도록 적응되는, 액세스 네트워크 장치.
  16. 제 15항에 있어서, 상기 PL 패킷 생성 유닛은 복수의 캡슐들을 생성하도록 적응되며, 각각의 캡슐은 대응 캡슐 어드레스를 가지는, 액세스 네트워크 장치.
  17. 무선 통신 시스템에서 데이터 패킷들을 프로세싱하기 위한 방법으로서,
    복수의 사용자들에게 전송하기 위한 복수의 접속 계층 패킷들을 수신하는 단계;
    상기 사용자들로부터 수신된 데이터 레이트 요청들에 기반하여, 물리 계층 패킷을 형성하기 위해, 제 1 사용자로 목적지가 정해진 제 1 접속 계층 패킷을 제 2 사용자로 목적지가 정해진 제 2 접속 계층 패킷으로 연접(concatenate)시키는 단계;
    상기 물리 계층 패킷에 대한 길이들의 세트로부터 길이를 선택하는 단계;
    상기 물리 계층 패킷을 전송하기 위해 전송 레이트들의 세트로부터 전송 레이트를 선택하는 단계; 및
    상기 물리 계층 패킷에 있는 상기 제 1 및 제 2 패킷들을 전송하는 단계를 포함하는, 데이터 패킷들을 프로세싱하기 위한 방법.
  18. 무선 통신 시스템에서 데이터 패킷들을 프로세싱하기 위한 방법으로서,
    액세스 네트워크 및 제 1 액세스 단말 사이에서 제 1 채널 조건을 결정하는 단계;
    상기 액세스 네트워크 및 제 2 액세스 단말 사이에서 제 2 채널 조건을 결정하는 단계;
    제 1 액세스 단말로의 전송을 위해 데이터의 제 1 블록을 수신하는 단계;
    제 2 액세스 단말로의 전송을 위해 데이터의 제 2 블록을 수신하는 단계;
    상기 데이터의 제 1 블록의 길이 및 상기 결정된 제 1 채널 조건에 기반하여 길이들의 세트로부터 제 1 보안 계층 패킷 길이를 선택하는 단계;
    상기 제 1 보안 패킷 계층 길이를 가진 제 1 보안 계층 패킷을 생성하는 단계;
    상기 데이터의 제 2 블록의 길이 및 상기 결정된 제 2 채널 조건에 기반하여 상기 길이들의 세트로부터 제 2 보안 계층 패킷 길이를 선택하는 단계;
    상기 제 2 보안 계층 패킷 길이를 가진 제 2 보안 계층 패킷을 생성하는 단계; 및
    상기 제 1 및 제 2 보안 계층 패킷들을 이용하여 물리 계층 패킷을 생성하는 단계를 포함하는, 데이터 패킷들을 프로세싱하기 위한 방법.
  19. 제 18항에 있어서, 상기 무선 통신 시스템은 비트 단위의 디폴트 보안 계층 패킷 길이를 가지며, 상기 제 1 선택된 보안 계층 패킷 길이는 상기 디폴트 보안 계층 패킷 길이보다 작은, 데이터 패킷들을 프로세싱하기 위한 방법.
  20. 제 18항에 있어서,
    코드 분할 다중 액세스(CDMA) 기술들을 이용하여 상기 물리 계층 패킷을 전송하는 단계를 더 포함하는, 데이터 패킷들을 프로세싱하기 위한 방법.
  21. 제 18항에 있어서, 상기 제 1 보안 계층 패킷 길이를 선택하는 단계는,
    서비스 품질(QoS) 요건을 결정하는 단계; 및
    상기 제 1 채널 조건 및 상기 QoS 요건의 함수로서 보안 계층 패킷 길이를 결정하는 단계를 포함하는, 데이터 패킷들을 프로세싱하기 위한 방법.
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