KR101022606B1 - 원자력 발전소의 디지털 신호 전자제어 처리를 위한 장치 및 방법 - Google Patents

원자력 발전소의 디지털 신호 전자제어 처리를 위한 장치 및 방법 Download PDF

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Abstract

본 발명은 원자력 발전소의 디지털 신호 전자제어 처리를 위한 장치 및 방법에 관한 것으로서, 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하고, 상기 센싱된 시스템 상태 신호를 수신하며, 독립된 두 개의 FPGA를 이용하여 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력하고, 상기 출력된 시스템 관리 신호에 따라 상기 원자력 발전소의 동작을 제어할 수 있다.

Description

원자력 발전소의 디지털 신호 전자제어 처리를 위한 장치 및 방법{APPARATUS AND METHOD OF ELECTRONIC CONTROL PROCESSING OF DIGITAL SIGNAL IN NUCLEAR POWER PLANT}
본 발명은 원자력 발전소의 디지털 신호 전자제어 처리를 위한 장치 및 방법에 관한 것으로서, 하나의 기능을 사용하기 위해 기존의 제어 장치 및 시스템에서 사용하던 다수의 로직 IC(Integrated Circuit) 대신에 이중화된 FPGA(Field Programmable Gate Array)로 구현하여 다수의 로직 IC에서 발생할 수 있는 불량률을 낮춰 발전소 운영의 안전성을 향상시키는 기술에 관한 것이다.
원자력 발전소는 보통 100개 이상의 개별적 기능을 가진 계통(system)들로 구성된다.
이들은 크게 원자로를 중심으로 한 핵증기공급계통(NSSS, Nuclear Steam Supply System)과 증기를 공급받아 발전기를 돌리는 터빈/발전기계통 그리고 기타 부수설비로 구분된다.
현재 한국 원자력 발전소의 주종을 이루고 있는 가압경수형 발전소를 살펴보면 원자로를 중심으로 한 1차 계통, 증기발생기, 터빈, 발전기 및 복수기를 포함한 2차 계통, 사고에 대비한 공학적 안전설비계통, 송배전계통, 계측제어계통, 기타 보조계통들로 구성되어 있다.
영광3, 4호기를 포함한 한국표준형 원자력 발전소는 보호 계통, 감시 계통, 및 제어 계통 등의 다양한 계통들로 구분된다.
원자력 발전소를 구성하는 각종 계통들은 각각의 기능을 수행하는 다수의 로직 IC로 구현된 카드로 선정된 동작을 수행한다.
그러나, 각각의 로직 IC에 문제가 생기는 경우 카드는 선정된 동작을 수행하지 못할 뿐만 아니라, 카드의 기능 정지로 인해 다른 카드, 제어 장치 또는 시스템에 영향을 미칠 수 있다.
이런 문제는 원자력 발전소의 보호, 감시, 및 제어 등의 일부 또는 전체의 기능을 마비시킬 수 있는 심각한 문제를 야기시킬 수도 있다.
본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치는 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 센싱부, 상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력하는 제1 FPGA 및 제2 FPGA, 및 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 시스템 제어부를 포함할 수 있다.
본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 단계, 제1 FPGA 및 제2 FPGA 중에서 적어도 하나를 이용하여, 상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력하는 단계, 및 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 단계를 포함할 수 있다.
본 발명의 일실시예에 따르면, 각각의 로직 IC을 이중화된 두 개의 FPGA로 구현하고, 하나의 FPGA에서 문제가 생기는 경우 다른 FPGA에서 선정된 동작을 처리함으로써 로직 IC에 문제가 생기는 경우에 대비할 수 있다.
본 발명의 일실시예에 따르면, 이중화된 두 개의 FPGA의 입출력을 기존 선정된 기능을 수행하는 카드의 입출력과 동일하게 설정함으로써, 하드웨어의 변경을 최소화하여 시스템의 안전성을 향상시킬 수 있다.
도 1은 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치를 설명하는 도면이다.
도 2는 본 발명의 다른 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치를 설명하는 도면이다.
도 3은 본 발명의 또 다른 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치를 설명하는 도면이다.
도 4 및 도 5는 본 발명의 다른 일실시예에 따른 디지털 신호 전자제어 장치가 적용되는 시스템을 설명하는 도면이다.
도 6은 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법을 설명하는 도면이다.
이하, 본 발명에 따른 바람직한 실시예를 첨부된 도면을 참조하여 상세하게 설명한다.
본 발명을 설명함에 있어서, 관련된 공지 기능 또는 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명을 생략할 것이다. 그리고, 본 명세서에서 사용되는 용어(terminology)들은 본 발명의 바람직한 실시예를 적절히 표현하기 위해 사용된 용어들로서, 이는 사용자, 운용자의 의도 또는 본 발명이 속하는 분야의 관례 등에 따라 달라질 수 있다. 따라서, 본 용어들에 대한 정의는 본 명세서 전반에 걸친 내용을 토대로 내려져야 할 것이다. 각 도면에 제시된 동일한 참조 부호는 동일한 부재를 나타낸다.
도 1은 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치(100)를 설명하는 도면이다.
본 발명의 일실시예에 따른 디지털 신호 전자제어 장치(100)는 이중화된, 즉 두 개의 독립된 FPGA를 통해서 기존 카드가 제공하는 선정된 기능을 제공함으로써, 원자력 발전소 운영의 안정성을 향상시킬 수 있다.
구체적으로, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치(100)는 센싱부(110), FPGA들(120), 및 시스템 제어부(130)를 포함할 수 있다.
본 발명의 일실시예에 따른 센싱부(110)는 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱(수집)할 수 있다.
본 발명의 일실시예에 따른 FPGA들(120)은 상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력할 수 있다.
예를 들어, 제1 FPGA(121)가 정상 동작하는 경우, 제1 FPGA(121)는 상기 시스템 상태 신호를 수집하고 상기 수집된 시스템 상태 신호에 기초하여 사전에 설정된 프로그램에 따라서 시스템 관리 신호를 출력할 수 있다.
FPGA의 선정된 기능은 디지털 신호 전자제어 장치(100)가 어느 시스템에 적용되는지에 따라서 가변적으로 변경될 수 있다.
예를 들어, 이중화된 FPGA가 노심보호연산기 시스템에 적용되는 경우, FPGA들(120)은 노심의 상태 정보를 상기 시스템 상태 신호로서 수신할 수 있다. 또한, FPGA들(120)은 상기 수신된 노심의 상태 정보를 수신하고, 노심의 안정도 및 운전 여유도를 계산하여 노심을 적절하게 관리할 수 있는 시스템 관리 신호를 출력할 수 있다.
FPGA의 선정된 기능에 대한 보다 구체적인 설명은 도 4 및 도 5를 통해서 추후 설명한다.
제2 FPGA(122)는 제1 FPGA(121)의 동작과는 독립하여 동작하고, 제1 FPGA(121)이 정상적으로 동작하는지 여부를 모니터링할 수 있다.
즉, 제2 FPGA(122)는 제1 FPGA(121)의 상태를 감시하고, 제1 FPGA(121)가 비정상적으로 동작하는 경우를 판단할 수 있다.
이를 위해, 제2 FPGA(122)는 주기적으로 클럭(Clock)이나 워치독 타이머(Watch-dog timer) 신호를 발생하여, 제1 FPGA(121)의 상태를 감시할 수 있다.
다른 예로, 제1 FPGA(121)가 제2 FPGA(122)에 주기적으로 클럭이나 워치독 타이머 신호를 전송하여 자신의 상태가 정상동작 함을 알릴 수 있다.
만약, 제1 FPGA(121)이 제2 FPGA(122)가 발생한 클럭이나 워치독 타이머 신호에 대한 응답을 하지 않는 경우, 또는 제1 FPGA(121)이 주기적으로 제2 FPGA(122)으로 클럭이나 워치독 타이머 신호를 전송하지 않는 경우, 제2 FPGA(122)는 제1 FPGA(121)가 비정상적으로 동작하지 않는다고 판단할 수 있다.
제1 FPGA(121)가 비정상적으로 동작하지 않는다고 판단되는 경우, 제2 FPGA(122)는 제1 FPGA(121)을 대신할 수 있다.
다시 말해, 제2 FPGA(122)는 제1 FPGA(121)가 비정상적으로 동작하지 않는다고 판단되는 경우, 제1 FPGA(121)를 대신하여 상기 시스템 상태 신호를 수집하고 상기 수집된 시스템 상태 신호에 따라서 사전에 설정된 프로그램에 따라서 시스템 관리 신호를 출력할 수 있다.
참고로, 제2 FPGA(122)가 정상 동작하는 경우에, 제1 FPGA(121)와 연결된 디지털 신호는 신호 왜곡을 방지하기 위해 Z(High Impedance)로서 유지될 수 있다. 또한, 제2 FPGA(122)에서 제1 FPGA(121)이 비정상적으로 동작한다고 판단하는 경우, Z(High Impedance) 상태를 해지하고 입력된 상기 시스템 상태 신호를 제어 및 처리하여 시스템 관리 신호로서 출력할 수 있다.
시스템 제어부(130)는 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어할 수 있다.
도 2는 본 발명의 다른 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치(200)를 설명하는 도면이다.
본 발명의 다른 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치(200)는 입력 버퍼(223) 및 출력 버퍼(224)를 통해서 FPGA들의 입출력을 제어할 수 있다.
도 1과 유사하게, 본 발명의 다른 일실시예에 따른 디지털 신호 전자제어 장치(200)는 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 센싱부(210), 입출력 버퍼를 포함하는 FPGA들(220), 및 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 시스템 제어부(230)를 포함할 수 있다.
FPGA들(220)은 입력 버퍼(223) 및 출력 버퍼(224)를 통해서 입력 신호를 출력 신호로 변환할 수 있다.
구체적으로, 입력 버퍼(223)는 센싱부(210)를 통해 상기 센싱된 시스템 상태 신호를 제1 FPGA(221) 및 제2 FPGA(222) 중에서 적어도 하나에 전달할 수 있다.
예를 들어, 입력 버퍼(223)는 제1 FPGA(221)가 정상적으로 동작하는 경우, 상기 센싱된 시스템 상태 신호를 제1 FPGA(221)에 전달하고, 제1 FPGA(221)가 비정상적으로 동작하고 제2 FPGA(222)가 정상적으로 동작하는 경우, 상기 센싱된 시스템 상태 신호를 제2 FPGA(222)에 전달할 수 있다.
정상적으로 동작하는지 여부를 알리기 위해, 입출력을 디폴트로 담당하는 제1 FPGA(221)는 입력 버퍼(223)에 페일오버(Failover) 신호를 주기적으로 전송할 수 있다.
입력 버퍼(223)는 제1 FPGA(221)로부터 페일오버(Failover) 신호를 수신하는 경우, 제1 FPGA(221)가 정상적으로 동작한다고 판단할 수 있다. 이에, 입력 버퍼(223)는 센싱된 시스템 상태 신호를 제1 FPGA(221)로 전달할 수 있다.
만약, 입력 버퍼(223)가 제1 FPGA(221)로부터 페일오버(Failover) 신호를 수신하지 못하는 경우, 입력 버퍼(223)는 제1 FPGA(221)가 비정상적으로 동작한다고 판단하고, 상기 센싱된 시스템 상태 신호를 제2 FPGA(22)로 전달할 수 있다.
입력 버퍼(223)와 마찬가지로, 출력 버퍼(224)는 제1 FPGA(221) 및 제2 FPGA(222) 중에서 적어도 하나로부터 출력되는 상기 시스템 관리 신호를 전달받을 수 있다.
이를 위해서, 출력 버퍼(224)는 정상적으로 동작하는 FPGA를 모니터링해야 한다.
입력 버퍼(223)와 마찬가지로, 출력 버퍼(224)는 제1 FPGA(221)로부터 페일오버(Failover) 신호를 수신하는 경우, 제1 FPGA(221)가 정상적으로 동작한다고 판단하고, 제1 FPGA(221)로부터 시스템 관리 신호를 수신할 수 있다.
또한, 출력 버퍼(224)는 제1 FPGA(221)로부터 페일오버(Failover) 신호를 수신하지 못하는 경우, 제1 FPGA(221)가 비정상적으로 동작한다고 판단하고, 제2 FPGA(222)로부터 시스템 관리 신호를 수신할 수 있다.
도 3은 본 발명의 또 다른 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 장치(300)를 설명하는 도면이다.
도 3에서 설명하는 각각의 디지털 신호 전자제어 장치(300)는 하나의 FPGA를 포함하며, 유사한 기능을 하는 인접한 디지털 신호 전자제어 장치와 내부적으로 연결되어 서로의 입/출력 신호를 공유 및 제어할 수 있다.
구체적으로, 본 발명의 또 다른 일실시예에 따른 디지털 신호 전자제어 장치(300)는 다른 기능을 처리하는 제1 FPGA(320)가 비정상적으로 동작하는 경우, 제1 FPGA(320) 대신에 제2 FPGA(330)에서 제1 FPGA(320)가 처리하는 입출력을 처리할 수 있다. 또한 반대로, 제1 FPGA(320)가 비정상적으로 동작하는 경우에는 제2 FPGA(330)가 제1 FPGA(320)가 처리하는 입출력을 대신하여 처리할 수 있다.
구체적으로, 본 발명의 또 다른 일실시예에 따른 디지털 신호 전자제어 장치(300)는 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 센싱부(310), FPGA들(320, 330), 및 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 시스템 제어부(340)를 포함할 수 있다.
제1 FPGA(320)와 제2 FPGA(330)는 정상 동작하는 경우에 각각의 기능을 수행하고, 어느 하나가 비정상적으로 동작하는 경우 다른 하나가 비정상적으로 동작하는 FPGA의 동작을 대신할 수 있다.
다시 말해, 제1 FPGA(320)와 제2 FPGA(330)가 모두 정상적으로 동작하는 경우, 제1 FPGA(320)는 센싱된 제1 시스템 상태 신호를 수신하여, 상기 수신된 제1 시스템 상태 신호에 대응하는 제1 시스템 관리 신호를 출력하고, 제2 FPGA(330)는 센싱된 제2 시스템 상태 신호를 수신하여, 상기 수신된 제2 시스템 상태 신호에 대응하는 제2 시스템 관리 신호를 출력할 수 있다.
제1 FPGA(320)가 비정상적으로 동작하는 경우 센싱부(310)에 입력되는 제1 시스템 상태 신호는 제2 FPGA(330)에서 처리될 수 있고, 제2 FPGA(330)가 비정상적으로 동작하는 경우 센싱부(310)에 입력되는 제2 시스템 상태 신호는 제1 FPGA(320)에서 처리될 수 있다.
비정상적인 상태를 파악하기 위해서, 제1 FPGA(320)와 제2 FPGA(330)는 클럭 및 워치독 타이머 신호를 이용하여, 서로의 상태를 감시할 수 있다.
본 발명의 일실시예에 따른 디지털 신호 전자제어 장치는 다양한 계통으로 분류되는 시스템에 적용될 수 있다.
예를 들어, 본 발명의 일실시예에 따른 디지털 신호 전자제어 장치는 보호 계통이나 감시 계통 등에 적용될 수 있다. 구체적인 예는 도 4 및 도 5를 통해서 설명한다.
도 4는 본 발명의 일실시예에 따른 디지털 신호 전자제어 장치가 적용되는 시스템을 설명하는 도면이다.
본 발명의 일실시예에 따른 디지털 신호 전자제어 장치는 센싱부(410), 각각의 기능을 처리하는 FPGA들(420), 및 시스템 제어부(430)를 포함할 수 있다.
센싱부(410)는 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하고, 시스템 제어부(430)는 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어할 수 있다.
센싱부(410)와 시스템 제어부(430)의 사이에는 두 개의 FPGA들을 쌍으로 갖는 FPGA들(420)을 통해 시스템 상태 신호를 수신하여 시스템 관리 신호를 출력할 수 있다.
예를 들어, 본 발명의 일실시예에 따른 디지털 신호 전자제어 장치는 노심보호연산기 시스템(CPCS, Core Protection Calculator System)에 적용될 수 있다.
노심보호연산기 시스템은 제어봉 위치에 따른 노심의 안정도 및 운전 여유도를 계산하기 위해 전송받은 +5V - +10V의 제어봉 위치 신호를 노심보호 연산기 및 제어봉집합체 연산기로 보내며, 이를 위해 두 개의 서로 다른 카드를 통해 각각의 신호를 보내는 기능을 담당한다.
상기 제어봉 위치 신호는 노심보호연산기 시스템의 카드에 전송되고, 같은 제어봉 위치 신호를 별도의 격리장치 없이 제어봉집합체 위치 광차단집합체의 임피던스 매칭 카드에 전송하는 등 카드 들이 선정된 제어 동작을 처리할 수 있다.
이러한 노심보호연산기 시스템의 카드 기능들을 대체하여 본 발명의 일실시예에 따른 디지털 신호 전자제어 장치가 적용될 수 있다.
노심보호연산기 시스템의 입출력 기능을 제공하는 각각의 카드들은 다수의 논리 게이트(logic gate)의 집합을 통해서 입출력 신호를 제어할 수 있다. 따라서, 원자력 발전소의 동작 중에 카드 내부 하나의 논리 게이트에 문제가 발생하는 경우, 해당 카드는 물론 원자력 발전소의 운영이 정지되는 심각한 문제가 야기될 수 있다.
이를 해결하고자, 각각의 카드들은 이중화된 두 개의 FGPA를 각각 포함하는 FPGA들(421, 422, 423, ...N)로 대체될 수 있다.
예를 들어, 이러한 노심보호연산기의 기능을 수행하기 위해서, FPGA들(420)은 한 쌍의 FPGA들(421, 422, 423, ...N)을 포함할 수 있다.
즉, 한 쌍으로 구성되는 FPGA들(421, 422, 423, ...N)은 노심보호연산기의 기능을 수행하기 위한 카드의 역할을 대신할 수 있다.
예를 들어, FPGA들(421, 422, 423, ...N)은 ADC(Analog to Digital Convertor) 카드, DI(Digital Input) 카드, DO(Digital Output) 카드, RO 카드, FI 카드, WDT(Watch Dog Timer) 카드, DALCAL(Digital Analog Loop-Back) 카드가 제공하는 각각의 기능을 제공할 수 있다.
예를 들어, 각각 제1 FPGA 및 제2 FPGA를 포함하는 FPGA들(421, 422, 423, ...N)은 센싱된 시스템 상태 신호를 수신하여 핵비등이탈률 여유도, 국부출력밀도 여유도, 및 중성자속 출력 중에서 적어도 하나를 관리하는 상기 시스템 관리 신호를 출력할 수 있다.
뿐만 아니라, 각각 제1 FPGA 및 제2 FPGA를 포함하는 FPGA들(421, 422, 423, ...N)은 상기 센싱된 시스템 상태 신호를 수신하여 노심보호연산기(CPC, Core Protection Calculator) 및 제어봉집합체 연산기(CEAC, Control Element Assembly Calculator) 중에서 어느 하나를 선택하기 위한 상기 시스템 관리 신호를 출력할 수 있고, 상기 센싱된 시스템 상태 신호를 수신하여 외부 표시장치에 상기 노심의 현 상태를 표시하기 위한 상기 시스템 관리 신호를 출력할 수 있으며, 상기 센싱된 시스템 상태 신호를 수신하여 저 핵비등이탈률 정지/예비정지 신호, 고 국부출력 정지/예비정지 신호, 감지기 고장 신호, 및 제어봉 인출 금지 신호 중에서 적어도 하나를 관리하는 상기 시스템 관리 신호를 출력할 수 있고, 상기 센싱된 시스템 상태 신호를 수신하여 원자로 냉각재 펌프의 속도를 측정하는 상기 시스템 관리 신호를 출력할 수 있다.
또한, 각각 제1 FPGA 및 제2 FPGA를 포함하는 FPGA들(421, 422, 423, ...N)은 상기 센싱된 시스템 상태 신호를 수신하여 주기적으로 워치독 타이머(Watch-dog timer) 신호를 발생하는 상기 시스템 관리 신호를 출력할 수 있고, 상기 센싱된 시스템 상태 신호를 수신하여 디지털/아날로그 루프백 신호(digital analog loop back)를 발생하는 상기 시스템 관리 신호를 출력할 수 있다.
구체적으로, 제1 FPGA와 제2 FPGA를 포함하는 FPGA들(421)는 ADC카드의 기능을 대신할 수 있다.
즉, 도 1 내지 도 3 중에서 어느 하나의 형태로서, 아날로그 입력을 수신하고, 제1 FPGA와 제2 FPGA 중에서 어느 하나를 통해서 디지털 변환한 뒤, 디지털의 형태로 출력할 수 있다.
이때, 아날로그 입력을 디지털 출력으로 변화하는 정보는 증기발생기의 1차측 저온관의 온도, 고온관의 냉각재 온도, 가입기 압력, 노외중성자속 검출기 신호, 및 목표 제어봉의 위치 등으로 구분될 수 있다.
마찬가지로, 두 개의 FPGA를 포함하는 FPGA들(421, 422, 423, ...N) 중에서 어느 하나는 DI(Digital Input) 카드를 대신하여 CPC/CEAC 선택 등의 신호를 입출력 할 수 있다.
또한, 두 개의 FPGA를 포함하는 FPGA들(421, 422, 423, ...N) 중에서 어느 하나는 DO(Digital Output) 카드를 대신하여 외부 표시장치 신호를 상기 시스템 관리 신호로서 출력할 수 있고, RO 카드를 대신하여 저 핵비등이탈률 (예비)정지 신호를 출력할 수 있으며, WDT(Watch Dog Timer) 카드를 대신하여 시스템이 동작 중일 때, 주기적인 신호를 발생할 수 있고, DALCAL(Digital Analog Loop-Back) 카드를 대신하여, FPGA들의 내부 동작 확인을 위한 신호를 출력할 수 있다.
또한, 각각 두 개의 FPGA를 포함하는 FPGA들(421, 422, 423, ...N) 중에서 어느 하나는 FI 카드를 대신하여 원자로 냉각재의 펌프 속도를 측정하기 위한 시스템 관리 신호를 출력할 수 있다.
기존 카드들은 내부를 구성하는 로직 IC가 오동작하는 경우, 카드 전체의 기능이 정지될 여지가 있으나, 본 발명에 따른 디지털 신호 전자제어 장치(400)는 이중화되고 독립된 두 개의 FPGA를 사용함으로써, 어느 하나의 FPGA가 오동작 하더라도 다른 하나의 FPGA를 통해서 해당 기능이 수행할 수 있다.
다른 예로, 본 발명의 일실시예에 따른 디지털 신호 전자제어 장치는 발전소 감시 시스템(PMS, Plant Monitoring System)에도 적용될 수 있다.
즉, 상기 시스템 상태 신호는 원자력 발전소의 발전소 감시 시스템에 입력되는 신호이고, 상기 시스템 관리 신호는 발전소 정보 수집, 발전소 정보 지시, 발전소 정보 기록, 경보 발생, 각종 정보 제공, 원자로심 및 1, 2차 측 성능평가 수단 제공 중에서 적어도 하나를 관리하기 위한 신호로 해석될 수 있다.
발전소 감시 시스템은 원자력 발전소의 정보를 수집, 지시, 및 기록할 수 있고, 경보를 발생할 수 있으며, 원자력 발전소가 기술지침서 한계치 이내에서 운전될 수 있도록 각종 정보를 제공할 수 있다. 또한, 발전소 감시 시스템은 원자로심 및 1/2차측 성능평가 수단을 제공할 수 있다.
이를 위해, 상기 발전소 감시 시스템은 캐비닛 별로 PDAS(Plant Data Acquisition) A-D의 안전 계통과, 비안전계통으로서 PDAS N1-N3, 및 PMCS(Plant Monitoring Computer System)를 포함할 수 있다.
이러한 상기 발전소 감시 시스템의 구성요소들은 상기 노심보호연산기 시스템과 같이 각각의 카드를 통해서 상술한 바와 같은 기능들을 제공할 수 있는데, 각각 두 개의 FPGA를 포함하는 FPGA들(421, 422, 423, ...N)은 상기 각각의 카드를 대체하여 원자력 발전소의 운영에 안전성을 향상시킬 수 있다.
도 4의 실시예에 따른 디지털 신호 전자제어 장치는 상기 노심보호연산기 시스템 및 상기 발전소 감시 시스템에 적용되기 위해, 센싱부가 상기 시스템 상태 신호를 센싱하는 메인 프로세서와 상기 센싱된 시스템 상태 신호의 입출력을 제어하는 입출력 버스 컨버터를 포함할 수 있다.
도 5는 본 발명의 다른 일실시예에 따른 디지털 신호 전자제어 장치가 적용되는 시스템을 설명하는 도면이다.
본 발명의 다른 일실시예에 따른 디지털 신호 전자제어 장치가 적용되는 시스템은 발전기 보호 시스템(PPS, Plant Protection System)에 적용될 수 있다.
즉, 상기 원자력 발전소의 발전소 보호 시스템에 입력되는 신호이고, 상기 시스템 관리 신호는 원자로 정지 신호, 안전주입 신호, 원자로 건물 격리 신호, 원자로 건물 살수 신호, 재순환 작동 신호, 주 증기 격리 신호, 보조급수 작동 신호, 연료건물 비상배기 작동 신호, 원자로 건물 배기 격리 작동 신호, 및 주제어실 비상환기 작동신호 중에서 적어도 하나로 해석될 수 있다.
상기 원자력 발전소의 발전소 보호 시스템은, 원자로의 정지에 관련하는 RPS(Reactor Protection System), PPS와 병행하여 원자력 발전소의 보호를 강화하는 DPS(Diverse Protection System), 및 허용치 이내로 설계기준 사고결과를 유지하는 ESFAS(Engineered Safety Features Actuation System)를 포함할 수 있다.
도 5와 같이, RPS와 ESFAS는 여러 블록들을 포함할 수 있고, 이러한 블록들은 카드로 구현될 수 있다. 각각의 카드를 통해서, 원자로의 정지, 발전소의 보호, 및 사고결과를 유지하는 기능들을 제공할 수 있다.
이러한 각각의 카드를 대신하여 이중화된 제1 FPGA(510) 및 제2 FPGA(520)가 적용될 수 있다.
즉, 제1 FPGA(510) 및 제2 FPGA(520)는 특정 카드의 기능을 수행하기 위해서 프로그램되어 있고, 제1 FPGA(510) 및 제2 FPGA(520) 중에서 어느 하나가 비정상적으로 동작하는 경우 다른 하나가 해당 기능을 대신하여 수행할 수 있다.
따라서, 제1 FPGA(510) 및 제2 FPGA(520)를 카드 대신에 이용하는 RPS와 ESFAS는 운영의 안정성이 향상될 수 있다.
구체적으로, 제1 FPGA(510) 및 제2 FPGA(520)는 입력된 아날로그 신호와 기설정된 고정/가변 설정치와 비교하는 'BISTABLES COMPARATORS', 상기 'BISTABLES COMPARATORS'에서 입력된 아날로그 신호가 기설정치에 도달하는지 여부를 판단하여 도달하면 출력하는 'BISTABLE RELAYS', 4개의 다중 채널을 포함하며, 각 채널에 동일한 발전소 인자를 감시하는 'BISTABLE COINCIDENCE LOGIC MATRICES'와 'MATRIX RELAY' 중 어느 하나라도 개폐된 경우 원자로 트립(Trip) 개폐기로 트립 신호를 초기화하거나, 'AUXILIARY RELAY CABINET'의 작동을 초기화하는 'AUXILIARY RELAY CABINET'을 대신하여 동작할 수 있다.
뿐만 아니라, 제1 FPGA(510) 및 제2 FPGA(520)는 BISTABLE COMPARATOR, BISTABLE RELAYS, BISTABLE COINCIDENCE LOGIC MATRICES, INITIATION LOGIC CIRCUIT의 진단 및 계측을 수행하는 ' TEST & CALIBRATION' 및 공급되는 전원과 Chassis Ground의 절연파괴를 감시하는 'GROUND DETECTION'의 기능을 대신할 수 있다.
도 6은 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법을 설명하는 도면이다.
본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱한다(단계 610).
다음으로, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 제1 FPGA 및 제2 FPGA 중에서 적어도 하나를 이용하여, 상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력한다(단계 620).
예를 들어, 제1 FPGA가 비정상적으로 동작하는 경우 제2 FPGA가 상기 제1 FPGA의 동작을 대신하여 상기 센싱된 시스템 상태 신호를 수신한 후 상기 시스템 관리 신호로 출력할 수 있다.
이를 위해, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 상기 제2 FPGA를 이용하여 상기 제1 FPGA의 상태를 감시할 수 있다.
또한, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 입력 단에 위치하는 입력 버퍼를 이용하여, 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나에 전달할 수 있다.
또한, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 출력 버퍼를 이용하여 상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나로부터 출력되는 상기 시스템 관리 신호를 전달받을 수 있다.
이를 위해, 상기 입력 버퍼 및 상기 출력 버퍼는 상기 제1 FPGA로부터 페일오버 신호를 수신하여 상기 제1 FPGA의 상태가 정상인지 비정상인지 여부를 판단할 수 있다.
즉, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 입력 버퍼에 수신되는 경우, 상기 제1 FPGA가 정상적으로 동작한다고 판단하여 상기 입력 버퍼를 통해 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로 전달할 수 있다.
또한, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 제1 FPGA로부터 페일오버(Failover) 신호가 상기 입력 버퍼에 수신되지 않는 경우, 상기 제1 FPGA가 비정상적으로 동작한다고 판단하여 상기 입력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로 전달할 수 있다.
입력측과 유사하게, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 출력 버퍼에 수신되는 경우, 상기 출력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로부터 전달받고, 상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 출력 버퍼에 수신되지 않는 경우, 상기 출력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로부터 전달받을 수 있다.
본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 특정 카드를 대신하는 제1 FPGA와 다른 특정 카드를 대신하는 제2 FPGA를 통해 안정성을 향상시킬 수도 있다.
구체적으로, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 제1 FPGA를 이용하여, 수신된 제1 시스템 상태 신호에 대응하는 제1 시스템 관리 신호를 출력하고, 상기 제2 FPGA를 이용하여, 수신된 제2 시스템 상태 신호에 대응하는 제2 시스템 관리 신호를 출력하는 경우를 고려할 수 있다.
이때, 본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 상기 제1 FPGA 및 상기 제2 FPGA를 이용하여 상호 간의 상태를 감시하여 각각의 FPGA의 상태를 감시할 수 있다.
예를 들어, 상기 제1 FPGA가 비정상적으로 동작하는 경우에는 상기 제2 FPGA가 상기 제1 FPGA를 대신하여 동작하고, 상기 제2 FPGA가 비정상적으로 동작하는 경우에는 상기 제1 FPGA가 상기 제2 FPGA를 대신하여 동작하여 상기 제1 시스템 관리 신호 및 상기 제2 시스템 관리 신호 중에서 적어도 하나를 출력할 수 있다.
본 발명의 일실시예에 따른 원자력 발전소의 디지털 신호 전자제어 방법은 상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어한다(단계 630).
결국, 본 발명의 일실시예에 따르면, 각각의 로직 IC을 이중화된 두 개의 FPGA로 구현하고, 하나의 FPGA에서 문제가 생기는 경우 다른 FPGA에서 선정된 동작을 처리함으로써 로직 IC에 문제가 생기는 경우에 대비할 수 있다.
또한, 본 발명의 일실시예에 따르면, 이중화된 두 개의 FPGA의 입출력을 기존 선정된 기능을 수행하는 카드의 입출력과 동일하게 설정함으로써, 하드웨어의 변경을 최소화하여 시스템의 안전성을 향상시킬 수 있다.
상술한 원자력 발전소의 디지털 신호 전자제어 방법은 다양한 컴퓨터 수단을 통하여 수행될 수 있는 프로그램 명령 형태로 구현되어 컴퓨터 판독 가능 매체에 기록될 수 있다. 상기 컴퓨터 판독 가능 매체는 프로그램 명령, 데이터 파일, 데이터 구조 등을 단독으로 또는 조합하여 포함할 수 있다. 상기 매체에 기록되는 프로그램 명령은 본 발명을 위하여 특별히 설계되고 구성된 것들이거나 컴퓨터 소프트웨어 당업자에게 공지되어 사용 가능한 것일 수도 있다. 컴퓨터 판독 가능 기록 매체의 예에는 하드 디스크, 플로피 디스크 및 자기 테이프와 같은 자기 매체(magnetic media), CD-ROM, DVD와 같은 광기록 매체(optical media), 플롭티컬 디스크(floptical disk)와 같은 자기-광 매체(magneto-optical media), 및 롬(ROM), 램(RAM), 플래시 메모리 등과 같은 프로그램 명령을 저장하고 수행하도록 특별히 구성된 하드웨어 장치가 포함된다. 프로그램 명령의 예에는 컴파일러에 의해 만들어지는 것과 같은 기계어 코드뿐만 아니라 인터프리터 등을 사용해서 컴퓨터에 의해서 실행될 수 있는 고급 언어 코드를 포함한다. 상기된 하드웨어 장치는 본 발명의 동작을 수행하기 위해 하나 이상의 소프트웨어 모듈로서 작동하도록 구성될 수 있으며, 그 역도 마찬가지이다.
이상과 같이 본 발명은 비록 한정된 실시예와 도면에 의해 설명되었으나, 본 발명은 상기의 실시예에 한정되는 것은 아니며, 본 발명이 속하는 분야에서 통상의 지식을 가진 자라면 이러한 기재로부터 다양한 수정 및 변형이 가능하다.
그러므로, 본 발명의 범위는 설명된 실시예에 국한되어 정해져서는 아니 되며, 후술하는 특허청구범위뿐 아니라 이 특허청구범위와 균등한 것들에 의해 정해져야 한다.
100: 디지털 신호 전자제어 장치 110: 센싱부
120: FPGA들 130: 시스템 제어부

Claims (28)

  1. 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 센싱부;
    상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력하는 제1 FPGA 및 제2 FPGA; 및
    상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 시스템 제어부
    를 포함하고,
    상기 제1 FPGA 및 상기 제2 FPGA는,
    클럭 및 워치독 타이머 신호 중에서 적어도 하나를 이용하여 상호 간의 상태를 감시하여 정상동작 여부를 확인하고,
    상기 제1 FPGA가 비정상적으로 동작하는 경우에는 상기 제2 FPGA가 상기 제1 FPGA를 대신하여 제1 시스템 관리 신호를 출력하고, 상기 제2 FPGA가 비정상적으로 동작하는 경우에는 상기 제1 FPGA가 상기 제2 FPGA를 대신하여 제2 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  2. 삭제
  3. 제1항에 있어서,
    상기 센싱된 시스템 상태 신호를 상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나에 전달하는 입력 버퍼; 및
    상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나로부터 출력되는 상기 시스템 관리 신호를 전달받는 출력 버퍼
    를 더 포함하는 원자력 발전소의 디지털 신호 전자제어 장치.
  4. 제3항에 있어서,
    상기 입력 버퍼는,
    상기 제1 FPGA로부터 페일오버(Failover) 신호를 수신하는 경우, 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로 전달하고, 상기 제1 FPGA로부터 페일오버(Failover) 신호를 수신하지 못하는 경우, 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로 전달하는 원자력 발전소의 디지털 신호 전자제어 장치.
  5. 제3항에 있어서,
    상기 출력 버퍼는,
    상기 제1 FPGA로부터 페일오버(Failover) 신호를 수신하는 경우, 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로부터 전달받고, 상기 제1 FPGA로부터 페일오버(Failover) 신호를 수신하지 못하는 경우, 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로부터 전달받는 원자력 발전소의 디지털 신호 전자제어 장치.
  6. 삭제
  7. 삭제
  8. 제1항에 있어서,
    상기 센싱부는,
    상기 시스템 상태 신호를 센싱하는 메인 프로세서; 및
    상기 센싱된 시스템 상태 신호의 입출력을 제어하는 입출력 버스 컨버터
    를 포함하는 원자력 발전소의 디지털 신호 전자제어 장치.
  9. 제1항에 있어서,
    상기 시스템 상태 신호는,
    상기 원자력 발전소의 노심에 대한 상태를 나타내는 신호이고, 상기 시스템 관리 신호는 상기 노심의 보호를 위한 신호인 원자력 발전소의 디지털 신호 전자제어 장치.
  10. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 증기발생기의 1차측 저온관 온도, 고온관의 냉각재 온도, 가입기 압력, 노외중성자속 검출기 신호, 및 목표 제어봉 위치 중에서 적어도 하나를 관리하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  11. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 핵비등이탈률 여유도, 국부출력밀도 여유도, 및 중성자속 출력 중에서 적어도 하나를 관리하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  12. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 노심보호연산기(CPC, CORE PROTECTION CALCULATOR) 및 제어봉집합체 연산기(CEAC, Control Element Assembly CALCULATOR) 중에서 어느 하나를 선택하기 위한 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  13. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 외부 표시장치에 상기 노심의 현상태를 표시하기 위한 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  14. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 저 핵비등이탈률 정지/예비정지 신호, 고 국부출력 정지/예비정지 신호, 감지기 고장 신호, 및 제어봉 인출 금지 신호 중에서 적어도 하나를 관리하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  15. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 원자로 냉각재 펌프의 속도를 측정하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  16. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 주기적으로 워치독 타이머(Watch-dog timer) 신호를 발생하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  17. 제9항에 있어서,
    상기 제1 FPGA 및 제2 FPGA 중에서 적어도 하나는,
    상기 센싱된 시스템 상태 신호를 수신하여 디지털/아날로그 루프백 신호(digital analog loop back)를 발생하는 상기 시스템 관리 신호를 출력하는 원자력 발전소의 디지털 신호 전자제어 장치.
  18. 제1항에 있어서,
    상기 시스템 상태 신호는,
    상기 원자력 발전소의 발전소 감시 시스템(PMS, Plant Monitoring System)에 입력되는 신호이고, 상기 시스템 관리 신호는 발전소 정보 수집, 발전소 정보 지시, 발전소 정보 기록, 경보 발생, 각종 정보 제공, 원자로심 및 1, 2차 측 성능평가 수단 제공 중에서 적어도 하나를 관리하기 위한 신호인 원자력 발전소의 디지털 신호 전자제어 장치.
  19. 제18항에 있어서,
    상기 발전소 감시 시스템은,
    PDAS(Plant Data Acquisition System) A-D, PDAS(Plant Data Acquisition System) N1~N3, 및 PMCS(Plant Monitoring Computer System) 중에서 적어도 하나의 시스템을 포함하는 원자력 발전소의 디지털 신호 전자제어 장치.
  20. 제1항에 있어서,
    상기 시스템 상태 신호는,
    상기 원자력 발전소의 발전소 보호 시스템(PPS, Plant Protection System)에 입력되는 신호이고, 상기 시스템 관리 신호는 원자로 정지 신호, 안전주입 신호, 원자로 건물 격리 신호, 원자로 건물 살수 신호, 재순환 작동 신호, 주 증기 격리 신호, 보조급수 작동 신호, 연료건물 비상배기 작동 신호, 원자로 건물 배기 격리 작동 신호, 및 주제어실 비상환기 작동신호 중에서 적어도 하나인 원자력 발전소의 디지털 신호 전자제어 장치.
  21. 제20항에 있어서,
    상기 원자력 발전소의 발전소 보호 시스템은,
    RPS(Reactor Protection System), DPS(Diverse Protection System), 및 ESFAS(Engineered Safety Features Actuation System) 중에서 적어도 하나의 시스템을 포함하는 원자력 발전소의 디지털 신호 전자제어 장치.
  22. 원자력 발전소의 운영에 따라 발생하는 시스템 상태 신호를 센싱하는 단계;
    제1 FPGA 및 제2 FPGA 중에서 적어도 하나를 이용하여, 상기 센싱된 시스템 상태 신호를 수신하고, 상기 수신된 시스템 상태 신호에 대응하는 시스템 관리 신호를 출력하는 단계;
    상기 출력된 시스템 관리 신호에 대응하여, 상기 원자력 발전소의 동작을 제어하는 단계; 및
    상기 제1 FPGA 및 상기 제2 FPGA에서, 클럭 및 워치독 타이머 신호 중에서 적어도 하나를 이용하여 상호 간의 상태를 감시하여 정상동작 여부를 확인하는 단계
    를 포함하고,
    상기 시스템 관리 신호를 출력하는 단계는,
    상기 제1 FPGA가 비정상적으로 동작하는 경우에는 상기 제2 FPGA가 상기 제1 FPGA를 대신하여 동작하고, 상기 제2 FPGA가 비정상적으로 동작하는 경우에는 상기 제1 FPGA가 상기 제2 FPGA를 대신하여 동작하여 상기 제1 시스템 관리 신호 및 상기 제2 시스템 관리 신호 중에서 적어도 하나를 출력하는 단계
    를 포함하는 원자력 발전소의 디지털 신호 전자제어 방법.
  23. 삭제
  24. 제22항에 있어서,
    입력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나에 전달하는 단계; 및
    출력 버퍼를 이용하여 상기 제1 FPGA 및 상기 제2 FPGA 중에서 적어도 하나로부터 출력되는 상기 시스템 관리 신호를 전달받는 단계
    를 더 포함하는 원자력 발전소의 디지털 신호 전자제어 방법.
  25. 제24항에 있어서,
    상기 전달하는 단계는,
    상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 입력 버퍼에 수신되는 경우, 상기 입력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로 전달하는 단계; 및
    상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 입력 버퍼에 수신되지 않는 경우, 상기 입력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로 전달하는 단계
    를 포함하는 원자력 발전소의 디지털 신호 전자제어 방법.
  26. 제24항에 있어서,
    상기 전달받는 단계는,
    상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 출력 버퍼에 수신되는 경우, 상기 출력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제1 FPGA로부터 전달받는 단계; 및
    상기 제1 FPGA로부터 페일오버(Failover) 신호가 상기 출력 버퍼에 수신되지 않는 경우, 상기 출력 버퍼를 이용하여 상기 센싱된 시스템 상태 신호를 상기 제2 FPGA로부터 전달받는 단계
    를 포함하는 원자력 발전소의 디지털 신호 전자제어 방법.
  27. 삭제
  28. 삭제
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