KR100981998B1 - 데이터 워드 내의 비트 삽입 - Google Patents

데이터 워드 내의 비트 삽입 Download PDF

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Abstract

시프트 및 삽입 명령 SLI, SRI를 지원하고, 이 시프트 및 삽입 명령은 특정된 시프트 양으로 소스 데이터 값을 시프트한 후, 이 시프트인 비트 이외의 그 시프트된 값으로부터의 비트를 목적 값 내의 나머지 비트를 변경하지 않으면서, 목적 값에 삽입하는데 사용되는 데이터 처리 시스템(2)이 구비된다.
레지스터, 시프트, 소스 데이터, 픽셀.

Description

데이터 워드 내의 비트 삽입{INSERTING BITS WITHIN A DATA WORD}
본 발명은 데이터 처리 시스템에 관한 것이다. 특히, 본 발명은, 프로그램 제어 하에서 데이터 워드 내의 비트의 삽입에 관한 것이다.
데이터 처리 시스템에 있어서는, 단일 데이터 워드 내에 복수의 비트 필드를 함께 패킹하는 것이 공지되어 있다. 예로서, 16비트 데이터 워드 내에, 이들 중 2개는 5비트 길이이고, 하나는 6비트 길이인 레드와 그린 및 블루 값을 각각 표현하는 3개의 컬러 성분 값을 패킹하는 것이 바람직할 수 있다. 흔히, 이들 다른 성분 값은 분리되어 처리되고, 그 크기는 분리되어 계산된다. 이러한 계산 후, 픽셀-바이-픽셀 베이시스 상에서, 더 콤팩트한 형태로 기억되고 더 용이하게 조작될 수 있도록 분리 성분은 단일 데이터 워드 내에서 함께 어셈블링될 필요가 있다.
이러한 데이터 패킹을 달성하기 위해서, 하나의 가능한 해결책은, 목적 레지스터 내에 삽입되는 소스 레지스터 내의 비트 필드의 길이와, 비트 필드가 삽입되는 목적 레지스터 내의 위치 모두를 특정하는 프로그램 명령을 제공하는 것이다. 전형적으로, 이러한 명령은, 소스 레지스터와, 목적 레지스터, 비트 필드 길이 및 비트 필드 삽입 위치를 특정해야 한다. 이러한 방법으로 단일 명령 내에 4개의 분리 파라미터를 특정하는 것은, 명령 내에서 이용할 수 있는 명령 비트 공간에 대해서 바람직하게 않은 높은 요구를 하게 되고, 이들이 소비하는 명령 비트 공간에 의해 이러한 명령은 바람직하지 않게 된다.
US-A-4,569,016은, 호스트 프리미티브 명령 설정 컴퓨팅 시스템의 하나의 동작 머신 사이클 내에서, 빠르고 효과적인 완전한 시프트와, 머지(merge), 삽입 및 비트 정렬 기능을 수행하기 위한 메커니즘을 개시한다. 일반적으로, 회로는, 마스터의 제어 하에서 링 시프트를 수행한다. 또한, 회로는, 하나의 머신 사이클로 모두 실행할 수 있는 기본적으로 병렬인 회전과 마스크 및 머지 기능을 조합한다. 또한, 회로는, 십진 패킹 및 언패킹 기능뿐 아니라 플로팅 포인트 프리 시프트 및 노말리제이션 기능을 실행하기 위해 특히 유용한 프리미티브 동작인 마스크 명령과 함께 강력한 비트와 디지트 및 비트 회전의 대책을 허용한다.
본 발명의 일측면으로부터,
조작되는 데이터 값을 기억하도록 동작되는 복수의 레지스터와,
상기 복수의 레지스터 내에 기억된 하나 이상의 데이터 값에 따라 데이터 처리 동작을 수행하도록 동작되는 처리 로직과,
프로그램 명령에 응답하여, 상기 프로그램 명령에 의해 특정된 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하는 명령 디코더를 구비하고,
상기 명령 디코더는, 시프트 및 삽입 명령에 응답하여, 상기 처리로직이
N 비트 위치의 시프트 양만큼 제1레지스터 내에 기억된 제1데이터 값을 시프트하여 N 시프트인 비트를 포함하는 시프트된 값을 형성하고(단, N은 복수의 다른 비제로 값 중 하나를 갖고); 및
상기 N 시트프인 비트 이외의 상기 시프트된 값의 각 비트를, 제2레지스터 내에 기억된 제2데이터 값 내의 대응하는 비트 위치에, 상기 N 시프트인 비트에 대응하는 상기 제2데이터 값 내의 비트을 변경시키지 않은 채로, 삽입해서 결과를 형성함으로써,
주어진 결과 값을 갖는 상기 결과를 산출하는 시프트 및 삽입 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하고,
상기 시프트 및 삽입 명령은, 상기 제1레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하고,
상기 시프트 및 삽입 명령은, 상기 제2레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하는 것을 특징으로 하는 데이터 처리 장치를 제공한다.
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본 발명은, 이러한 명령을 사용하는 것이 바람직한 대부분의 경우, 비트 필드 길이와 비트 필드 위치를 분리해서 특정할 수 있는 완전한 유연성이 요구되지 않게 한다. 대신, 소스 값에 적용되는 시프트 양을 특정하는 단일 파라미터는, 소 스 값의 비트가 목적 값에 기입되는 시작 위치를 제어한다. 목적 값 내에 기입된 비트는, 연관된 명령의 시프트 방향에 따라서, 시작 위치로부터 목적 값의 적합한 종단으로 연장된다. 이는, 다수의 비트가 궁극적으로 요구되기보다 삽입될 수 있게 한다. 그런데, 본 기술은, 대부분의 경우, 다수의 이러한 명령이 실행되고, 최종의 패킹 데이터 값이 요구되는 정확한 비트를 포함하도록 하나의 명령 내에 기입된 초과 비트를 다음 명령 내의 요구 데이터로 오버라이트하게 한다. 따라서, 동작의 패킹 타입이나 다른 비트 어셈블리 동작이, 바람직한 작은 명령 비트 공간 요구를 갖는 명령으로 달성될 수 있다. 상기된 본 발명의 표현은, 특정된 시프트 동작 및 특정된 삽입 동작으로 주어진 결과 값을 갖는 결과를 산출하는 시프트 및 삽입 명령으로 만들어진다. 이러한 시프트 및 삽입이 수행되는 것 같이 동일한 결과 값을 달성하기 위해 채용되는 실제 메커니즘이 변화될 수 있다. 이러한 변형 메커니즘 및 단계는 본 기술에 포함된다. 시프트 및 삽입 단계는, 요구된 최종 결과가 입력과 관련되는지를 표현하는 한 방법이지만, 입력과 출력 간의 동일한 관계가 다양한 다른 방법으로 달성되고 표현될 수 있다. 이들 대안은, 본 기술 내에 포함된다.
시프트 양은, 명령 내에서 특정된 레지스터 내에 기억된 값으로 특정되거나, 대안적으로, 바람직하게는 시프트 및 삽입 명령 자체 내에서 엔코드된 직접 값으로서 특정될 수 있다.
필드(선택적으로, 제1레지스터 및 제2레지스터 중 하나에 공유되는)를 특정하는 목적 레지스터도 사용될 수 있다.
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본 기술의 시프트는 환경에 따라 우측 시프트나 좌측 시프트일 수 있고, 패킹이나 비트 삽입의 요구 형태일 수 있다.
바람직한 실시형태에 있어서 제1데이터 값과 제2데이터 값이 동일 비트 수를 가짐에도 불구하고, 제1데이터 값 및 제2데이터 값은 다른 비트 길이를 가질 수 있고, 다른 길이의 레지스터 내에 기억될 수 있다.
제1값의 시프트를 사용해서,
상기 제2데이터 값 내의 비트들 중 어느 것이 상기 시프트된 데이터 값 내의 대응하는 비트들로 대체되는지와 상기 제2데이터 값 내의 비트들 중 어느 것이 변경되지 않는지를 선택하기 위한 마스크 값을 형성하는 바람직한 방법에도 불구하고, 상기된 바와 같이, 입력과 출력 간의 관계는 다양한 다른 방법으로 실행될 수 있다. 바람직하게는, 이 마스크 값은, 스타팅 마스크에 따른 시프트나 마스크를 직접 형성하는 명령의 디코더와 같은 대안적인 기술로 형성될 수 있다.
본 발명은, 스칼라 처리 시스템 및 단일 명령 다중 데이터 패킷(SIMD) 처리 시스템 내에서 모두 바람직하게 사용될 수 있다.
본 발명의 다른 측면으로부터,
복수의 레지스터 내에서 조작되는 데이터 값을 기억하는 단계와,
상기 복수의 레지스터 내에 기억된 하나 이상의 데이터 값에 따라 데이터 처리 로직을 사용해서 데이터 처리 동작을 수행하는 단계와,
프로그램 명령에 응답하여, 명령 디코더를 사용해서 상기 프로그램 명령에 의해 특정된 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하는 단계를 구비하고,
상기 명령 디코더는, 시프트 및 삽입 명령에 응답하여, 상기 처리 로직이,
N 비트 위치의 시프트 양만큼 제1레지스터 내에 기억된 제1데이터 값을 시프트하여 N 시프트인 비트를 포함하는 시프트된 값을 형성하고(단, N은 복수의 다른 비제로 값 중 하나를 갖고); 및
상기 N 시트프인 비트 이외의 상기 시프트된 값의 각 비트를, 제2레지스터 내에 기억된 제2데이터 값 내의 대응하는 비트 위치에, 상기 N 시프트인 비트에 대응하는 상기 제2데이터 값 내의 비트를 변경시키지 않은 채로, 삽입해서 결과를 형성함으로써,
주어진 결과 값을 갖는 상기 결과를 산출하는 시프트 및 삽입 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하고,
상기 시프트 및 삽입 명령은, 상기 제1레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하고,
상기 시프트 및 삽입 명령은, 상기 제2레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하는 것을 특징으로 하는 데이터 처리 방법을 제공한다.
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첨부 도면을 참조로 본 발명의 실시형태가 기재되는데,
도 1은 본 발명의 기술을 사용할 수 있는 타입의 데이터 처리 시스템을 개략적으로 나타내고,
도 2는 본 발명의 일례에 따른 3개의 다른 시프트 및 삽입 명령의 신택스를 개략적으로 나타내며,
도 3은 시프트 및 삽입 명령의 액션을 개략적으로 나타내고,
도 4는 시프트 및 삽입 동작을 위한 하드웨어 구성을 개략적으로 나타내며,
도 5는 스칼라 처리 시스템 내의 픽셀 값 패킹 동작의 예를 나타내고,
도 6은 단일 명령 다중 데이터 시스템 내의 픽셀 패킹 동작을 개략적으로 나타낸다.
도 1은 레지스터 뱅크(4), 멀티플라이어(6), 시프터(8) 및, 가산기(10)를 포함하는 적분 회로 형태일 수 있는 데이터 처리 시스템(2)을 개략적으로 나타낸다. 레지스터 뱅크(4), 멀티플라이어(6), 시프터(8) 및 가산기(10)는, 명령 디코더(12)에 의해 생성된 제어 신호의 제어 하에서, 요구 데이터 처리 동작을 실행하기 위한 처리 로직을 형성하도록 고려될 수 있다. 명령 디코더(12) 자체는, 명령 파이프라인(14)에 로드된 프로그램 명령에 응답한다. 전형적으로, 도 2의 데이터 처리 시스템이 다수의 소자를 포함하는 것은 명백하지만, 도면을 명확하게 하기 위해서 이들 소자는 생략한다. 동작시, 프로그램 명령은 명령 파이프라인(14)으로 인출되고, 이들이 명령 파이프라인(14) 내의 실행 스테이지에 도달할 때, 명령 디코더(12)에 의해 사용되어, 처리 로직(4, 6, 8, 10)의 다양한 소자가 요구 데이터 처리 동작을 실행하도록 형성되는 제어 신호를 생성한다. 전형적으로, 처리 로직은, 도 1에 나타낸 단순한 곱셈, 시프트 및 가산 동작 이외의 처리 동작을 제공하기 위한 다수의 또 다른 소자를 포함하게 된다.
도 2는 도 1의 데이터 처리 시스템(2)으로 지원될 수 있는 몇몇 예의 시프트 및 삽입 명령의 신택스를 나타낸다. 좌측 시프트 및 삽입 명령 SLI는, 목적 레지스터 dest를 특정하는 레지스터 필드와, 소스 레지스터 src를 특정하는 레지스터 필드 및, 직접 값 #imm을 특정하는 필드를 포함한다. 소스 레지스터는, 시프트된 후 목적 레지스터에 삽입되는 데이터 값을 포함하는데, 목적 레지스터 내의 몇몇 비트는 변경되지 않는다. 이하에 더 설명되는 바와 같이, 직접 값 #imm은, 삽입이 일어나기 전에, 소스 레지스터 값에 적용된 시프트 양을 특정하고, 삽입이 일어나는 위치를 효과적으로 특정한다.
도 2는 상기 명령의 우측 시프트 변형, 즉 SRI 명령을 나타낸다. 또한, 시프트 값이 제2소스 레지스터 src2에 의해 특정된 좌측 시프트된 명령의 변형도 나타낸다.
도 1에 도시된 바와 같이, 신택스와 정확한 형태의 명령은 일례일 뿐이고, 본 기술의 다른 실시형태는 다양한 삽입 표현과 신택스를 사용할 수 있다.
도 3은 시프트 및 삽입 동작의 일례를 나타낸다. 레지스터(16)는 소스 값을 포함한다. 이 소스 값은, 화소 값과 같은 데이터 부분(18)을 포함한다. 데이터 부분(18) 외측의 레지스터(16)의 부분은, 의미 없는 것을 나타내거나, 폐기되는 것이 바람직한 데이터 값의 소수부일 수 있다.
이 예에서, 레지스터(16) 내의 값은, 관련된 SRI 명령 내의 직접 필드 #imm으로 특정된 양만큼 우측 시프트된다. 레지스터의 좌측 종단에서, 시프트인 비트(shifted in bits)가 생성되는 시프트된 값에 도입된다. 이는, 정상 시프트 동작의 행동이다.
목적 값은 레지스터(20) 내에 유지되고, 시프트인 비트 이외의 시프트된 값의 부분은, 목적 값 내에 초기에 기억된 대응하는 비트를 대신해서 이 목적 값 내에 기입된다. 시프트된 값 내의 시프트인 비트에 대응하는 목적 값(20) 내의 비트 는 대체되지 않고, 변경되지 않는다. 최종 결과 값은, 시프트된 값으로부터 삽입된 비트가 이들 대응하는 위치에서 그 초기 비트를 대체함에 따라, 초기 목적 값을 포함한다. 현재의 예에 있어서는, 데이터 부분(18) 이외의 시프트된 값의 비트, 즉 비트 G 및 H가, 결과 값 내에 삽입되는 것을 볼 수 있다. 그 다음, 중요하면, 이들 원하지 않는 비트는, 후속하는 시프트 및 삽입 동작 내의 또 다른 비트 값으로, 필요에 따라 오버라이트할 수 있다.
도 4는 시프트 및 삽입 명령이 어떻게 수행되는 지에 관한 하드웨어 표현을 개략적으로 나타낸다. 소스 레지스터(22)는, 이 예에 있어서는 자체 값을 좌측 시프터(24)에 공급한다. 명령의 우측 시프트 변형을 위해서, 우측 시프트 회로가 대신 사용되는 것은 명백하다. 이 예에 있어서, 시프트 양은 직접 값 #4로 특정된다. 좌측 시프터(24)는, 그 4개의 가장 오른쪽 비트 위치에 4개의 시프트인 제로 값을 갖는 시프트된 값(26)을 생성한다. 시프트된 값(26)의 생성과 병렬로, 모두 1을 포함하는 스타팅 마스크 값(28)을 취하고, 이를 그 좌측 시프터(30)로 소스 값(22)에 적용되는 것과 동일하게 시프트시킴으로써, 마스크 값이 생성된다. 마스크 값으로의 시프트인 값은, 다시 제로이고, 이는 시프트된 마스크(32)로 귀결된다. 그 다음, 시프트된 마스크는, 시프트된 값(26)으로부터의 비트나 목적 값(36)으로부터의 비트를 선택해서 결과 값(38)으로 공급하는 다중 비트 멀티플렉서(34)에 공급되는 다중 비트 제어 신호로서 사용될 수 있다.
도 5는, 16비트 결과 값으로의 레드와 그린 및 블루 픽셀 값 성분의 스칼라 패킹 동작을 나타낸다. 제1동작은, 우측 시프트 및 삽입 명령을 사용하는 레드 및 그린 성분 값에 따라, 5비트 위치의 시프트 양으로 실행한다. 이는, 5비트 레드 성분 R5이 결과 내에서 변경되지 않게 하지만, 그린 성분 G6에 기입할 뿐 아니라, 그 나머지를 그 결과에 기입한다. 제2명령은, 조합된 레드 및 그린 성분을 취하고, 블루 성분 B5이 미리 삽입된 그린 성분 G6의 종단에 인접하고, 16비트 결과 값 내의 나머지 위치를 채우도록 11비트 위치의 시프트 양으로 우측 시프트 및 삽입 명령을 수행함으로써, 조합된 레드 및 그린 성분을 블루 성분 B5에 삽입한다.
도 6은 도 5에 도시된 바와 같이 동일 타입의 패킹 동작을 나타내지만, 단일 명령 다중 데이터(SMID) 시스템 내에서 수행된 경우이다. 인식된 바와 같이, 4세트의 픽셀 값이 2개의 SIMD 우측 시프트 및 삽입 명령을 사용해서 병렬로 함께 패깅될 수 있도록, SIMD 시스템 내의 각 데이터 레인에 따라, 동일한 시프트 및 삽입 동작이 분리되어 수행된다.

Claims (26)

  1. 조작되는 데이터 값들을 기억하도록 동작하는 복수의 레지스터와,
    상기 복수의 레지스터 내에 기억된 하나 이상의 데이터 값에 따라 데이터 처리 동작을 수행하도록 동작하는 처리 로직(6, 8, 10)과,
    프로그램 명령에 응답해서 상기 프로그램 명령에 의해 특정된 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하는 명령 디코더(12)를 구비하고,
    상기 명령 디코더는, 시프트 및 삽입 명령(SLI, SRI)에 응답하여, 상기 처리 로직이,
    제1레지스터(16) 내에 기억된 제1데이터 값(18)을 N 비트 위치의 시프트 양(#imm)만큼 시프트해서 N 시프트인 비트들을 포함하는 시프트된 값을 형성하고(단, N은 복수의 다른 비제로 값 중 하나를 갖고); 및
    상기 시프트 양에만 의존해서 선택되는 상기 N 시트프인 비트들 이외의 상기 시프트된 값의 모든 각 비트를, 제2레지스터(20) 내에 기억된 제2데이터 값 내의 대응하는 비트 위치에, 상기 N 시프트인 비트들에 대응하는 상기 제2데이터 값 내의 비트들을 변경시키지 않은 채로, 삽입하여 결과를 형성함으로써,
    주어진 결과 값을 갖는 상기 결과를 산출하는 시프트 및 삽입 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하고,
    상기 시프트 및 삽입 명령은, 상기 제1레지스터로서 사용하도록 레지스터 뱅크(4) 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하고,
    상기 시프트 및 삽입 명령은, 상기 제2레지스터로서 사용하도록 레지스터 뱅크(4) 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하는 것을 특징으로 하는 데이터 처리 장치.
  2. 제1항에 있어서,
    상기 시프트 및 삽입 명령은, 상기 N 비트 위치의 상기 시프트 양을 특정하는 직접 값을 포함하는 것을 특징으로 하는 데이터 처리 장치.
  3. 제1항 또는 제2항에 있어서,
    상기 시프트 및 삽입 명령은, 목적 레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드(dest)를 포함하는 것을 특징으로 하는 데이터 처리 장치.
  4. 제3항에 있어서,
    상기 목적 레지스터를 위한 상기 레지스터 특정 필드는, 상기 제1레지스터 및 제2레지스터 중 하나와 공유되는 것을 특징으로 하는 데이터 처리 장치.
  5. 제1항 또는 제2항에 있어서,
    상기 제1데이터 값은 오른쪽 시프트된 것을 특징으로 하는 데이터 처리 장치.
  6. 제1항 또는 제2항에 있어서,
    상기 제1데이터 값은 왼쪽 시프트된 것을 특징으로 하는 데이터 처리 장치.
  7. 제1항 또는 제2항에 있어서,
    상기 제1데이터 값과 상기 제2데이터 값은 동수의 비트를 갖는 것을 특징으로 하는 데이터 처리 장치.
  8. 제1항 또는 제2항에 있어서,
    상기 시프트 및 삽입 명령에 응답해서, 상기 처리 로직이 상기 제1데이터 값을 시프트하도록 동작하는 것을 특징으로 하는 데이터 처리 장치.
  9. 제1항 또는 제2항에 있어서,
    상기 시프트 및 삽입 명령에 응답해서, 상기 처리 로직은, 상기 제2데이터 값 내의 비트들 중 어느 것이 상기 시프트된 데이터 값 내의 대응하는 비트들로 대체되는지와 상기 제2데이터 값 내의 비트들 중 어느 것이 변경되지 않는지를 선택하기 위한 마스크 값을 형성하도록 동작하는 것을 특징으로 하는 데이터 처리 장치.
  10. 제1항 또는 제2항에 있어서,
    상기 처리 로직이 단일 명령 다중 데이터 처리 로직이고, 상기 제1레지스터 및 상기 제2레지스터가 제1의 단일 명령 다중 데이터 레지스터 및 제2의 단일 명령 다중 데이터 레지스터의 각 부분이며, 상기 시프트 및 삽입 명령이 각 처리 레인에서 복수의 시프트 및 삽입 동작의 병렬 실행을 제어하도록 동작되는 것을 특징으로 하는 데이터 처리 장치.
  11. 제1항 또는 제2항에 있어서,
    상기 처리 로직이 스칼라 처리 로직인 것을 특징으로 하는 데이터 처리 장치.
  12. 조작되는 데이터 값들을 복수의 레지스터 내에 기억하는 단계와,
    상기 복수의 레지스터 내에 기억된 하나 이상의 데이터 값에 따라 처리 로직을 사용해서 데이터 처리 동작을 수행하는 단계와,
    프로그램 명령에 응답하여, 명령 디코더를 사용해서 상기 프로그램 명령에 의해 특정된 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하는 단계를 포함하고,
    상기 명령 디코더는, 시프트 및 삽입 명령에 응답하여,
    상기 처리 로직이, 제1레지스터 내에 기억된 제1데이터 값을 N 비트 위치의 시프트 양만큼 시프트해서 N 시프트인 비트들을 포함하는 시프트된 값을 형성하고(단, N은 복수의 다른 비제로 값 중 하나를 갖고); 및
    상기 처리 로직이 상기 시프트 양에만 의존해서 선택되는 상기 N 시트프인 비트들 이외의 상기 시프트된 값의 모든 각 비트를, 제2레지스터 내에 기억된 제2데이터 값 내의 대응하는 비트 위치에, 상기 N 시프트인 비트들에 대응하는 상기 제2데이터 값 내의 비트들을 변경시키지 않은 채로, 삽입하여 결과를 형성함으로써,
    주어진 결과 값을 갖는 상기 결과를 산출하는 시프트 및 삽입 데이터 처리 동작을 수행하도록 상기 처리 로직을 제어하며,
    상기 시프트 및 삽입 명령은, 상기 제1레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하고,
    상기 시프트 및 삽입 명령은, 상기 제2레지스터로서 사용하도록 상기 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하는 것을 특징으로 하는 데이터 처리 방법.
  13. 제12항에 있어서,
    상기 시프트 및 삽입 명령은, 상기 N 비트 위치의 시프트 양을 특정하는 직접 값을 포함하는 것을 특징으로 하는 데이터 처리 방법.
  14. 제12항 또는 제13항에 있어서,
    상기 시프트 및 삽입 명령은, 목적 레지스터로서 사용하도록 레지스터 뱅크 내의 레지스터를 특정하는 레지스터 특정 필드를 포함하는 것을 특징으로 하는 데이터 처리 방법.
  15. 제14항에 있어서,
    상기 목적 레지스터를 위한 상기 레지스터 특정 필드는, 상기 제1레지스터 및 제2레지스터 중 하나와 공유되는 것을 특징으로 하는 데이터 처리 방법.
  16. 제12항 또는 제13항에 있어서,
    상기 제1데이터 값은 오른쪽 시프트된 것을 특징으로 하는 데이터 처리 방법.
  17. 제12항 또는 제13항에 있어서,
    상기 제1데이터 값은 왼쪽 시프트된 것을 특징으로 하는 데이터 처리 방법.
  18. 제12항 또는 제13항에 있어서,
    상기 제1데이터 값과 상기 제2데이터 값은 동수의 비트를 갖는 것을 특징으로 하는 데이터 처리 방법.
  19. 제12항 또는 제13항에 있어서,
    상기 시프트 및 삽입 명령에 응답해서, 상기 처리 로직이 상기 제1데이터 값을 시프트하도록 동작하는 것을 특징으로 하는 데이터 처리 방법.
  20. 제12항 또는 제13항에 있어서,
    상기 시프트 및 삽입 명령에 응답해서, 상기 처리 로직은, 상기 제2데이터 값 내의 비트들 중 어느 것이 상기 시프트된 데이터 값 내의 대응하는 비트들로 대체되는지와 상기 제2데이터 값 내의 비트들 중 어느 것이 변경되지 않는지를 선택하기 위한 마스크 값을 형성하도록 동작하는 것을 특징으로 하는 데이터 처리 방법.
  21. 제12항 또는 제13항에 있어서,
    상기 처리 로직이 단일 명령 다중 데이터 처리 로직이고, 상기 제1레지스터 및 상기 제2레지스터가 제1의 단일 명령 다중 데이터 레지스터 및 제2의 단일 명령 다중 데이터 레지스터의 각 부분이며, 상기 시프트 및 삽입 명령이 각 처리 레인에서 복수의 시프트 및 삽입 동작의 병렬 실행을 제어하도록 동작되는 것을 특징으로 하는 데이터 처리 방법.
  22. 제12항 또는 제13항에 있어서,
    상기 처리 로직이 스칼라 처리 로직인 것을 특징으로 하는 데이터 처리 방법.
  23. 삭제
  24. 삭제
  25. 삭제
  26. 삭제
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