KR100921143B1 - Semiconductor light emitting device - Google Patents

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Abstract

본 발명의 실시 예는 따른 반도체 발광소자 및 그 제조방법에 관한 것이다.An embodiment of the present invention relates to a semiconductor light emitting device and a method of manufacturing the same.

본 발명의 실시 예에 따른 반도체 발광소자 제조방법은 제 1도전성 반도체층을 형성하는 단계; 상기 제 1도전성 반도체층 위에 활성층을 형성하는 단계; 상기 활성층 위에 제 2도전성 반도체층을 형성하는 단계를 포함하며, 상기 층들 중 적어도 한 층은 성장 시 램프로 노광하여 in-situ 성장되는 것을 특징으로 한다.Method of manufacturing a semiconductor light emitting device according to an embodiment of the present invention comprises the steps of forming a first conductive semiconductor layer; Forming an active layer on the first conductive semiconductor layer; And forming a second conductive semiconductor layer on the active layer, wherein at least one of the layers is grown in-situ by exposure to a lamp during growth.

LED, 램프, 노광, 소수 캐리어 LED, lamp, exposure, minority carrier

Description

반도체 발광소자{Semiconductor light emitting device}Semiconductor light emitting device

본 발명의 실시 예는 반도체 발광소자 및 그 제조방법에 관한 것이다.An embodiment of the present invention relates to a semiconductor light emitting device and a method of manufacturing the same.

Ⅲ-Ⅴ족 질화물 반도체(group Ⅲ-Ⅴ nitride semiconductor)는 물리적, 화학적 특성으로 인해 발광 다이오드(LED) 또는 레이저 다이오드(LD) 등의 발광 소자의 핵심 소재로 각광을 받고 있다. Group III-V nitride semiconductors are spotlighted as core materials of light emitting devices such as light emitting diodes (LEDs) or laser diodes (LDs) due to their physical and chemical properties.

Ⅲ-Ⅴ족 질화물 반도체는 통상 InxAlyGa1-x-yN (0≤x≤1, 0 ≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 물질로 이루어져 있다. 이러한 질화물 반도체 재료를 이용한 LED 혹은 LD는 청색 또는 녹색 파장대의 광을 얻기 위한 발광 소자에 많이 사용되고 있으며, 핸드폰의 키패드 발광부, 전광판, 조명 장치 등 각종 제품의 광원으로 응용되고 있다.A III-V nitride semiconductor is usually made of a semiconductor material having a composition formula of In x Al y Ga 1-xy N (0 ≦ x ≦ 1, 0 ≦ y ≦ 1, 0 ≦ x + y ≦ 1). LED or LD using such a nitride semiconductor material is widely used in the light emitting device for obtaining light in the blue or green wavelength band, and is applied as a light source of various products such as keypad light emitting part of the mobile phone, an electronic board, a lighting device.

이러한 발광 다이오드를 제조함에 있어서, 활성층의 발광 효율을 증대시키고, 역방향 전류와 역방향 전압 등의 다이오드 특성을 개선해 주거나, ESD 등의 전기적 내성을 강화시켜 주고자 하는 연구들이 진행되고 있다.In manufacturing such a light emitting diode, studies are being conducted to increase the luminous efficiency of the active layer, to improve diode characteristics such as reverse current and reverse voltage, or to enhance electrical resistance of ESD.

본 발명의 실시 예는 고품질 박막이 성장될 수 있도록 한 반도체 발광소자 및 그 제조방법을 제공한다.An embodiment of the present invention provides a semiconductor light emitting device and a method of manufacturing the same so that a high quality thin film can be grown.

본 발명의 실시 예는 활성층의 발광 효율을 증대시키고 다이오드의 특성 개선 및 전기적인 내성을 강화시켜 줄 수 있는 반도체 발광소자 및 그 제조방법을 제공한다.An embodiment of the present invention provides a semiconductor light emitting device and a method of manufacturing the same, which can increase the luminous efficiency of the active layer, improve the characteristics of the diode, and enhance electrical resistance.

본 발명의 실시 예에 따른 반도체 발광소자는 제 1도전성 반도체층; 제 1도전성 반도체층 위에 형성된 활성층; 상기 활성층 위에 형성된 제 2도전성 반도체층을 적어도 포함하며, 상기 층들 중 적어도 한 층에 대해 램프로 노광하여 소수 캐리어를 제공하는 것을 특징으로 한다.A semiconductor light emitting device according to an embodiment of the present invention includes a first conductive semiconductor layer; An active layer formed on the first conductive semiconductor layer; At least one second conductive semiconductor layer formed on the active layer, characterized in that to expose at least one of the layers with a lamp to provide a minority carrier.

본 발명의 실시 예에 따른 반도체 발광소자 제조방법은 제 1도전성 반도체층을 형성하는 단계; 상기 제 1도전성 반도체층 위에 활성층을 형성하는 단계; 상기 활성층 위에 제 2도전성 반도체층을 형성하는 단계를 포함하며, 상기 층들 중 적어도 한 층은 성장 시 램프로 노광하여 in-situ 성장되는 것을 특징으로 한다. Method of manufacturing a semiconductor light emitting device according to an embodiment of the present invention comprises the steps of forming a first conductive semiconductor layer; Forming an active layer on the first conductive semiconductor layer; And forming a second conductive semiconductor layer on the active layer, wherein at least one of the layers is grown in-situ by exposure to a lamp during growth.

본 발명의 실시 예에 따른 반도체 발광소자 및 그 제조방법에 의하면, 활성층의 발광 효율을 증대시켜 줄 수 있다.According to the semiconductor light emitting device and the manufacturing method thereof according to the embodiment of the present invention, it is possible to increase the luminous efficiency of the active layer.

또한 LED 구조의 역방향 전류, 역 방향 전압 등의 다이오드 특성을 개선하 며, ESD 등의 전기적 내성을 강화시켜 줄 수 있다.In addition, it can improve diode characteristics such as reverse current and reverse voltage of LED structure, and can strengthen electrical resistance of ESD.

또한 결정성이 우수한 제 1도전성 반도체층을 제공할 수 있다.In addition, a first conductive semiconductor layer excellent in crystallinity can be provided.

이하, 본 발명의 실시 예에 따른 반도체 발광소자 및 그 제조방법에 대하여 첨부된 도면을 참조하여 설명하면 다음과 같다. 본 발명에 따른 실시 예의 설명에 있어서, 각 층(막), 영역, 패턴 또는 구조물들이 기판, 각 층(막), 영역, 패드 또는 패턴들의 "위(on)"에 또는 "아래(under)"에 형성되는 것으로 기재되는 경우에 있어, "위(on)"와 "아래(under)"는 "directly"와 "indirectly"의 의미를 모두 포함한다. 또한 각 층의 위 또는 아래에 대한 기준은 도면을 기준으로 설명한다.Hereinafter, a semiconductor light emitting device and a method of manufacturing the same according to an exemplary embodiment of the present invention will be described with reference to the accompanying drawings. In the description of an embodiment according to the present invention, each layer (film), region, pattern or structure is "on" or "under" the substrate, each layer (film), region, pad or patterns. In the case where it is described as being formed in, "on" and "under" include both the meaning of "directly" and "indirectly". In addition, the criteria for the top or bottom of each layer will be described with reference to the drawings.

도 1은 본 발명의 제 1실시 예에 따른 반도체 발광소자를 나타낸 단면도이다.1 is a cross-sectional view illustrating a semiconductor light emitting device according to a first embodiment of the present invention.

도 1을 참조하면, 반도체 발광소자(100)는 기판(111), 버퍼층(113), 제 1언도프드 GaN층(115), 제 1도전성 반도체층(117), 활성층(119), 제 2도전성 반도체층(121)을 포함한다.Referring to FIG. 1, the semiconductor light emitting device 100 may include a substrate 111, a buffer layer 113, a first undoped GaN layer 115, a first conductive semiconductor layer 117, an active layer 119, and a second conductive property. The semiconductor layer 121 is included.

상기 기판(111)은 사파이어 기판(Al203), GaN, SiC, ZnO, Si, GaP 그리고 GaAs 등으로 이루어진 군에서 선택될 수 있으며, 소자의 실장 방식에 따라 상기 기판은 제거될 수도 있다.The substrate 111 may be selected from the group consisting of sapphire substrate (Al 2 O 3 ), GaN, SiC, ZnO, Si, GaP and GaAs, and the substrate may be removed according to the device mounting method.

상기 버퍼층(113)은 기판 위에 형성되며, GaN, InN, AlN, AlInN, InGaN, AlGaN, InAlGaN 등이 선택적으로 형성된다. 상기 버퍼층(113) 위에는 제 1 언도프 드(undoped) GaN층(115)이 형성된다. 여기서, 버퍼층(113) 또는/및 제 1언도프드 GaN층(115)은 선택적으로 제거될 수도 있다. The buffer layer 113 is formed on a substrate, and GaN, InN, AlN, AlInN, InGaN, AlGaN, InAlGaN, etc. are selectively formed. A first undoped GaN layer 115 is formed on the buffer layer 113. Here, the buffer layer 113 and / or the first undoped GaN layer 115 may be selectively removed.

상기 제 1언도프드 GaN층(115) 위에는 제 1도전성 반도체층(117)이 형성된다. 상기 제 1도전성 반도체층(117)은 n형 반도체층으로 구현될 수 있는 데, 상기 n형 반도체층은 GaN, AlGaN, InGaN 등 중에서 선택될 수 있으며, n형 도펀트(예: Si, Ge, Sn 등)가 도핑된다.A first conductive semiconductor layer 117 is formed on the first undoped GaN layer 115. The first conductive semiconductor layer 117 may be implemented as an n-type semiconductor layer, the n-type semiconductor layer may be selected from GaN, AlGaN, InGaN, etc., n-type dopants (eg, Si, Ge, Sn Etc.) is doped.

상기 제 1도전성 반도체층(117) 위에는 활성층(1119)이 형성된다. 상기 활성층(119)은 예컨대, InGaN 우물층/GaN 장벽층 또는 InGaN 우물층/AlGaN 장벽층을 한 주기로 하여, 단일 또는 다중 양자 우물 구조로 형성될 수 있다. 여기서, 우물층 InxGa1-xN은 0<x≤1로 조절할 수 있다. An active layer 1119 is formed on the first conductive semiconductor layer 117. The active layer 119 may be formed in a single or multiple quantum well structure, for example, with one cycle of an InGaN well layer / GaN barrier layer or an InGaN well layer / AlGaN barrier layer. Herein, the well layer In x Ga 1-x N may be adjusted to 0 <x≤1.

상기 활성층(119) 위에는 제 2도전성 반도체층(121)이 형성된다. 상기 제 2도전성 반도체층(121)은 예컨대, p형 도펀트가 도핑된 p형 반도체층으로 구현될 수 있다. 상기 p형 반도체층은 GaN층, AlGaN층, InGaN층 등과 같은 GaN계 화합물 반도체 중에서 어느 하나로 이루어질 수 있다.The second conductive semiconductor layer 121 is formed on the active layer 119. For example, the second conductive semiconductor layer 121 may be implemented as a p-type semiconductor layer doped with a p-type dopant. The p-type semiconductor layer may be made of any one of a GaN compound semiconductor such as a GaN layer, an AlGaN layer, an InGaN layer, or the like.

또한 상기의 제 2도전성 반도체층(121) 위에는 제 3도전성 반도체층(미도시)을 형성할 수도 있다. 여기서 제 3도전성 반도체층은 n형 반도체층으로 구현될 수 있다. In addition, a third conductive semiconductor layer (not shown) may be formed on the second conductive semiconductor layer 121. The third conductive semiconductor layer may be implemented as an n-type semiconductor layer.

이러한 반도체 발광소자의 각 층을 성장함에 있어서, 상기의 반도체층들 중에서 적어도 하나의 반도체층의 성장 시 램프(lamp)를 이용하여 노광하여 in-situ 성장함으로써, 노광된 층이 성장시 주입된 물질들과의 화학 반응에 의해 전자나 정공과 같은 소수 캐리어(photo enhanced minority carrier)가 발생된다. 이에 따라 활성층의 발광 효율이나 전기적인 내성을 강화시켜 줄 수 있다.In the growth of each layer of the semiconductor light emitting device, a material implanted when the exposed layer is grown by growing in-situ by exposing using a lamp when the at least one semiconductor layer is grown. By chemical reactions with the photons, photo enhanced minority carriers such as electrons and holes are generated. This can enhance the luminous efficiency and electrical resistance of the active layer.

여기서 램프(lamp)는 광 전계 루미네센스(photo electro luminescence) 성장을 위한 램프로써, 예컨대 수은 램프(mercury lamp), 엑스선(x-ray), 전자선, 할로겐 램프 중에서 적어도 하나를 선택적으로 이용할 수 있으며, 이에 한정하지 않는다. 또한 서로 다른 반도체층에 대해 모두 동일한 램프 또는 서로 다른 램프로 이용할 수도 있다.The lamp is a lamp for growing photo electro luminescence, and for example, at least one of a mercury lamp, an x-ray, an electron beam, and a halogen lamp may be selectively used. It is not limited to this. In addition, the same lamp or different lamps may be used for different semiconductor layers.

도 2는 도 1의 제 1언도프드 GaN층의 성장 예를 나타낸 도면이다.FIG. 2 is a diagram illustrating an example of growth of the first undoped GaN layer of FIG. 1.

도 2를 참조하면, 기판 위에 버퍼층을 형성한 후, 동일 성장 장비를 이용하여 소정의 성장온도에서 NH3와 TMGa을 공급하여 소정 두께로 도펀트를 포함하지 않는 제 1언도프드 GaN층(115)을 형성하게 되는 데, 이때 제 1언도프드 GaN층(115)은 동일 성장 장비(in-situ) 내에서 램프(130)를 이용한 노광을 통해 in-situ 성장하게 된다.Referring to FIG. 2, after the buffer layer is formed on the substrate, NH 3 and TMGa are supplied at a predetermined growth temperature using the same growth equipment to provide a first undoped GaN layer 115 including no dopant in a predetermined thickness. In this case, the first undoped GaN layer 115 is grown in-situ through exposure using the lamp 130 in the same growth equipment (in-situ).

이때 램프(130)로 노광함으로써, 제 1언도프드 GaN층(115)의 결정에는 성장 도중 상기 램프(130)의 노광에 의해 소수 홀(photo enhanced minority hall)(Hm)을 발생시키고, 상기 기판(111)과 GaN층 결정 사이의 불일치로 인해 포지티브 전하(positive charge)를 갖는 결함(dislocation)(Dt) 주위에는 소수 홀(Hm)이 존재하지 않는 데드 존(115B)이 형성된다. In this case, by exposing with the lamp 130, the crystals of the first undoped GaN layer 115 generate photo enhanced minority halls Hm by the exposure of the lamp 130 during growth, and the substrate ( Due to the inconsistency between the 111 and GaN layer crystals, a dead zone 115B is formed in which no minority holes Hm exist around a defect Dt having a positive charge.

여기서 GaN 생성 반응식은 다음과 같다.The GaN formation scheme is as follows.

(CH3)3Ga(g) + NH3(g) -> GaN(s) + 3CH4(g), g : 가스 상태, s : 고체 상태(CH 3 ) 3 Ga (g) + NH 3 (g)-> GaN (s) + 3CH 4 (g), g: gas state, s: solid state

이러한 GaN 생성 반응식에 의해 결정결함(Dt) 주위에는 정상적인 성장 예컨대, 정상 성장 레이트가 2um/hr 정도로 성장되며, 그 이외의 영역은 상기와 같은 반응식에 의해 생성되는 정공(+) 또는 전자(-)의 중간 생성물의 생성이 방해되어, 정상 성장 레이트보다 10~15% 낮은 속도로 성장된다. 이러한 성장 레이트의 차이로 인하여 제 1언도프드 GaN층(115)의 표면(115A)은 러프한 표면 또는 요철 형상의 표면으로 형성된다. 이러한 제 1언도프드 GaN(115)의 표면이 러프하게 형성됨으로써, LED 구조 특성에 나쁜 영향을 주는 결정결함(dislocation)이 피닝(pinning)될 수 있는 프리 스페이스(free surface)를 증대시켜 줄 수 있다.Normal growth, for example, a normal growth rate is grown around 2 um / hr by the GaN generation reaction equation (Dt), and the other regions are holes (+) or electrons (-) generated by the above reaction equation. The production of the intermediate product of is hindered and grows at a rate of 10-15% lower than the normal growth rate. Due to this difference in growth rate, the surface 115A of the first undoped GaN layer 115 is formed with a rough surface or an uneven surface. Since the surface of the first undoped GaN 115 is roughly formed, it is possible to increase the free surface in which dislocations, which adversely affect the LED structure characteristics, may be pinned. .

이로 인해, 도 1의 제 1도전성 반도체층(117)의 결함을 감소시켜 주어, 상부에 성장되는 활성층(119)의 발광 효율을 증대시키고, 최종 LED 구조의 역방향 전류, 역방향 전압 등의 다이오드 특성을 개선하며, ESD(electrostatic discharge) 등의 전기적 내성을 강화시켜 줄 수 있다.As a result, defects of the first conductive semiconductor layer 117 of FIG. 1 are reduced, thereby increasing luminous efficiency of the active layer 119 grown on the top, and improving diode characteristics such as reverse current and reverse voltage of the final LED structure. It can improve electrical resistance, such as electrostatic discharge (ESD).

또한 상기 실시 예에서는 제 1언도프드 GaN(115)의 성장시 램프로 노광하여 in-situ 성장을 수행하였으나, 제 1도전성 반도체층(117)에 대해서도 동일한 방식으로 램프로 노광하여 in-situ 성장을 수행할 수 있다.In the above embodiment, in-situ growth was performed by exposing with a lamp during growth of the first undoped GaN 115, but in-situ growth was also performed by exposing with a lamp in the same manner with respect to the first conductive semiconductor layer 117. Can be done.

도 3은 도 1의 활성층의 양자 우물층의 성장 예를 나타낸 도면이다.3 is a diagram illustrating an example of growth of a quantum well layer of the active layer of FIG. 1.

도 3을 참조하면, 활성층(119)은 소정의 성장 온도에서 질소, 수소를 캐리어 가스 사용하고 분위기 가스 NH3, TMGa(TFGa), TMln 및 TMAl을 공급하여 소정 두께의 InxGa(1-x)N(0<x≤1) 양자우물층(119A) 및 양자 장벽층(119B)이 성장된다. Referring to FIG. 3, the active layer 119 uses a carrier gas of nitrogen and hydrogen at a predetermined growth temperature and supplies atmospheric gases NH 3 , TMGa (TFGa), TMln, and TMAl to provide In x Ga (1-x ) having a predetermined thickness. ) N (0 <x ≦ 1) quantum well layer 119A and quantum barrier layer 119B are grown.

상기 InGaN 양자 우물층(119A)의 성장시 다량의 Ga 빈 격자점(Ga vacancy)이 발생되며, 이러한 Ga 빈 격자점은 네거티브 전하(negatively charge)를 띠고 있어, 양전자(positron)를 트랩하게 된다.When the InGaN quantum well layer 119A grows, a large amount of Ga vacancy is generated, and the Ga vacancy has a negative charge, thereby trapping a positron.

이를 위해, 상기 InGaN 양자 우물층(119A)의 성장시 램프(132)를 이용하여 노광하여 in-situ 성장함으로써, 소수 홀(minority hall)이 발생되고 발생된 소수 홀이 Ga 빈 격자점에 트랩됨으로써, 네거티브 전하로 되어 있는 GaN의 Ga 빈 격자점의 발생을 효과적으로 방지하게 된다. 즉, GaN의 Ga 빈 격자점의 생성을 소수 홀(photo enhanced minority hall)을 이용하여 보상하여 Ga 빈 격자점을 중화시켜 줌으로써, 양전자(positron)가 Ga 빈 격자점에 트랩되는 것을 방지할 수 있어, 양전자가 발광에 기여할 수 있게 된다.To this end, when the InGaN quantum well layer 119A is grown, it is exposed by using the lamp 132 to grow in-situ so that minority holes are generated and the generated minority holes are trapped at Ga empty lattice points. Therefore, it is possible to effectively prevent the generation of Ga empty lattice points of GaN which are negative charges. That is, by compensating the generation of Ga empty lattice points of GaN by using photo enhanced minority halls to neutralize Ga empty lattice points, it is possible to prevent positrons from being trapped by Ga empty lattice points. The positron can contribute to light emission.

이로 인해, 활성층의 프리 포지스런(free positron)이 증가하게 될 수 있어, 비 방사 재결합(non-radiative recombination)을 감소시켜 줌으로서, 발광 효율을 증대시켜 줄 수 있다.As a result, the free positron of the active layer may be increased, thereby reducing the non-radiative recombination, thereby increasing the luminous efficiency.

도 4는 본 발명의 제 2실시 예에 따른 반도체 발광소자(100A)를 나타낸 단면도이며, 도 5는 인듐에 의한 V 결함(118B)을 나타낸 도면이며, 도 6은 도 4의 로우 몰 InGaN층의 성장 예를 나타낸 도면이다. 이러한 제 2실시 예는 제 1실시 예와 동일한 부분에 대해서는 동일 부호로 처리하고 중복 설명은 생략하기로 한다.4 is a cross-sectional view illustrating a semiconductor light emitting device 100A according to a second embodiment of the present invention, FIG. 5 is a view illustrating a V defect 118B due to indium, and FIG. 6 is a view of the low mol InGaN layer of FIG. 4. It is a figure which shows the growth example. The second embodiment will be denoted by the same reference numerals for the same parts as the first embodiment, and description thereof will be omitted.

도 4 내지 도 6을 참조하면, 제 1도전성 반도체층(117) 위에는 인듐 함량이 낮은 로우 몰(low mole) InGaN층(118)이 형성되는 데, 상기 로우 몰 InGaN층(118)은 활성층(119)의 내부양자효율(internal quantum efficiency)을 증가시키기 위해서 상기 활성층(119) 성장 전, 상기 활성층(119)의 스트레인(strain)을 제어할 수 있도록 인듐 함량이 낮은 InGaN 확산층(spreading layer) 또는 InGaN 장벽층(barrier layer) 등으로 성장될 수 있다. 여기서 상기 로우 몰 InGaN층(118)을 성장시킴에 있어서, 도핑되는 인듐의 함량은 5%미만이 되도록 조절된다. 4 to 6, a low mole InGaN layer 118 having a low indium content is formed on the first conductive semiconductor layer 117, and the low mole InGaN layer 118 is formed of an active layer 119. InGaN spreading layer or InGaN barrier with low indium content to control the strain of the active layer 119 before growth of the active layer 119 to increase the internal quantum efficiency It can be grown in a layer (barrier layer) or the like. In growing the low mol InGaN layer 118, the indium doped content is controlled to be less than 5%.

도 5에 도시된 바와 같이, InGaN층에 인듐이 혼합된 경우, 상기 인듐 원자(atom)은 (0001) 표면에 위치하는 것보다 경사 표면(

Figure 112008086960966-pat00001
)에 위치하게 된다. 따라서 인듐이 혼합된 경우 V 결함(118B)이 다량 생성될 수 있는데, 이러한 인듐이 혼합된 층의 표면은 어느 일정한 표면에너지 E(surface)를 가질 것이고, V 결함(118B)이 형성되면 상기 표면 에너지는 E'로 변화게 된다.As shown in FIG. 5, when indium is mixed in the InGaN layer, the indium atoms are inclined rather than located on the (0001) surface.
Figure 112008086960966-pat00001
). Therefore, a large amount of V defect 118B may be generated when indium is mixed, and the surface of the indium mixed layer may have a certain surface energy E, and when the V defect 118B is formed, the surface energy. Becomes E '.

또한 표면 에너지 E'는 아래와 같이 나타낼 수 있다.In addition, the surface energy E 'can be expressed as follows.

*E' = f(S, λx)* E '= f (S, λx)

여기서 S는 (0001) facet가 없어지고, (

Figure 112008086960966-pat00002
)facet가 형성되면서 생기는 에너지이고, λx는 전위 코어 에너지이다. 상기 InGaN층(118)의 표면이 최소의 E' 값을 가질 때까지 V 결함(118B)은 계속 생성되어 커질 것이다. Where S loses (0001) facet, (
Figure 112008086960966-pat00002
is the energy produced by the formation of facet, and λx is the potential core energy. The V defect 118B will continue to generate and grow until the surface of the InGaN layer 118 has a minimum E 'value.

이는 상기 InGaN층(118)에 인듐이 혼합되는 경우 포텐셜 에너지 차이(1.5~2V)에 의해 (0001)표면(118A) 보다 경사진 표면(

Figure 112008086960966-pat00003
)에 우선적으로 성장이 일어나게 된다.This is due to the potential energy difference (1.5-2V) when indium is mixed with the InGaN layer 118, which is inclined than the (0001) surface 118A.
Figure 112008086960966-pat00003
), Growth occurs first.

이를 방지하기 위해, 도 6에 도시된 바와 같이 램프(134)로 노광하는 상태에서 로우 몰 InGaN층(118)을 in-situ 성장함으로써, 로우 몰 InGaN층(118)의 성장시 인듐 도핑에 의해 발생하는 V 결함(118B)의 생성과 성장을 억제하여 고 품질의 InGaN층을 성장할 수 있다.In order to prevent this, as shown in FIG. 6, the low mol InGaN layer 118 is grown in-situ in the state exposed to the lamp 134, thereby generating the indium doping during the growth of the low mol InGaN layer 118. By suppressing the generation and growth of the V defect 118B, a high quality InGaN layer can be grown.

다시 말하면, 로우 몰 InGaN층(118)의 성장 도중 in-situ 노광에 의해 소수 홀(photo enhanced minority hall)을 발생시키면, 상기 소수 홀이 표면(예:

Figure 112008086960966-pat00004
) 전계 상태(surface electric state)를 교란시켜 주어, 인듐에 의한 V 결함(V-defect)(118B)의 생성과 성장을 제한하게 된다. 즉, 로우 몰 InGaN(118)에서 V 결함(118B)의 표면(
Figure 112008086960966-pat00005
)에 대한 포텐셜 에너지를 교란시켜 주어, V 결함(118B)에 계속 붙으려는 인듐을 방해하여 V 결함(118B)의 성장을 제한하게 된다.In other words, if a photo enhanced minority hall is generated by in-situ exposure during the growth of the low mol InGaN layer 118, the minority hole may be a surface (e.g.,
Figure 112008086960966-pat00004
) Disturbs the surface electric state, limiting the generation and growth of V-defect 118B by indium. That is, the surface of the V defect 118B in the low mol InGaN 118 (
Figure 112008086960966-pat00005
Perturbing the potential energy for V), thereby inhibiting indium from continuing to attach to V defect 118B, thereby limiting the growth of V defect 118B.

도 7은 본 발명의 제 3실시 예를 나타낸 반도체 발광소자(100B)를 나타낸 단면도이고, 도 8은 도 7의 제 2도전성 반도체층의 성장 예를 나타낸 도면이다. 이러한 제 3실시 예는 제 1실시 예와 동일한 부분에 대해서는 동일 부호로 처리하고 중복 설명은 생략하기로 한다.7 is a cross-sectional view illustrating a semiconductor light emitting device 100B according to a third exemplary embodiment of the present invention, and FIG. 8 is a diagram illustrating a growth example of the second conductive semiconductor layer of FIG. 7. The third embodiment will be denoted by the same reference numerals for the same parts as the first embodiment, and description thereof will be omitted.

도 7 및 도 8을 참조하면, 상기 제 2도전성 반도체층(121)을 성장하기 전에 제 2언도프드 GaN층(120)을 성장하고, 제 2언도드프 GaN층(121) 위에 제 2도전성 반도체층을 성장하게 된다. 여기서 제 2도전성 반도체층(121) 위에 제 3언도프드 GaN층을 형성할 수도 있다.7 and 8, before the second conductive semiconductor layer 121 is grown, the second undoped GaN layer 120 is grown, and the second conductive semiconductor layer is grown on the second undoped GaN layer 121. Will grow. The third undoped GaN layer may be formed on the second conductive semiconductor layer 121.

상기 제 2도전성 반도체층(121)은 수소(H)를 캐리어 가스로 하여 소정의 온 도에서, TMGa, (EtCp2Mg) {Mg(C2H5C5H4)2} 및 NH3을 공급하여 p-GaN층으로 구현된다.The second conductive semiconductor layer 121 is implemented as a p-GaN layer by supplying TMGa, (EtCp2Mg) {Mg (C2H5C5H4) 2} and NH 3 at a predetermined temperature using hydrogen (H) as a carrier gas. .

이때, Mg를 도핑한 p-GaN층(121)을 얇게 성장시키고, 상기 p-GaN층(121)의 아래에 제 2언도프드 GaN층(120)을 형성해 줌으로써, 도핑되어 있는 p-GaN층(121)에서 제 2언도프드 GaN층(120)으로 마그네슘(Mg)들이 자연스럽게 확산(diffusion)하게 되어 고 품위의 Mg가 도핑된 p-GaN층(121)의 형성이 가능하게 된다. 여기서, 상기 제 2언도프드 GaN층의 두께는 10Å~500Å이고, 상기 제 2도전성 반도체층의 두께는 10Å~2000Å로 형성될 수 있다.At this time, the p-GaN layer 121 doped with Mg is thinly grown, and a second undoped GaN layer 120 is formed under the p-GaN layer 121 to thereby form a doped p-GaN layer ( Magnesium (Mg) naturally diffuses from the 121 to the second undoped GaN layer 120 to form a p-GaN layer 121 doped with high-quality Mg. Here, the thickness of the second undoped GaN layer may be 10 kPa to 500 kPa, and the thickness of the second conductive semiconductor layer may be 10 kPa to 2000 kPa.

이때, 마이너스 전하를 띤 수소(H) 이온이 발생하여 Mg-H 결합이 발생하는 구간은 제 2언도프드 GaN층(120) 위의 p-GaN층(121)에서 발생되므로, p-GaN층(121)의 성장시 램프(136)를 이용하여 노광하여 in-situ 성장함으로써, 제 2언도프드 GaN층(120)에 의해 소수 홀(minority hole) 발생되므로 Mg-H 결합을 방해하여 주게 된다.At this time, since the negatively charged hydrogen (H) ions are generated to generate Mg-H bonds in the p-GaN layer 121 on the second undoped GaN layer 120, the p-GaN layer ( When the growth of 121 is performed by using the lamp 136 to expose and grow in-situ, since a minority hole is generated by the second undoped GaN layer 120, the Mg-H coupling is interrupted.

즉, p-GaN층(121)에서 Mg 도핑시에는 Mg이 암모니아 가스의 H와 결합되어 전기적으로 절연 특성을 보이는 Mg-H 결합체를 형성한다. 따라서 고농도의 p-GaN층(121)을 얻는 것이 어렵다. 이를 위해, p-GaN층(121)의 성장 시 램프(136)로 노광하여 in-situ 성장하여 소수 전자(photo enhanced minority electron)를 발생시켜 줌으로써, 상기 발생된 소수 전자가 H 이온과 결합된다. 이에 따라 Mg와 분위기 가스 및 이송 가스로 사용되는 H 이온과의 결합으로 인해 p-GaN층(121)의 홀 캐리어(hall carrier) 농도를 저하시키는 현상을 개선할 수 있다. That is, when Mg is doped in the p-GaN layer 121, Mg is combined with H of ammonia gas to form an Mg-H conjugate having electrical insulating properties. Therefore, it is difficult to obtain a high concentration of p-GaN layer 121. To this end, the p-GaN layer 121 is exposed to the lamp 136 and grows in-situ to generate photo enhanced minority electrons, thereby combining the generated minor electrons with H ions. Accordingly, the phenomenon in which the hole carrier concentration of the p-GaN layer 121 is lowered due to the combination of Mg and H ions used as an atmosphere gas and a transport gas may be improved.

이러한 p-GaN층(121) 성장 시 램프(136)를 이용하여 소수 전자를 생성시켜 줌으로써, 상기 생성된 소수 전자와 Mg 이온과의 1차 결합을 형성하여 Mg-H 결합을 방지하고 NH3 및 H2 가스 등을 배제한 상태에서 고온의 단시간 열처리를 통하여 홀 농도(hall concentration)를 증가시켜 줄 수 있다. 이에 따라 발광다이오드의 구동 전압을 개선하고 사용하는 Mg 소스의 양을 줄여, 활성층의 데미지(damage)를 줄임으로써 발광 효율을 개선하는 등의 효과가 있다.When the p-GaN layer 121 grows, by generating a small number of electrons by using the lamp 136, by forming a primary bond between the generated small number of electrons and Mg ions to prevent the Mg-H bond, NH 3 and It is possible to increase the hall concentration through the short time heat treatment at high temperature in the state of excluding H 2 gas. Accordingly, there is an effect such as improving the driving voltage of the light emitting diode and reducing the amount of Mg source used, thereby reducing the damage of the active layer to improve the luminous efficiency.

이상에서 본 발명에 대하여 실시 예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을 한정하는 것이 아니며, 본 발명이 속하는 분야의 통상의 지식을 가진 자라면 본 발명의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 본 발명의 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.Although the present invention has been described above with reference to the embodiments, these are only examples and are not intended to limit the present invention, and those skilled in the art to which the present invention pertains may have an abnormality within the scope not departing from the essential characteristics of the present invention. It will be appreciated that various modifications and applications are not illustrated. For example, each component specifically shown in the embodiment of the present invention can be modified. And differences relating to such modifications and applications will have to be construed as being included in the scope of the invention defined in the appended claims.

도 1은 본 발명의 제 1실시 예에 따른 반도체 발광소자를 나타낸 단면도.1 is a cross-sectional view showing a semiconductor light emitting device according to a first embodiment of the present invention.

도 2는 도 1의 제 1 언도프드 GaN층의 성장 예를 나타낸 도면.FIG. 2 is a view showing a growth example of the first undoped GaN layer of FIG. 1;

도 3은 도 1의 활성층의 양자 우물층의 성장 예를 나타낸 단면도.3 is a cross-sectional view illustrating an example of growth of a quantum well layer of the active layer of FIG. 1.

도 4는 본 발명의 제 2실시 예에 따른 반도체 발광소자를 나타낸 단면도.4 is a cross-sectional view of a semiconductor light emitting device according to a second exemplary embodiment of the present invention.

도 5는 도 4에서의 로우 몰 InGaN층의 V결함 예를 나타낸 도면.FIG. 5 shows an example of a V defect of a low mol InGaN layer in FIG. 4. FIG.

도 6은 도 4의 로우 몰 InGaN층의 성장 예를 나타낸 도면.FIG. 6 is a view showing a growth example of the low mol InGaN layer of FIG. 4; FIG.

도 7은 본 발명의 제 3실시 예에 따른 반도체 발광소자를 나타낸 단면도.7 is a cross-sectional view showing a semiconductor light emitting device according to a third embodiment of the present invention.

도 8은 도 7의 제 2도전성 반도체층의 성장 예를 나타낸 도면.FIG. 8 is a view illustrating a growth example of the second conductive semiconductor layer of FIG. 7;

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

100,100A,100B : 반도체 발광소자100,100A, 100B: semiconductor light emitting device

111 : 기판 113 : 버퍼층111 substrate 113 buffer layer

115 : 제 1언도프드 GaN층 117 : 제 1도전성 반도체층115: first undoped GaN layer 117: first conductive semiconductor layer

118 : 로우 몰 InGaN층 119 : 활성층118: low mol InGaN layer 119: active layer

119A : 양자 우물층 119B : 양자 장벽층119A: Quantum Well Layer 119B: Quantum Barrier Layer

120 : 제 2언도프드 GaN층 121 : 제 2도전성 반도체층120: second undoped GaN layer 121: second conductive semiconductor layer

Claims (7)

제 1도전성 반도체층; A first conductive semiconductor layer; 제 1도전성 반도체층 위에 형성된 활성층;An active layer formed on the first conductive semiconductor layer; 상기 활성층 위에 형성된 제 2도전성 반도체층을 포함하며,A second conductive semiconductor layer formed on the active layer, 상기 층들 중 복수개의 층은 그 반도체층의 성장도중 램프의 노광에 의해 생성된 소수 캐리어를 포함하는 것을 특징으로 하는 반도체 발광소자.Wherein the plurality of layers comprises minority carriers produced by exposure of a lamp during growth of the semiconductor layer. 제 1도전성 반도체층; A first conductive semiconductor layer; 제 1도전성 반도체층 위에 형성된 활성층;An active layer formed on the first conductive semiconductor layer; 상기 활성층 위에 형성된 제 2도전성 반도체층;A second conductive semiconductor layer formed on the active layer; 상기 제2도전성 반도체층 위에 제3도전성 반도체층을 포함하며,A third conductive semiconductor layer on the second conductive semiconductor layer, 상기 층들 중 적어도 한 층은 그 반도체층의 성장도중 램프의 노광에 의해 생성된 소수 캐리어를 포함하는 것을 특징으로 하는 반도체 발광소자.At least one of said layers includes minority carriers produced by exposure of a lamp during growth of said semiconductor layer. 제 1도전성 반도체층; A first conductive semiconductor layer; 상기 제1도전성 반도체층 위에 형성된 활성층;An active layer formed on the first conductive semiconductor layer; 상기 활성층 위에 형성된 제 2언도프드 반도체층;A second undoped semiconductor layer formed on the active layer; 상기 제2언도프드 반도체층 위에 형성된 제2도전성 반도체층을 포함하며,A second conductive semiconductor layer formed on the second undoped semiconductor layer, 상기 제2도전성 반도체층은 그 반도체층의 성장도중 램프의 노광에 의해 생성된 소수 캐리어를 포함하는 것을 특징으로 하는 반도체 발광소자.And the second conductive semiconductor layer comprises a minority carrier generated by exposure of a lamp during growth of the semiconductor layer. 제1항 내지 제3항 중 어느 한 항에 있어서,The method according to any one of claims 1 to 3, 상기 제1도전성 반도체층 아래에 형성된 제1언도프드 반도체층을 포함하며,A first undoped semiconductor layer formed under the first conductive semiconductor layer, 상기 제1언도프드 반도체층은 그 반도체층의 성장도중 램프에 의해 노광되며, 상기 램프의 노광에 의해 생성된 소수 캐리어를 포함하는 것을 특징으로 하는 반도체 발광소자.And the first undoped semiconductor layer is exposed by a lamp during the growth of the semiconductor layer, and includes a minority carrier generated by the exposure of the lamp. 제4항에 있어서,The method of claim 4, wherein 상기 제1언도프드 반도체층의 아래에 형성된 버퍼층 및 상기 버퍼층 아래에 형성된 기판을 포함하는 것을 특징으로 하는 반도체 발광소자.And a buffer layer formed under the first undoped semiconductor layer and a substrate formed under the buffer layer. 제 3항에 있어서,The method of claim 3, wherein 상기 제2언도프드 반도체층의 두께는 10Å~500Å이고, The second undoped semiconductor layer has a thickness of 10 kPa to 500 kPa, 상기 제 2도전성 반도체층의 두께는 10Å~2000Å로 형성되는 반도체 발광소자.The thickness of the second conductive semiconductor layer is a semiconductor light emitting device formed of 10 ~ 2000Å. 제 1항 내지 제3항 중 어느 한 항에 있어서,The method according to any one of claims 1 to 3, 상기 램프는 수은 램프, X선, 전자선, 할로겐 램프 중 적어도 하나를 포함하는 반도체 발광소자.The lamp includes at least one of a mercury lamp, X-rays, electron beams, halogen lamps.
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4904337A (en) * 1988-06-06 1990-02-27 Raytheon Company Photo-enhanced pyrolytic MOCVD growth of group II-VI materials
JPH08255927A (en) * 1995-03-16 1996-10-01 Rohm Co Ltd Fabrication of semiconductor light emitting element
JPH10242061A (en) * 1997-02-27 1998-09-11 Sharp Corp Manufacture of gallium nitride compound semiconductor

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4904337A (en) * 1988-06-06 1990-02-27 Raytheon Company Photo-enhanced pyrolytic MOCVD growth of group II-VI materials
JPH08255927A (en) * 1995-03-16 1996-10-01 Rohm Co Ltd Fabrication of semiconductor light emitting element
JPH10242061A (en) * 1997-02-27 1998-09-11 Sharp Corp Manufacture of gallium nitride compound semiconductor

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