KR100782327B1 - 반도체 장치 사이의 단일형 병렬데이터 인터페이스 방법,기록매체 및 반도체 장치 - Google Patents
반도체 장치 사이의 단일형 병렬데이터 인터페이스 방법,기록매체 및 반도체 장치 Download PDFInfo
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Abstract
Description
Claims (19)
- N(2이상의 정수) 비트의 제1 병렬데이터를 스크램블링하여 제2병렬데이터를 발생하는 단계;제1로직 레벨의 비트 수 및 제2 로직 레벨의 비트 수의 차이가 소정 범위에 속하도록 상기 제2병렬데이터의 적어도 하나의 비트를 선택적으로 변환하거나 상기 제2병렬데이터에 적어도 하나의 비트를 부가하여 M(>N)비트의 밸런스 코드를 생성하는 단계; 및상기 밸런스 코드를 M개의 데이터 라인들을 통하여 병렬로 전송하는 단계를 구비하는 것을 특징으로 하는 단일형(Single ended) 병렬데이터 인터페이스 방법.
- 제1항에 있어서, 상기 제2병렬데이터를 발생하는 단계는,소정의 패턴의 난수열을 생성하는 단계; 및상기 N비트의 제1병렬 데이터와 상기 생성된 소정의 패턴의 난수열을 로직 연산하는 단계를 구비하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스 방법.
- 제1항에 있어서, 상기 밸런스 코드를 생성하는 단계는,8비트/10비트 코딩 방식에 의하여 상기 밸런스 코드를 생성하거나 데이터 버스 인버전 DC방식에 의하여 상기 밸런스 코드를 생성하는 것을 특징으로 하는 단일 형 병렬데이터 인터페이스 방법.
- 제1항에 있어서, 상기 단일형 병렬데이터 인터페이스 방법은,상기 M개의 데이터 라인들을 통하여 상기 M비트의 밸런스코드를 병렬로 수신하는 단계:상기 수신된 밸런스코드를 디코딩하여 상기 제2병렬데이터를 복원하는 단계; 및상기 제2병렬데이터를 저장하는 단계를 더 구비하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스 방법.
- 제1항에 있어서, 상기 단일형 병렬데이터 인터페이스 방법은,상기 M개의 데이터 라인들을 통하여 상기 M비트의 밸런스 코드를 수신하는 단계;상기 수신된 밸런스코드를 디코딩하여 상기 제2병렬데이터를 복원하는 단계;상기 복원된 제2병렬데이터를 디스크램블링(descrambling)하여 상기 제1병렬데이터를 복원하는 단계; 및상기 제1병렬데이터를 저장하는 단계를 더 구비하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스 방법.
- 제1항 내지 제5항 중의 어느 한 항에 기재된 방법을 실행하기 위한 프로그램 을 기록한 기록매체.
- N비트의 제1 병렬데이터를 수신하여 난수열 패턴을 가진 제2병렬데이터를 생성하는 스크램블러(Scrambler); 및제1로직 레벨의 비트 수 및 제2 로직 레벨의 비트 수의 차이가 소정 범위에 속하도록 상기 제2병렬데이터의 적어도 하나의 비트를 선택적으로 변환하거나 상기 제2병렬데이터에 적어도 하나의 비트를 부가하여 M(>N)비트의 밸런스 코드를 생성하는 밸런스 코딩 블록; 및상기 밸런스 코드를 M개의 데이터 라인들을 통하여 병렬로 출력하는 출력 드라이버를 구비하는 것을 특징으로 하는 반도체 장치.
- 제7항에 있어서, 상기 스크램블러는,N비트의 난수열을 생성시키는 난수열 발생기; 및상기 N비트의 제1병렬 데이터 및 상기 생성된 N비트 난수열을 논리 연산하는 논리 연산 블록을 구비하는 것을 특징으로 하는 반도체 장치.
- 제8항에 있어서, 상기 논리 연산 블록은,상기 N비트의 제1병렬 데이터의 각각의 비트와 상기 N비트의 난수열의 각각의 비트를 배타적 논리합(exclusive OR)시킨 결과에 기초하여 상기 제2병렬 데이터를 출력하는 것을 특징으로 하는 반도체 장치.
- 제7항에 있어서, 상기 밸런스 코딩 블록은,8비트/10비트 코딩 방식에 의하여 상기 밸런스 코드를 생성하거나 데이터 버스 인버전 DC방식에 의하여 상기 밸런스 코드를 생성하는 것을 특징으로 하는 반도체 장치.
- M개의 데이터 라인들을 통하여 M비트의 밸런스코드를 병렬로 수신하는 데이터 수신부;상기 수신된 밸런스코드를 디코딩하여 N비트의 병렬데이터를 출력하는 밸런스 코드 디코딩 블록;상기 N비트의 병렬데이터를 디스크램블링(descrambling)하는 디스크램블러(Descrambler); 및상기 디스크램블러의 출력을 저장하는 데이터 저장부를 구비하는 것을 특징으로 하는 반도체 장치.
- 제11항에 있어서, 상기 밸런스 코드 디코딩 블록은,8비트/10비트 코딩 방식에 의하여 디코딩 또는 데이터 버스 인버전 DC방식에 의하여 디코딩하는 것을 특징으로 하는 반도체 장치.
- 제11항에 있어서, 상기 디스크램블러는,N비트의 난수열을 생성시키는 난수열 발생기; 및상기 N비트의 병렬데이터 및 상기 생성된 N비트의 난수열을 논리 연산하는 논리 연산 블록을 구비하는 것을 특징으로 하는 반도체 장치.
- 단일형 병렬데이터 인터페이스를 사용하는 제1반도체 장치 및 제2반도체 장치를 구비하는 시스템에 있어서,상기 제1반도체 장치는,N(2이상의 정수) 비트의 제1 병렬데이터를 수신하여 난수열 패턴을 가진 제2병렬데이터를 생성하는 스크램블러(Scrambler);제1로직 레벨의 비트 수 및 제2 로직 레벨의 비트 수의 차이가 소정 범위에 속하도록 상기 제2병렬데이터의 적어도 하나의 비트를 선택적으로 변환하거나 상기 제2병렬데이터에 적어도 하나의 비트를 부가하여 M(>N)비트의 밸런스 코드를 생성하는 밸런스 코딩 블록; 및상기 밸런스 코드를 M개의 데이터 라인들을 통하여 병렬로 출력하는 출력 드라이버를 구비하며,상기 제2반도체 장치는,M개의 데이터 라인들을 통하여 M비트의 밸런스코드를 병렬로 수신하는 데이터 수신부; 및상기 수신된 밸런스코드를 디코딩하여 N비트의 상기 제2병렬데이터를 복원하는 밸런스 코드 디코딩 블록을 구비하는 것을 특징으로 하는 시스템.
- 제14항에 있어서, 상기 제2반도체 장치는,상기 제2병렬데이터를 디스크램블링(descrambling)하여 상기 제1병렬데이터를 복원하는 디스크램블러(Descrambler); 및상기 디스크램블러의 출력을 저장하는 데이터 저장부를 더 구비하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스를 사용하는 시스템.
- 제15항에 있어서, 상기 스크램블러는,N비트의 난수열을 생성하는 난수열 발생기; 및상기 N비트의 제1병렬 데이터 및 상기 생성된 N비트 난수열을 논리 연산하는 논리 연산 블록을 구비하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스를 사용하는 시스템.
- 제16항에 있어서, 상기 논리 연산 블록은,상기 N비트의 제1병렬데이터의 각각의 비트와 상기 N비트의 난수열의 각각의 비트를 배타적 논리합(exclusive OR)시킨 결과에 기초하여 상기 제2병렬데이터를 출력하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스를 사용하는 시스템.
- 제15항에 있어서, 상기 밸런스 코딩 블록은,8비트/10비트 코딩 방식에 의하여 상기 밸런스 코드를 생성하거나 데이터 버 스 인버전 DC방식에 의하여 상기 밸런스 코드를 생성하는 것을 특징으로 하는 단일형 병렬데이터 인터페이스를 사용하는 시스템.
- 제15항에 있어서,상기 제1반도체 장치는 메모리 컨트롤러이고,상기 제2반도체 장치는 DRAM,SRAM 또는 플래쉬 메모리 장치인 것을 특징으로 하는 단일형 병렬인터페이스를 사용하는 시스템.
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