KR100603368B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 안정적인 구동을 목적으로 한다.
이와 같은 목적을 달성하기 위하여, 본 발명은, 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 유지전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
프레임과 프레임 사이의 휴지기에서, 주사전극 라인들에, 유지방전 단계에서 인가되는 정극성의 제 1 전압보다 작은 부극성의 제 2 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법을 제공한다.

Description

플라즈마 디스플레이 패널의 구동방법 {Driving method of plasma display panel}
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 도면이다.
도 2는 도 1에 플라즈마 디스플레이 패널 각각의 전극에 인가되는 종래 구동 신호의 일예를 설명하기 위한 타이밍도이다.
도 3은 종래의 프레임과 프레임 사이의 휴지기에서의 구동신호와 FET의 동작전압을 보여주는 도면이다.
도 4는 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도 5는 본 발명의 휴지기에서의 구동신호와 FET의 동작 전압을 보여주는 도면이다.
도 6은 도 4의 구동장치 중 X 구동부와 Y 구동부를 도시한 구동회로의 회로도이다.
* 도면의 주요부분에 대한 부호의 설명 *
Ce...방전셀, SF...서브필드,
PR...리셋 기간, PA...어드레스 기간,
PS...유지방전 기간, Vg...그라운드 전압,
1...플라즈마 표시 패널, 400...영상처리부,
402...논리제어부, 404...Y 구동부,
406...어드레스 구동부, 408...X 구동부,
Vs...제 1 전압 또는 유지방전 전압,
Vset+Vs...상승 최고 전압,
Vnf...하강 최저 전압,
Va...어드레스 전압,
Vsch...스캔 하이 전압,
Vscl...제 2 전압 또는 스캔 로우 전압,
M1, M2, ...M15... 제 1 스위치, 제 2 스위치, ..., 제 15스위치.
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로서, 더 상세하게는 플라즈마 디스플레이 패널을 안정적으로 구동시키기 위한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 도면이다.
도 1을 참조하여 설명하면, 플라즈마 디스플레이 패널은 전극 구조는 패널의 수평방향에 평행하게 배치되는 주사전극 라인들과 유지전극 라인들이 있으며, 상기 주사전극 라인들 및 유지전극 라인들에 수직으로 교차하게 배치되는 어드레스 전극 라인들이 있다. 주사전극 라인, 유지전극 라인 및 어드레스 전극 라인이 교차하는 부분은 방전셀(Ce)을 구획하며, 상기 방전셀(Ce)은 플라즈마 디스플레이 패널의 한 화소로서의 역할을 한다. 방전셀(Ce)의 공간내에는 R, G, B 형광체 와 플라즈마 형성용 가스가 있으며, 상기 주사전극, 유지전극 및 어드레스 전극 각각에 인가되는 전압에 의해, 방전셀(Ce) 내부에 벽전하가 생성된다. 상기 벽전하에 의해 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 방전셀(Ce)들의 형광체가 여기되어 빛이 발생하게 된다.
도 2는 도 1에 플라즈마 디스플레이 패널의 각각의 전극에 인가되는 종래 구동 신호의 일예를 설명하기 위한 타이밍도이다.
플라즈마 디스플레이 패널의 구동방법으로, 주로 사용되는 어드레스-디스플레이 분리 구동방법이 미국특허 제 5541618호에 개시되어 있다. 즉, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정개수 예컨대 8개의 서브필드들로 분할될 수 있으며, 각 서브필드는 리셋 구간과, 어드레스 구간 및, 유지방전 구간으로 분할된다.
도 1 및 도 2를 참조하여 설명하면, 한 서브필드(SF)는 리셋 기간(PR), 어드레스 기간(PA) 및 유지방전 기간(PS)을 구비하고, 어드레스전극(A), 유지전극(X) 및 주사전극(Y1~Yn)에 각각 구동신호가 인가된다.
먼저 리셋 기간(PR)은 모든 주사 전극 라인들(Y1, ... , Yn)에 대해 리셋펄스를 인가하여, 초기화 방전을 수행함으로써, 전체 방전셀(Ce)의 벽전하 상태를 초기화한다. 어드레스 기간(PA)에 들어가기 전에 리셋 기간(PR)이 수행되며, 이는 전 화면에 걸쳐 수행하므로, 상당히 고르면서도 원하는 분포의 벽전하 배치를 만들 수 있다.
다음에, 어드레스 기간(PA)에는, 켜져야 할 셀을 선택하기 위해, 유지전극(X)에 바이어스 전압(Vb)이 인가되고, 주사전극(Y)에는 스캔 하이 전압(Vsch)이 인가되고, 주사전극 라인별(Y1, Y2, ..., Yn)로 스캔 로우 전압(Vscl)을 갖는 주사펄스가 인가된다. 어드레스 전극(A)에는 어드레스 전압(Va)을 갖는 표시 데이터 신호가 인가된다.
다음에, 유지방전 기간(PS)에는, 어드레스 기간(PA)에서 선택된 켜져야 할 셀에서 유지방전이 수행되도록, 유지전극(X)과 주사전극(Y)에 유지방전 전압(Vs)을 갖는 유지펄스를 교대로 인가한다. 이때, 유지방전을 수행하는 방전셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 방전셀들의 형광체가 여기되어 빛이 발생된다.
도 3은 종래의 프레임과 프레임 사이의 휴지기에서의 구동신호와 FET의 동작전압을 보여주는 도면이다.
도 3을 참고하여 설명하면, 종래에는 프레임과 프레임 사이의 휴지기(RE)에서, 주사전극(Y)에 제 1 전압인 유지방전 전압(Vs)을 인가하였으며, 유지전극(X)에는 그라운드 전압(Vg)을 인가하였다. 휴지기(RE)에서의 유지전극(Y), 주사전극(Y)에 인가되는 전압은 다음 프레임의 동작에 영향을 미친다. 구동신호에 따른 각 구동 전압을 인가하기 위해 스위치의 역할을 하는 각 FET(Field emission transistor)의 동작 전압이 소정 전압 이상이라면, 각 FET가 턴 온 되어 각 구동전 압이 주사전극(Y), 유지전극(X) 또는 어드레스 전극(미도시)에 인가된다. 이때 각 구동전압은 정극성의 전압 또는 부극성의 전압일 수 있다. 구동전압이 정극성의 전압인 경우 FET의 동작 전압을 Vcc 전압이라 하고, 부극성의 전압인 경우 FET의 동작 전압을 -Vcc 전압이라 한다면, 상기 휴지기(RE)에서 FET의 동작 전압인 Vcc 또는 -Vcc의 전압이 일정하게 유지되어야 다음 프레임 동작 초기에 FET 동작이 불안정해지지 않게 된다. 일반적으로 Vcc 전압은 전원공급장치에서 공급되나, -Vcc 전압은 그러하지 않고, 정극성의 동작 전압 Vcc와 인가되는 부극성의 구동전압과의 합으로서 만들어 사용하게 된다. 이와 같은 경우에, 주사전극에 인가되는 전압이 높으면, 기준 전위가 잡히지 않게 된다. 따라서 상기와 같이 휴지기(RE)에서 주사전극(Y)에 제 1 전압인 유지방전 전압(Vs)을 인가하는 경우에, 기준 전위가 잡히지 않아 부극성의 전압을 공급하는 FET의 -Vcc 전압이 시간에 따라 점차 떨어지게 되는 문제점이 발생한다. 이로 인해 휴지기(RE) 후 FET의 동작은 불안정해지며, 전체적으로 플라즈마 디스플레이 패널의 구동이 불안정해지게 된다.
본 발명은 상기와 같은 문제점을 해결하기 위하여, 안정적으로 구동하기 위한 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
상기와 같은 목적을 달성하기 위하여, 본 발명은, 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 유지전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레 이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
프레임과 프레임 사이의 휴지기에서, 주사전극 라인들에, 유지방전 단계에서 인가되는 정극성의 제 1 전압보다 작은 부극성의 제 2 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법을 제공한다.
이러한 본 발명의 다른 특징에 의하면, 상기 휴지기에서, 상기 유지전극 라인들에 그라운드 전압을 인가할 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 휴지기에서, 상기 어드레스 전극 라인들에 그라운드 전압을 인가할 수 있다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한다.
일본공개공보 1999-120924호에는 통상적인 플라즈마 디스플레이 패널의 구조가 개시되어 있다. 즉, 통상적인 플라즈마 디스플레이 패널의 앞쪽 및 뒤쪽 글라스 기판들 사이에는, 어드레스 전극 라인들(A1, A2, ... , Am), 유전층, 주사전극 라인들(Y1, ... , Yn), 유지전극 라인들(X1, ... , Xn), 형광층, 격벽 및 일산화마그네슘 (MgO) 보호층이 마련되어 있다.
어드레스 전극 라인들(A1, A2, ... , Am)은 뒤쪽 글라스 기판의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층은 어드레스 전극 라인들(A1, A2, ... , Am)의 앞쪽에 도포된다. 아래쪽 유전층의 앞쪽에는 격벽들이 어드레스 전극 라인들 (A1, A2, ... , Am)과 평행한 방향으로 형성된다. 이 격벽들은 각 디스플레이 셀의 방전 영역을 구획하고, 각 디스플레이 셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광층은 격벽들 사이에서 어드레스 전극 라인들(A1, A2, ... , Am) 상의 유전층의 앞에 도포되며, 순차적으로 적색발광 형광층, 녹색발광 형광층, 청색발광 형광층이 배치된다.
유지전극 라인들(X1, ... , Xn)과 주사전극 라인들(Y1, ... , Yn)은 어드레스 전극 라인들(A1, A2, ... , Am)과 직교되도록 앞쪽 글라스 기판의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 유지전극 라인(X1, ... , Xn)과 각 주사전극 라인(Y1, ... , Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(Xnb, Ynb)이 결합되어 형성될 수 있다. 앞쪽 유전층은 유지전극 라인들(X1, ... , Xn)과 주사전극 라인들(Y1, ... , Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널을 보호하기 위한 보호층 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층의 뒤쪽에 전면 도포되어 형성된다. 방전 공간에는 플라즈마 형성용 가스가 밀봉된다.
플라즈마 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 리셋, 어드레스 및 유지방전 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 리셋 단계에서는, 구동될 디스플레이 셀들의 전하 상태가 균일하게 된다. 어드레스 단계에서는, 선택될 디스플레이 셀들의 전하 상태와 선택되지 않을 디스플레이 셀들의 전하 상태가 설정된다. 유지방전 단계에서는, 선택될 디스플레이 셀들에서 디 스플레이 방전이 수행된다. 이때, 디스플레이 방전을 수행하는 디스플레이 셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 디스플레이 셀들의 형광층이 여기되어 빛이 발생된다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은, 상기 구조의 플라즈마 디스플레이 패널에 한정되는 것이 아니며, 3 전극 구조의 모든 플라즈마 디스플레이 패널에 적용될 수 있음에 유의해야 한다.
도 4는 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도면을 참조하면, 플라즈마 디스플레이 패널을 구동하기 위한 구동장치는 영상 처리부(400), 제어부(402), 어드레스 구동부(406), X 구동부(408) 및 Y 구동부(404)를 포함한다.
영상 처리부(400)는 외부 영상 신호를 입력받아 영상 처리(Image processing)하여 내부 영상 신호를 출력한다. 내부 영상 신호로는 각각 8비트의 적색(R), 녹색(G), 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들이 있다.
논리 제어부(402)는 상기 영상 처리부(400)로부터의 내부 영상 신호를 입력받아 감마 보정, APC(Automatic power control)단계 등을 거쳐 어드레스 전극 라인들, 주사전극 라인들 및 유지전극 라인들 각각에 인가되는 구동신호들을 제어하기 위한 구동 제어 신호들(SA, SY, SX)을 출력한다.
어드레스 구동부(406)는, 논리 제어부(402)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 입력받아 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다.
X 구동부(408)는 논리 제어부(402)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호(SX)를 입력받아 처리하여 유지전극 라인들에 인가한다.
Y 구동부(404)는 논리 제어부(402)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 입력받아 처리하여 주사전극 라인들에 인가한다.
본 발명의 안정적인 플라즈마 디스플레이 패널의 구동방법에 있어서, 휴지기에서 어드레스 구동부(406), X 구동부(408) 및 Y 구동부(404)에서 각각 어드레스 전극 라인들, 주사전극 라인들 및 유지전극 라인들에 본 발명의 구동신호들을 출력한다.
도 5는 본 발명의 휴지기에서의 구동신호와 FET의 동작 전압을 보여주는 도면이다.
하나의 프레임이 8개의 서브필드로 구성된다고 가정하면, 소정 프레임의 제 8 서브필드 종료 후와 다음 프레임의 제 1 서브필드 사이를 휴지기(RE)라고 한다. 상기 휴지기(RE)는 프레임과 프레임 사이의 발광 중지 기간으로서, 상기 휴지기(RE)에서의 유지전극(X)과 주사전극(Y)에 인가되는 전압에 따라 다음 프레임의 동작에 영향을 미치게 된다. 휴지기(RE) 바로 전의 제 8 서브필드의 유지방전 단계에서는 주사전극(Y) 및 유지전극(X)에 교호하게 인가되는 유지펄스가 인가되며 상기 유지펄스는 제 1전압인 유지방전 전압(Vs)을 갖는다. 휴지기(RE)에서는 주사전극(Y)에 상기 제 1 전압(Vs)보다 낮은 부극성의 제 2 전압이 인가되는 것이 바람직하 다. 제 2 전압은 어드레스 단계에서 주사전극(Y)에 인가되는 부극성의 스캔 로우 전압(Vscl)으로 정할 수 있다.
또한 휴지기(RE)에서는, 유지전극(X) 및 어드레스 전극(미도시)에 그라운드 전압(Vg)이 인가되는 것이 바람직하다. 휴지기(RE)에서 상기와 같은 구동신호들이 각각 주사전극, 유지전극 및 어드레스 전극에 인가되면, 부극성의 전압을 스위칭하는 FET의 동작전압은 도면과 같이 일정하게 된다. 이에 대해서는 이하 도 6을 참조하여 상세히 설명한다.
도 6은 도 4의 구동장치 중 X 구동부와 Y 구동부를 도시한 구동회로의 회로도이다.
이하에서 도 2, 도 5 및 도 6을 참조하여 설명한다. 먼저, 도 2의 구동신호를 공급하기 위한 도 6의 회로의 동작을 설명하면, 리셋 기간(PR)에서 주사전극 라인들(Y1, ... , Yn)에는, 먼저 제 1 전압인 유지방전 전압(Vs)이 인가된다. 이를 위해, 도 6의 구동회로에서 제 1 스위치(M1)가 턴 온 되고, 동시에 제 3, 제 5, 및 제 10 스위치(M3, M5, M10)가 턴 온 되어 패널 커패시터(Cp)에 제 1 전압(Vs) 인가된다. 다음에, 주사전극 라인들(Y1, ... , Yn)에 제 1 전압(Vs)에서 상승 램프 신호가 인가되면서 최종적으로 상승 최고 전압(Vset+Vs)이 인가되도록 하기 위하여, 구동회로에서 제 1 스위치(M1)가 턴 온 되고 제 3스위치(M3)는 턴 오프 되어, 제 1 전압(Vs)이 커패시터(Cset)에 충전된다. 상승 전압(Vset)을 공급하는 제 4스위치(M4)가 턴 온 되고, 동시에 제 5 및 제 10 스위치(M5, M10)가 턴 온 되어 패널 커패시터(Cp)에는 제 1 전압(Vs)부터 상승 기울기를 갖으며 상승하여 최종적으로 상 승 최고 전압(Vset+Vs)이 인가된다. 다음에, 제 1 전압(Vs)에서 하강 램프 신호가 인가되어 최종적으로 하강 최저 전압(Vnf)이 인가되도록 하기 위하여, 제 8스위치(M8)가 턴 온 되고, 동시에 제 10스위치(M10)가 턴 온 되어 패널 커패시터(Cp)에 하강 기울기를 갖으며 하강하여 최종적으로 하강 최저 전압(Vnf)이 인가된다.
리셋 기간(PR)에서 유지전극 라인들(X1, ... , Xn)에는 일단 그라운드 전압(Vg)이 인가된다. 즉, 제 15스위치(M15)가 턴 온 되고, 동시에 제 13스위치(M13)가 턴 온 되어 그라운드 전압(Vg)이 패널 커패시터(Cp)에 인가된다. 다음에, 주사전극(Y)에 하강 기울기를 갖는 하강 램프 신호가 인가되기 시작하는 시점에, 바이어스 전압(Vb)이 인가된다. 이를 위하여 구동회로에서, 제 11스위치(M11)와 제 12스위치(M12)가 턴 온 되어 패널 커패시터(Cp)에 바이어스 전압(Vb)이 인가된다.
어드레스 기간(PA)에 주사전극 라인들(Y1, ... , Yn)에는, 일단 스캔 하이 전압(Vscl)이 인가된다. 이를 위하여 구동회로에서, 제 6스위치(M6)와 제 7스위치(M7)가 턴 온 되어 스캔 로우 전압(Vscl)이 커패시터(Csc)에 충전되고, 제 9스위치(M9)가 턴 온 되어 패널 커패시터(Cp)에는 스캔 로우 전압(Vscl)보다 높은 스캔 하이 전압(Vsch)이 인가된다. 한편, 각 주사전극 라인마다 순차적으로 스캔을 수행하기 위해 주사펄스가 인가되며, 이를 위해 제 2 전압인 스캔 로우 전압(Vscl)이 순차적으로 인가된다. 이를 위하여 구동회로에서는 제 6스위치(M6)와 제 7스위치(M7)가 턴 온 되고, 동시에 제 10스위치(M10)가 턴 온 되어, 패널 커패시터(Cp)에 제 2 전압(Vscl)이 인가된다.
어드레스 기간(PR)에 유지전극 라인들(X1, ... , Xn)에는, 바이어스 전압 (Vb)이 계속 인가된다. 따라서 구동회로에서, 제 11스위치(M11)와 제 12스위치(M12)가 턴 온 되어 패널 커패시터(Cp)에 바이어스 전압(Vb)이 인가된다.
유지방전 기간(PS)에 주사전극(Y)과 유지전극(X)에는 제 1전압(Vs)과 그라운드 전압(Vg)을 갖는 유지펄스가 교호하게 인가한다. 먼저 주사전극(Y)에는 제 1스위치(M1)가 턴 온 되고, 동시에 제 3, 제 5, 및 제 10스위치(M3, M5, M10)가 턴 온 되어 제 1 전압(Vs)이 패널 커패시터(Cp)에 인가된다. 한편, 제 2스위치(M2)가 턴 온 되고, 동시에 제 3, 제 5, 및 제 10스위치(M3, M5, M10)가 턴 온 되어 그라운드 전압(Vg)이 패널 커패시터(Cp)에 인가된다. 한편, 에너지 회수 회로(Y-ERC)는 패널 커패시터(Cp)에 남아있는 전하를 회수하여 충전하거나 충전된 전하들을 패널 커패시터(Cp)에 방전하여 에너지를 회수하는 기능을 한다.
유지전극(X)에는 제 15스위치(M15)가 턴 온 되고, 동시에 제 13스위치(M13)가 턴 온 되어 패널 커패시터(Cp)에 그라운드 전압(Vg)이 인가된다. 한편, 제 14스위치(M14)가 턴 온 되고, 동시에 제 13스위치(M13)가 턴 온 되어 패널 커패시터(Cp)에 제 1 전압(Vs)이 인가된다. 한편, 에너지 회수 회로(X-ERC)는 패널 커패시터(Cp)에 남아있는 전하를 회수하여 충전하거나 충전된 전하들을 패널 커패시터(Cp)에 방전하여 에너지를 회수하는 기능을 한다.
다음에, 도 5의 휴지기에서의 구동신호를 공급하기 위한 도 6의 회로의 동작을 설명한다. 휴지기(RE)에서 주사전극(Y)에 제 1 전압(Vs)보다 낮은 부극성의 제 2 전압, 즉 스캔 로우 전압(Vscl)이 인가되기 위해서, 구동회로에서는 제 6 및 제 7스위치(M6, M7)가 턴 온 되고, 동시에 제 10스위치(M10)가 턴 온 된다.
유지전극(X)에 그라운드 전압(Vg)이 인가되기 위해서, 구동회로에서는 제 15스위치(M15)가 턴 온 되고, 동시에 제 13스위치(M13)가 턴 온 된다.
한편, 각 전압을 패널 커패시터(Cp)에 인가하기 위한 스위치들, 즉 FET들은 모두 동작 전압 이상의 전압이 게이트와 소스 단자 사이에 인가되어야 턴 온 동작이 수행된다. 정극성의 전압, 예를 들어, 유지방전 전압(Vs), 상승 전압(Vset), 스캔 하이 전압(Vsch), 바이어스 전압(Vb)들을 패널 커패시터(Cp)에 인가하기 위하여, 상기 전압들을 스위칭하는 해당 FET들(M1, M4, M9, M11, M12)은 전원공급장치(미도시)로부터 게이트 단자에 Vcc(대략 15V)전압을 인가받아 스위칭 동작을 수행한다. 또한, 부극성의 전압, 예를 들어, 스캔 로우 전압(Vscl), 하강 최저 전압(Vnf)들을 패널 커패시터(Cp)에 인가하기 위하여, 해당 FET들(M6, M7, M8)은 게이트 단자에 -Vcc 전압을 인가받아 스위칭 동작을 수행한다. -Vcc 전압은 제 2 전압인 스캔 로우 전압(Vscl)과 Vcc 전압(대략 15V)의 합으로써 사용될 수 있다.
만약, 휴지기(RE)에서, 종래와 같이 주사전극(Y)에 제 1 전압(Vs)을 인가하는 경우에는 부극성의 전압을 공급하는 해당 FET들(M6, M7, M8)의 게이트 단자에 인가되는 -Vcc 전압의 기준전위가 잡히지 않게 되어 -Vcc 전압이 시간이 흐를수록 점점 강하된다. 그러나 본 발명의 휴지기(RE)에서는, 주사전극(Y)에 부극성의 스캔 로우 전압(Vscl)을 인가하면, 부극성의 전압을 공급하는 해당 FET들(M6, M7, M8)의 게이트 단자에는 -Vcc 전압이 전압강하 없이 안정적으로 인가되게 된다. 따라서 휴지기(RE) 이후의 다음 프레임에서, 안정적인 Vcc 전압과 -Vcc 전압이 구동회로에 공급되므로, 상기 구동회로에서 안정적인 구동신호가 발생하게 되며, 구동신호 파 형의 왜곡이 방지되게 된다.
상기한 바와 같은 본 발명의 따르면, 다음과 같은 효과를 얻을 수 있다.
첫째, 휴지기에서 FET의 게이트 단자에 입력되는 Vcc 전원과 -Vcc 전원이 전압강하 없이 안정되게 된다.
둘째, 휴지기에서 구동회로에 안정적인 전원이 공급되므로, 구동신호는 파형의 왜곡이 없는 안정적인 구동신호가 발생하게 되어, 안정적인 플라즈마 디스플레이 패널 구동방법을 제공한다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (4)

  1. 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 유지전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    상기 리셋 단계에서, 상기 주사전극에는 제 1 전압에서 상승 램프 신호가 인가된 후 상기 1 전압에서 하강 램프 신호가 인가되고, 상기 유지전극에는 상기 하강 램프 신호 인가시 바이어스 전압이 인가되고,
    상기 어드레스 단계에서, 상기 주사전극에 스캔 하이 전압이 인가되면서 순차적으로 스캔 로우 전압을 갖는 주사펄스가 인가되고, 상기 어드레스 전극에 상기 주사펄스에 해당하는 표시 데이터 신호가 인가되고,
    상기 유지방전 단계에서, 상기 주사전극 및 상기 유지전극에 상기 제 1 전압과 그라운드 전압을 갖는 유지펄스가 서로 교호하게 인가되며,
    상기 프레임과 프레임 사이의 휴지기에서, 상기 주사전극 라인들에, 상기 제 1 전압보다 작은 부극성의 제 2 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  2. 제 1 항에 있어서, 상기 부극성의 제 2 전압은,
    상기 스캔 로우 전압인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  3. 제 1항에 있어서, 상기 휴지기에서,
    상기 유지전극 라인들에 그라운드 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  4. 제 1항에 있어서, 상기 휴지기에서,
    상기 어드레스 전극 라인들에 그라운드 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
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