KR100615240B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 제조비용 저감 및 방전 신뢰성 확보를 위한 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
이와 같은 목적을 달성하기 위하여, 본 발명은, 서로 대향 이격된 앞쪽 기판과 뒤쪽 기판을 갖고, 기판들 사이에 주사전극 및 유지전극 라인들이 서로 나란하게 형성되고, 어드레스 전극 라인들이 주사전극 및 유지전극 라인들에 대하여 교차되게 형성된 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 방전 디스플레이 패널의 구동 방법에 있어서,
리셋 단계는, 유지전극에, 그라운드 전압을 인가하고,
주사전극에, (a) 제 1 전압을 인가하는 단계 (b) 제 1 전압에서 제 2 전압까지 상승 기울기를 갖는 전압을 인가하는 단계 (c) 제 1 전압을 인가하는 단계 및 (d) 제 1 전압에서 제 3 전압까지 하강 기울기를 갖는 전압을 인가하는 단계를 포함하고,
어드레스 전극에, (b)단계에서 제 1 전압보다 낮고 그라운드 전압보다 높은 제 4 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법을 제공한다.

Description

플라즈마 디스플레이 패널의 구동방법 {Driving method of plasma display panel}
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 도면이다.
도 2는 도 1에 플라즈마 디스플레이 패널의 각각의 전극에 인가되는 종래 구동 신호의 일예를 설명하기 위한 타이밍도이다.
도 3은 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도 4는 본 발명의 일 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도 5는 본 발명의 다른 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도 6은 본 발명의 또 다른 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도 7은 도 3의 구동장치 중 Y 구동부를 도시한 회로도이다.
도 8은 도 7의 하강 회로부를 보여주는 회로도이다.
* 도면의 주요부분에 대한 부호의 설명 *
Ce...방전셀, SF...서브필드,
PR...리셋 기간, PA...어드레스 기간,
PS...유지방전 기간, Vg...그라운드 전압,
1...플라즈마 표시 패널, 200...영상처리부,
202...논리제어부, 204...Y 구동부,
206...어드레스 구동부,
Vs...제 1 전압 또는 유지방전 전압,
Vset+Vs...제 2 전압 또는 상승 최고 전압,
Vnf...제 3 전압 또는 하강 최저 전압,
Va...제 4 전압 또는 어드레스 전압,
Vsch...스캔 하이 전압,
Vscl...제 5 전압 또는 스캔 로우 전압.
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로서, 더 상세하게는 플라즈마 디스플레이 패널의 제조비용 저감 및 방전 신뢰성 확보를 위한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 도면이다.
도 1을 참조하여 설명하면, 플라즈마 디스플레이 패널은 전극 구조는 패널의 수평방향에 평행하게 배치되는 주사전극 라인들과 유지전극 라인들이 있으며, 상기 주사전극 라인들 및 유지전극 라인들에 수직으로 교차하게 배치되는 어드레스 전극 라인들이 있다. 주사전극 라인, 유지전극 라인 및 어드레스 전극 라인이 교차하는 부분은 방전셀(Ce)을 구획하며, 상기 방전셀(Ce)은 플라즈마 디스플레이 패널의 한 화소로서의 역할을 한다. 방전셀(Ce)의 공간내에는 R, G, B 형광체 와 플라즈마 형성용 가스가 있으며, 상기 주사전극, 유지전극 및 어드레스 전극 각각에 인가되는 전압에 의해, 방전셀(Ce) 내부에 벽전하가 생성된다. 상기 벽전하에 의해 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 방전셀(Ce)들의 형광체가 여기되어 빛이 발생하게 된다.
도 2는 도 1에 플라즈마 디스플레이 패널의 각각의 전극에 인가되는 종래 구동 신호의 일예를 설명하기 위한 타이밍도이다.
플라즈마 디스플레이 패널(1)의 구동방법으로, 주로 사용되는 어드레스-디스플레이 분리 구동방법이 미국특허 제 5541618호에 개시되어 있다. 즉, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정개수 예컨대 8개의 서브필드들로 분할될 수 있으며, 각 서브필드는 리셋 구간과, 어드레스 구간 및, 유지방전 구간으로 분할된다.
도 1 및 도 2를 참조하여 설명하면, 한 서브필드(SF)는 리셋 기간(PR), 어드레스 기간(PA) 및 유지방전 기간(PS)을 구비하고, 어드레스전극(A), 유지전극(X) 및 주사전극(Y1~Yn)에 각각 구동신호가 인가된다.
먼저 리셋 기간(PR)은 모든 주사 전극 라인들(Y1, ... , Yn)에 대해 리셋펄스를 인가하여, 초기화 방전을 수행함으로써, 전체 방전셀(Ce)의 벽전하 상태를 초 기화한다. 어드레스 기간(PA)에 들어가기 전에 리셋 기간(PR)이 수행되며, 이는 전 화면에 걸쳐 수행하므로, 상당히 고르면서도 원하는 분포의 벽전하 배치를 만들 수 있다.
다음에, 어드레스 기간(PA)에는, 켜져야 할 셀을 선택하기 위해, 유지전극(X)에 바이어스 전압(V'b)이 인가되고, 주사전극(Y)에는 스캔 하이 전압(V'sch)이 인가되고, 주사전극 라인별(Y1, Y2, ..., Yn)로 스캔 로우 전압(V'scl)을 갖는 주사펄스가 인가된다. 어드레스 전극(A)에는 어드레스 전압(V'a)을 갖는 표시 데이터 신호가 인가된다.
다음에, 유지방전 기간(PS)에는, 어드레스 기간(PA)에서 선택된 켜져야 할 셀에서 유지방전이 수행되도록, 유지전극(X)과 주사전극(Y)에 유지방전 전압(V's)을 갖는 유지펄스를 교대로 인가한다. 이때, 유지방전을 수행하는 방전셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 방전셀들의 형광체가 여기되어 빛이 발생된다.
도 2에 도시된 종래의 구동신호는 플라즈마 디스플레이 패널의 구동장치로부터 생성되어 주사전극(Y), 유지전극(X), 어드레스 전극(A)에 각각 입력된다. 상기 각각의 전극에 서로 다른 구동신호가 인가되도록 구동장치를 제조하기 위해서는 제조비용이 높아진다는 문제점이 발생하게 된다. 따라서 종래의 구동신호는 플라즈마 디스플레이 패널의 제조비용의 관점에서 보면, 개선의 여지가 있다고 볼 수 있을 것이다.
본 발명은 상기와 같은 문제점을 해결하기 위하여, 플라즈마 디스플레이 패널의 제조비용 저감 및 방전 신뢰성 확보를 위한 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
상기와 같은 목적을 달성하기 위하여, 본 발명은 서로 대향 이격된 앞쪽 기판과 뒤쪽 기판을 갖고, 상기 기판들 사이에 주사전극 및 유지전극 라인들이 서로 나란하게 형성되고, 어드레스 전극 라인들이 상기 주사전극 및 유지전극 라인들에 대하여 교차되게 형성된 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 방전 디스플레이 패널의 구동 방법에 있어서,
리셋 단계는, 유지전극에, 그라운드 전압를 인가하고,
주사전극에,
(a) 제 1 전압을 인가하는 단계
(b) 제 1 전압에서 제 2 전압까지 상승기울기를 갖는 전압을 인가하는 단계
(c) 제 1 전압을 인가하는 단계
(d) 제 1 전압에서 제 3 전압까지 하강기울기를 갖는 전압을 인가하는 단계 를 포함하고,
어드레스 전극에, (b)단계에서 제 1 전압보다 낮고 그라운드 전압보다 높은 제 4 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법을 제공한다.
이러한 본 발명의 다른 특징에 의하면, 상기 어드레스 단계는,
유지전극에, 그라운드 전압을 인가하고,
주사전극에, 주사전극 라인별로 순차적으로 제 5 전압을 소정 시간 동안 인가하고,
어드레스 전극에, 켜져야 할 셀을 선택하도록, 상기 소정 시간 동안 제 4 전압을 인가할 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 유지방전 단계는,
유지전극 및 어드레스 전극에, 그라운드 전압을 인가하고,
주사전극에 정극성의 제 1 전압과 부극성의 제 1전압을 교대로 인가할 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 상승 기울기는 단계적으로 상승하는 상승 폭을 갖을 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 상승 폭은 점점 작아질 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 하강 기울기는 단계적으로 하강하는 하강 폭을 갖을 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상기 하강 폭은 점점 작아질 수 있다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한 다.
일본공개공보 1999-120924호에는 통상적인 플라즈마 디스플레이 패널의 구조가 개시되어 있다. 즉, 통상적인 플라즈마 디스플레이 패널의 앞쪽 및 뒤쪽 글라스 기판들 사이에는, 어드레스 전극 라인들(A1, A2, ... , Am), 유전층, Y 전극 라인들(Y1, ... , Yn), X 전극 라인들(X1, ... , Xn), 형광층, 격벽 및 일산화마그네슘 (MgO) 보호층이 마련되어 있다.
어드레스 전극 라인들(A1, A2, ... , Am)은 뒤쪽 글라스 기판의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층은 어드레스 전극 라인들(A1, A2, ... , Am)의 앞쪽에 도포된다. 아래쪽 유전층의 앞쪽에는 격벽들이 어드레스 전극 라인들(A1, A2, ... , Am)과 평행한 방향으로 형성된다. 이 격벽들은 각 디스플레이 셀의 방전 영역을 구획하고, 각 디스플레이 셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광층은 격벽들 사이에서 어드레스 전극 라인들(A1, A2, ... , Am) 상의 유전층의 앞에 도포되며, 순차적으로 적색발광 형광층, 녹색발광 형광층, 청색발광 형광층이 배치된다.
X 전극 라인들(X1, ... , Xn)과 Y 전극 라인들(Y1, ... , Yn)은 어드레스 전극 라인들(A1, A2, ... , Am)과 직교되도록 앞쪽 글라스 기판의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X 전극 라인(X1, ... , Xn)과 각 Y 전극 라인(Y1, ... , Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(Xnb, Ynb)이 결합되어 형성될 수 있다. 앞쪽 유전층은 X 전극 라인들 (X1, ... , Xn)과 Y 전극 라인들(Y1, ... , Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널을 보호하기 위한 보호층 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층의 뒤쪽에 전면 도포되어 형성된다. 방전 공간에는 플라즈마 형성용 가스가 밀봉된다.
플라즈마 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 리셋, 어드레스 및 유지방전 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 리셋 단계에서는 구동될 디스플레이 셀들의 전하 상태가 균일하게 된다. 어드레스 단계에서는, 선택될 디스플레이 셀들의 전하 상태와 선택되지 않을 디스플레이 셀들의 전하 상태가 설정된다. 유지방전 단계에서는, 선택될 디스플레이 셀들에서 디스플레이 방전이 수행된다. 이때, 디스플레이 방전을 수행하는 디스플레이 셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 디스플레이 셀들의 형광층이 여기되어 빛이 발생된다.
본 발명에 따른 플라즈마 디스플레이 패널구동방법은, 상기 구조의 플라즈마 디스플레이 패널에 한정되는 것이 아니며, 리셋구간을 가지는 모든 구동 파형에 의해 구동되는 플라즈마 디스플레이 패널에 적용될 수 있음에 유의해야 한다.
도 3은 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도 3을 참조하면, 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치는, 영상처리부(200), 논리제어부(202), 어드레스 구동부(206), Y 구동부(204) 및 플라즈마 표시 패널(1)을 포함한 다.
영상처리부(200)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8비트의 적색(R), 녹색(G), 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다.
논리제어부(202)는 영상처리부(200)로부터의 내부영상 신호를 입력받아 감마보정, APC(Automatic power control) 단계 등을 거쳐 어드레스 구동 제어신호(SA)와, Y 구동 제어신호(SY)를 출력한다.
어드레스 구동부(206)는, 논리제어부(202)로부터의 구동 제어신호들(SA, SY)중에서 어드레스 구동 제어신호(SA)를 처리하여 어드레스 전압을 갖는 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 플라즈마 표시 패널(1)의 어드레스 전극 라인들(A1, A2, ... , Am)에 인가한다. 또한 본 발명의 구동 방법에 따라, 리셋 단계에서, 주사전극에 상승 램프 신호가 인가되는 동안 주사전극과 유지전극 사이 및 주사전극과 어드레스 전극 사이의 큰 전위차로 인하여 강방전이 발생하는 것을 방지하기 위하여, 상기 상승 램프 신호가 인가되는 동안 어드레스 전극에 어드레스 전압을 갖는 바이어스 펄스를 인가한다. 즉, 유지전극과 어드레스 전극 사이의 전위차가 작아져 강방전이 발생할 가능성이 저감된다.
Y 구동부(204)는 논리제어부(202)로부터의 구동 제어 신호들(SA, SY)중에서 Y 구동 제어신호(SY)를 처리하여 플라즈마 표시 패널(1)의 주사 전극 라인들(Y1, ... , Yn)에 인가한다. 본 발명의 구동방법과 관련하여, Y 구동부(204)에서는 리셋 기간에 상승 램프 신호와 하강 램프 신호를 출력하고, 어드레스 기간에 스캔 하이 전압을 인가하고, 주사전극 라인들에 순차적으로 스캔 로우 전압을 갖는 주사펄스를 인가한다. 유지방전 기간에 정극성의 유지방전 전압과 부극성의 유지방전 전압을 교대로 갖는 유지펄스를 출력한다.
종래와 달리 본 발명의 플라즈마 디스플레이 패널의 구동방법을 실현하기 위한 플라즈마 디스플레이 패널의 구동장치에는 X 구동부가 없다. 이는 본 발명의 구동신호 중 유지전극(X)에 인가되는 구동신호는 모두 그라운드 전압이 인가되므로, 유지전극(X)에 인가되는 구동신호를 발생하기 위한 X 구동부를 제거할 수 있게 된다. 따라서 플라즈마 디스플레이 패널의 제조비용은 저감되게 된다.
한편, 안정적인 방전 신뢰성 확보를 위해, 본 발명의 주사전극(Y)에 인가되는 구동신호는, 종래의 유지전극(X)에 인가되는 구동신호를 대체하도록 조정되어야 한다. 이하에서 본 발명의 구동신호에 대해 상세히 설명하기로 한다.
도 4는 본 발명의 일 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도면을 참조하여 설명하면, 리셋 기간(PR)에서, 유지전극(X)에는 그라운드 전압(Vg)이 인가된다.
주사전극(Y)에는 그라운드 전압(Vg)으로부터 급격하게 상승하여 제 1 전압, 즉 유지방전 전압(Vs)이 인가되고, 다음에 제 1 전압(Vs)에서 제 2 전압까지 상승 기울기를 갖는 전압이 인가된다. 여기서 제 2 전압은 제 1 전압(Vs)보다 높은 상승 최고 전압(Vset+Vs)이다. 다음에, 제 2 전압(Vset+Vs)으로부터 급격하게 하강시킨 제 1전압(Vs)이 인가된다. 다음에, 제 1 전압(Vs)에서 제 3 전압까지 하강 기울기 를 갖는 전압이 인가된다. 제 3 전압은 하강 최저 전압(Vnf)으로 유지방전 전압 보다 낮다.
종래와 달리 유지전극(X)에는 그라운드 전압(Vg)이 인가되므로, 이를 보상하기 위하여, 주사전극(Y)에서는 특히 하강 램프 신호 인가 구간인, 제 1 전압(Vs)에서 제 3 전압(Vnf)까지 구간에서의 하강 기울기가 종래 보다 더 급격해진다.
어드레스 전극(A)에는, 주사전극(Y)에 상승 램프 신호가 인가되는 구간인, 제 1 전압(Vs)에서 제 2 전압(Vset+Vs)까지 구간동안, 제 4 전압인 어드레스 전압(Va)을 갖는 바이어스 펄스를 인가한다. 제 4 전압(Va)은 제 1 전압(Vs)보다 낮고, 그라운드 전압(Vg)보다는 높은 전압이다. 바이어스 펄스가 없다면, 상승 램프 신호 인가 구간에서, 주사전극(Y)과 유지전극(X) 사이, 그리고 주사전극(Y)과 어드레스 전극(A) 사이의 큰 전위차에 의해 강방전이 발생할 가능성이 생기게 된다. 또한 주사전극(Y)의 하강 램프 신호 인가 구간에서 종전보다 더 급격한 기울기를 가지므로, 각 전극 사이의 큰 전위차에 의해 강방전이 발생할 가능성이 있다. 상기 리셋 기간(PR)에서 강방전이 발생하면, 켜져야 할 셀을 선택하는 어드레스 기간(PA)후에, 유지방전을 수행하는 유지방전 기간(PS)에서, 상기 켜져야 할 셀로 선택되지 않은 셀에서도 유지방전이 일어날 수 있다. 이를 오방전이라고 하며, 상기 리셋기간(PR)에서의 영향으로 오방전이 발생할 가능성이 높아진다. 이를 방지하기 위하여, 리셋 기간(PR)에서 주사전극(Y)의 상승 램프 신호 인가 구간동안 어드레스 전극(A)에 제 4 전압(Va)을 갖는 바이어스 펄스를 인가한다. 한편, 바이어스 펄스를 인가하기 위하여 어드레스 전극에 제 4 전압(Va)을 인가하는 것은 어드레스 기간 (PR)에서 어드레스 전극에 인가되는 전압과 동일한 전압을 사용하므로, 플라즈마 디스플레이 패널의 전원공급장치로부터 별도의 전원을 공급받지 않아도 되는 장점이 있다.
어드레스 기간(PA)에서는, 유지전극(X)에 그라운드 전압(Vg)을 인가한다.
주사전극(Y)에 스캔 하이 전압(Vsch)을 인가하고, 주사전극 라인별(Y1, Y2, ..., Yn)로 순차적으로 제 5 전압인 스캔 로우 전압(Vscl)을 갖는 주사펄스를 소정시간 동안 인가한다. 즉, 플라즈마 디스플레이 패널(1)의 상부에서 하부 방향으로 순차적으로 스캔을 수행한다.
어드레스 전극(A)에서는, 켜져야 할 셀을 선택하기 위해, 주사펄스가 인가되는 동안에, 제 4 전압(Va)을 갖는 표시 데이터 신호를 인가한다. 주사펄스와 표시 데이터 신호의 전위차에 의해 켜져야 할 셀이 선택되어 방전셀 내부에 벽전하가 쌓이게 된다.
유지방전 기간(PS)에서는, 유지전극(X) 및 어드레스 전극(A)에 그라운드 전압(Vg)을 인가한다.
주사전극(Y)에는 정극성의 제 1 전압(Vs)과 부극성의 제 1 전압(Vs)이 교대로 인가된다. 상기 어드레스 기간(PA)에서 켜져야 할 셀로 선택된 방전셀 내부의 벽전압과 주사전극(Y)에 인가되는 제 1 전압(Vs)에 의해 방전이 개시되고, 유지된다.
도 5는 본 발명의 다른 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도 6은 본 발명의 또 다른 실시예로서, 플라즈마 디스플레이 패널의 구동신호에 대한 타이밍도이다.
도 5 및 도 6을 참조하여 설명하면, 도 5 및 도 6의 어드레스 기간 및 유지방전 기간에서의 구동신호는 도 4의 어드레스 기간 및 유지방전 기간의 구동 신호와 동일하다. 따라서 어드레스 기간(PA)에서는, 유지전극(X)에 그라운드 전압(Vg)을 인가한다.
주사전극(Y)에 스캔 하이 전압(Vsch)을 인가하고, 주사전극 라인별(Y1, Y2, ..., Yn)로 순차적으로 제 5 전압인 스캔 로우 전압(Vscl)을 갖는 주사펄스를 소정시간 동안 인가한다. 즉, 플라즈마 디스플레이 패널(1)의 상부에서 하부 방향으로 순차적으로 스캔을 수행한다.
어드레스 전극(A)에서는, 켜져야 할 셀을 선택하기 위해, 주사펄스가 인가되는 동안에, 제 4 전압(Va)을 갖는 표시 데이터 신호를 인가한다. 주사펄스와 표시 데이터 신호의 전위차에 의해 켜져야 할 셀이 선택되어 방전셀 내부에 벽전하가 쌓이게 된다.
유지방전 기간(PS)에서는, 유지전극(X) 및 어드레스 전극(A)에 그라운드 전압(Vg)을 인가한다.
주사전극(Y)에는 정극성의 제 1 전압(Vs)과 부극성의 제 1 전압(Vs)이 교대로 인가된다. 상기 어드레스 기간(PA)에서 켜져야 할 셀로 선택된 방전셀 내부의 벽전압과 주사전극(Y)에 인가되는 제 1 전압(Vs)에 의해 방전이 개시되고, 유지된다.
한편, 리셋 기간(PR)에서, 유지전극(X)에는 그라운드 전압(Vg)이 인가된다.
주사전극(Y)에는 그라운드 전압(Vg)으로부터 급격하게 상승하여 제 1 전압(Vs)이 인가되고, 다음에 제 1 전압(Vs)에서 제 2 전압(Vset+Vs)까지 상승 기울기를 갖으며 전압이 인가된다.
이때, 어드레스 전극(A)에는, 제 4 전압(Va)을 갖는 바이어스 펄스를 인가한다. 이로 인하여, 제 1 전압(Vs)에서 제 2 전압(Vset+Vs)까지의 구간동안에, 주사전극(Y)과 어드레스 전극(A) 사이의 전위차가 작아져, 방전셀 내부에서 강방전이 발생할 가능성이 저감된다.
또한, 방전셀 내부의 강방전이 발생할 가능성을 저감시키기 위해, 주사전극(Y)에서의 상승 기울기는 도 5와 같이 단계적으로 상승하는 상승 폭을 갖는 것을 특징으로 할 수 있다. 또한, 상기 상승 폭은 점점 작아지는 것을 특징으로 할 수 있다.
유지전극(X)과 주사전극(Y)의 전위차가, 제 1 전압(Vs)과 제 2 전압(Vset+Vs) 사이의 전압인 방전개시전압보다 높아지게 되는 경우에, 도 5와 같이 상승 기울기를 단계적으로 상승시키면, 상기 전위차가 연속적으로 방전개시전압보다 높아져 순간적인 방전개시로 인한 강방전이 발생하지 않고, 단계적으로 방전개시전압보다 높아져 약방전이 발생할 가능성이 많아진다.
또한 단계적으로 상승하는 상승 폭을 도 6과 같이 점점 작게 하면, 제 1 전압(Vs)과 제 2 전압(Vset+Vs) 사이의 방전개시전압에서의 상승 폭이 점점 작게 되어 약방전이 발생할 가능성이 더 높아지게 된다.
다음에, 제 2 전압(Vset+Vs)으로부터 급격하게 하강한 제 1 전압(Vs)이 주사전극(Y)에 인가된다.
다음에, 제 1 전압(Vs)에서 제 3 전압(Vnf)까지 하강 기울기를 갖는 전압이 인가된다.
X 구동부를 제거하기 위한 본 발명의 구동방법에 의하면, 종래보다 제 3 전압(Vnf)은 더 작아야 주사전극(Y)과 유지전극(X) 사이의 전위차가 방전개시전압보다 커져 방전셀 내부에서 방전이 발생하여 방전셀을 초기화시키게 된다. 본 발명의 구동신호에서 제 3 전압(Vnf)이 종래보다 더 작은 크기의 전압이므로, 하강 기울기의 크기는 종래보다 더 급격해 진다. 급격해진 하강기울기로 인해 주사전극(Y)과 유지전극(X) 사이의 전위차가 방전개시전압보다 순간적으로 커져 방전셀 내부에서 강방전이 발생할 가능성이 많아진다. 이로 인하여, 유지방전 기간에서 켜져야 할 셀로 선택되지 않은 방전셀에서 오방전이 발생할 가능성이 생긴다.
이를 방지하기 위하여, 하강 기울기는 도 5에 도시된 바와 같이 단계적으로 하강하는 하강 폭을 갖는 것을 특징으로 할 수 있다.
유지전극(X)과 주사전극(Y)의 전위차가, 제 1 전압(Vs)과 제 3 전압(Vnf) 사이의 전압인 방전개시전압보다 높아지게 되는 경우에, 도 5와 같이 하강 기울기를 단계적으로 하강시키면, 상기 전위차가 연속적으로 방전개시전압보다 높아져 순간적인 방전개시로 인한 강방전이 발생하지 않고, 단계적으로 방전개시전압보다 높아져 약방전이 발생할 가능성이 많아진다.
또한 상기 하강 폭을 도 6과 같이 점점 작게 하면, 제 1 전압(Vs)과 제 3 전 압(Vnf) 사이에 있는 방전개시전압 근방에서의 하강 폭이 점점 작게 되어 약방전이 발생할 가능성이 더 높아지게 된다.
상기 하강 기울기를 단계적으로 하는 방법에 대해서는 이하에서 설명하기로 한다.
도 7은 도 3의 구동장치 중 Y 구동부를 도시한 회로도이다.
도 8은 도 7의 하강 회로부를 보여주는 회로도이다.
이하에서 도 7 및 도 8을 참조하여 도 5 및 도 6의 주사전극에 인가되는 구동신호의 발생을 설명한다. 먼저 리셋 기간(PR)에서 스위치 M1이 턴 온 되며, 동시에 스위치 M3, M5, M9도 턴 온 되어 패널 커패시터(Cp)에 제 1 전압이 인가된다. 다음에 제 2 전압(Vset+Vs)을 인가하기 위해, 스위치 M1이 턴 온 되어 제 1 전압(Vs)이커패시터(Cset)에 충전되고, Vset 전압이 공급되도록 스위치 M4가 턴 온 되며, 동시에 스위치 M5와 M9가 턴 온 되어 패널 커패시터에 상승 기울기를 갖는 전압이 인가되고, 최종적으로는 제 2 전압(Vset+Vs)을 갖는 전압이 인가된다. 다음에 하강 회로부(700)로부터의 전압은 스위치 M9가 턴 온 됨으로써 패널 커패시터(Cp)에 인가된다. 하강 회로부(700)로부터는 하강 기울기를 갖는 전압이 인가되고, 최종적으로는 제 3 전압(Vnf)을 갖는 전압이 인가된다.
다음에 어드레스 기간(PA)에서 그라운드 전압(Vg)은 스위치 M0가 턴 온 되고, 동시에 스위치 M3,M5,M9 가 턴 온 되어 패널 커패시터(Cp)에 인가된다.
스캔 로우 전압(Vscl)이 스위치 M6 과 M7이 턴 온 되어 커패시터(Csc)에 충전되며, 스캔 하이 전압(Vsch)이 공급되어 스위치 M8이 턴 온 되어 패널 커패시터 (Cp)에 계속적으로 스캔 하이 전압(Vsch)이 인가된다. 한편, 스캔 로우 전압(Vscl)은 스위치 M6 과 M7이 턴 온 되고, 스위치 M8은 턴 오프 되며, 스위치 M9가 턴 온 되어 패널 커패시터(Cp)에 인가된다.
다음에 유지방전 기간(PS)에서 스위치 M1이 턴 온 되고, 동시에 스위치M3,M5,M9 가 턴온 되어 패널 커패시터(Cp)에 정극성의 제 1 전압(Vs)이 인가된다. 부극성의 제 1 전압(-Vs)은 스위치 M2가 턴 온 되고, 동시에 스위치 M3,M5,M9 가 턴 온 되어 패널 커패시터(Cp)에 인가된다. 한편, 에너지 회수 회로(ERC)는 패널 커패시터(Cp)에 전하를 충전 또는 방전하여 에너지를 회수하는 기능을 한다.
한편, 도 8의 하강 회로부(700)는 단계적 하강에 의한 하강 폭을 갖는 하강 기울기를 제공한다. 그 동작을 살펴보면, 도 7의 패널 커패시터(Cp)로부터의 전하가 스위치 M10을 통해 커패시터(Cdump)에 저장된다. 전하가 커패시터(Cdump)에 축적됨에 따라 스위치 M10의 소스 단자의 전압이 증가하여 스위치 M10의 게이트 단자와 비교하여 높아지면 스위치 M10은 턴 오프 된다. 스위치 M10이 턴 오프 되면, 커패시터(Cdump)에 저장된 전하는 다이오드(Dc)와 저항(Rd)를 통해 방전되고, 충분히 방전되면 다시 스위치 M10은 턴 온 되어 상기 동작을 반복 수행한다. 이러한 패널 커패시터(Cp)에 저장된 전압을 하강시키고, 스위치(M10)를 턴 오프 하는 동작은 패널 커패시터(Cp)에 남아있는 전압이 제 3 전압(Vnf)이될 때까지 반복한다. 따라서 도 5의 단계적 하강에 의한 하강 폭을 갖는 하강기울기가 제공될 수 있다.
한편, 상기 저항(Rd)을 가변 저항으로 사용하면, 커패시터(Cdump)로부터 방전되는 변동 폭을 조절할 수 있다. 일단 하강 기울기는 저항(Rd)와 커패시터 (Cdump)의 시정수에 비례한다. 따라서 가변 저항을 점점 큰 것을 사용할수록, 단계적 하강 폭은 점점 줄어들 것이다. 이를 이용하여 도 6에 나타난 단계적 하강 폭이 점점 작아지는 하강기울기를 제공할 수 있다.
상기한 바와 같은 본 발명의 따르면, 다음과 같은 효과를 얻을 수 있다.
첫째, X 구동부가 없는 플라즈마 디스플레이 패널의 구동방법을 제공하므로, 제조비용의 저감 효과가 있다.
둘째, X 구동부가 없어도 방전 안전을 위해, 리셋 기간에 어드레스 전극을 인가하므로, 방전 신뢰성이 확보된다.
셋째, 또한 리셋 기간에 주사전극에 인가되는 상승 램프 함수의 상승 기울기와 하강 램프함수의 하강 기울기를 단계적으로 상승 또는 하강시킴으로써 강방전 발생 가능성을 저감하므로, 방전 신뢰성이 더 확보된다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (7)

  1. 서로 대향 이격된 앞쪽 기판과 뒤쪽 기판을 갖고, 상기 기판들 사이에 주사전극 및 유지전극 라인들이 서로 나란하게 형성되고, 어드레스 전극 라인들이 상기 주사전극 및 유지전극 라인들에 대하여 교차되게 형성된 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 상기 서브필드들 각각에서 리셋, 어드레스, 및 유지방전 단계들이 수행되는 방전 디스플레이 패널의 구동 방법에 있어서,
    상기 리셋 단계는,
    상기 유지전극에, 그라운드 전압을 인가하고,
    상기 주사전극에, (a) 제 1 전압을 인가하는 단계; (b) 상기 제 1 전압에서 제 2 전압까지 상승 기울기를 갖는 전압을 인가하는 단계; (c) 상기 제 1 전압을 인가하는 단계; 및 (d) 상기 제 1 전압에서 제 3 전압까지 하강 기울기를 갖는 전압을 인가하는 단계를 포함하고,
    상기 어드레스 전극에, 상기 (b) 단계에서 제 1 전압보다 낮고 그라운드 전압보다 높은 제 4 전압을 인가하고,
    상기 상승 기울기는 단계적으로 상승하는 상승 폭을 갖고, 상기 하강 기울기는 단계적으로 하강하는 하강 폭을 갖고,
    상기 단계적으로 상승하는 상승 기울기의 상승 폭은 점점 작아지고, 상기 단계적으로 하강하는 하강 기울기의 하강 폭은 점점 작아지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서, 상기 어드레스 단계는,
    상기 유지전극에, 그라운드 전압을 인가하고,
    상기 주사전극에, 주사전극 라인별로 순차적으로 제 5 전압을 소정 시간 동 안 인가하고,
    상기 어드레스 전극에, 켜져야 할 셀을 선택하도록, 상기 소정 시간동안 상기 제 4 전압을 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1항에 있어서, 상기 유지방전 단계는,
    상기 유지전극 및 어드레스 전극에, 그라운드 전압을 인가하고,
    상기 주사전극에 정극성의 제 1 전압과 부극성의 제 1전압을 교대로 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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