KR100599620B1 - Plasma display panel - Google Patents
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Abstract
본 발명은 주사 전극과 유지 전극을 함께 구동하는 통합 보드에 적합한 표시 전극들의 단자부 구조를 갖는 플라즈마 디스플레이 패널에 관한 것이다.The present invention relates to a plasma display panel having a terminal portion structure of display electrodes suitable for an integrated board for driving scan electrodes and sustain electrodes together.
본 발명에 따른 플라즈마 디스플레이 패널은, 서로 대향 배치되는 제1 기판 및 제2 기판과; 제1 기판에 형성되는 어드레스 전극들과; 제2 기판의 일면에서 어드레스 전극과 직교하는 방향을 따라 형성되는 주사 전극들과 유지 전극들을 구비하는 표시 전극들과; 제1 기판과 제2 기판 사이에 배치되어 양 기판을 접합시키는 밀봉재를 포함한다. 주사 전극들은 제2 기판의 일측 가장자리로 인출되어 비표시 영역 상에 주사 전극 단자부들을 형성하고, 유지 전극들은 연결 배선에 의해 전기적으로 연결됨과 아울러 적어도 하나의 유지 전극이 주사 전극 단자부들과 같은 방향의 가장자리로 인출되어 유지 전극 단자부를 형성한다. 연결 배선은 밀봉재의 내측과 외측에 걸쳐 형성된다.A plasma display panel according to the present invention includes: a first substrate and a second substrate disposed to face each other; Address electrodes formed on the first substrate; Display electrodes including scan electrodes and sustain electrodes formed in a direction orthogonal to the address electrode on one surface of the second substrate; It includes a sealing material disposed between the first substrate and the second substrate to bond both substrates. The scan electrodes are led out to one edge of the second substrate to form scan electrode terminal portions on the non-display area, the sustain electrodes are electrically connected by connecting wires, and the at least one sustain electrode is in the same direction as the scan electrode terminal portions. It is drawn out to the edge to form the sustain electrode terminal portion. The connection wiring is formed over the inside and the outside of the sealing material.
플라즈마, 단자부, 어드레스전극, 표시전극, 주사전극, 유지전극, 표시영역, 비표시영역, 방열Plasma, terminal, address electrode, display electrode, scan electrode, sustain electrode, display area, non-display area, heat radiation
Description
도 1은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 평면도이다.1 is a plan view of a plasma display panel according to an exemplary embodiment of the present invention.
도 2는 도 1의 부분 확대도이다.FIG. 2 is a partially enlarged view of FIG. 1.
도 3은 접속 유닛이 설치된 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 평면도이다.3 is a plan view of a plasma display panel according to an embodiment of the present invention, in which a connection unit is installed.
도 4는 표시 영역의 내부 구조를 설명하기 위해 도시한 플라즈마 디스플레이 패널의 부분 분해 사시도이다.4 is a partially exploded perspective view of the plasma display panel illustrated to explain an internal structure of the display area.
도 5는 도 4에 도시한 제2 기판의 부분 확대 단면도이다.FIG. 5 is a partially enlarged cross-sectional view of the second substrate illustrated in FIG. 4.
도 6은 본 발명의 플라즈마 디스플레이 패널에 적용 가능한 구동 파형을 나타낸 도면이다.6 is a view showing a drive waveform applicable to the plasma display panel of the present invention.
도 7은 유지 전극 단자부의 다른 구성예를 도시한 플라즈마 디스플레이 패널의 부분 평면도이다.7 is a partial plan view of a plasma display panel showing another configuration example of the sustain electrode terminal portion.
도 8과 도 9는 각각 연결 배선의 단면 구조를 설명하기 위해 도시한 플라즈마 디스플레이 패널의 부분 단면도이다.8 and 9 are partial cross-sectional views of the plasma display panel shown for explaining the cross-sectional structure of the connection wiring, respectively.
도 10은 연결 배선의 다른 구성예를 도시한 플라즈마 디스플레이 패널의 평면도이다.10 is a plan view of a plasma display panel showing another configuration example of the connection wiring.
도 11과 도 12는 각각 방열 부재의 구성을 설명하기 위해 도시한 플라즈마 디스플레이 패널의 부분 단면도이다.11 and 12 are partial cross-sectional views of the plasma display panel shown for explaining the structure of the heat radiating member, respectively.
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 보다 상세하게는 표시 전극을 구성하는 주사 전극과 유지 전극의 단자부 구조를 개선한 플라즈마 디스플레이 패널에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel, and more particularly, to a plasma display panel having improved terminal structure of scan electrodes and sustain electrodes.
일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel; PDP)은 방전셀 내의 기체 방전에 의해 생성된 진공 자외선으로 형광체를 여기시켜 화상을 구현하는 표시장치로서, 박형이며 고해상도의 대화면 구성이 가능한 장점이 있다. 이러한 PDP는 인가되는 구동 전압 파형의 형태와 방전셀 구조에 따라 직류형과 교류형으로 구분되는데, 통상 3전극 면방전 구조의 교류형 PDP가 널리 사용되고 있다.In general, a plasma display panel (PDP) is a display device for realizing an image by exciting phosphors by vacuum ultraviolet rays generated by gas discharge in a discharge cell. The plasma display panel (PDP) is thin and has a high-resolution large screen configuration. Such PDPs are classified into a direct current type and an alternating current type according to the shape of the driving voltage waveform and the discharge cell structure. An AC PDP having a three-electrode surface discharge structure is widely used.
종래의 일반적인 교류형 PDP에서는 각 방전셀에 대응하여 후면 기판에 어드레스 전극과 격벽 및 형광체층이 형성되고, 전면 기판에 어드레스 전극과 직교하는 방향을 따라 주사 전극과 유지 전극의 쌍으로 구성되는 표시 전극이 형성된다. 어드레스 전극과 표시 전극은 유전층으로 덮여지며, 방전셀 내부는 방전 가스(주로 Ne-Xe 혼합 가스)로 채워진다.In the conventional general AC PDP, an address electrode, a partition, and a phosphor layer are formed on a rear substrate corresponding to each discharge cell, and a display electrode composed of a pair of scan electrodes and sustain electrodes along a direction orthogonal to the address electrodes on the front substrate. Is formed. The address electrode and the display electrode are covered with a dielectric layer, and the discharge cell is filled with discharge gas (mainly Ne-Xe mixed gas).
일반적으로 교류형 PDP는 한 프레임이 복수의 서브필드로 분할 구동되며, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다.In general, in the AC PDP, one frame is divided into a plurality of subfields, and each subfield includes a reset period, an address period, and a sustain period.
리셋 기간은 방전셀에 어드레싱 동작이 원활히 수행될 수 있도록 각 방전셀 의 상태를 초기화하는 기간이고, 어드레스 기간은 켜지는 방전셀과 켜지지 않는 방전셀을 선택하여 켜지는 방전셀에 벽전하를 쌓아두는 동작을 수행하는 기간이다. 그리고 유지 기간은 켜질 방전셀에 실제로 영상을 표시하기 위한 방전을 수행하는 기간이다.The reset period is a period in which the state of each discharge cell is initialized so that the addressing operation can be performed smoothly in the discharge cell. The address period is configured to accumulate wall charges in the discharge cells that are turned on by selecting the discharge cells that are turned on and the discharge cells that are not turned on. The period of time to perform an operation. The sustain period is a period in which discharge for actually displaying an image is performed on the discharge cells to be turned on.
이러한 동작을 수행하기 위해서 유지 기간에서는 주사 전극과 유지 전극에 교대로 유지 방전 펄스가 인가되고, 리셋 기간과 어드레스 기간에서는 주사 전극에 리셋 파형과 주사 파형이 인가된다. 따라서 주사 전극을 구동하기 위한 주사 구동 보드와, 유지 전극을 구동하기 위한 유지 구동 보드가 별개로 존재하며, 주사 전극과 주사 구동 보드 및 유지 전극과 유지 구동 보드를 연결하기 위한 접속 구조가 별개로 요구된다.In order to perform such an operation, a sustain discharge pulse is applied to the scan electrode and the sustain electrode alternately in the sustain period, and the reset waveform and the scan waveform are applied to the scan electrode in the reset period and the address period. Therefore, a scan drive board for driving the scan electrode and a sustain drive board for driving the sustain electrode exist separately, and a connection structure for connecting the scan electrode and the scan drive board and the sustain electrode and the sustain drive board is separately required. do.
통상의 PDP에서는 주사 전극들이 전면 기판의 일측 가장자리로 인출되어 주사 전극 단자부를 형성하고, 연성 인쇄회로(flexible printed circuit; FPC)가 이 단자부에 접속되어 주사 전극과 주사 구동 보드를 전기적으로 연결하며, 유지 전극들이 전면 기판의 다른 일측 가장자리로 인출되어 유지 전극 단자부를 형성하고, 연성 인쇄회로가 이 단자부에 접속되어 유지 전극과 유지 구동 보드를 전기적으로 연결하게 된다.In a typical PDP, scan electrodes are drawn to one edge of the front substrate to form a scan electrode terminal portion, and a flexible printed circuit (FPC) is connected to the terminal portion to electrically connect the scan electrode and the scan drive board. The storage electrodes are led to the other edge of the front substrate to form the storage electrode terminal portion, and the flexible printed circuit is connected to the terminal portion to electrically connect the storage electrode and the sustain driving board.
이와 같이 종래의 PDP는 별개의 주사 구동 보드와 유지 구동 보드를 샤시 베이스에 설치하고, 별도의 공정으로 주사 전극 단자부와 유지 전극 단자부에 연성 인쇄회로를 접속하는 작업이 요구되므로, 제조 공정수가 늘어나고 제조 비용이 증가한다는 문제점이 있다. 또한 전술한 PDP는 방전셀 내에 방전을 반복해서 일으켜 화상을 표시함에 따라, 구동시 그 내부에 많은 열이 발생하며, 화면의 휘도를 높이기 위해 방전 강도를 높일수록 더 많은 열이 발생한다는 문제점이 있다.As described above, in the conventional PDP, a separate scan drive board and a sustain drive board are installed in the chassis base, and a separate process is required to connect a flexible printed circuit to the scan electrode terminal part and the sustain electrode terminal part. There is a problem that the cost increases. In addition, the above-described PDP repeatedly displays a discharge in the discharge cell to display an image, and thus, a large amount of heat is generated during driving, and more heat is generated as the discharge intensity is increased to increase the brightness of the screen. .
따라서 본 발명은 상기한 문제점을 해소하기 위한 것으로서, 본 발명의 목적은 주사 전극과 유지 전극을 함께 구동하는 통합 보드 및 이 통합 보드에 적합한 표시 전극들의 단자부 구조를 가지며, 방열 효율이 우수한 플라즈마 디스플레이 패널을 제공하는데 있다.Accordingly, an object of the present invention is to solve the above problems, and an object of the present invention is to provide an integrated board for driving a scan electrode and a sustain electrode together, and a terminal part structure of display electrodes suitable for the integrated board. To provide.
상기의 목적을 달성하기 위하여 본 발명은,In order to achieve the above object, the present invention,
서로 대향 배치되는 제1 기판 및 제2 기판과, 제1 기판에 형성되는 어드레스 전극들과, 제2 기판의 일면에서 어드레스 전극과 직교하는 방향을 따라 형성되는 주사 전극들과 유지 전극들을 구비하는 표시 전극들과, 제1 기판과 제2 기판 사이에 배치되어 양 기판을 접합시키는 밀봉재를 포함하며, 주사 전극들은 제2 기판의 일측 가장자리로 인출되어 비표시 영역 상에 주사 전극 단자부들을 형성하고, 유지 전극들은 연결 배선에 의해 전기적으로 연결됨과 아울러 적어도 하나의 유지 전극이 주사 전극 단자부들과 같은 방향의 가장자리로 인출되어 유지 전극 단자부를 형성하며, 연결 배선이 밀봉재의 내측과 외측에 걸쳐 형성되는 플라즈마 디스플레이 패널을 제공한다.A display having first and second substrates disposed opposite to each other, address electrodes formed on the first substrate, and scan electrodes and sustain electrodes formed along a direction orthogonal to the address electrodes on one surface of the second substrate And a sealing material disposed between the electrodes and the first substrate and the second substrate to bond the two substrates, wherein the scan electrodes are drawn to one edge of the second substrate to form the scan electrode terminal portions on the non-display area, and hold it. The electrodes are electrically connected by connecting wirings, and at least one storage electrode is drawn out to the edge in the same direction as the scan electrode terminal portions to form the storage electrode terminal portions, and the connecting wirings are formed on the inside and outside of the sealing material. Provide a panel.
상기 주사 전극 단자부들과 이와 이웃한 유지 전극 단자부는 단일의 접속 유닛에 접속된다. 상기 표시 전극들은 어드레스 전극의 길이 방향을 따라 배열되는 적어도 2개의 전극군으로 분리되고, 각 전극군 별로 별개의 접속 유닛에 접속될 수 있다.The scan electrode terminal portions and the sustain electrode terminal portion adjacent thereto are connected to a single connection unit. The display electrodes may be divided into at least two electrode groups arranged along the length direction of the address electrode, and may be connected to separate connection units for each electrode group.
상기 연결 배선은 흑색 전극층과 백색 전극층의 적층 구조로 이루어지거나, 백색 전극층으로 이루어질 수 있다.The connection wiring may be formed of a stacked structure of a black electrode layer and a white electrode layer, or may be formed of a white electrode layer.
상기 플라즈마 디스플레이 패널은 연결 배선과 이어지면서 밀봉재 내측에서 표시 영역의 장변측 가장자리 바깥을 둘러싸는 연장부를 더욱 포함할 수 있으며, 연장부는 적어도 표시 영역의 장변측 가장자리 바깥을 둘러싸는 길이를 가지며 형성된다.The plasma display panel may further include an extension part connected to the connection line to surround the outside of the long side edge of the display area inside the sealing material, and the extension may have a length at least surrounding the outside of the long side edge of the display area.
상기 플라즈마 디스플레이 패널은 밀봉재 외측의 연결 배선 위를 덮는 방열 부재를 더욱 포함할 수 있으며, 방열 부재는 실리콘층 또는 흑연층으로 이루어질 수 있다.The plasma display panel may further include a heat dissipation member covering the connection line outside the sealing material, and the heat dissipation member may be formed of a silicon layer or a graphite layer.
이하, 첨부한 도면을 참고하여 본 발명의 바람직한 실시예를 보다 상세하게 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 1 내지 도 3은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 평면도이고, 도 4는 표시 영역의 내부 구조를 설명하기 위해 도시한 플라즈마 디스플레이 패널의 부분 분해 사시도이며, 도 5는 도 4에 도시한 제2 기판의 확대 단면도이다.1 to 3 are plan views of a plasma display panel according to an embodiment of the present invention, FIG. 4 is a partially exploded perspective view of the plasma display panel shown to explain the internal structure of the display area, and FIG. It is an expanded sectional view of the 2nd board | substrate shown.
먼저 도 4와 도 5를 참고하여 표시 영역의 내부 구조에 대해 설명한다.First, the internal structure of the display area will be described with reference to FIGS. 4 and 5.
도면을 참고하면, 플라즈마 디스플레이 패널(PDP)은 제1 기판(2)과 제2 기판(4)이 임의의 간격을 두고 서로 대향 배치되고, 양 기판의 사이 공간에는 방전셀들 (6R, 6G, 6B)이 마련되어 각 방전셀(6R, 6G, 6B)의 독립적인 방전 매커니즘에 의한 가시광 방출로 임의의 칼라 영상을 구현한다.Referring to the drawing, in the plasma display panel PDP, the
상기 제1 기판(2)의 내면에는 일방향(도면의 y축 방향)을 따라 어드레스 전극들(8)이 형성되고, 어드레스 전극들(8)을 덮으면서 제1 기판(2) 전체에 제1 유전층(10)이 형성된다. 어드레스 전극(8)은 일례로 스트라이프 패턴으로 이루어져 이웃한 어드레스 전극(8)과 소정의 간격을 두고 나란하게 위치한다.
제1 유전층(10) 위에는 격벽(12), 일례로 격자 모양의 폐쇄형 격벽이 형성되어 방전셀들(6R, 6G, 6B)을 구획하며, 격벽(12)의 네 측면과 제1 유전층(10) 상면에 걸쳐 적색, 녹색 또는 청색의 형광체층(14R, 14G, 14B)이 위치한다. 격벽(12)의 형상은 전술한 구조에 한정되지 않고 스트라이프형 또는 격자 모양 이외의 다른 폐쇄형 구조로 이루어질 수 있다.A
그리고 제1 기판(2)에 대향하는 제2 기판(4)의 일면에는 어드레스 전극(8)과 직교하는 방향(도면의 x축 방향)을 따라 주사 전극(16)과 유지 전극(18)의 쌍으로 구성되는 표시 전극들(20)이 형성되고, 표시 전극들(20)을 덮으면서 제2 기판(4) 전체에 투명한 제2 유전층(22)과 MgO 보호막(24)이 위치한다.A pair of
상기 주사 전극(16)과 유지 전극(18)은 각 방전셀(6R, 6G, 6B)의 외곽부에 한 쌍이 대응되게 형성되는 버스 전극(16a, 18a)과, 버스 전극(16a, 18a)으로부터 각 방전셀(6R, 6G, 6B) 내부를 향해 연장되어 한 쌍이 마주보도록 형성되는 돌출 전극(16b, 18b)으로 이루어질 수 있다. 돌출 전극(16b, 18b)은 방전셀(6R, 6G, 6B) 내부에서 플라즈마 방전을 일으키는 역할을 하며, 통상 ITO(Indium Tin Oxide)로 이루어진다. 버스 전극(16a, 18a)은 돌출 전극들(16b, 18b)에 구동 전압을 인가하는 역할을 하며, 화면의 콘트라스트 확보를 위한 흑색 전극층(26)과 도전성이 우수한 백색 전극층(28)의 적층 구조로 이루어질 수 있다.The
전술한 제1 기판(2)과 제2 기판(4)은 프릿(frit)과 같은 밀봉재(30, 도 1 참고)에 의해 가장자리가 일체로 접합되고, 방전셀(6R, 6G, 6B) 내부에 방전 가스(주로 Ne-Xe 혼합 가스)가 채워진 상태로 밀봉되어 PDP를 구성한다.The
이러한 PDP는 방전셀들(6R, 6G, 6B)이 위치하는 실질적인 표시가 이루어지는 표시 영역(100, 도 1 참고)과, 표시 영역(100)의 외곽을 따라 설정되는 비표시 영역(200, 도 1 참고)을 구비한다. 상기 어드레스 전극들(8)과 표시 전극들(20)은 각각 제1 기판(2)과 제2 기판(4)의 일측 가장자리로 인출되어 비표시 영역(200) 상에 단자부를 형성하며, 이 단자부에 연성 인쇄회로(FPC)와 같은 접속 유닛(32, 도 3 참고)이 접속되어 PDP 구동에 필요한 전압을 인가받는다. 도면에서는 편의상 표시 전극 단자부들과 여기에 접속되는 접속 유닛만을 도시하였다.The PDP includes a display area 100 (refer to FIG. 1) in which a substantial display in which discharge
여기서, 본 실시예의 PDP는 주사 전극(16)과 유지 전극(18)을 함께 구동하는 통합 보드(도시하지 않음)을 구비하며, 이 통합 보드에 적합한 표시 전극(20)의 단자부 구조를 제공한다. 통합 보드의 실현은 본 실시예의 PDP가 유지 전극(18)에 일정한 기준 전압만을 인가한 상태에서 리셋 기간과 어드레스 기간 및 유지 기간에서 주사 전극(16)에 리셋 파형과 주사 파형 및 유지 방전 펄스를 인가하는 구동 방식에 근거할 수 있다.Here, the PDP of this embodiment includes an integrated board (not shown) for driving the
도 6을 참고하여 본 발명에 적용 가능한 PDP 구동 파형에 대해 설명한다. 아 래에서는 편의상 하나의 방전셀을 구성하는 주사 전극(이하 'Y 전극'이라 한다)과 유지 전극(이하 'X 전극'이라 한다) 및 어드레스 전극(이하 'A 전극'이라 한다)에 인가되는 구동 파형에 대해서만 설명한다. 도시한 구동 파형에서 Y 전극과 X 전극에 인가되는 전압은 통합 보드에서 공급되고, A 전극에 인가되는 전압은 어드레스 버퍼 보드에서 공급된다. 이 때, X 전극은 기준 전압(도 6에서는 접지 전압)만을 인가받으므로 X 전극에 인가되는 전압에 대해서는 설명을 생략한다.A PDP driving waveform applicable to the present invention will be described with reference to FIG. 6. For convenience, the driving is applied to the scan electrode (hereinafter referred to as the 'Y electrode'), the sustain electrode (hereinafter referred to as the 'X electrode') and the address electrode (hereinafter referred to as the 'A electrode') constituting one discharge cell for convenience. Only waveforms will be described. In the illustrated driving waveform, the voltage applied to the Y electrode and the X electrode is supplied from the integrated board, and the voltage applied to the A electrode is supplied from the address buffer board. In this case, since the X electrode receives only the reference voltage (the ground voltage in FIG. 6), the description of the voltage applied to the X electrode is omitted.
도 6을 참고하면, 하나의 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지며, 리셋 기간은 상승 기간과 하강 기간으로 이루어진다.Referring to FIG. 6, one subfield includes a reset period, an address period, and a sustain period, and the reset period includes a rising period and a falling period.
리셋 기간의 상승 기간에서는 A 전극을 기준 전압(도 6에서는 0V)으로 유지한 상태에서 Y 전극의 전압을 Vs 전압에서 Vset 전압까지 점진적으로 증가시킨다. 도 6에서는 Y 전극의 전압이 램프 형태로 증가하는 것을 도시하였다. Y 전극의 전압이 증가하는 중에 Y 전극과 X 전극 사이 및 Y 전극과 A 전극 사이에 미약한 방전이 일어나면서 Y 전극에 (-) 벽전하가 형성되고, X 전극 및 A 전극에 (+) 벽전하가 형성된다. 리셋 기간에서는 모든 방전셀의 상태를 초기화해야 하므로 Vset 전압은 모든 조건의 방전셀에서 방전이 일어날 수 있을 정도의 높은 전압이다.In the rising period of the reset period, the voltage of the Y electrode is gradually increased from the Vs voltage to the Vset voltage while the A electrode is maintained at the reference voltage (0 V in FIG. 6). In FIG. 6, the voltage of the Y electrode is increased in the form of a lamp. While the voltage of the Y electrode increases, a weak discharge occurs between the Y electrode and the X electrode and between the Y electrode and the A electrode, and a negative wall charge is formed on the Y electrode, and a positive wall on the X electrode and the A electrode. An electric charge is formed. In the reset period, since the state of all the discharge cells must be initialized, the voltage Vset is high enough to cause the discharge in all the discharge cells.
이어서, 리셋 기간의 하강 기간에서는 Y 전극의 전압을 Vs 전압에서 Vfn 전압까지 점진적으로 감소시킨다. 그러면 Y 전극과 X 전극 사이 및 Y 전극과 A 전극 사이에서 미약한 방전이 일어나면서 Y 전극에 형성된 (-) 벽전하와 X 및 A 전극에 형성된 (+) 벽전하가 소거된다. 이로써 X 전극과 Y 전극 사이의 벽전압이 거의 0V가 되어, 어드레스 기간에서 어드레스 방전이 일어나지 않은 방전셀이 유지 기간에 서 오방전하는 것을 방지할 수 있다.Then, in the falling period of the reset period, the voltage of the Y electrode is gradually decreased from the voltage of Vs to the voltage of Vfn. Then, a weak discharge occurs between the Y electrode and the X electrode and between the Y electrode and the A electrode, and the negative wall charges formed on the Y electrode and the positive wall charges formed on the X and A electrodes are erased. As a result, the wall voltage between the X electrode and the Y electrode becomes almost 0 V, whereby the discharge cells in which the address discharge has not occurred in the address period can be prevented from being erroneously discharged in the sustain period.
다음으로, 어드레스 기간에서 켜질 방전셀을 선택하기 위해 Y 전극과 A 전극에 각각 VscL 전압을 가지는 주사 펄스 및 Va 전압을 가지는 어드레스 펄스를 인가한다. 그리고 선택되지 않은 Y 전극은 VscL 전압보다 높은 VscH 전압으로 바이어스하고, 켜지지 않을 방전셀의 A 전극에는 기준 전압을 인가한다. 그러면 선택된 방전셀에서 A 전극과 Y 전극 사이에 방전이 일어나서 Y 전극에 (+) 벽전하가 형성되고, A 전극 및 X 전극에 각각 (-) 벽전하가 형성된다. 그 결과 Y 전극과 X 전극 사이에 Y 전극의 전위가 X 전극의 전위에 대해 높도록 벽전압(Vwxy)이 형성된다.Next, in order to select the discharge cells to be turned on in the address period, a scan pulse having a VscL voltage and an address pulse having a Va voltage are applied to the Y electrode and the A electrode, respectively. The non-selected Y electrode biases the VscH voltage higher than the VscL voltage, and applies a reference voltage to the A electrode of the discharge cell that will not be turned on. Then, a discharge occurs between the A electrode and the Y electrode in the selected discharge cell, thereby forming positive wall charges on the Y electrode and negative wall charges on the A electrode and the X electrode, respectively. As a result, the wall voltage Vwxy is formed between the Y electrode and the X electrode such that the potential of the Y electrode is high with respect to the potential of the X electrode.
이어서, 유지 기간에서는 어드레스 방전이 일어난 방전셀에 대하여 Y 전극에 먼저 Vs 전압을 가지는 펄스를 인가하여 Y 전극과 X 전극 사이에서 유지 방전을 일으킨다. 이 때, Vs 전압은 Y 전극과 X 전극 사이의 방전개시 전압(Vfxy)보다 낮고 (Vs + Vwxy) 전압이 Vfxy 전압보다 낮도록 설정된다. 유지 방전의 결과 Y 전극에 (-) 벽전하가 형성되고, X 전극과 A 전극에 각각 (+) 벽전하가 형성되어, Y 전극에 대한 X 전극의 벽전압(Vfyx)이 높은 전압으로 형성된다.Subsequently, in the sustain period, a pulse having a voltage of Vs is first applied to the Y electrode to the discharge cell in which the address discharge has occurred, thereby causing sustain discharge between the Y electrode and the X electrode. At this time, the voltage Vs is set to be lower than the discharge start voltage Vfxy between the Y electrode and the X electrode, and the voltage (Vs + Vwxy) is lower than the voltage Vfxy. As a result of the sustain discharge, negative wall charges are formed on the Y electrode, positive wall charges are formed on the X electrode and the A electrode, respectively, and the wall voltage Vfyx of the X electrode with respect to the Y electrode is formed at a high voltage. .
이어서, Y 전극에 -Vs 전압을 가지는 펄스를 인가하여 Y 전극과 X 전극 사이에 유지 방전을 일으킨다. 그 결과 Y 전극에 (+) 벽전하가 형성되고, X 전극과 A 전극에 각각 (-) 벽전하가 형성되어 Y 전극에 Vs 전압이 인가될 때 유지 방전이 일어날 수 있는 상태로 된다. 이후, 주사 전극에 Vs 전압의 유지 방전 펄스를 인가하는 과정과 -Vs 전압의 유지 방전 펄스를 인가하는 과정을 해당 서브필드가 표시하는 가중치에 대응하는 횟수만큼 반복한다.Subsequently, a pulse having a voltage of -Vs is applied to the Y electrode to generate sustain discharge between the Y electrode and the X electrode. As a result, positive wall charges are formed on the Y electrode, negative wall charges are formed on the X electrode and the A electrode, respectively, so that a sustain discharge can occur when the Vs voltage is applied to the Y electrode. Thereafter, the process of applying the sustain discharge pulse of the Vs voltage and the process of applying the sustain discharge pulse of the -Vs voltage to the scan electrode is repeated a number of times corresponding to the weight indicated by the corresponding subfield.
이와 같이 본 실시예의 PDP는 전술한 구동 파형에 근거하여 주사 전극(16)과 유지 전극(18)을 함께 구동시키는 통합 보드를 구비할 수 있다.As such, the PDP of the present embodiment may include an integrated board for driving the
다음으로, 통합 보드에 적합한 주사 전극(16)과 유지 전극(18)의 단자부 구조에 대해 설명한다.Next, the structure of the terminal portion of the
도 1 내지 도 3을 참고하면, 주사 전극들(16)은 제2 기판(4)의 일측 가장자리(일례로 도면을 기준으로 좌측 가장자리)로 인출되어 비표시 영역(200) 상에 주사 전극 단자부들(16c)을 형성한다. 유지 전극들(18)은 연결 배선(34)에 의해 전기적으로 연결되고, 어느 하나의 유지 전극(18)이 주사 전극 단자부들(16c)과 같은 방향의 가장자리로 인출되어 유지 전극 단자부(18c)를 형성한다. 특히 표시 전극들(20)은 어드레스 전극의 길이 방향(도면의 y축 방향)을 따라 배열되는 적어도 2개의 전극군(36)으로 분리될 수 있으며, 각 전극군(36) 별로 전술한 주사 전극(16)과 주사 전극 단자부들(16c) 및 유지 전극(18)과 유지 전극 단자부(18c) 구조를 갖는다.1 to 3, the
상기 각 전극군(36)에서 유지 전극들(18)은 제2 기판(4)의 다른 일측 가장자리(일례로 도면을 기준으로 우측 가장자리)를 향해 비표시 영역(200)에 그 단부가 연장되고, 이 비표시 영역(200) 상에서 연결 배선(34)이 유지 전극들(18)의 단부와 이어지도록 유지 전극(18)과 직교하는 방향을 따라 형성된다.In each of the
상기 유지 전극 단자부(18c)는 한 전극군(36)을 구성하는 복수의 유지 전극들(18)에 있어서 이 유지 전극들(18)의 최외곽에 위치하는 2개의 유지 전극(18) 중 어느 하나의 유지 전극(일례로 도 2에서 유지 전극들의 최외곽에 위치하는 하나의 유지 전극)으로부터 연장된 것일 수 있다. 또한 유지 전극 단자부(18c)는 해당 전극군(36)에서 최외곽에 위치하는 하나의 유지 전극(18)으로부터 연장된 것일 수 있다.The sustain
다른 한편으로, 유지 전극 단자부(18c)는 도 7에 도시한 바와 같이 한 전극군을 구성하는 복수의 유지 전극들(18)에 있어서 이 유지 전극들(18)의 최외곽에 위치하는 2개의 유지 전극(18)으로부터 연장된 것일 수 있다.On the other hand, as shown in Fig. 7, the sustain
한 전극군(36) 내에서 그 일단이 인출되어 유지 전극 단자부(18c)를 형성하는 유지 전극(18)의 위치는 전술한 예들에 한정되지 않는다.The position of the sustain
전술한 단자부 구조를 갖는 표시 전극들(20)은 전극군(36) 별로 단일의 접속 유닛(32)에 접속되어 통합 보드와 연결된다. 즉, 한 전극군(36) 내의 주사 전극들(16)로부터 연장된 주사 전극 단자부들(16c)과 적어도 하나의 유지 전극(18)으로부터 연장된 유지 전극 단자부(18c)가 공통의 접속 유닛(32)에 접속되어 통합 보드와 연결된다. 이로써 본 실시예의 PDP는 접속 유닛(32)의 개수를 줄일 수 있어 제조 공정수가 줄어들고 제조 비용이 감소되는 장점을 갖는다.The
이 때, 하나의 접속 유닛(32)에 접속되는 주사 전극 단자부들(16c)은 사선부를 통해 전극 피치가 감소되어 표시 영역(100)에서의 전극 피치보다 작은 전극 피치를 갖는다.At this time, the scan
또한, 본 실시예에서는 연결 배선(34)의 일부가 밀봉재(30) 외측으로 인출되어 PDP 방열에 유리한 구조를 가진다. 연결 배선(34)은 밀봉재(30) 내측과 밀봉재(30) 외측에 걸치도록 충분히 큰 폭을 가지며 형성되며, PDP 내부에서 발생한 열을 밀봉재 외측으로 방출시키는 역할을 한다.In addition, in the present embodiment, a part of the
이러한 연결 배선(34)은 전술한 유지 전극(18)의 버스 전극(16a)과 동일하게 흑색 전극층과 백색 전극층이 적층된 구조로 이루어지거나, 흑색 전극층 없이 백색 전극층만으로 구성될 수 있다. 도 8에 연결 배선(34)이 흑색 전극층(26)과 백색 전극층(28)의 적층 구조인 경우를 도시하였으며, 도 9에 연결 배선(34')이 백색 전극층(28)만으로 구성된 경우를 도시하였다.The
한편, 유지 전극들(18)은 도 10에 도시한 바와 같이 밀봉재(30) 내측에서 보다 큰 표면적을 갖도록 형성되어 PDP 내부에서 발생하는 열을 보다 효율적으로 방출시키는 구성을 가질 수 있다.Meanwhile, as shown in FIG. 10, the sustain
이를 위하여 표시 영역(100)의 최외곽에 위치하는 2개의 전극군(36)은 연결 배선(34)과 이어지면서 밀봉재(30) 내측에서 표시 영역(100)의 장변측 가장자리 바깥을 둘러싸도록 형성되는 연장부(38)를 포함한다. 연장부(38)는 최소한 표시 영역(100)의 장변측 가장자리와 같은 길이를 가지며 형성되고, 유지 전극(18)보다 큰 폭을 가지며 형성된다. 연결 배선(34)과 연장부(38)는 백색 전극층으로 이루어질 수 있다.To this end, the two
또한, 본 실시예에서는 밀봉재(30) 외측으로 인출된 연결 배선(34) 위에 방열 부재를 형성하여 연결 배선(34)의 방열 효율을 배가시키는 구조를 제공한다. 방열 부재는 도 11에 도시한 실리콘층(40) 또는 도 12에 도시한 흑연층(42)으로 이루어질 수 있다. 실리콘층(40)은 밀봉재(30) 외측으로 연결 배선(34)이 인출된 제2 기판(4)의 일측 가장자리를 따라 충분한 두께를 가지며 도포되는데, 이러한 실리콘 층(40)은 연결 배선(34)의 방열 효율을 높이는 역할과 함께 밀봉재(30) 외측을 둘러싸 PDP의 기밀성을 높이는 역할도 겸한다.In addition, the present embodiment provides a structure in which the heat dissipation member is formed on the
방열 부재는 전술한 실리콘층(40)과 흑연층(42)에 한정되지 않으며, 연결 배선(34)의 기능성을 저하시키지 않으면서 연결 배선(34)의 방열 효율을 높이는 물질층이면 방열 부재로 적용 가능하다.The heat dissipation member is not limited to the
상기에서는 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다.Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications and changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. Naturally, it belongs to
이와 같이 본 발명에 의한 플라즈마 디스플레이 패널은 제2 기판의 일측 가장자리에서 한 전극군 내의 주사 전극 단자부들과 유지 전극 단자부를 공통의 접속 유닛에 접속하여 통합 보드에 연결한다. 따라서 본 발명의 플라즈마 디스플레이 패널은 접속 유닛의 개수를 줄일 수 있어 제조 공정수가 줄어들고 제조 비용이 감소되는 효과를 갖는다. 또한 본 발명의 플라즈마 디스플레이 패널은 연결 배선을 통해 패널 내부의 열을 외부로 방출시켜 방열 효율이 향상되는 효과가 있다.As described above, the plasma display panel according to the present invention connects the scan electrode terminal portions and the sustain electrode terminal portions in one electrode group at one edge of the second substrate to a common connection unit and connects them to the integrated board. Accordingly, the plasma display panel of the present invention can reduce the number of connection units, thereby reducing the number of manufacturing steps and reducing the manufacturing cost. In addition, the plasma display panel of the present invention has the effect that the heat dissipation efficiency is improved by emitting heat inside the panel to the outside through the connection wiring.
Claims (13)
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