KR0135208B1 - 사설교환기에서의 CCS No.7 망 정합장치 - Google Patents

사설교환기에서의 CCS No.7 망 정합장치

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KR0135208B1 KR1019940036485A KR19940036485A KR0135208B1 KR 0135208 B1 KR0135208 B1 KR 0135208B1 KR 1019940036485 A KR1019940036485 A KR 1019940036485A KR 19940036485 A KR19940036485 A KR 19940036485A KR 0135208 B1 KR0135208 B1 KR 0135208B1
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Abstract

본 발명은 사설교환기에서의 CCS No.7 망 정합장치에 관한 것이다.
종래에는 CCS No.7 망을 국설교환기에 정합하기 위한 기술은 개발된 바 있으나, CCS No.7 망을 사설교환기에 정합하기 위한 기술은 미비한 실정에 있다. 따라서, 국내에서 제작된 사설교환기는 CCS No.7 망을 채택하고 있는 국가에서 사용할 수 없게 되는 문제점이 있었다.
본 발명은 간단한 회로구성으로 CCS No.7 망을 사설교환기에 정합할 수 있으므로, 경제성 있게 CCS No.7 망을 접속할 수 있다.

Description

사설교환기에서의 CCS No.7 망 정합장치
제 1 도는 본 발명에 따른 사설교환기의 CCS No.7 망 정합장치 구성도
*도면의 주요부분에 대한 부호의 설명*
10 : CPU,11 : 메모리맵 디코더,
12,13 : 메모리부,14 : 버스정합부,
15 : 링크제어기,16 : 클럭보상부,
17 : TSL정합부,18,20 : ST-버스 억세스회로,
19,21 : 링크 인터페이스회로,22 : RS-232C정합부
본 발명은 사설교환기에 관한 것으로, 특히 CCS(Common Channel Signalling) No.7 망을 사설교환기에 정합하도록 한 CCS No.7 망 정합장치에 관한 것이다.
일반적으로, 교환망에 있어서 각 국가별로 다양한 신호 방식이 채택되어 사용되고 있다.
종래에는 CCS No.7 망을 국설교환기에 정합하기 위한 기술이 개발된 바 있으나, CCS No.7 망을 사설교환기에 정합하기 위한 기술은 미비한 실정에 있다. 따라서, 국내에서 제작된 사설교환기는 CCS No.7 망을 채택하고 있는 국가에서 사용할 수 없게 되는 문제점이 있었다.
본 발명은 상술한 바와 같은 문제점을 해결하기 위하여 안출된 것으로, 간단한 회로구성으로 CCS No.7 망을 사설교환기에 정합하도록 하는 CCS No.7 망 정합장치를 제공하는데에 목적이 있다.
이하 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명한다.
본 발명에 따른 사설교환기의 CCS No.7 망 정합장치는 제 1 도에 도시된 바와 같이 CPU(10), 메모리맵 디코더(11), 메모리부(12,13), 버스정합부(14), 링크제어기(15), 클럭보상부(16), TSL(Time Switch Link)정합부(17), ST-버스 억세스회로(18,20), 링크 인터페이스회로(19,21) 및 RS-232C 정합부(22)를 구비하여 이루어진다. 링크 인터페이스회로(19,21) 및 RS-232C 정합부(22)를 구비하여 이루어진다. 링크 인터페이스회로(19,21)는 CCS No.7 망의 링크를 정합하기 위한 것으로, 링크측에 대하여 OSI(Open System Interconnection)의 계층 2∼7 정보를 입출력하며, 출력동기를 감시하여 출력동기가 링크로 부터의 입력동기와 일치하지 않는 경우 인터럽트를 발생하여 ST-버스 억세스회로(18,20)의 각각에 출력한다. ST-버스 억세스회로(18,20)는 링크 인터페이스회로(19,21)의 각각으로 부터 병렬로 인가되는 메시지를 직렬로 변환하여 CPU(10)측에 전달한다. TSL정합부(17)는 타임스위치부와 정합하기 위한 것으로, 타임스위치부로 인가되는 4.096MHz와 2.048MHz의 클럭을 클럭보상부(16)측으로 전달하고, 타임스위치부로 부터 인가되는 통화데이타를 링크 인터페이스회로(19,21)측에 전달하고, 링크 인터페이스회로(19,21)로 부터 인가되는 통화데이타를 타임스위치부 측에 전달한다. 클럭보상부(16)는 타임스위치부로 부터 TSL정합부(17)를 통해 인가되는 4.096MHz와 2.048MHz 클럭을 보상하여 버스정합부(14), 링크 인터페이스회로(19,21) 및 링크제어기(15)측에 공급한다. 링크제어기(15)는 링크 인터페이스회로(19,21)를 통해 인가되는 계층 2∼4 정보를 추출하여 CPU(10)측에 병렬로 출력하고, CPU(10)로 부터 병렬로 인가되는 계층 2∼4 정보를 소정 전송 포맷으로 변환하여 링크 인터페이스회로(19,21)측에 출력한다. RS-232C 정합부(22)는 모니터를 정합하게 함으로써 운용자가 모니터를 통해 관리할 수 있도록 한다. 메모리부(12)는 CPU(10)의 동작에 필요한 소프트웨어를 저장하며, 메모리맵 디코더(11)는 각 회로부를 초기화함과 동시에 각 회로부를 억세스 하는데에 필요한 각 회로부의 어드레스를 분류한다. 버스정합부(14)는 메임프로세서 측의 로컬 병렬버스를 정합하기 위한 것으로 클럭보상부(16)로 부터 인가되는 클럭에 따라 동작하는데, 메모리부(13)와 메인프로세서간에 입출력되는 콜정보를 전달한다. 메모리부(13)는 CPU(10)로 부터 인가되는 콜정보를 일시 저장하였다가 버스정합부(14)측으로 출력하고, 버스정합부(14)로 부터 인가되는 콜정보를 일시저장 하였다가 CPU(10)측으로 출력한다. CPU(10)는 링크제어기(15)로 부터 인가되는 계층 2∼4 정보를 처리하여 메모리부(13)측에 콜정보를 출력하고, 메모리부(13)로부터 인가되는 콜정보에 따라 계층 2∼4 정보를 링크제어기(15)측에 출력하며, 계층 2∼4 정보를 링크제어기(15)측에 출력할 때 ST-버스 억세스회로(18,20)로 부터의 인터럽트에 따라 출력동기를 보정한다.
이와 같은 CCS No.7 망 정합장치는 다음과 같이 동작한다.
먼저, 가입자로부터의 호를 상대국 측에 연결하는 경우, 메인 프로세서로 부터 출력된 콜정보가 버스정합부(14)와 메모리부(13)를 통해 CPU(10)측에 전달되면 CPU(10)가 계층 2∼4 정보를 링크제어기(15)측에 출력한다. 이때, 링크제어기(15)는 CPU(10)로 부터 인가되는 계층 2∼4 정보를 소정 포맷으로 변환하여 링크 인터페이스회로(19,21)를 통해 각 링크측에 출력하여 상대국 측에 호접속 요구한다. 이와 같이하여 상대국 측과 통화로가 연결되면, TSL정합부(17)와 링크 인터페이스회로(19,21)가 타임스위치부와 링크간에 입출력되는 통화데이타를 전달하므로써 통화 가능하게 한다.
또한, 상대국으로 부터의 호를 가입자 측에 연결하는 경우, 링크로 부터의 계층 2∼4 정보가 링크 인터페이스회로(19,20)를 통해 링크제어기(15)측에 인가되면, 링크제어기(26)가 계층 2∼4 정보를 추출하여 CPU(10)측에 출력한다. 이때, CPU(10)는 링크제어기(15)로 부터 인가된 계층 2∼4 정보를 처리하여 콜정보를 메모리부(13)와 버스정합부(14)를 통해 메인프로세서 측에 출력한다. 이에 따라, 메인프로세서가 타임스위치부를 제어하여 대응되는 가입자를 연결함으로써 호를 연결한다. 이와 같이하여 호가 연결되면, TSL정합부(17)와 링크 인터페이스회로(19,21)가 타임스위치와 링크간에 입출력되는 통화데이타를 전달하므로써 통화가 가능하게 된다. 이상 설명한 바와 같이, 본 발명은 간단한 회로 구성으로 CCS No.7 망을 사설교환기에 정합할 수 있으므로, 경제성 있게 CCS No.7 망을 접속할 수 있게 된다.

Claims (1)

  1. 사설교환기에 있어서, CCS No.7 망의 제 1 링크를 정합하여 ,상기 제 1 링크에 대하여 계층 2∼7 정보를 입출력하고, 출력동기를 감시하여 출력동기가 상기 링크의 입력동기와 일치하지 않는 경우 인터럽트를 발생하는 제 1 링크 인터페이스회로(19) : 상기 제 1 링크 인터페이스회로(19)로 부터 인가되는 인터럽트를 병렬로 전달하는 제 1 ST-버스 억세스회로(18) : CCS No.7 망의 제 2 링크를 정합하여, 상기 제 2 링크에 대하여 계층 2∼7 정보를 입출력하고, 출력동기를 감시하여 출력동기가 상기 링크의 입력동기와 일치하지 않는 경우 인터럽트를 발생하는 제 2 링크 인터페이스회로(21) : 상기 제 2 링크 인터페이스회로(21)로 부터 인가되는 인터럽트를 병렬로 전달하는 제 2 ST-버스 억세스회로(20) : 타임스위치부를 정합하여, 상기 타임스위치로 부터 인가되는 소정 주파수의 클럭을 전달하고, 상기 타임스위치부와 상기 제 1 및 제 2 링크인터페이스 회로(19,21)간에 입출력되는 통화데이타를 전달하는 TSL정합부(17) : 메인프로세서를 정합하여 콜정보를 입출력하는 버스정합부(14), 상기 제 1 및 제 2 링크 인터페이스회로(19,21)로 부터 직렬로 인가된 계층 2∼4 정보를 추출하여 병렬로 출력하고, 병렬로 인가되는 계층 2∼4 정보를 직렬로 변환하여 상기 제 1 및 제 2 링크 인터페이스회로(19,21)측에 출력하는 링크제어기(15) : 상기 버스정합부(14)측에 대하여 콜정보를 입출력하는 제 1 메모리부(13) : 상기 링크제어기(15)로부터 인가된 계층 2∼4 정보를 수신하면 콜정보를 상기 제 1 메모리부(13)측에 출력하고, 상기 제 1 메모리부(13)로 부터 콜정보를 수신하면 상기 링크제어기(15)측에 계층 2∼4 정보를 출력하며, 상기 제 1 및 제 2 ST-버스 억세스회로(18,20)로 부터 인가되는 인터럽트에 따라 출력동기를 조절하는 CPU(10) : 모니터를 상기 CPU(10)에 정합하기 위한 RS-232C 정합부(22) : 상기 CPU(10)를 동작시키기 위한 소프트웨어를 저장하는 제 2 메모리부(12) : 상기 TSL 정합부(17)로 부터 인가되는 소정 주파수의 클럭을 보상하여 상기 버스정합부(14), 제 1 및 제 2 링크 인터페이스회로(19,21) 및 링크제어기(15)측에 공급하는 클럭보상부(16) : 상기 각 회로부를 초기화 하고 상기 각 회로부의 어드레스를 분류하는 메모리맵 디코더(11)를 포함하는 것을 특징으로 하는 사설교환기에서의 CCS No.7 망 정합장치.
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* Cited by examiner, † Cited by third party
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KR20000066146A (ko) * 1999-04-13 2000-11-15 김영환 넘버.7의 타이머값 조정 방법

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