JPWO2022004837A5 - 情報処理装置、情報処理方法及び情報処理プログラム - Google Patents
情報処理装置、情報処理方法及び情報処理プログラム Download PDFInfo
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Claims (10)
- 第1の演算手段と、
前記第1の演算手段と共通の仮想アドレス空間が割り当てられた第2の演算手段と、
前記第1の演算手段が備えるローカルメモリに記憶された第1のページテーブルと、
前記第2の演算手段が備えるローカルメモリに記憶された第2のページテーブルと、
前記第2の演算手段がアクセスした前記第2のページテーブルのページの第1のビットフラグが前記第2の演算手段がアクセスしたページのデータの無効を示す場合には、前記第2の演算手段がアクセスしたページと同一のページ番号のページを含む前記第1のページテーブルの複数のページのデータを一括して前記第2のページテーブルに転送する転送指示を生成するデータ管理手段と、
を備える情報処理装置。 - 前記データ管理手段は、一括して転送される前記複数のページを、前記第2の演算手段のメモリアクセスの空間的局所性に基づいて選択する、請求項1に記載された情報処理装置。
- 前記データ管理手段は、
前記第2の演算手段がアクセスした前記第2のページテーブルのページの第1のビットフラグが前記第2の演算手段がアクセスした前記ページのデータの無効を示し、
かつ、
前記第2の演算手段がアクセスした前記ページと同一のページ番号の前記第1のページテーブルのページのデータが前記第1の演算手段によって変更されてないことを前記第1のページテーブルの第2のビットフラグが示す場合は、前記転送指示を取り消し、前記第2の演算手段がアクセスした前記ページの第1のビットフラグを前記第2の演算手段がアクセスした前記ページのデータの有効を示すように設定する、請求項1又は2に記載された情報処理装置。 - 前記第1の演算手段及び前記第2の演算手段は、それぞれ、アクセスした前記ページの前記第1のビットフラグがデータの有効を示す場合には前記データを用いた処理を行い、前記第1のビットフラグが前記データの無効を示す場合には前記データを用いた処理を行わない、
請求項1乃至3のいずれかに記載された情報処理装置。 - 前記データ管理手段は、同一のページ番号の前記第1のページテーブルのページ及び前記第2のページテーブルのページのそれぞれの前記第1のビットフラグの有効及び無効を排他的に設定する、請求項4に記載された情報処理装置。
- 前記第1の演算手段及び前記第2の演算手段の一方は中央処理装置(CPU)であり、他方は画像処理装置(GPU)である、請求項1乃至5のいずれかに記載された情報処理装置。
- 前記第1の演算手段と前記第2の演算手段との間で転送される転送データを格納するデータ格納手段を備える、請求項1乃至6のいずれかに記載された情報処理装置。
- 前記データ管理手段は、前記第1の演算手段の前記ローカルメモリを制御する第1の管理手段と前記第2の演算手段の前記ローカルメモリを制御する第2の管理手段とを含み、前記データ格納手段は、前記第1の管理手段が制御する第1の格納手段と前記第2の管理手段が制御する第2の格納手段とを含み、
前記第1の演算手段と、前記第1の管理手段と、前記第1の格納手段とを備える第1のデバイスと、
前記第2の演算手段と、前記第2の管理手段と、前記第2の格納手段とを備える第2のデバイスと、
を備える、請求項7に記載された情報処理装置。 - 共通の仮想アドレス空間が割り当てられた第1の演算手段と第2の演算手段とによって演算を行い、
前記第1の演算手段が備えるローカルメモリに第1のページテーブルを記憶し、
前記第2の演算手段が備えるローカルメモリに第2のページテーブルを記憶し、
前記第2の演算手段がアクセスした前記第2のページテーブルのページの第1のビットフラグが前記第2の演算手段がアクセスしたページのデータの無効を示す場合には、前記第2の演算手段がアクセスしたページと同一のページ番号のページを含む前記第1のページテーブルの複数のページのデータを一括して前記第2のページテーブルに転送する転送指示を生成する、
情報処理方法。 - 情報処理装置のコンピュータに、
共通の仮想アドレス空間が割り当てられた第1の演算手段と第2の演算手段とによって演算を行う処理、
前記第1の演算手段が備えるローカルメモリに第1のページテーブルを記憶する処理、
前記第2の演算手段が備えるローカルメモリに第2のページテーブルを記憶する処理、
前記第2の演算手段がアクセスした前記第2のページテーブルのページの第1のビットフラグが前記第2の演算手段がアクセスしたページのデータの無効を示す場合には、前記第2の演算手段がアクセスしたページと同一のページ番号のページを含む前記第1のページテーブルの複数のページのデータを一括して前記第2のページテーブルに転送する転送指示を生成する処理、
を実行させるための情報処理プログラム。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2020115307 | 2020-07-03 | ||
JP2020115307 | 2020-07-03 | ||
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Publications (3)
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---|---|
JPWO2022004837A1 JPWO2022004837A1 (ja) | 2022-01-06 |
JPWO2022004837A5 true JPWO2022004837A5 (ja) | 2023-03-10 |
JP7420251B2 JP7420251B2 (ja) | 2024-01-23 |
Family
ID=79316293
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022534108A Active JP7420251B2 (ja) | 2020-07-03 | 2021-07-01 | 情報処理装置、情報処理方法及び情報処理プログラム |
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WO (1) | WO2022004837A1 (ja) |
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JP2010211506A (ja) * | 2009-03-10 | 2010-09-24 | Nec Corp | 不均一メモリアクセス機構を備えるコンピュータ、コントローラ、及びデータ移動方法 |
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-
2021
- 2021-07-01 JP JP2022534108A patent/JP7420251B2/ja active Active
- 2021-07-01 WO PCT/JP2021/024911 patent/WO2022004837A1/ja active Application Filing
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