JPS6416728U - - Google Patents
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- Publication number
- JPS6416728U JPS6416728U JP1987111430U JP11143087U JPS6416728U JP S6416728 U JPS6416728 U JP S6416728U JP 1987111430 U JP1987111430 U JP 1987111430U JP 11143087 U JP11143087 U JP 11143087U JP S6416728 U JPS6416728 U JP S6416728U
- Authority
- JP
- Japan
- Prior art keywords
- delay line
- variable
- line element
- buffer circuit
- variable delay
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000003990 capacitor Substances 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Pulse Circuits (AREA)
Description
第１図は本考案に係る遅延線の一実施例を示す
回路図、第２図は本考案の他の実施例を示す回路
図、第３図は本考案の参考となる遅延線を示す回
路図である。 １……入力端子、３，５……信号源、Ｃ……コ
ンデンサ、Ｃｐ……バイパスコンデンサ、ＤＬ，
ＤＬ１，ＤＬ２，ＤＬ４……遅延線素子、ＤＬ１
′，ＤＬ２′，ＤＬ３……可変遅延線素子、Ｄｖ
……可変容量ダイオード、Ｅ……電源、Ｉ，Ｊ…
…バツフア回路、Ｌ，Ｌ１〜Ｌ４……インダクタ
ンス素子、Ｒ１〜Ｒ２……抵抗、Ｒｔ……感温抵
抗。
回路図、第２図は本考案の他の実施例を示す回路
図、第３図は本考案の参考となる遅延線を示す回
路図である。 １……入力端子、３，５……信号源、Ｃ……コ
ンデンサ、Ｃｐ……バイパスコンデンサ、ＤＬ，
ＤＬ１，ＤＬ２，ＤＬ４……遅延線素子、ＤＬ１
′，ＤＬ２′，ＤＬ３……可変遅延線素子、Ｄｖ
……可変容量ダイオード、Ｅ……電源、Ｉ，Ｊ…
…バツフア回路、Ｌ，Ｌ１〜Ｌ４……インダクタ
ンス素子、Ｒ１〜Ｒ２……抵抗、Ｒｔ……感温抵
抗。
Claims (1)
- 【実用新案登録請求の範囲】 (1) 捲線されたインダクタンス素子にコンデン
サを梯子状に接続してなる遅延線素子と、 この遅延線素子に直列的に接続されたバツフア
回路と、 捲線されたインダクタンス素子のタツプに可変
容量ダイオードを梯子状に接続してなり、前記バ
ツフア回路に対して直列的に形成された可変遅延
線素子と、 前記バツフア回路の温度特性と逆の温度特性で
前記可変遅延線素子の遅延時間を変化させる制御
信号を前記可変容量ダイオードに出力する信号源
と、 を具備してなることを特徴とする可変遅延線。 (2) 前記可変遅延線素子が前記遅延線素子の一
部として形成されてなる実用新案登録請求の範囲
第１項記載の遅延線。 (3) 前記可変遅延線素子が前記遅延線素子と別
個のものとして形成されてなる実用新案登録請求
の範囲第１項記載の遅延線。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987111430U JPS6416728U (ja) | 1987-07-21 | 1987-07-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987111430U JPS6416728U (ja) | 1987-07-21 | 1987-07-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6416728U true JPS6416728U (ja) | 1989-01-27 |
Family
ID=31349470
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1987111430U Pending JPS6416728U (ja) | 1987-07-21 | 1987-07-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6416728U (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0330210U (ja) * | 1989-07-26 | 1991-03-25 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5783922A (en) * | 1980-11-12 | 1982-05-26 | Fujitsu Ltd | Delay circuit |
-
1987
- 1987-07-21 JP JP1987111430U patent/JPS6416728U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5783922A (en) * | 1980-11-12 | 1982-05-26 | Fujitsu Ltd | Delay circuit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0330210U (ja) * | 1989-07-26 | 1991-03-25 |
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