JPS6372818U - - Google Patents
Info
- Publication number
- JPS6372818U JPS6372818U JP16632986U JP16632986U JPS6372818U JP S6372818 U JPS6372818 U JP S6372818U JP 16632986 U JP16632986 U JP 16632986U JP 16632986 U JP16632986 U JP 16632986U JP S6372818 U JPS6372818 U JP S6372818U
- Authority
- JP
- Japan
- Prior art keywords
- gate circuit
- switch
- closes
- opens
- gate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Keying Circuit Devices (AREA)
Description
第１図は本考案の一実施例である８ビツトのゲ
ート回路付きデイツプスイツチの回路図、第２図
は従来例のリード用ゲート回路及びプルアツプ用
抵抗を備えたデイツプスイツチの回路図である。 １…ゲート回路付きデイツプスイツチ、２…デ
イツプスイツチ、３…リード用ゲート回路、４…
中央演算処理装置（ＣＰＵ）。
ート回路付きデイツプスイツチの回路図、第２図
は従来例のリード用ゲート回路及びプルアツプ用
抵抗を備えたデイツプスイツチの回路図である。 １…ゲート回路付きデイツプスイツチ、２…デ
イツプスイツチ、３…リード用ゲート回路、４…
中央演算処理装置（ＣＰＵ）。
Claims (1)
- 入力されるゲート信号に応答して開閉するゲー
ト回路と、上記ゲート回路と直列に接続され開閉
状態となるスイツチを、ともに１個の筐体内に備
えたことを特徴とするゲート回路付きスイツチ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16632986U JPS6372818U (ja) | 1986-10-29 | 1986-10-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16632986U JPS6372818U (ja) | 1986-10-29 | 1986-10-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6372818U true JPS6372818U (ja) | 1988-05-16 |
Family
ID=31097201
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16632986U Pending JPS6372818U (ja) | 1986-10-29 | 1986-10-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6372818U (ja) |
-
1986
- 1986-10-29 JP JP16632986U patent/JPS6372818U/ja active Pending
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