JPS6372602U - - Google Patents
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- Publication number
- JPS6372602U JPS6372602U JP16718186U JP16718186U JPS6372602U JP S6372602 U JPS6372602 U JP S6372602U JP 16718186 U JP16718186 U JP 16718186U JP 16718186 U JP16718186 U JP 16718186U JP S6372602 U JPS6372602 U JP S6372602U
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- JP
- Japan
- Prior art keywords
- output
- analog output
- analog
- output section
- integrating amplifier
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 5
- 238000001514 detection method Methods 0.000 description 2
Landscapes
- Safety Devices In Control Systems (AREA)
Description
第1図は、この考案の一実施例を示すデジタル
制御装置の回路図、第2図は、同デジタル制御装
置のリレー指令オン/オフの動作モードを示すフ
ロー図、第3図は、同デジタル制御装置の差絶対
値検出回路の具体例を示す図、第4図は、従来の
デジタル制御装置の回路を示す図である。 1:CPU、2:D/A変換器、4:アナログ
出力部、7:積分アンプ、Rys:リレー接点、
8:差絶対値検出回路、9:比較器。
制御装置の回路図、第2図は、同デジタル制御装
置のリレー指令オン/オフの動作モードを示すフ
ロー図、第3図は、同デジタル制御装置の差絶対
値検出回路の具体例を示す図、第4図は、従来の
デジタル制御装置の回路を示す図である。 1:CPU、2:D/A変換器、4:アナログ
出力部、7:積分アンプ、Rys:リレー接点、
8:差絶対値検出回路、9:比較器。
Claims (1)
- 【実用新案登録請求の範囲】 デジタル演算器と、このデジタル演算器の出力
をアナログ値に変換するD/A変換器と、このD
/A変換器のアナログ出力を保持するアナログ出
力部と、このアナログ出力部の出力を受けて積分
する積分アンプとを備えるデジタル制御装置にお
いて、 前記アナログ出力部と前記積分アンプの入力間
にスイツチング手段を設けると共に、前記アナロ
グ出力部の出力と前記積分アンプの出力の差を算
出する手段と、この算出された差値が所定値以上
か否かを判別する手段とを設け、差値が所定値以
上の場合に前記スイツチング手段をオフしておく
ようにしたことを特徴とするデジタル制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16718186U JPS6372602U (ja) | 1986-10-30 | 1986-10-30 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16718186U JPS6372602U (ja) | 1986-10-30 | 1986-10-30 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6372602U true JPS6372602U (ja) | 1988-05-16 |
Family
ID=31098872
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16718186U Pending JPS6372602U (ja) | 1986-10-30 | 1986-10-30 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6372602U (ja) |
-
1986
- 1986-10-30 JP JP16718186U patent/JPS6372602U/ja active Pending