JPS6359424U - - Google Patents
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- Publication number
- JPS6359424U JPS6359424U JP15491486U JP15491486U JPS6359424U JP S6359424 U JPS6359424 U JP S6359424U JP 15491486 U JP15491486 U JP 15491486U JP 15491486 U JP15491486 U JP 15491486U JP S6359424 U JPS6359424 U JP S6359424U
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- JP
- Japan
- Prior art keywords
- flip
- flop
- input signal
- inverted output
- circuit
- Prior art date
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- Pending
Links
- 230000001960 triggered effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案の後縁トリガ型Ｓ―Ｒフリツプ
フロツプ回路の実施例を示す回路図、第２図は従
来の後縁トリガにて動作するＳ―Ｒフリツプフロ
ツプ回路の回路図である。 １……Ｊ―Ｋフリツプフロツプ、２……単安定
マルチ回路、３……Ｄフリツプフロツプ、４及び
５……ＡＮＤ回路、６……ＮＯＲ回路、Ｓ……セ
ツト入力信号、Ｒ……リセツト入力信号、ＣＬＫ
……クロツク入力端子、……プリセツト入
力端子、……クリア入力端子。
フロツプ回路の実施例を示す回路図、第２図は従
来の後縁トリガにて動作するＳ―Ｒフリツプフロ
ツプ回路の回路図である。 １……Ｊ―Ｋフリツプフロツプ、２……単安定
マルチ回路、３……Ｄフリツプフロツプ、４及び
５……ＡＮＤ回路、６……ＮＯＲ回路、Ｓ……セ
ツト入力信号、Ｒ……リセツト入力信号、ＣＬＫ
……クロツク入力端子、……プリセツト入
力端子、……クリア入力端子。
Claims (1)
- Ｄフリツプフロツプの正転出力とリセツト入力
信号及び反転出力とセツト入力信号とのＡＮＤを
夫々とり両ＡＮＤ出力のＮＯＲを前記Ｄフリツプ
フロツプのクロツク入力とするとともに前記反転
出力をＤ端子入力としたことを特徴とする後縁ト
リガ型ＳＲフリツプフロツプ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15491486U JPS6359424U (ja) | 1986-10-08 | 1986-10-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15491486U JPS6359424U (ja) | 1986-10-08 | 1986-10-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6359424U true JPS6359424U (ja) | 1988-04-20 |
Family
ID=31075137
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15491486U Pending JPS6359424U (ja) | 1986-10-08 | 1986-10-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6359424U (ja) |
-
1986
- 1986-10-08 JP JP15491486U patent/JPS6359424U/ja active Pending
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