JPS6348335U - - Google Patents
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- Publication number
- JPS6348335U JPS6348335U JP14134586U JP14134586U JPS6348335U JP S6348335 U JPS6348335 U JP S6348335U JP 14134586 U JP14134586 U JP 14134586U JP 14134586 U JP14134586 U JP 14134586U JP S6348335 U JPS6348335 U JP S6348335U
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- JP
- Japan
- Prior art keywords
- delay
- contact
- current limiting
- power supply
- power
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 1
Landscapes
- Emergency Protection Circuit Devices (AREA)
Description
第１図は、本考案の一実施例を示す回路図、第
２図は第１図の回路の時間経過による非遅延接点
、遅延接点、リレー接点、ＤＣ／ＤＣ電源盤入力
の変化を示すタイムチヤートである。 １……時差スイツチ、１ａ……非遅延接点、１
ｂ……遅延接点、２……電流制限素子、３……リ
レー、３ａ……リレー接点、４……コンデンサ、
５……抵抗、６……ダイオード、７……直流電源
、８……ＤＣ／ＤＣ電源盤。
２図は第１図の回路の時間経過による非遅延接点
、遅延接点、リレー接点、ＤＣ／ＤＣ電源盤入力
の変化を示すタイムチヤートである。 １……時差スイツチ、１ａ……非遅延接点、１
ｂ……遅延接点、２……電流制限素子、３……リ
レー、３ａ……リレー接点、４……コンデンサ、
５……抵抗、６……ダイオード、７……直流電源
、８……ＤＣ／ＤＣ電源盤。
Claims (1)
- 【実用新案登録請求の範囲】 直流電源より電力を受電する電源盤の突入電流
制限回路において、 直流電源に接続され、遅延時間を有する遅延接
点と遅延時間を有しない非遅延接点とを備えた時
差スイツチと、 時差スイツチの非遅延接点と電源盤との間に接
続され、電源投入時の突入電流を制限する電流制
限素子と、 時差スイツチの遅延接点と電源盤との間に接続
され、遅延時間を有するリレー接点を備えたリレ
ーを有することを特徴とする突入電流制限回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14134586U JPS6348335U (ja) | 1986-09-17 | 1986-09-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14134586U JPS6348335U (ja) | 1986-09-17 | 1986-09-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6348335U true JPS6348335U (ja) | 1988-04-01 |
Family
ID=31049037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14134586U Pending JPS6348335U (ja) | 1986-09-17 | 1986-09-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6348335U (ja) |
-
1986
- 1986-09-17 JP JP14134586U patent/JPS6348335U/ja active Pending