JPH0318639U - - Google Patents
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- Publication number
- JPH0318639U JPH0318639U JP7013388U JP7013388U JPH0318639U JP H0318639 U JPH0318639 U JP H0318639U JP 7013388 U JP7013388 U JP 7013388U JP 7013388 U JP7013388 U JP 7013388U JP H0318639 U JPH0318639 U JP H0318639U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- inrush current
- time
- power supply
- turned
- Prior art date
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- Pending
Links
- 230000001629 suppression Effects 0.000 claims description 5
- 239000003990 capacitor Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Emergency Protection Circuit Devices (AREA)
Description
第１図は、この考案の突入電流抑制回路の一実
施例を示す回路図、第２図は、第１図に示した回
路各部の信号波形図、第３図は、従来の突入電流
抑制回路の一例を示す回路図である。 ２……主電源回路、４……電源スイツチ、５…
…トライアツク、１１……突入電流抑制回路、１
２……補助電源回路、１３……遅延回路、Ｒ……
電流制限抵抗。
施例を示す回路図、第２図は、第１図に示した回
路各部の信号波形図、第３図は、従来の突入電流
抑制回路の一例を示す回路図である。 ２……主電源回路、４……電源スイツチ、５…
…トライアツク、１１……突入電流抑制回路、１
２……補助電源回路、１３……遅延回路、Ｒ……
電流制限抵抗。
Claims (1)
- 交流入力回路に接続したコンデンサ・インプツ
ト型の主電源回路に、電源の投入とともに流入す
る突入電流を、投入後一定時間が経過したときに
導通するスイツチング素子が並列接続された電流
制限抵抗により制限する突入電流抑制回路であつ
て、前記交流入力回路に接続した補助電源回路と
、この補助電源回路より電源の供給を受け、該供
給時点から所定時間が経過した時点で前記スイツ
チング素子を導通せしめる遅延回路とを具備した
ことを特徴とする突入電流抑制回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7013388U JPH0318639U (ja) | 1988-05-27 | 1988-05-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7013388U JPH0318639U (ja) | 1988-05-27 | 1988-05-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0318639U true JPH0318639U (ja) | 1991-02-25 |
Family
ID=31606034
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7013388U Pending JPH0318639U (ja) | 1988-05-27 | 1988-05-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0318639U (ja) |
-
1988
- 1988-05-27 JP JP7013388U patent/JPH0318639U/ja active Pending