JPS6345834Y2 - - Google Patents

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JPS6345834Y2
JPS6345834Y2 JP1979152601U JP15260179U JPS6345834Y2 JP S6345834 Y2 JPS6345834 Y2 JP S6345834Y2 JP 1979152601 U JP1979152601 U JP 1979152601U JP 15260179 U JP15260179 U JP 15260179U JP S6345834 Y2 JPS6345834 Y2 JP S6345834Y2
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capacitor
diode
gate
bidirectional
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Description

【考案の詳細な説明】 本考案は交流電源に接続された負荷を制御する
スイツチング素子のゲートトリガ回路に関するも
ので、回路の消費電力低減と安全性の向上を目的
とする。
[Detailed Description of the Invention] The present invention relates to a gate trigger circuit for a switching element that controls a load connected to an AC power source, and aims to reduce power consumption and improve safety of the circuit.

一般に双方向3端子サイリスタ(以下、サイリ
スタと称す)のゲートトリガ回路は、パルストラ
ンスを用いたものが主流であるが、サイリスタの
ゲート感度は一般的に悪く、したがつてパルスト
ランスを駆動するゲートトリガ回路の消費電力は
大きくなる。またパルストランスは形状的に比較
的大きな面積を要し、実装上問題となる場合があ
つた。
In general, gate trigger circuits for bidirectional three-terminal thyristors (hereinafter referred to as thyristors) mainly use pulse transformers, but the gate sensitivity of thyristors is generally poor, so the gate trigger circuit that drives the pulse transformer The power consumption of the trigger circuit increases. Further, the pulse transformer requires a relatively large area due to its shape, which sometimes poses a problem in mounting.

また第4図に示すように、交流電源21にサイ
リスタ22と負荷23を直列に接続した負荷回路
を備え、スイツチングトランジスタ24と電流制
限抵抗25によつて直接サイリスタ22のゲート
をトリガする構成においては、サイリスタ22の
ゲートトリガに必要な電流が直流電源26に必要
となり、また負荷制御回路27の回路電流ととも
に、直流電源26の電源容量も問題となり、その
結果、電源トランスの要否が実装上問題となる。
そしてまた前記スイツチングトランジスタ24が
短絡故障をすれば、負荷制御回路24の制御域を
外れることになり、その結果、サイリスタ22は
ゲートトリガ状態を継続し、オン状態となつてし
まう欠点を有する。
Furthermore, as shown in FIG. 4, an AC power supply 21 is provided with a load circuit in which a thyristor 22 and a load 23 are connected in series, and the gate of the thyristor 22 is directly triggered by a switching transistor 24 and a current limiting resistor 25. In this case, the current required for the gate trigger of the thyristor 22 is required in the DC power supply 26, and the power capacity of the DC power supply 26 becomes a problem as well as the circuit current of the load control circuit 27. As a result, the necessity of a power transformer is determined due to implementation. It becomes a problem.
If the switching transistor 24 is short-circuited again, it will be out of the control range of the load control circuit 24, and as a result, the thyristor 22 will continue to be in the gate-triggered state and turn on.

本考案はゲートトリガ回路にコンデンサの充放
電回路を構成することにより、上記従来の問題点
を解消するものである。
The present invention solves the above conventional problems by configuring a capacitor charging/discharging circuit in the gate trigger circuit.

以下、本考案をその実施例を示す図面にもとづ
いて説明する。第1図において、1は交流電源
で、この交流電源1に負荷2と、双方向3端子サ
イリスタよりなるスイツチング素子3を直列に接
続して負荷回路を構成している。4は直流電源
で、この直流電源4の正側には抵抗5,6を介し
てスイツチングトランジスタ7を直列に接続して
いる。8は負荷制御回路で、この負荷制御回路8
はスイツチングトランジスタ7を制御するもので
ある。9は前記抵抗5と6の接続点に接続された
コンデンサで、このコンデンサ9にはダイオード
10を直列に接続している。また前記ダイオード
10のアノードはスイツチング素子3のゲート端
子に接続されている。なお、前記スイツチングト
ランジスタ7のエミツタ、ダイオード10のカソ
ードおよびスイツチング素子3のT1端子は共に
直流電源4の負側に接続されている。
Hereinafter, the present invention will be explained based on drawings showing embodiments thereof. In FIG. 1, reference numeral 1 denotes an AC power supply, to which a load 2 and a switching element 3 consisting of a bidirectional three-terminal thyristor are connected in series to form a load circuit. 4 is a DC power supply, and a switching transistor 7 is connected in series to the positive side of the DC power supply 4 via resistors 5 and 6. 8 is a load control circuit, and this load control circuit 8
is for controlling the switching transistor 7. A capacitor 9 is connected to the connection point between the resistors 5 and 6, and a diode 10 is connected in series with the capacitor 9. Further, the anode of the diode 10 is connected to the gate terminal of the switching element 3. The emitter of the switching transistor 7, the cathode of the diode 10, and the T1 terminal of the switching element 3 are all connected to the negative side of the DC power supply 4.

上記構成において、負荷制御回路8がスイツチ
ング素子3のオフ信号を出力した場合、スイツチ
ングトランジスタ7はオフとなり、その結果、直
流電源4の正側から抵抗5、コンデンサ9、ダイ
オード10、直流電源4の負側へと経由する充電
回路Aが構成され、コンデンサ9に電荷が蓄積さ
れる。次に負荷制御回路8がスイツチング素子3
のオン信号を出力すると、スイツチングトランジ
スタ7がオンするため、充電されているコンデン
サ9の充電電荷は、抵抗6、スイツチングトラン
ジスタ7、スイツチング素子3のT1端子とゲー
トを経由する放電回路Bを通じて放電される。こ
の放電によりスイツチング素子3はマイナスゲー
トトリガモードによつてオンする。スイツチング
素子3のオンにより負荷2への通電がなされる。
なお、前記負荷制御回路8が交流電源のゼロボル
トで出力を発すれば、コンデンサ9と抵抗5の充
電時定数は交流電源の半サイクル時間に設定すれ
ばよい。
In the above configuration, when the load control circuit 8 outputs an off signal for the switching element 3, the switching transistor 7 is turned off, and as a result, the resistor 5, the capacitor 9, the diode 10, and the DC power source 4 are connected from the positive side of the DC power source 4. A charging circuit A is configured to pass through to the negative side of the capacitor 9, and charge is accumulated in the capacitor 9. Next, the load control circuit 8 switches the switching element 3
When the on signal is output, the switching transistor 7 is turned on, so that the charge in the capacitor 9 is transferred to the discharge circuit B via the resistor 6, the switching transistor 7, the T1 terminal of the switching element 3, and the gate. discharged through. Due to this discharge, the switching element 3 is turned on in the minus gate trigger mode. When the switching element 3 is turned on, the load 2 is energized.
Note that if the load control circuit 8 outputs an output at zero volts of the AC power supply, the charging time constant of the capacitor 9 and the resistor 5 may be set to the half cycle time of the AC power supply.

第2図は本考案の他の実施例を示したもので、
すなわち、この第2図は、第1図においてスイツ
チングトランジスタ7のコレクタに接続されてい
た抵抗6を、スイツチング素子3のゲート端子に
接続したものであるが、抵抗6はコンデンサ9の
放電電流制限用であるから、放電経路中に挿入す
ればよい。
Figure 2 shows another embodiment of the present invention.
That is, in FIG. 2, the resistor 6, which was connected to the collector of the switching transistor 7 in FIG. 1, is connected to the gate terminal of the switching element 3. Therefore, it can be inserted into the discharge path.

以上のように第1図および第2図の場合は、ス
イツチング素子3のゲートトリガをコンデンサ9
の放電電流で行なうようにしているため、直流電
源4の回路電流を低減することができるととも
に、スイツチングトランジスタ7の短絡故障に対
しても安全となるものである。
As described above, in the case of FIGS. 1 and 2, the gate trigger of the switching element 3 is connected to the capacitor 9.
Since the discharge current is set to 1, the circuit current of the DC power source 4 can be reduced, and the switching transistor 7 is safe from short-circuit failure.

第3図は本考案のさらに他の実施例を示したも
ので、すなわち、この第3図は、スイツチング素
子3のゲート端子にダイオード11を接続し、か
つこのダイオード11はカソードをコンデンサ9
とダイオード10の接続点に接続したものであ
る。この第3図の構成においては、スイツチング
トランジスタ7のオフによりコンデンサ9に充電
電流が流れる場合において、ダイオード10がオ
ープン故障したり、スイツチング素子3のゲート
感度のバラツキによりミストリガが発生するよう
な状態にあつたとしても、スイツチング素子3の
ゲート端子に電流が流入するのをダイオード11
により確実に阻止することができる。なお、前記
スイツチング素子3はコンデンサ9の放電電流の
みでトリガされるゲートトリガ回路であるため、
安全性はきわめて向上するものである。
FIG. 3 shows still another embodiment of the present invention, in which a diode 11 is connected to the gate terminal of the switching element 3, and the cathode of the diode 11 is connected to the capacitor 9.
and the connection point of the diode 10. In the configuration shown in FIG. 3, when a charging current flows to the capacitor 9 due to the switching transistor 7 being turned off, there is a situation where the diode 10 is open-circuited or a mis-trigger occurs due to variations in the gate sensitivity of the switching element 3. diode 11 prevents current from flowing into the gate terminal of switching element 3.
This can be reliably prevented. Note that since the switching element 3 is a gate trigger circuit that is triggered only by the discharge current of the capacitor 9,
Safety is greatly improved.

以上のように本考案によれば、負荷と直列に接
続されたスイツチング素子を、コンデンサに充電
された電荷の放電によつてトリガするものである
ため、ゲートトリガ回路の消費電流を低減させる
ことができるとともに、スイツチングトランジス
タの短絡故障やダイオードのオープン故障等に対
してもゲートトリガ回路のフエールセーフ性を実
現することができる。すなわちスイツチングトラ
ンジスタ7のオープンおよびシヨート故障ではコ
ンデンサ9の充放電が不能となりトリガ電流が得
られなくなる。コンデンサ9のオープン故障はゲ
ート回路が開放になり、シヨート故障は放電電流
が消滅すると同時にダイオード10の順方向電圧
で双方向3端子サイリスタのゲート電圧が非トリ
ガ電圧に抑制される。ダイオード10のシヨート
故障も前記同様で、オープン故障に関してもコン
デンサ9の充電回路がしや断されるのである。従
つて、双方向3端子サイリスタ3はコンデンサ9
の放電電流のみによつてトリガされる構成のた
め、高信頼性と高安全性を有するスイツチング素
子のゲートトリガ回路を得ることができるのであ
る。
As described above, according to the present invention, since the switching element connected in series with the load is triggered by discharging the charge stored in the capacitor, it is possible to reduce the current consumption of the gate trigger circuit. In addition, the gate trigger circuit can be fail-safe against short-circuit failures of switching transistors, open failures of diodes, and the like. That is, if the switching transistor 7 is opened or shot, the capacitor 9 cannot be charged or discharged, and no trigger current can be obtained. An open failure of the capacitor 9 causes the gate circuit to open, and a short failure causes the discharge current to disappear, and at the same time, the forward voltage of the diode 10 suppresses the gate voltage of the bidirectional three-terminal thyristor to a non-trigger voltage. The short failure of the diode 10 is the same as described above, and the charging circuit of the capacitor 9 is immediately cut off in the case of an open failure. Therefore, the bidirectional three-terminal thyristor 3 is connected to the capacitor 9
Since the configuration is triggered only by the discharge current, it is possible to obtain a gate trigger circuit for a switching element with high reliability and high safety.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本考案の一実施例を示すゲートトリガ
回路図、第2図は本考案の他の実施例を示すゲー
トトリガ回路図、第3図は本考案のさらに他の実
施例を示すゲートトリガ回路図、第4図は従来例
を示すゲートトリガ回路図である。 1……交流電源、2……負荷、3……スイツチ
ング素子、4……直流電源、5,6……抵抗、7
……スイツチングトランジスタ、9……コンデン
サ、10,11……ダイオード。
Fig. 1 is a gate trigger circuit diagram showing one embodiment of the invention, Fig. 2 is a gate trigger circuit diagram showing another embodiment of the invention, and Fig. 3 is a gate trigger circuit diagram showing another embodiment of the invention. Trigger Circuit Diagram: FIG. 4 is a gate trigger circuit diagram showing a conventional example. 1... AC power supply, 2... Load, 3... Switching element, 4... DC power supply, 5, 6... Resistance, 7
...Switching transistor, 9...Capacitor, 10, 11...Diode.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 交流電源に負荷と双方向性3端子サイリスタと
を直列に接続した負荷回路と、前記双方向性3端
子サイリスタのゲート側にアノードが接続される
とともに、前記双方向性3端子サイリスタの陰極
にカソードが接続されたダイオードと、前記ダイ
オードと並列に接続され、前記ダイオードのアノ
ードに接続されたコンデンサとNPNトランジス
タを有する直列回路と、前記コンデンサを含む前
記NPNトランジスタのコレクタと前記双方向性
3端子サイリスタのゲート間に設けられた放電電
流制限用抵抗と、前記NPNトランジスタのベー
スに接続された負荷制御回路と、前記NPNトラ
ンジスタのコレクタから前記コンデンサに至る回
路上で、かつ前記コンデンサに隣接する回路位置
に抵抗を介して接続された直流電源とからなるゲ
ートトリガ回路。
A load circuit in which a load and a bidirectional 3-terminal thyristor are connected in series to an AC power source, an anode connected to the gate side of the bidirectional 3-terminal thyristor, and a cathode connected to the cathode of the bidirectional 3-terminal thyristor. a series circuit having a diode connected to the diode, a capacitor connected in parallel with the diode and an anode of the diode, and an NPN transistor, a collector of the NPN transistor including the capacitor, and the bidirectional three-terminal thyristor. a discharge current limiting resistor provided between the gates of the transistor, a load control circuit connected to the base of the NPN transistor, and a circuit position on the circuit from the collector of the NPN transistor to the capacitor and adjacent to the capacitor. A gate trigger circuit consisting of a DC power supply connected to the gate via a resistor.
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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5226834U (en) * 1975-08-13 1977-02-24

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