JPS6333383Y2 - - Google Patents
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- JPS6333383Y2 JPS6333383Y2 JP18542982U JP18542982U JPS6333383Y2 JP S6333383 Y2 JPS6333383 Y2 JP S6333383Y2 JP 18542982 U JP18542982 U JP 18542982U JP 18542982 U JP18542982 U JP 18542982U JP S6333383 Y2 JPS6333383 Y2 JP S6333383Y2
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- JP
- Japan
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- voltage
- converter
- tuning voltage
- tuning
- circuit
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- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000003071 parasitic effect Effects 0.000 description 1
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Noise Elimination (AREA)
Description
【考案の詳細な説明】
本考案は、電子チユーナのチユーニング電圧発
生回路に関するものである。[Detailed Description of the Invention] The present invention relates to a tuning voltage generation circuit for an electronic tuner.
電子チユーナにおけるチユーニング電圧用の供
給電源として、DC−DCコンバータを用いるチユ
ーニング電圧発生回路が知られている。この回路
でしばしば問題になるのは、低受信帯域では、
DC−DCコンバータに依るビート妨害が比較的大
きいことである。一方、低受信帯域では、チユー
ニング電圧は比較的低くてよい。 A tuning voltage generation circuit using a DC-DC converter is known as a power supply for tuning voltage in an electronic tuner. A problem often encountered with this circuit is that at low reception bands,
The problem is that the beat disturbance caused by the DC-DC converter is relatively large. On the other hand, in low reception bands, the tuning voltage may be relatively low.
本考案は、上記事情にもとづいてなされたもの
で、低受信帯域では、DC−DCコンバータをバイ
パスして電圧供給が行なえるようにして、ビート
妨害を回避できるようにした電子チユーナのチユ
ーニング電圧発生回路を提供しようとするもので
ある。 The present invention was developed based on the above circumstances, and is a tuning voltage generator for an electronic tuner that bypasses the DC-DC converter to supply voltage in low reception bands, thereby avoiding beat disturbance. It is intended to provide a circuit.
この目的のため、本考案は、電子チユーナにお
けるチユーニング電圧用の供給電源としてDC−
DCコンバータを用いるものにおいて、チユーニ
ング電圧が所定値の上下によつてDC−DCコンバ
ータを経由して電圧を与えるか、バイパスされる
かを切換える切換回路を設けたことを特徴とする
ものである。 For this purpose, the present invention proposes a DC-
A device using a DC converter is characterized by being provided with a switching circuit that switches whether the voltage is applied via the DC-DC converter or bypassed depending on whether the tuning voltage rises or falls above or below a predetermined value.
以下、本考案の一実施例を図面を参照して具体
的に説明する。図において、符号１はチユーナで
あり、＋BVの電圧電源からは切換回路２を介し
てDC−DCコンバータ３に電圧供給がなされ、上
記DC−DCコンバータ３からは高電圧がLPF（ロ
ーパスフイルタ）４を介してチユーナ１に供給さ
れるようになつている。チユーナ１からは、
OSC信号がプリスケーラおよびコントローラ５
に与えられ、LPFに制御信号が入る。 Hereinafter, one embodiment of the present invention will be specifically described with reference to the drawings. In the figure, reference numeral 1 is a tuner, and voltage is supplied from a +BV voltage power source to a DC-DC converter 3 via a switching circuit 2, and a high voltage is supplied from the DC-DC converter 3 to an LPF (low-pass filter) 4. It is designed to be supplied to tuner 1 via. From Chuyuna 1,
OSC signal is prescaler and controller 5
A control signal is input to the LPF.
一方、LPF４の出力側には、チユーニング電
圧VTを検出して基準電圧V1と比較する比較回路
６があつて、上記切換回路２を切換動作するよう
になつており、チユーニング電圧VTがV1以下に
なると、上記切換回路２からバイパスしてLPF
４に電源電圧＋Ｂが与えられる。 On the other hand, on the output side of the LPF 4, there is a comparison circuit 6 that detects the tuning voltage V T and compares it with the reference voltage V 1 , which switches the switching circuit 2 so that the tuning voltage V T is When V becomes less than 1 , the above switching circuit 2 is bypassed and the LPF is switched on.
4 is given a power supply voltage +B.
上記比較回路６および切換回路２は、例えば、
第２図のような構成になつている。ここではオペ
アンプ７があつて、一方の入力チユーニング電圧
VTが印加され、他方の入力に抵抗R1，R2で分圧
された基準電圧V1が印加されていて、VT＞V1の
時には、トランジスタQ1にベース電圧を与えて
DC−DCコンバータ３に電源電圧VCC（＋Ｂ）を与
えるが、VT＞V1の時には、トランジスタQ1のベ
ース電圧が下り、電源電圧VCCはダイオードD1を
介してLPF４に与えられる。なおD2は、DC−
DCコンバータ３の出力側に設けたダイオードで
ある。 The comparison circuit 6 and the switching circuit 2 are, for example,
The configuration is as shown in Figure 2. Here, operational amplifier 7 is placed, and one input tuning voltage
When V T is applied and the reference voltage V 1 divided by resistors R 1 and R 2 is applied to the other input, and when V T > V 1 , the base voltage is applied to the transistor Q 1 .
A power supply voltage V CC (+B) is applied to the DC-DC converter 3, but when V T >V 1 , the base voltage of the transistor Q 1 drops, and the power supply voltage V CC is applied to the LPF 4 via the diode D 1 . Note that D 2 is DC−
This is a diode provided on the output side of the DC converter 3.
このような構成では、チユーナ１の電圧が低受
信帯域においては、VTの低下により比較回路６
を介して切換回路２に制御信号が入り、低電圧に
切換え、DC−DCコンバータ３を通さずにLPF４
に電源電圧を与える。その結果、DC−DCコンバ
ータ３に依るビート妨害が回避される。 In such a configuration, when the voltage of the tuner 1 is low in the reception band, the comparator circuit 6
A control signal is input to the switching circuit 2 through
Give the power supply voltage to. As a result, beat interference caused by the DC-DC converter 3 is avoided.
なお上記実施例では、コントローラ５を設けた
PLLシンセサイザを示したが、ボルテージシン
セサイザでも同様に本考案に係るチユーニング電
圧発生回路は利用できる。 In the above embodiment, the controller 5 is provided.
Although a PLL synthesizer is shown, the tuning voltage generation circuit according to the present invention can be similarly used in a voltage synthesizer.
本考案は、以上詳述したように、チユーニング
電圧を比較して、基準電圧を分岐点として、比較
出力を用いて切換えを行ない、DC−DCコンバー
タを経由するか、バイパスで通すかによつて、チ
ユーナの受信帯域の高低に応じた無給電圧の切換
えを行なうため、比較的影響の大きい低受信帯域
でのビート妨害を回避できるという実用上の効果
が得られる。 As described in detail above, the present invention compares the tuning voltages, uses the reference voltage as a branch point, uses the comparison output to perform switching, and then switches the tuning voltages depending on whether the tuning voltage is passed through a DC-DC converter or by bypass. Since the parasitic voltage is switched according to the height of the reception band of the tuner, a practical effect can be obtained in that beat disturbance in the low reception band, which has a relatively large influence, can be avoided.
第１図は本考案の一実施例を示すブロツク構成
図、第２図は要部の回路構成図である。
１……チユーナ、２……切換回路、３………
DC−DCコンバータ、４……LPF、５……プリス
ケーラ＆コントローラ、６……比較回路、７……
オペアンプ、R1，R2……抵抗、Q1……トランジ
スタ、D1，D2……ダイオード。
FIG. 1 is a block diagram showing an embodiment of the present invention, and FIG. 2 is a circuit diagram of the main parts. 1...Tuner, 2...Switching circuit, 3......
DC-DC converter, 4...LPF, 5...Prescaler & controller, 6... Comparison circuit, 7...
Operational amplifier, R1 , R2 ...Resistor, Q1 ...Transistor, D1 , D2 ...Diode.
Claims (1)
DC−DCコンバータよりの出力を電子チユーナの
チユーニング電圧としたものにおいて、 前記チユーニング電圧が所定値より大きいとき
は、前記直流電圧をDC−DCコンバータに入力
し、該コンバータの出力よりチユーニング電圧を
与えると共に、所定値より小さいときは、DC−
DCコンバータをバイパスさせ、前記直流電圧を
DC−DCコンバータを介さずにチユーニング電圧
として供給するように切換える切換回路を設けた
ことを特徴とする電子チユーナのチユーニング電
圧発生回路。[Scope of claim for utility model registration] Direct current voltage is input to a DC-DC converter, and
In the case where the output from the DC-DC converter is used as the tuning voltage of the electronic tuner, when the tuning voltage is larger than a predetermined value, the DC voltage is input to the DC-DC converter, and the tuning voltage is applied from the output of the converter. In addition, when it is smaller than the predetermined value, DC−
Bypassing the DC converter, the DC voltage is
A tuning voltage generation circuit for an electronic tuner, characterized in that a switching circuit is provided for switching to supply a tuning voltage without going through a DC-DC converter.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18542982U JPS5988961U (en) | 1982-12-08 | 1982-12-08 | Tuning voltage generation circuit for electronic tuner |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18542982U JPS5988961U (en) | 1982-12-08 | 1982-12-08 | Tuning voltage generation circuit for electronic tuner |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5988961U JPS5988961U (en) | 1984-06-16 |
| JPS6333383Y2 true JPS6333383Y2 (en) | 1988-09-06 |
Family
ID=30400787
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18542982U Granted JPS5988961U (en) | 1982-12-08 | 1982-12-08 | Tuning voltage generation circuit for electronic tuner |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5988961U (en) |
-
1982
- 1982-12-08 JP JP18542982U patent/JPS5988961U/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5988961U (en) | 1984-06-16 |
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