JPH0248893Y2 - - Google Patents

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JPH0248893Y2
JPH0248893Y2 JP1981012241U JP1224181U JPH0248893Y2 JP H0248893 Y2 JPH0248893 Y2 JP H0248893Y2 JP 1981012241 U JP1981012241 U JP 1981012241U JP 1224181 U JP1224181 U JP 1224181U JP H0248893 Y2 JPH0248893 Y2 JP H0248893Y2
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Description

【考案の詳細な説明】 この考案は安定化電源回路に係り、特にその軽
負荷時のリツプルの影響ならびに重負荷時の効率
の低下を防止し得るように改良したものに関す
る。
DETAILED DESCRIPTION OF THE INVENTION This invention relates to a stabilized power supply circuit, and in particular to a stabilized power supply circuit that has been improved to prevent the effects of ripples during light loads and decreases in efficiency during heavy loads.

従来、音響機器等を含む電子機器一般に広く使
用される安定化電源回路として第1図a,bに示
すように構成されたものが知られている。すなわ
ち、aは電源トランスT1、整流平滑回路RA1
介して与えられる直流入力を制御トランジスタ
Q1、バイアス抵抗RB1および定電圧ダイオード
ZD1を含む安定化回路SC1により入力追従式に制
御して負荷RL1に安定化された直流出力を供給し
得るようにしたものである。
2. Description of the Related Art Conventionally, a stabilized power supply circuit configured as shown in FIGS. 1a and 1b is known as a stabilized power supply circuit widely used in general electronic equipment including audio equipment and the like. That is, a is a transistor that controls the DC input provided via the power transformer T 1 and the rectifier and smoothing circuit RA 1 .
Q 1 , bias resistor R B1 and voltage regulator diode
The stabilizing circuit SC 1 including ZD 1 performs control in an input tracking manner to supply a stabilized DC output to the load R L1 .

また、bは電源トランスT2、整流平滑回路
FA2を介して与えられる直流入力を制御トランジ
スタQ2,Q3、バイアス抵抗RB2および定電圧ダイ
オードND2を含む安定化回路SC2により出力追従
式に制御して負荷RL2に安定化された直流出力を
供給し得るようにしたものである。
In addition, b is a power transformer T 2 and a rectifying and smoothing circuit.
The DC input applied via FA 2 is controlled in an output tracking manner by a stabilizing circuit SC 2 including control transistors Q 2 , Q 3 , bias resistor R B2 and voltage regulator diode ND 2 and stabilized by the load R L2 . It is designed to be able to supply direct current output.

ところで、このような安定化電源回路は電源ト
ランスT1,T2自体の電圧変動率が問題となると
共に、負荷RL1,RL2の軽重の差によつていかな
る状態でも確実に安定化された直流出力を効率よ
く得ることが困難である。
By the way, in such a stabilized power supply circuit, the voltage fluctuation rate of the power transformers T 1 and T 2 themselves becomes a problem, and the load R L1 and R L2 are reliably stabilized under any conditions due to the difference in weight. It is difficult to obtain DC output efficiently.

つまり、軽負荷時の場合は出力電圧の低下すな
わち電源効率の低下はあまりみられないものの、
リツプルの影響が非常に大きくなつてしまうから
である。
In other words, when the load is light, there is not much of a drop in output voltage, that is, a drop in power supply efficiency.
This is because the influence of ripples becomes extremely large.

また、重負荷時の場合は上述の場合と反対に電
源効率の低下が生じてしまうからである。
In addition, when the load is heavy, the power supply efficiency decreases, contrary to the above-mentioned case.

すなわち、重負荷時においては制御トランジス
タQ1,Q2のベース・エミツタ間電圧VBEがスイツ
チング時に残つてしまうために、定電圧ダイオー
ドZD1の電圧をVZ、直流入力電圧をVAとしたと
き VZ+VBE>VA の場合には出力電圧VCCは VCC=VA−VBE となつて、VBE分だけの損失を免れることができ
ないからである。
In other words, under heavy loads, the base-emitter voltage V BE of the control transistors Q 1 and Q 2 remains during switching, so the voltage of the constant voltage diode ZD 1 is set to V Z and the DC input voltage is set to V A. This is because when V Z + V BE > V A , the output voltage V CC becomes V CC = V A − V BE , and a loss equal to V BE cannot be avoided.

そこで、この考案は以上のような点に鑑みてな
されたもので、簡易な構成でしかも確実に軽負荷
時のリツプルの影響ならびに重負荷時の効率の低
下を防止し得るように改良した極めて良好な安定
化電源回路を提供することを目的としている。
Therefore, this idea was devised in view of the above points, and it has a simple structure and is an extremely good product that has been improved to reliably prevent ripple effects under light loads and decreases in efficiency under heavy loads. The purpose is to provide a stable power supply circuit.

以下図面を参照してこの考案の一実施例につき
詳細に説明する。
An embodiment of this invention will be described in detail below with reference to the drawings.

すなわち、第2図においてT11は一次側が交流
電源A・Cに接続された電源トランスである。そ
して、この電源トランスT11の二次側はその中点
が接地され且つその両端が整流平滑回路RA11
構成する図示極性のダイオードD11,D12を介し
て共通に接続された後、同コンデンサC11を介し
て接地される。
That is, in FIG. 2, T11 is a power transformer whose primary side is connected to AC power sources A and C. The secondary side of this power transformer T 11 is grounded at its midpoint, and its both ends are commonly connected via diodes D 11 and D 12 of the polarity shown in the figure, which constitute the rectifying and smoothing circuit RA 11 . Grounded via capacitor C11 .

また、上記ダイオードD11,D12の共通接続点
は安定化回路SC11を構成する主制御トランジス
タQ11のエミツタに接続される。
Further, the common connection point of the diodes D 11 and D 12 is connected to the emitter of the main control transistor Q 11 constituting the stabilizing circuit SC 11 .

ここで、主制御トランジスタQ11はそのコレク
タが図示極性の定電圧ダイオードZD11およびエ
ラー検出用素子となる抵抗R11を直列に介して接
地されると共にコンデンサC12および負荷RL11
並列に介して接地され、且つそのベースが抵抗
R12を介し補助制御トランジスタQ12のコレクタ
に接続されている。
Here, the collector of the main control transistor Q 11 is grounded through a constant voltage diode ZD 11 with the polarity shown and a resistor R 11 serving as an error detection element in series, and connected in parallel through a capacitor C 12 and a load R L11 . grounded and its base is a resistor.
Connected via R12 to the collector of the auxiliary control transistor Q12 .

また、上記補助制御トランジスタQ12はそのエ
ミツタが直接的に接地され、且つそのベースが抵
抗R13を介してコントロール信号(またはバイア
ス電圧)入力端INに接続されると共にエラー検
出用トランジスタQ13のコレクタに接続されてい
る。
Furthermore, the emitter of the auxiliary control transistor Q12 is directly grounded, and the base is connected to the control signal (or bias voltage) input terminal IN via the resistor R13 , as well as the error detection transistor Q13 . connected to the collector.

そして、このエラー検出用トランジスタQ13
は、そのエミツタが直接的に接地され且つそのベ
ースが前記定電圧ダイオードZD11と抵抗R11の接
続中点に接続されている。
And this error detection transistor Q13
has its emitter directly grounded and its base connected to the midpoint between the constant voltage diode ZD11 and the resistor R11 .

而して、以上の構成においてコントロール信号
(またはバイアス電圧)入力端INの電位がオフ
(ロー)レベルである場合には、補助制御トラン
ジスタQ12および主制御トランジスタQ11が共に
カツトオフ状態となるために、電源トランスT11
および整流平滑回路RA11を介して図示点に導
出される直流入力が出力側の図示点には導出さ
れることがないようにした安定化回路SC11全体
の非動作状態となる。
Therefore, in the above configuration, when the potential of the control signal (or bias voltage) input terminal IN is at an off (low) level, both the auxiliary control transistor Q 12 and the main control transistor Q 11 are in the cut-off state. In, power transformer T 11
The entire stabilizing circuit SC 11 becomes inoperative so that the DC input led out to the indicated point via the rectifying and smoothing circuit RA 11 is not led out to the indicated point on the output side.

次に、コントロール信号(またはバイアス電
圧)入力端INの電位がオン(ハイ)レベルであ
る場合には補助制御トランジスタQ12および主制
御トランジスタQ11が共にオン状態となり、図示
点に導出される直流入力が出力側の図示点に
後述するような制御動作を伴つて導出される如く
した安定化回路SC11全体の動作状態となる。
Next, when the potential of the control signal (or bias voltage) input terminal IN is on (high) level, both the auxiliary control transistor Q 12 and the main control transistor Q 11 are on, and a direct current is drawn to the point shown in the figure. The overall operating state of the stabilizing circuit SC 11 is such that the input is guided to the illustrated point on the output side with a control operation as will be described later.

そして、この場合負荷RL11が軽負荷である場合
つまり出力電流I0が小なる範囲では第3図に示す
ように上記点電位VAは図示破線部の如く高い
状態で且つリツプル分も含まれた状態のままで上
記点に制御トランジスタQ11のエミツタ・コレ
クタ電圧VCE分だけ低下された殆ど点電位に等
しい電位として導出されようとする。しかるに、
この場合定電圧ダイオードZD11の作用およびエ
ラー検出用トランジスタQ13の作用によつて該
点の電位が VZ〔ZD11〕+VBE〔Q13〕 となる如く、上記補助制御トランジスタQ12を介
して主制御トランジスタのエミツタ・コレクタ間
電圧VCEが制御されることになる。すなわち、か
かる帰還ループによる制御動作によつて軽負荷時
の出力電圧VCCは第3図の直線領域イの如くVZ
〔ZD11〕+VBE〔Q13〕<VAの範囲で所定の値に安定
化されるようになると共に、リツプル分が影響を
及ぼさないように除去されるようになるものであ
る。
In this case, when the load R L11 is a light load, that is, in a range where the output current I 0 is small, as shown in FIG. In this state, the potential is lowered by the emitter-collector voltage V CE of the control transistor Q 11 and is almost equal to the point potential. However,
In this case, the potential at that point becomes V Z [ZD 11 ] + V BE [Q 13 ] due to the action of the voltage regulator diode ZD 11 and the action of the error detection transistor Q 13 through the auxiliary control transistor Q 12 . Thus, the emitter-collector voltage V CE of the main control transistor is controlled. In other words, due to the control operation by such a feedback loop, the output voltage V CC at light load becomes V Z as shown in the linear region A in Fig. 3.
It is stabilized to a predetermined value within the range of [ZD 11 ]+V BE [Q 13 ]<V A , and the ripple component is removed so as not to have any influence.

また、負荷RL11が重負荷である場合つまり出力
電流I0が大なる範囲では、点の電位VAが VZ〔ZD11〕+VBE〔Q13〕>VA なる領域で定電圧ダイオードZD11が動作しなく
なるために、制御トランジスタQ11からの出力電
圧VCC VCC=VA−VCE〔Q11〕 となる。ここで、VCE<VBEであるから従来に比
してVBE−VCE分だけ損失を少なくすることがで
き、延いてはそれだけ電源効率を改善し得るもの
である。
In addition, when the load R L11 is a heavy load, that is, in a range where the output current I 0 is large , the voltage regulator diode ZD 11 stops operating, the output voltage from the control transistor Q 11 becomes V CC V CC =V A −V CE [Q 11 ]. Here, since V CE <V BE , the loss can be reduced by V BE −V CE compared to the conventional case, and the power supply efficiency can be improved accordingly.

すなわち、以上のような安定化電源回路は軽負
荷時のリツプルの影響を防止し得るので、例えば
負荷として発振器を用いた場合にリツプル成分に
より変調を受ける如くした不所望な事態を未然に
回避することが可能となる。また、軽負荷時には
良好な安定化作用が伴われているので、それだけ
負荷側の使用部品に対しての過電圧保護効果を発
揮せしめることが可能となる。
In other words, the above-described stabilized power supply circuit can prevent the effects of ripples during light loads, thereby avoiding undesirable situations such as modulation caused by ripple components when an oscillator is used as a load, for example. becomes possible. In addition, since a good stabilizing effect is provided during light loads, it is possible to exert an overvoltage protection effect on the parts used on the load side.

そして、このような効果は特に音響機器に適用
した場合に電源ハムの影響を改善し得ることも手
伝つて十二分に発揮されたものである。また、特
にシンセサイザチユーナ等におけるチユーニング
用電圧可変容量ダイオードに与える電圧の安定化
にも寄与し得るものである。
These effects are more than fully demonstrated, especially when applied to audio equipment, in part because they can improve the effects of power supply hum. In addition, it can also contribute to stabilizing the voltage applied to the voltage variable capacitance diode for tuning, especially in synthesizer tuners and the like.

なお、この考案は上記し且つ図示した実施例の
みに限定されることなく、この考案の要旨を逸脱
しない範囲で種々の変形や適用が可能であること
は言う迄もない。
It goes without saying that this invention is not limited to the embodiments described above and illustrated, and that various modifications and applications can be made without departing from the gist of this invention.

従つて、以上詳述したようにこの考案によれ
ば、簡易な機成でしかも確実に軽負荷時のリツプ
ルの影響ならびに重負荷時の効率の低下を防止し
得るように改良した極めて良好な安定化電源回路
を提供することが可能となる。
Therefore, as detailed above, this invention has a simple structure and is improved to reliably prevent ripple effects under light loads and decreases in efficiency under heavy loads, resulting in extremely good stability. It becomes possible to provide an integrated power supply circuit.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図a,bは従来の安定化電源回路を示す構
成説明図、第2図はこの考案に係る安定化電源回
路の一実施例を示す構成説明図、第3図は第2図
の作用を説明するため電圧電流特性曲線図であ
る。 T11……電源トランス、RA11……整流平滑回
路、D11,D12……ダイオード、C11,C12……コン
デンサ、SC11……安定化回路、Q11……主制御ト
ランジスタ、R11〜R13……抵抗、ZD11……定電
圧ダイオード、RL11……負荷、Q12……補助制御
トランジスタ、Q13……エラー検出用トランジス
タ。
Figures 1a and b are configuration explanatory diagrams showing a conventional stabilized power supply circuit, Figure 2 is a configuration explanatory diagram showing an embodiment of the stabilized power supply circuit according to this invention, and Figure 3 is the function of Figure 2. FIG. 2 is a voltage-current characteristic curve diagram for explaining. T 11 ... Power transformer, RA 11 ... Rectifier and smoothing circuit, D 11 , D 12 ... Diode, C 11 , C 12 ... Capacitor, SC 11 ... Stabilization circuit, Q 11 ... Main control transistor, R 11 ~ R 13 ... Resistor, ZD 11 ... Constant voltage diode, R L11 ... Load, Q 12 ... Auxiliary control transistor, Q 13 ... Error detection transistor.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] エミツタおよびコレクタがそれぞれ所定の直流
入力電位を与える直流入力側および所定の直流出
力電位を与える直流出力側に対応して接続された
主制御トランジスタと、この主制御トランジスタ
の直流出力側と基準電位点間に直列に接続された
定電圧ダイオードおよびエラー検出用素子と、こ
れら定電圧ダイオードとエラー検出用素子との接
続中点にベースが接続され且つエミツタが基準電
位点に接続されたエラー検出用トランジスタと、
このエラー検出用トランジスタのコレクタにベー
スが接続され且つエミツタおよびコレクタが基準
電位点および前記主制御トランジスタのベースに
接続された補助制御トランジスタとを具備し、こ
の補助制御トランジスタを外部からのコントロー
ル信号で選択的にオン・オフせしめると共に、前
記直流出力側に接続される負荷が軽負荷の状態で
直流出力電位が前記定電圧ダイオードによる定電
圧と前記エラー検出用トランジスタのベース・エ
ミツタ間電圧との和による安定化電圧とされて前
記直流入力側に現れるリツプル分を除去したもの
となり、且つ重負荷の状態で直流出力電位が直流
入力電位から前記制御トランジスタのコレクタ・
エミツタ間電圧を差し引いた電圧とされて電源効
率を向上したものとなる如く構成したことを特徴
とする安定化電源回路。
A main control transistor whose emitter and collector are respectively connected to a DC input side that provides a predetermined DC input potential and a DC output side that provides a predetermined DC output potential, and a DC output side of this main control transistor and a reference potential point. A constant voltage diode and an error detection element connected in series between them, and an error detection transistor whose base is connected to the connection midpoint between the constant voltage diode and the error detection element and whose emitter is connected to a reference potential point. and,
An auxiliary control transistor is provided, the base of which is connected to the collector of the error detection transistor, and whose emitter and collector are connected to a reference potential point and the base of the main control transistor, and the auxiliary control transistor is controlled by an external control signal. In addition to selectively turning on and off, when the load connected to the DC output side is light, the DC output potential is the sum of the constant voltage by the constant voltage diode and the base-emitter voltage of the error detection transistor. The stabilized voltage is obtained by removing the ripple component appearing on the DC input side, and the DC output potential changes from the DC input potential to the collector voltage of the control transistor under heavy load.
A stabilized power supply circuit characterized in that it is configured such that the voltage is obtained by subtracting the voltage between the emitters and the power supply efficiency is improved.
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JPS57127217U JPS57127217U (en) 1982-08-07
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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50106603A (en) * 1974-01-16 1975-08-22

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Publication number Priority date Publication date Assignee Title
JPS48103837U (en) * 1972-03-07 1973-12-04
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