JPS63284414A - Servo device with encoder open-phase detecting circuit - Google Patents

Servo device with encoder open-phase detecting circuit

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JPS63284414A
JPS63284414A JP11705287A JP11705287A JPS63284414A JP S63284414 A JPS63284414 A JP S63284414A JP 11705287 A JP11705287 A JP 11705287A JP 11705287 A JP11705287 A JP 11705287A JP S63284414 A JPS63284414 A JP S63284414A
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JP
Japan
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phase
open
circuit
encoder
pulse
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Application number
JP11705287A
Other languages
Japanese (ja)
Inventor
Kuniaki Kubokura
久保倉 邦明
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
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Publication of JPS63284414A publication Critical patent/JPS63284414A/en
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Abstract

PURPOSE:To take a corresponding countermeasure speedily by detecting the open phase of a pair of signals in an incremental two-phase encoder when the signals are in the open-phase state and deciding abnormality. CONSTITUTION:The 90 deg. out-of-phase A-phase and B-phase outputs 2 and 3 of the incremental two-phase encoder 1 are supplied to a processing circuit 4, which generates pulses by a part 5 at the leading-edge and trailing-edge parts of the A-phase and B-phase pulses 2 and 3, multiply the pulses by two, and send the signals to an open-phase detecting circuit 20. When the pulse 2 enters the open-phase state and is held at a high potential, a clear pulse input for the counter of the A-phase monitor circuit 21 misses, B-phase doubled pulses are counted successively, and an output appears at a terminal 26, so that the output 34 of the circuit 20 becomes an 'H' signal indicating the open- phase state. Further, when the B-phase is open, the output 34 rises to 'H' by the similar function of a B-phase monitor circuit 27.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、例えばFA用サーボモータ制御に使用される
エンコーダ欠相検出回路付サーボ装置に係り、さらに詳
細には、回転や直線運動など、正逆2運動方向の速度・
位置検出に2相のエンコーダを用いる場合に、その1方
向の欠相検出を実現して、機器の動作安全を向上させる
ことのできる、エンコーダ欠相検出回路付サーボ装置に
関するものであ葛。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a servo device with an encoder open-phase detection circuit used, for example, for controlling a servo motor for FA, and more specifically, for rotational and linear motion, Velocity in two directions of forward and reverse movement
This invention relates to a servo device with an encoder open-phase detection circuit that can detect open-phase in one direction when using a two-phase encoder for position detection and improve operational safety of the device.

〔従来の技術〕[Conventional technology]

従来より、エンコーダは、回転や直線運動など、正逆2
運動方向の速度や位置の検出器として多用されている。
Traditionally, encoders have been used for both forward and reverse motion, such as rotation and linear motion.
It is often used as a speed and position detector in the direction of motion.

そして、それらは、光学式や磁気式の原理にもとづいて
、角度や位置に対応して電気パルスを発生するよう構成
されており、特に、インクリメンタル式(増分値式)の
エンコーダは、2ビツトの2相パルスを発生させるべく
、A相。
Based on optical or magnetic principles, these encoders are configured to generate electrical pulses in response to angles and positions.In particular, incremental encoders are 2-bit encoders. A phase to generate two-phase pulses.

B相を形成し、正転逆転の検出と併せて、パルス数の2
倍化や4倍化をはかり、検出器の分解能向上ができるの
で、一般に広く用いられている。その応用例は、マイク
ロコンピュータを用いたディジタル制御サーボモータに
見られ、モータの回転位置検出は、エンコーダの2相出
力パルスから4倍の数のクロックパルスを形成し、(以
下、ファインカウントと称す)、これを8ビツトのカウ
ンタにより数えるようにしており1回転方向は、電気的
に90度異なる2相出力の位相(進相遅相)関係から判
別し、正転の場合は、ファインカウントを加算し、逆転
の場合は減算するアップダウンカウンタによ゛す、常に
現在位置を検出する方法が多用されている。そして、そ
の具体的制御回路は、4ビツトや8ビツト、あるいは1
6ビツトマイクロコンピユータなどを中心に構成され、
ソフトによってカバーされる部分が多いが、処理スピー
ドを要する周辺部などは、各種TTLのディジタルIC
によって構成される例も多い。
B phase is formed, and in addition to detecting forward and reverse rotation, the number of pulses is 2.
It is generally widely used because it can double or quadruple it and improve the resolution of the detector. An example of its application is a digitally controlled servo motor using a microcomputer. The rotational position of the motor is detected by forming four times the number of clock pulses from the two-phase output pulses of the encoder (hereinafter referred to as fine counting). ), this is counted by an 8-bit counter, and the direction of one rotation is determined from the phase relationship (lead phase, slow phase) of the two-phase outputs that are electrically 90 degrees apart, and in the case of forward rotation, a fine count is used. A frequently used method is to constantly detect the current position using an up/down counter that adds up and subtracts in the case of reversal. The specific control circuit is 4 bits, 8 bits, or 1 bit.
It is mainly composed of a 6-bit microcomputer, etc.
Many parts are covered by software, but peripheral parts that require processing speed are covered by various TTL digital ICs.
There are many examples where it is constructed by

なお、モータ制御に関する先行技術は、例えば(1)「
メカトロニクス・1 最先端の制御用モータ」第154
頁〜第157頁・1984年2月27日・株式会社技術
調査会発行 (2)「メカトロニクスの原動力 ″83
小形モータ技術シンポジウム」 (会期:昭和57年2
月22日〜2月25日)資料筒6−3−1頁〜第6−3
−8頁・社団法人日本能率協会発行 (3)「続・制御
用モータの活用」第66頁〜第74頁・昭和6゜年3月
1日・株式会社大河出版発行 (4)rDCモータの制
御回路設計」第141頁〜第160頁・昭和60年5月
20日・CQ出版株式会社発行などに記載されている。
Note that prior art related to motor control includes, for example, (1) “
Mechatronics 1: Cutting-edge control motors” No. 154
Pages - No. 157, February 27, 1984, Published by Gijutsu Kenkyukai Co., Ltd. (2) "The driving force of mechatronics" 83
"Small Motor Technology Symposium" (Date: February 1982)
Monthly 22nd to February 25th) Document cylinder pages 6-3-1 to 6-3
-8 pages, published by the Japan Management Association (3) "Continued: Utilization of control motors", pages 66 to 74, March 1, 1938, published by Taiga Publishing Co., Ltd. (4) rDC motors "Control Circuit Design", pages 141 to 160, May 20, 1985, published by CQ Publishing Co., Ltd.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

ところで、従来、エンコーダからのパルス信号全体が異
常に欠損した場合(例えば、異常軸ロックや回路接続外
れなど)、これを指令に対する応答欠如として検出し、
保護回路を動作させることは既におこなわれている。
By the way, conventionally, when the entire pulse signal from the encoder is abnormally lost (for example, due to abnormal axis locking or disconnection of the circuit), this is detected as a lack of response to the command.
Activating the protection circuit has already been done.

しかし、2相中の1相のパルスが欠損する、いわゆる「
欠相」については、正常動作との区別の困難さもあり、
安価で有効な検出方法は見当らず、なお、欠相の場合は
、速度・位置・回転方向全体に誤信号が発生し、システ
ムの信頼性・安全性に悪影響をおよぼす。
However, one of the two phase pulses is missing, so-called "
Regarding "open phase", it is difficult to distinguish it from normal operation.
No inexpensive and effective detection method has been found, and in the case of an open phase, erroneous signals are generated for the entire speed, position, and direction of rotation, which adversely affects the reliability and safety of the system.

本発明は、前記した従来技術の問題点を解決すべく種々
検討の結果なされたものであって、その目的とするとこ
ろは、インクリメンタル式2相エンコーダ中の1相の信
号が欠相した場合に、速やかにこの欠相を検出して異常
判別をおこない、非常停止などの措置を早急に講じるこ
とのできるエンコーダ欠相検出回路付サーボ装置を提供
しようとするものである。゛ 〔問題点を解決するための手段〕 前記目的を達成するため、本発明に係るエンコーダ欠相
検出回路付サーボ装置は、インクリメンタル式2相の正
逆2運動方向検出用エンコーダを有し、かつ各々の相の
発生信号より作成した対応信号により、互いに一方をク
リア入力とし、他方をカウント入力として、相互に欠相
監視・検出する手段を備えたことを特徴とするものであ
る。
The present invention was made as a result of various studies in order to solve the problems of the prior art described above, and its purpose is to solve the problems of the prior art described above. It is an object of the present invention to provide a servo device with an encoder open-phase detection circuit that can quickly detect this open-phase, determine an abnormality, and take immediate measures such as an emergency stop. [Means for solving the problem] In order to achieve the above object, a servo device with an encoder open phase detection circuit according to the present invention has an incremental two-phase encoder for detecting two forward and reverse motion directions, and The present invention is characterized by having means for mutually monitoring and detecting open phase by using corresponding signals created from the generated signals of each phase, with one input being used as a clear input and the other input being used as a count input.

〔作用〕[Effect]

以上の構成において、装置が正常に作動している状態に
あっては、各相対応パルスが交互に発生し、運動方向切
替り時のみ、同一相のパルスが2個連続して発生する。
In the above configuration, when the device is in normal operation, pulses corresponding to each phase are generated alternately, and only when the movement direction is switched, two pulses of the same phase are generated consecutively.

そして、いずれかの相が欠相すると、この相のパルスは
発生せず、残りの正常相のパルスのみが発生することに
なる。すなわち、1相欠相による異常時には、クリアパ
ルスが入らないので、同一相のパルスが連続して3個以
上続くことになる。したがって、このときを異常発生時
として検出し、かついずれの相が欠相したかも併せて検
出する。
If any phase is open, pulses of this phase will not be generated, and only pulses of the remaining normal phases will be generated. That is, in the event of an abnormality due to one phase loss, a clear pulse is not input, so three or more pulses of the same phase continue. Therefore, this time is detected as the time when an abnormality occurs, and which phase is open is also detected.

〔実施例〕〔Example〕

以下、本発明を、第1図〜第4図の一実施例にもとづい
て説明すると、第1図はエンコーダ欠相検出回路付サー
ボ装置の電気回路図、第2図〜第4図はいずれも第1図
に示すサーボ装置の各種信号波形図である。
Hereinafter, the present invention will be explained based on an embodiment shown in Figs. 1 to 4. Fig. 1 is an electric circuit diagram of a servo device with an encoder open phase detection circuit, and Figs. 2 to 4 are all electrical circuit diagrams. 2 is a diagram of various signal waveforms of the servo device shown in FIG. 1. FIG.

第1図において、1はインクリメンタル式の2相エンコ
ーダであり、2,3のA相、B相出力は、第2図に示す
ごとく、各々デジタルパルスを電気的に90度の位相差
で出力する。4は前記エンコーダ1の出力2,3を処理
して、ファインカウントの作成と回転方向とを判別する
従来の処理回路である。
In Figure 1, 1 is an incremental two-phase encoder, and the A-phase and B-phase outputs of 2 and 3 each output digital pulses with an electrical phase difference of 90 degrees, as shown in Figure 2. . Reference numeral 4 designates a conventional processing circuit that processes the outputs 2 and 3 of the encoder 1 to determine the creation of a fine count and the rotation direction.

処理回路4において、各相パルスの2倍化回路5は、D
タイプのフリップフロップ6と、排他的論理和7,8と
によって構成され、第2図に符号9.10で示すごとく
、各相のパルス2,3の立上り、立下り部にパルスを作
り、パルスを2倍化する。
In the processing circuit 4, the doubling circuit 5 for each phase pulse is D
It is composed of a type flip-flop 6 and exclusive ORs 7 and 8, and as shown by reference numeral 9.10 in FIG. Double the amount.

11はパルスの4倍化回路であり、データセレクタ/マ
ルチプレクサ12を用いて、排他的論理和13の出力に
より、出力パルス信号9,10を  。
Reference numeral 11 denotes a pulse quadrupling circuit, which uses a data selector/multiplexer 12 to output pulse signals 9 and 10 from an exclusive OR 13.

選択的に出力14.15へ反転出力する。その波形は、
第2図に符号16,14.15で示すごときであり、正
転から逆転すると、A相、B相の電気的位相関係が第2
図の時間t1を境にして逆転することを、出力16によ
って判別し、出力14゜15に反映しており、これらは
さらに、回転方向判別回路17により、第2図に符号1
8で示すごとく、回転方向表示信号として出力される。
Selectively invert output to outputs 14 and 15. The waveform is
As shown in Fig. 2 with reference numerals 16, 14, and 15, when the rotation is reversed from normal rotation, the electrical phase relationship between the A phase and B phase becomes second.
It is determined by the output 16 that the rotation is reversed after time t1 in the figure, and this is reflected in the outputs 14 and 15.
As shown at 8, it is output as a rotation direction display signal.

また、出力14.15は、アップダウンカウンタ19を
動作させ、現在位置を把握して、図示を省略した関係回
路と共同で各種の制御を実現する。そして。
Further, the outputs 14 and 15 operate the up/down counter 19, grasp the current position, and implement various controls in collaboration with related circuits (not shown). and.

前記したごとき従来の処理回路4に対し、第1図に符号
20で示す欠相検出回路を増設して欠相検出をおこなう
のが本発明の要旨である。
The gist of the present invention is to perform open phase detection by adding an open phase detection circuit shown by the reference numeral 20 in FIG. 1 to the conventional processing circuit 4 as described above.

欠相検出回路20において、21は A相監視回路、2
2は4ビットバイナリ−カウンタであり。
In the open phase detection circuit 20, 21 is an A phase monitoring circuit;
2 is a 4-bit binary counter.

B相の2倍化パルス10は、論理和23を介し、カウン
トパルスとして入力される。そして、監視されるA相2
倍化パルス9がクリアパルスとして入力される。装置の
正常作動時、カウンタ22の2° 21.2z出力であ
るQA 、Qa 、Qc端子24,25.26の出力状
態は、第2図に同符号で示すごときであり、端子26に
出力は現れない。
The B-phase doubled pulse 10 is input as a count pulse via the logical sum 23. And A phase 2 to be monitored
Doubling pulse 9 is input as a clear pulse. During normal operation of the device, the output states of the QA, Qa, and Qc terminals 24, 25, and 26, which are the 2° 21.2z outputs of the counter 22, are as shown by the same symbols in FIG. It does not appear.

27は、A相監視回路21と同様に構成されたB相監視
回路で、B相監視回路27は、カウンタ28、論理和2
9.端子30,31.32を有する。ただし、A相監視
回路21のカウンタ22に対し、B相監視回路27のカ
ウンタ28は、その入力A、B相が入れ替えである。そ
して、装置の正常作動時、カウンタ28の2o 、2t
 、2z出力であるQA 、Qa 、Qc端子30,3
1.32の出力状態は、第2図に同符号で示すごときで
あり、端子32には、A相監視回路21に設けられてい
るカウンタ22の端子26と同様、出力は現れない。
27 is a B-phase monitoring circuit configured similarly to the A-phase monitoring circuit 21, and the B-phase monitoring circuit 27 includes a counter 28, a logical sum 2
9. It has terminals 30, 31, and 32. However, in contrast to the counter 22 of the A-phase monitoring circuit 21, the inputs of the counter 28 of the B-phase monitoring circuit 27 are exchanged. When the device is operating normally, the counter 28 is 2o and 2t.
, 2z outputs QA , Qa , Qc terminals 30,3
The output state of 1.32 is as shown by the same reference numerals in FIG.

第3図には、時間tzにおいてA相出力2が欠相し、高
電位を継続し続けた場合における装置各部の動作波形が
示されている。
FIG. 3 shows the operating waveforms of each part of the device when the A-phase output 2 has an open phase at time tz and continues to be at a high potential.

第3図の時間tzにおいて、A相出力2が欠相し、高電
位を継続し続けると、A相2倍化パルス9の出力が欠除
すると共に、その他の出力16゜14.15.18にも
異常を生じていることが判る。そして、A相監視回路2
1のカウンタ22に対するクリアパルス入力である前記
パルス9、すなわちA相2倍化パルス9の出力が欠除し
ているため、B相2倍化パルス10が順次カウントされ
At time tz in FIG. 3, the A-phase output 2 has an open phase and if the high potential continues, the output of the A-phase doubled pulse 9 is absent and the other outputs 16°14.15.18 It can be seen that an abnormality has also occurred. Then, the A phase monitoring circuit 2
Since the pulse 9 which is the clear pulse input to the counter 22 of No. 1, that is, the output of the A-phase doubling pulse 9, is missing, the B-phase doubling pulse 10 is sequentially counted.

遂には一つンタ22の2・出力端子であ°るQ・端子2
6に出力が現れる。すなわち、パルスカウント数が4に
至り、これにより、カウンタ22のカウントパルス入力
は、論理和23を介して高電位に保持され、以降のパル
スカウントはおこなわず。
Finally, one terminal 22, Q terminal 2, which is the output terminal.
The output appears at 6. That is, the pulse count reaches 4, and as a result, the count pulse input of the counter 22 is held at a high potential via the logical sum 23, and subsequent pulse counts are not performed.

出力34は、欠相を示す高レベルに保持される。Output 34 is held at a high level indicating an open phase.

なお、B相監視i路27の方は、A相欠相でカウントパ
ル不入力がなく、全てが低レベルとなる。
Incidentally, in the B-phase monitoring i-path 27, there is no count pulse failure due to the A-phase open phase, and all signals are at a low level.

A相が高レベル継続ではなく、低レベル継続による欠相
に至った場合にも、基本的には、前記と同様、監視回路
21のカウンタ22が、正常時の限界カウント数2を超
えて3,4とカウントし、出力34を高レベルとして欠
相を検出する。
Even if the phase A is not kept at a high level but continues to be at a low level resulting in a phase failure, basically the counter 22 of the monitoring circuit 21 exceeds the normal count limit of 2 and reaches 3, as described above. , 4, and the output 34 is set to a high level to detect an open phase.

また、第4図はB相欠相時における装置各部の動作波形
を示す。
Further, FIG. 4 shows the operating waveforms of each part of the device when the B phase is out of phase.

しかして、第4図の時間t8において、B相出力3が欠
相し、高レベルを継続し続けた場合には。
However, at time t8 in FIG. 4, if the B-phase output 3 has an open phase and continues to be at a high level.

B相監視回路27のカウンタ28が、正常時の限界カウ
ント数2を超えて3,4とカウントし、出力34を高レ
ベルとして欠相を検出する。なおり相が低レベル継続に
よる欠相に至った場合にも、前記と同様にして欠相検出
をおこなう。
The counter 28 of the B-phase monitoring circuit 27 counts 3 and 4, exceeding the normal limit count number 2, and sets the output 34 to a high level to detect an open phase. Even when the phase continues to be at a low level, resulting in an open phase, open phase detection is performed in the same manner as described above.

ところで、第1図の実施例においては、検出回路20の
各々のカウンタ22,28により、22ビツトのQc端
子26.あるいは32のカウント数4を以って欠相検出
をおこなう場合について例示したが、それよりも1カウ
ント早いところ、すなわち2°、21ビツトのQa t
 Q@端子24゜25の両者が高レベルとなるカウント
数3.あるいは端子30.31の両者が高レベルとなる
カウント数3で欠相検出することもできる。
In the embodiment shown in FIG. 1, each counter 22 and 28 of the detection circuit 20 outputs a 22-bit Qc terminal 26 . Alternatively, the case where open phase detection is performed using count number 4 of 32 has been exemplified;
Count number 3 when both Q@terminals 24 and 25 are at high level. Alternatively, an open phase can be detected when both terminals 30 and 31 are at a high level at a count of 3.

また、正・逆転指令などとの条件判別を考慮し、その過
渡時を除外して考えれば、さらに1カウント前の21ビ
ツトのqa端子25、あるいは端子31の出力を以って
欠相検出することもできる。
In addition, if we consider the condition discrimination between forward and reverse commands, and exclude the transient period, phase loss can be detected using the output of the 21-bit qa terminal 25 or terminal 31 one count earlier. You can also do that.

一方、カウンタ22や28のカウントパルス入力部にお
ける論理和23.29を使用することなく、かつカウン
タ22,28のカウント量を拡大しておけば、どれだけ
の区間(時間)欠相したかをもカウントし、各種制御用
情報として有効利用することもできる。
On the other hand, if the count amount of the counters 22 and 28 is expanded without using the logical sum 23.29 at the count pulse input section of the counters 22 and 28, it is possible to calculate how much period (time) the phase is lost. It can also be counted and used effectively as various control information.

他方、カウンタ22や28に代えて、シフトレジスタを
用いることもできる。
On the other hand, a shift register may be used instead of the counters 22 and 28.

さらに、本発明にあっては、第1図に示すごとく、ファ
インカウントの4倍化パルスを用いる場合に限らず、単
に2相中の1相のパルスの立上り。
Furthermore, in the present invention, as shown in FIG. 1, the use is not limited to the case where a fine count quadrupled pulse is used, but simply the rise of a pulse of one phase among two phases.

あるいは立下りを利用するようにしてもよい、これを、
第5図および第6図にもとづいて説明すると、第5図は
本発明に係るサーボ装置の他の実施例を示す電気回路図
、第6図は第5図に示すサーボ装置の各種信号波形図で
ある。
Alternatively, you can use the falling edge.
Explaining based on FIGS. 5 and 6, FIG. 5 is an electric circuit diagram showing another embodiment of the servo device according to the present invention, and FIG. 6 is a diagram of various signal waveforms of the servo device shown in FIG. It is.

第5図において、40はエンコーダ1のA相出力2およ
びB相出力3を利用して正転パルス41゜逆転パルス4
2を作り出すアップ/ダウンパルス発生回路である。そ
して、アップ/ダウンパルス発生回路40の構成は、単
安定マルチバイブレータ43.44と、インバータ45
およびアンド回148.49よりなり、単安定マルチバ
イブレータ43,44は、各々A相パルスの立上り、立
下り時にパルス出力46.47を発生する。これらの出
力46.47は、B相出力3との論理積48゜49によ
り、アップパルスおよびダウンパルスとして、逆転、正
転パルス42,41を出力する。
In FIG. 5, 40 is a forward rotation pulse 41° and a reverse rotation pulse 4 using the A phase output 2 and B phase output 3 of the encoder 1.
This is an up/down pulse generation circuit that generates 2. The up/down pulse generation circuit 40 is composed of monostable multivibrators 43 and 44 and an inverter 45.
The monostable multivibrators 43 and 44 each generate a pulse output 46.47 at the rise and fall of the A-phase pulse. These outputs 46 and 47 output reverse and forward pulses 42 and 41 as up pulses and down pulses by a logical product 48°49 with the B-phase output 3.

その関係を第6図に示す。The relationship is shown in FIG.

また、第5図において、出力41.42は、第1図と同
様、アップダウンカウンタ19に入力され、現在位置表
示や目標位置との偏差割出しなどの制御をおこなう。
Further, in FIG. 5, outputs 41 and 42 are input to the up/down counter 19 as in FIG. 1, and are used to display the current position, calculate the deviation from the target position, and perform other controls.

なお、第6図には、時間t4において正転から逆転して
いる例が示されている。そして、第5図の実施例におい
て、′欠相監視・検出をおこなうには、前記したごとき
従来のアップ/ダウンパルス発生回路40に対し、第5
図に符号50で示す付加回路を増設する。
Note that FIG. 6 shows an example in which the rotation is reversed from normal rotation at time t4. In the embodiment shown in FIG. 5, in order to perform open-phase monitoring and detection, a fifth
An additional circuit indicated by reference numeral 50 in the figure is added.

付加回路50は、エンコーダB相出力3に対しても、A
相と同様、立上りパルス51.立下りパルス52を得る
べく、単安定マルチバイブレータ54.55.インバー
タ56からなるパルス発生回路53を有し、かっA相、
B相共、パルス2倍化のため、立上り、立下りパルスの
論理和を得るべく、論理和58.59を有する。そいて
、第1図、第2図と同様に、それぞれ人相2倍化パルス
9、B相2倍化パルス10を出力し、第1図と同じ欠相
検出回路20を有するものであって、以上の構成におい
て、A相あるいはB相の欠相検出は、第1図の場合と同
様につき、その説明を割愛する。
The additional circuit 50 also provides A for the encoder B phase output 3.
Similarly to the phase, the rising pulse 51. To obtain the falling pulse 52, monostable multivibrators 54, 55 . It has a pulse generation circuit 53 consisting of an inverter 56,
Both phase B has a logical sum of 58.59 to obtain a logical sum of rising and falling pulses for pulse doubling. 1 and 2, it outputs a human phase doubling pulse 9 and a B phase doubling pulse 10, respectively, and has the same open phase detection circuit 20 as in FIG. In the above configuration, the detection of phase loss of phase A or phase B is the same as in the case of FIG. 1, and its explanation will be omitted.

〔発明の効果〕〔Effect of the invention〕

本発明は以上のごときであり、図示実施例の説明からも
明らかなように、本発明によれば、インクリメンタル式
2相エンコーダ中の1相の信号が欠相した場合に、速や
かにこの欠相を検出して異常判別をおこない、非常停止
などの措置を早急に講じることのできるエンコーダ欠相
検出回路付サーボ装置を得ることができる。
The present invention is as described above, and as is clear from the explanation of the illustrated embodiments, according to the present invention, when one phase signal in an incremental two-phase encoder has a phase loss, the phase loss can be promptly detected. It is possible to obtain a servo device with an encoder open-phase detection circuit that can detect abnormality and immediately take measures such as emergency stop.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明に係るエンコーダ欠相検出回路付サーボ
装置の一実施例を示す電気回路図、第2図〜第4図はい
ずれも第1図に示すサーボ装置の各種信号波形図、第5
図は本発明に係るサーボ装置の他の実施例を示す電気回
路図、第6図は第5図に示すサーボ装置の各種信号波形
図である。 1・・・インクリメンタル式2相エンコーダ、4・・・
ファインカウント作成および回転方向判別処理回路20
・・・欠相検出回路、21・・・A相監視回路、22・
・・4ビットバイナリ−カウンタ、27・・・B相監視
回路、28・・・4ビットバイナリ−カウンタ。
FIG. 1 is an electric circuit diagram showing an embodiment of a servo device with an encoder open-phase detection circuit according to the present invention, and FIGS. 2 to 4 are various signal waveform diagrams of the servo device shown in FIG. 5
The figure is an electric circuit diagram showing another embodiment of the servo device according to the present invention, and FIG. 6 is a diagram of various signal waveforms of the servo device shown in FIG. 5. 1... Incremental two-phase encoder, 4...
Fine count creation and rotation direction determination processing circuit 20
...Open phase detection circuit, 21...A phase monitoring circuit, 22.
... 4-bit binary counter, 27... B phase monitoring circuit, 28... 4-bit binary counter.

Claims (1)

【特許請求の範囲】 1、インクリメンタル式2相の正逆2運動方向検出用エ
ンコーダを有し、かつ各々の相の発生信号より作成した
対応信号により、互いに一方をクリア入力とし、他方を
カウント入力として、相互に欠相監視・検出する手段を
備えたことを特徴とするエンコーダ欠相検出回路付サー
ボ装置。 2、特許請求の範囲第1項記載の発明において、対応信
号作成回路として、エンコーダと欠相監視・検出手段と
の間に、各相のパルス2倍化回路を有するエンコーダ欠
相検出回路付サーボ装置。 3、特許請求の範囲第2項記載の発明において、パルス
2倍化回路として、各相にDタイプフリップフロップと
排他的論理和回路とを有するエンコーダ欠相検出回路付
サーボ装置。 4、特許請求の範囲第2項記載の発明において、カウン
トパルス3以上の設定値をもつて判別する欠相検出回路
を有するエンコーダ欠相検出回路付サーボ装置。 5、特許請求の範囲第2項記載の発明において、パルス
2倍化回路の後段に位置して、パルス4倍化回路と、現
在位置カウンタと、回転方向表示回路とを有し、かつこ
れらと並列に、パルス2倍化回路出力を入力とする欠相
検出回路を有するエンコーダ欠相検出回路付サーボ装置
。 6、特許請求の範囲第2項記載の発明において、パルス
2倍化回路として、単安定マルチバイブレータと、論理
和回路とを有するエンコーダ欠相検出回路付サーボ装置
[Claims] 1. It has an incremental two-phase encoder for detecting two forward and reverse motion directions, and uses corresponding signals created from the generated signals of each phase so that one of them is used as a clear input and the other is used as a count input. A servo device with an encoder open phase detection circuit, characterized in that it is equipped with means for mutually monitoring and detecting open phase. 2. In the invention described in claim 1, there is provided a servo with an encoder open-phase detection circuit, which has a pulse doubling circuit for each phase between the encoder and the open-phase monitoring/detection means as a corresponding signal generation circuit. Device. 3. A servo device with an encoder open phase detection circuit having a D-type flip-flop and an exclusive OR circuit in each phase as a pulse doubling circuit according to the invention as set forth in claim 2. 4. A servo device with an encoder open-phase detection circuit that discriminates when the count pulse has a set value of 3 or more in the invention as set forth in claim 2. 5. The invention as set forth in claim 2, further comprising a pulse quadrupling circuit, a current position counter, and a rotation direction display circuit located at a subsequent stage of the pulse doubling circuit, and A servo device with an encoder open-phase detection circuit that has an open-phase detection circuit that receives the pulse doubling circuit output in parallel. 6. A servo device with an encoder open phase detection circuit having a monostable multivibrator and an OR circuit as the pulse doubling circuit according to the invention as set forth in claim 2.
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014050136A (en) * 2012-08-29 2014-03-17 Toshiba Schneider Inverter Corp Inverter device
US9318939B2 (en) 2013-04-16 2016-04-19 Ricoh Company, Ltd. Motor control device, image forming apparatus, and motor control method

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JPS57160878A (en) * 1981-03-27 1982-10-04 Tokyo Shibaura Electric Co Detector for trouble of pulse generator for elevator

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