JPS63197208A - Bus connection structure - Google Patents
Bus connection structureInfo
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- JPS63197208A JPS63197208A JP62030918A JP3091887A JPS63197208A JP S63197208 A JPS63197208 A JP S63197208A JP 62030918 A JP62030918 A JP 62030918A JP 3091887 A JP3091887 A JP 3091887A JP S63197208 A JPS63197208 A JP S63197208A
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- slots
- processor
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- Structure Of Printed Boards (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、バスの接続構造に関し、特に1つのきよう体
内のバックボートに1つのプロセッサ部に1または複数
のアダプタ部が接続される入出力制御部を複数台、実装
する場合のこれらプロセッサ部およびアダプタ部を接続
するバスの接続構造に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a bus connection structure, and particularly to a bus connection structure in which one or more adapter units are connected to one processor unit to a backboard in one host body. The present invention relates to a connection structure of a bus that connects a processor section and an adapter section when a plurality of output control sections are mounted.
従来、この種のバス接続構造は、あらかじめ決めた実装
形態に従って製作されたバックボート上の配線パターン
によりプロセッサ部およびアダプタ部を接続するか、又
は、システム構成に従って、バックボートを布線するこ
とによって構成していた。Conventionally, this type of bus connection structure connects the processor section and the adapter section using a wiring pattern on the backboard manufactured according to a predetermined implementation form, or by wiring the backboard according to the system configuration. It was composed.
上述した従来のバスの接続構造は、下記に示す欠点があ
る。The conventional bus connection structure described above has the following drawbacks.
あらかじめ決めた実装形態に従ったパターンによるバス
の接続構造の場合、
1、プロセッサ部に接続されるアダプタ部の数が限定さ
れる。In the case of a bus connection structure with a pattern according to a predetermined implementation form: 1. The number of adapter units connected to the processor unit is limited.
2、システムの構成が限定される。2. The system configuration is limited.
3.バックボートに設けられるプロ、セッサ部およびア
ダプタ部装着用のスロット間のバスの接続用の配線パタ
ーンが固定のため、システムの構成を異るものにしよう
とした場合に空スロットができてしまい、スロットが余
っているにもかかわらず、制御部の追加が行えない場合
がある。3. The wiring pattern for connecting the bus between the slots for installing the processor, processor section, and adapter section provided on the backboard is fixed, so if you try to change the system configuration, empty slots will be created. Even though there are extra slots, it may not be possible to add a control unit.
バ・ツクボードを布線により接続するバスの接続構造の
場合、
1、システム毎に布線を行うため時間と費用がかかる。In the case of a bus connection structure in which bus boards are connected by wiring, 1. Wiring is required for each system, which is time-consuming and costly.
2、アダプタ部等の増設等を行う場合、再布線を行う必
要がある。2. When adding an adapter unit, etc., it is necessary to rewire.
3、布線工事ミスがシステム毎に異った場所で発生する
可能性がある。3. Mistakes in wiring work may occur in different locations for each system.
本発明のバスの接続構造は、それぞれに複数の入力端子
および複数の出力端子が設けられた同一の複数のスロッ
トが並べて設けられたバックボートに前記スロットそれ
ぞれの前記出力端子それぞれを前記スロットの一方の側
に並ぶものの前記入力端子の対応するものに接続する配
線を設け、前記スロットのうちのプロセッサ部が装着さ
れたものの前記一方の側に連続して並ぶものに装着され
る1または複数のアダプタ部の内部に前記入力端子それ
ぞれを前記出力端子の対応するものとを接続する配線を
設けたことを特徴とする。In the bus connection structure of the present invention, each of the output terminals of each of the slots is connected to one of the slots in a backboard in which a plurality of identical slots each having a plurality of input terminals and a plurality of output terminals are provided side by side. One or more adapters are provided with wiring connected to the corresponding ones of the input terminals of the slots lined up on the side, and are attached to the slots lined up continuously on the one side of the slots in which the processor unit is installed. The device is characterized in that wiring is provided inside the unit to connect each of the input terminals to the corresponding one of the output terminals.
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
第1図は本発明の一実施例を適用するシステムのブロッ
ク図で、汎用バス10には、プロセッサ部P 1〜P、
が接続され、プロセッサ部P1には、内部バスB1を介
してアダプタ部Ail〜AI、1が接続されている9以
下同様にプロセ・ソサ部Pnには、内部バスB、を介し
てアダプタ部A、、1−A!Ifiが接続される。内部
バスB1に接続されるアダプタ部の数はシステムにより
変わる。当然のことながら内部バス81〜B、は各々独
立してぃなければならないことは言うまでもない。FIG. 1 is a block diagram of a system to which an embodiment of the present invention is applied, in which a general-purpose bus 10 includes processor units P1 to P,
are connected to the processor section P1, and adapter sections Ail to AI, 1 are connected to the processor section P1 via an internal bus B1. ,,1-A! Ifi is connected. The number of adapter units connected to internal bus B1 varies depending on the system. It goes without saying that each of the internal buses 81-B must be independent.
第2図は第1図に示すシステムの内部バスを設けたバ・
ツクボードの配線を示した図であるや第2図に於いて、
鎖線で示すスロット81〜S5はバックボートに設けら
れるコネクタで、スロットS1にはプロセッサ部P1が
実装され、プロ・ソトS2にはプロセ・ソサ部P1に接
続されるアダプタ部Allが実装され、スロットS3に
はプロセッサ部P!に接続されるアダプタ部A12が実
装され、プロ・ソトS4にはプロセッサ部P2が実装さ
れ、スロットS5にはプロセッサ部P2に接続されるア
ダプタ部P21が実装される。Figure 2 shows a bus with an internal bus for the system shown in Figure 1.
In Figure 2, which is a diagram showing the wiring of the board,
Slots 81 to S5 indicated by chain lines are connectors provided on the backboard, the processor part P1 is mounted in the slot S1, the adapter part All connected to the processor part P1 is mounted in the pro-soto S2, and the slots S3 has a processor section P! An adapter section A12 connected to the processor section A12 is installed in the slot S4, a processor section P2 is installed in the slot S5, and an adapter section P21 connected to the processor section P2 is installed in the slot S5.
スロット81〜S5それぞれには端子が2列に並べられ
、第2図の左側の端子を入力端子1とし、右側の端子を
出力端子2とする。Terminals are arranged in two rows in each of the slots 81 to S5, with the terminal on the left side in FIG. 2 being the input terminal 1, and the terminal on the right side being the output terminal 2.
バックボート上に設ける配線3により、相隣り合うスロ
ットの互いに対応する入出力端子1.2は、図中実線に
示す如く接続する。アダプタ部All、AI□、A2□
(スロットS2.S3.S5に実装)内には互いに対応
する入出力端子1.2を接続する配線4(図中、点線で
示す)を設ける。Wiring 3 provided on the backboard connects the corresponding input/output terminals 1.2 of adjacent slots as shown by solid lines in the figure. Adapter part All, AI□, A2□
(Mounted in slots S2, S3, and S5) are provided with wires 4 (indicated by dotted lines in the figure) that connect mutually corresponding input/output terminals 1.2.
従って、スロットS1に実装されたプロセッサPlには
、スロットS2及びスロットS3にアダプタ部A I
H、A 12が接続される。プロセッサ部P1.p2で
は入力端子1.2を互いに接続しないのでプロセッサ部
Pl + P 2それぞれの内部バスは分離されている
。仮にスロットS4にプロセッサ部P2の代りにアダプ
タ部を実装したとするとスロットS1からプロ・ソトS
5まで内部バスが接続されることが理解できるであろう
。Therefore, the processor Pl mounted in the slot S1 has an adapter part A I installed in the slot S2 and a slot S3.
H, A 12 are connected. Processor section P1. In p2, the input terminals 1.2 are not connected to each other, so the internal buses of each processor section Pl+P2 are separated. If an adapter section is installed in slot S4 instead of processor section P2, then pro-soto S is installed from slot S1.
It will be appreciated that up to 5 internal buses can be connected.
以上説明したように本発明は、バックボートに設けられ
たスロットそれぞれにおいて1つの信号に対し入力端子
と出力端子を用意し、相隣合うスロット間において入出
力の関係で対応する入出力端子を接続し、かつスロット
に装着されるアダプタ部でスロット内での対応する入出
力ビンを接続することにより、プロセッサ部に接続する
アダプタ部の数が限定されることなく内部バスを構成で
き、柔軟にシステムを構築できると言う効果が鳥る、As explained above, the present invention provides an input terminal and an output terminal for one signal in each slot provided in a backboard, and connects corresponding input/output terminals in an input/output relationship between adjacent slots. In addition, by connecting the corresponding input/output bins in the slot with the adapter section installed in the slot, an internal bus can be configured without limiting the number of adapter sections connected to the processor section, making the system flexible. The effect of being able to build a
第1図は、本発明の一実施例が適用されるシステム構成
を7示すブロック図、第2図は第1図に示すシステムに
適用する実施例に用いられるバックボートの配線を示す
図である。FIG. 1 is a block diagram showing a system configuration to which an embodiment of the present invention is applied, and FIG. 2 is a diagram showing the wiring of a backboard used in the embodiment applied to the system shown in FIG. 1. .
Claims (1)
けられた同一の複数のスロットが並べて設けられたバッ
クボートに前記スロットそれぞれの前記出力端子それぞ
れを前記スロットの一方の側に並ぶものの前記入力端子
の対応するものに接続する配線を設け、前記スロットの
うちのプロセッサ部が装着されたものの前記一方の側に
連続して並ぶものに装着される1または複数のアダプタ
部の内部に前記入力端子それぞれを前記出力端子の対応
するものとを接続する配線を設けたことを特徴とするバ
スの接続構造。A backboard in which a plurality of identical slots, each of which is provided with a plurality of input terminals and a plurality of output terminals, is arranged side by side, and the output terminals of each of the slots are arranged on one side of the slots, respectively. Wiring is provided to connect to the corresponding one, and each of the input terminals is installed inside one or more adapter parts that are installed in one or more adapter parts that are installed in one of the slots that is successively arranged on one side of the one in which the processor part is installed. A bus connection structure characterized in that wiring is provided to connect the corresponding output terminals.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62030918A JPS63197208A (en) | 1987-02-12 | 1987-02-12 | Bus connection structure |
US07/154,583 US4853831A (en) | 1987-02-12 | 1988-02-10 | Bus connection structure for interruption control system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62030918A JPS63197208A (en) | 1987-02-12 | 1987-02-12 | Bus connection structure |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63197208A true JPS63197208A (en) | 1988-08-16 |
Family
ID=12317077
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62030918A Pending JPS63197208A (en) | 1987-02-12 | 1987-02-12 | Bus connection structure |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63197208A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100252174B1 (en) * | 1997-02-21 | 2000-04-15 | 윤종용 | Backplane recognition device |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57211623A (en) * | 1981-06-23 | 1982-12-25 | Panafacom Ltd | Assembling system for composite processor system |
-
1987
- 1987-02-12 JP JP62030918A patent/JPS63197208A/en active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57211623A (en) * | 1981-06-23 | 1982-12-25 | Panafacom Ltd | Assembling system for composite processor system |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100252174B1 (en) * | 1997-02-21 | 2000-04-15 | 윤종용 | Backplane recognition device |
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