JPS63195753U - - Google Patents

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JPS63195753U
JPS63195753U JP8722587U JP8722587U JPS63195753U JP S63195753 U JPS63195753 U JP S63195753U JP 8722587 U JP8722587 U JP 8722587U JP 8722587 U JP8722587 U JP 8722587U JP S63195753 U JPS63195753 U JP S63195753U
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JP
Japan
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package
semiconductor integrated
signal input
integrated circuit
measurement terminal
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JP8722587U
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【図面の簡単な説明】
第1図Aはこの考案の一実施例の斜視図、第1
図Bは第1図Aの平面図、第1図Cは第1図Aの
側面図、第2図は第1図Cの拡大縦断面図、第3
図Aは第2図の要部の斜視図、第3図Bは第2図
の測定用端子の拡大図、第4図Aは従来例の斜視
図、第4図Bは第4図Aの平面図、第4図Cは第
4図Aの側面図である。 1……パツケージ、1a……表面、2……信号
入出力ピン、3……半導体集積回路、11……穴
、12……測定用端子。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 実装された半導体集積回路に接続され、パ
    ツケージより突出する複数の信号入出力ピンを有
    する半導体集積回路用パツケージにおいて、 上記パツケージにおける各信号入出力ピンの突
    出側とは反対側の表面に、各信号入出力ピンに接
    続される測定用端子を設けたことを特徴とする半
    導体集積回路用パツケージ。 (2) 測定用端子は、パツケージ表面側に形成さ
    れた穴に嵌合されるほぼ筒状のソケツト体より成
    ることを特徴とする実用新案登録請求の範囲第1
    項記載の半導体集積回路用パツケージ。
JP8722587U 1987-06-05 1987-06-05 Pending JPS63195753U (ja)

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JP8722587U JPS63195753U (ja) 1987-06-05 1987-06-05

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JP8722587U JPS63195753U (ja) 1987-06-05 1987-06-05

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JPS63195753U true JPS63195753U (ja) 1988-12-16

Family

ID=30944253

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JP8722587U Pending JPS63195753U (ja) 1987-06-05 1987-06-05

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