JPS631506Y2 - - Google Patents

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JPS631506Y2
JPS631506Y2 JP17734280U JP17734280U JPS631506Y2 JP S631506 Y2 JPS631506 Y2 JP S631506Y2 JP 17734280 U JP17734280 U JP 17734280U JP 17734280 U JP17734280 U JP 17734280U JP S631506 Y2 JPS631506 Y2 JP S631506Y2
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JP
Japan
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stop
circuit
output
period
playback
Prior art date
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Expired
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JP17734280U
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Japanese (ja)
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JPS57100371U (en
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  • Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
  • Optical Recording Or Reproduction (AREA)

Description

【考案の詳細な説明】 本考案は、ストツプ再生期間の設定を可能にし
たビデオデイスクプレーヤのストツプ期間設定回
路に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a stop period setting circuit for a video disc player that allows setting of a stop playback period.

ビデオデイスクレコードは、垂直帰線区間に制
御コードと記録コードを記録しており、これを再
生するビデオデイスクプレーヤはこの制御コード
を検出してモードの変更を為している。この制御
コードのうちピクチヤーストツプコードは、垂直
帰線区間中の第16・第18H若くは第279第280Hに
重畳記録されており、通常再生モードで再生中の
ビデオデイスクプレーヤをピクチヤーストツプコ
ード検出と共にストツプ再生モードに変更せしめ
ている。しかし、このストツプ再生モードは螺線
状に形成された記録トラツクを飛越し乍らピクチ
ヤーストツプコードが記録されているトラツクを
再生し続ける関係上、次の再生モードに移ること
ができる。
A video disc record records a control code and a recording code in the vertical retrace interval, and a video disc player that plays the video disc record detects this control code and changes the mode. Among these control codes, the picture stop code is superimposed and recorded on the 16th, 18th, or 279th and 280th H in the vertical retrace interval, and the picture stop code is used to control the video disk player playing in normal playback mode. Upon detection, the mode is changed to stop playback mode. However, in this stop reproduction mode, the track on which the picture stop code is recorded is continued to be reproduced while skipping over the recording track formed in a spiral shape, so that it is possible to move to the next reproduction mode.

そこで、本考案は上述の点に鑑み、ビデオデイ
スクレコードの垂直帰線区間内に予めストツプ再
生期間を指定するストツプ期間指定コードを重畳
記録しておき、ビデオデイスクプレーヤ側でこの
ストツプ期間指定コードを検出してストツプ期間
の設定を可能にした新規なストツプ期間設定回路
を提案せんとするものである。
Therefore, in view of the above points, the present invention has been developed by superimposing and recording a stop period designation code for specifying a stop playback period in advance within the vertical retrace interval of a video disc record, and by having the video disc player side read this stop period designation code. We would like to propose a novel stop period setting circuit that can detect and set the stop period.

以下、本考案を図示せる一実施例に従い説明す
る。本実施例は、従来のピクチヤーストツプコー
ドに代えてストツプ期間指定コードを第16Hに記
録したビデオデイスクレコードを利用するもので
あり、このストツプ期間指定コードは、ストツプ
再生期間をフレーム数で表示するコードであり、
第17・第18Hにはフレームナンバーコードが記録
されている。本実施例のストツプ期間設定回路
は、前述した様なビデオデイスクレコードを再生
するときに動作するものであり、その要部回路は
第1図に示す様な回路構成となる。本実施例は、
ピツクアツプ出力をビデオ再生回路1によつて再
生映像信号Vに変換する基本回路に本考案を付加
するものである。まず再生映像信号を入力とする
抜取パルス発生回路2からは第2図に図示する様
に、第16Hに重畳されているストツプ期間指定コ
ードを抜取る第1抜取出力aと、第17・第18Hに
重畳されているフレームナンバーを抜取る第2抜
取出力bとがそれぞれ導出される。両抜取出力
a,bはオア回路Oを経て再生映像信号Vと共に
第1アンド回路A1に印加され、ストプ期間指定
コードとフレームナンバーを論理積出力として導
出する。この論理積出力はデーターラツチ回路3
にその都度ラツチされる。第1抜取出力aと、後
述のストツプ制御出力Cの反転出力を入力とする
第2アンド回路A2は論理積出力をプリセツト出
力として減算回路4に入力することによつて通常
再生期間中前記データラツチ回路3にラツチされ
る第16H目のラツチ出力を減算回路4にプリセツ
トしている。減算回路4の出力を入力とするデー
タ識別回路5は、ストツプ期間指定コードの入力
を検出して直ちにストツプ制御出力cを発し、ビ
デオデイスクプレーヤをストツプモードとする。
このストツプ制御出力cの発生によつて第2アン
ド回路A2はプリセツト出力の発生を阻止し、第
3アンド回路A3は減算出力の発生を許容する。
再生映像信号Vを入力とする垂直同期分離回路6
より発生する垂直同期信号は、次段の1/2分周回
路7に入力され、フレーム周期の分周出力に変換
される。。この分周出力は第3アンド回路A3を介
してストツプモードでのみ減算出力として減算回
路4に入力される。この減算計数によつてストツ
プモードの設定期間が計数され、減算値が“0”
となると同時にストップ制御出力cは消勢され、
ビデオデイスクプレーヤは再び通常再生モードに
切換えられ、以後減算回路4は次のストツプ再生
に備えてプリセツト動作を繰り返す。尚データー
ラツチ回路3にラツチされるフレームナンバーは
減算回路4に入力されることなくフレームナンバ
ー表示回路(図示省略)に導出される。
Hereinafter, the present invention will be explained according to an illustrative embodiment. This embodiment utilizes a video disk record in which a stop period designation code is recorded in the 16th H instead of the conventional picture stop code, and this stop period designation code indicates the stop playback period in number of frames. code,
Frame number codes are recorded in the 17th and 18th H. The stop period setting circuit of this embodiment operates when reproducing a video disc record as described above, and its main circuit has a circuit configuration as shown in FIG. In this example,
The present invention is added to a basic circuit for converting a pickup output into a reproduced video signal V by a video reproduction circuit 1. First, as shown in FIG. 2, the sampling pulse generation circuit 2 which inputs the reproduced video signal outputs a first sampling output a which extracts the stop period designation code superimposed on the 16th H, and the 17th and 18th H. A second sampling output b for extracting the frame number superimposed on the second sampling output b is respectively derived. Both sampled outputs a and b are applied to the first AND circuit A1 together with the reproduced video signal V via the OR circuit O, and the stop period designation code and the frame number are derived as an AND output. This AND output is the data latch circuit 3.
is latched each time. A second AND circuit A2 , which receives the first sampled output a and the inverted output of the stop control output C, which will be described later, inputs the AND output as a preset output to the subtraction circuit 4, thereby maintaining the data latch during the normal playback period. The 16th H latch output latched in circuit 3 is preset in subtraction circuit 4. The data identification circuit 5, which receives the output of the subtraction circuit 4, detects the input of the stop period designation code and immediately issues a stop control output c, thereby setting the video disc player in the stop mode.
By generating this stop control output c, the second AND circuit A2 prevents the generation of the preset output, and the third AND circuit A3 allows the generation of the subtraction output.
Vertical synchronization separation circuit 6 that receives the reproduced video signal V as input
The vertical synchronizing signal generated is input to the next stage 1/2 frequency divider circuit 7, and is converted into a frequency divided output of the frame period. . This frequency-divided output is input to the subtraction circuit 4 as a subtraction output only in the stop mode via the third AND circuit A3 . This subtraction count counts the stop mode setting period, and the subtraction value is “0”.
At the same time, the stop control output c is deenergized,
The video disc player is again switched to the normal playback mode, and thereafter the subtraction circuit 4 repeats the preset operation in preparation for the next stop playback. The frame number latched by the data latch circuit 3 is not input to the subtraction circuit 4, but is led to a frame number display circuit (not shown).

上述せる如く、本考案によれば、ストツプ期間
を任意に設定可能にすることにより、再生期間を
長せしめることができるばかりか、ストツプ再生
モードを含む再生モードの切換を自動的に為すこ
とができ、その効果は大である。
As described above, according to the present invention, by making it possible to arbitrarily set the stop period, not only can the playback period be lengthened, but also the playback mode including the stop playback mode can be automatically switched. , the effect is great.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本考案の一実施例回路ブロツク図、第
2図は同要部波形図をそれぞれ顕わす。 主な図番の説明、3……データラツチ回路、4
……減算回路、5……データ識別回路。
FIG. 1 shows a circuit block diagram of an embodiment of the present invention, and FIG. 2 shows a waveform diagram of the main parts thereof. Explanation of main figure numbers, 3...Data latch circuit, 4
...Subtraction circuit, 5...Data identification circuit.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] ビデオデイスクレコードをフレーム周期で回転
せしめ乍ら映像信号を再生するビデオデイスクプ
レーヤに於て、再生映像信号よりストツプ再生期
間をフレーム数で表示するストツプ期間指定コー
ドをラツチするデータラツチ回路と、該ラツチ出
力をプリセツトすると共に垂直同期信号の1/2分
周出力を減算計数する減算回路と、該減算値が
“0”となつたことを検出してストツプ再生モー
ドを解除するデータ識別回路とをそれぞれ配して
成るストツプ期間設定回路。
A data latch circuit that latches a stop period designation code that displays the stop playback period in terms of the number of frames from the playback video signal in a video disk player that plays back a video signal while rotating a video disk record at a frame cycle, and the latch output. and a data identification circuit that detects when the subtracted value becomes "0" and cancels the stop playback mode. A stop period setting circuit consisting of:
JP17734280U 1980-12-09 1980-12-09 Expired JPS631506Y2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17734280U JPS631506Y2 (en) 1980-12-09 1980-12-09

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17734280U JPS631506Y2 (en) 1980-12-09 1980-12-09

Publications (2)

Publication Number Publication Date
JPS57100371U JPS57100371U (en) 1982-06-21
JPS631506Y2 true JPS631506Y2 (en) 1988-01-14

Family

ID=29971137

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17734280U Expired JPS631506Y2 (en) 1980-12-09 1980-12-09

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JPS57100371U (en) 1982-06-21

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