JPS63129318U - - Google Patents

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JPS63129318U
JPS63129318U JP2116487U JP2116487U JPS63129318U JP S63129318 U JPS63129318 U JP S63129318U JP 2116487 U JP2116487 U JP 2116487U JP 2116487 U JP2116487 U JP 2116487U JP S63129318 U JPS63129318 U JP S63129318U
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JP
Japan
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low
amplifier circuit
input signal
signal
circuit
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JP2116487U
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  • Control Of Amplification And Gain Control (AREA)
  • Amplifiers (AREA)
  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)

Description

【図面の簡単な説明】
第1図は、本考案の低電圧用電力増幅回路の一
実施例を示す回路図、第2図は、本考案の低電圧
用電力増幅回路の他の実施例を示す回路図、第3
図は、低電圧用増幅段の出力波形を説明する為の
波形図である。 2,7,14……アツテネータ回路、3,8…
…増幅回路、4,9……SEPP型の増幅回路、
13……ローパスフイルタ、15……反転型増幅
回路、5,10……スピーカ。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 第1と第2のスピーカを夫々SEPP型の
    第1と第2の増幅回路によつて鳴動する低電圧用
    電力増幅回路と、入力信号の低周波帯域の信号の
    みが選択されて反転増幅する第3の増幅回路とを
    具え、該第1乃至第3の増幅回路が前記第1と第
    2のスピーカと共にBTL接続されて、該入力信
    号の低周波帯域の信号が増幅されることを特徴と
    する低電圧用電力増幅回路。 (2) 前記入力信号の低周波帯域の信号が、ロー
    パスフイルタを介して導出され、アツテネータ回
    路を介して該第3の増幅回路に係給される実用新
    案登録請求の範囲第1項記載の低電圧用電力増幅
    回路。 (3) 前記第3の増幅回路の利得を制御してブー
    スト量を設定する第1項記載の低電圧用電力増幅
    回路。
JP2116487U 1987-02-16 1987-02-16 Pending JPS63129318U (ja)

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JP2116487U JPS63129318U (ja) 1987-02-16 1987-02-16

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JPS63129318U true JPS63129318U (ja) 1988-08-24

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JP2116487U Pending JPS63129318U (ja) 1987-02-16 1987-02-16

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JP (1) JPS63129318U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0487404A (ja) * 1990-07-31 1992-03-19 Sanyo Electric Co Ltd 増幅回路

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0487404A (ja) * 1990-07-31 1992-03-19 Sanyo Electric Co Ltd 増幅回路

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