JPS63111029U - - Google Patents
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- Publication number
- JPS63111029U JPS63111029U JP162287U JP162287U JPS63111029U JP S63111029 U JPS63111029 U JP S63111029U JP 162287 U JP162287 U JP 162287U JP 162287 U JP162287 U JP 162287U JP S63111029 U JPS63111029 U JP S63111029U
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- JP
- Japan
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- set value
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- Granted
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- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Logic Circuits (AREA)
Description
図は本考案に係る装置の構成ブロツク図である
。 ＣＵ……バイナリーカウンタ、ＲＥ１，ＲＥ２
……レジスタ、ＣＭＰ……コンパレータ、ＳＣＴ
……セレクタ。
。 ＣＵ……バイナリーカウンタ、ＲＥ１，ＲＥ２
……レジスタ、ＣＭＰ……コンパレータ、ＳＣＴ
……セレクタ。
Claims (1)
- アツプ／ダウン端子に計数すべきパルス信号が
印加されるバイナリーカウンタと、１つの設定値
が共通に与えられ当該設定値を保持するとともに
前記バイナリーカウンタのＭＳＢ出力に応じて互
いに符号が逆の設定値を出力する第１、第２のレ
ジスタと、前記バイナリーカウンタの出力と前記
第１、第２のレジスタのいずれか一方からの出力
とを比較するコンパレータと、前記バイナリーカ
ウンタのＭＳＢ出力に応じて前記コンパレータの
出力を極性を変えて取出すセレクタとを備えた絶
対値比較装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP162287U JPH0520018Y2 (ja) | 1987-01-09 | 1987-01-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP162287U JPH0520018Y2 (ja) | 1987-01-09 | 1987-01-09 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63111029U true JPS63111029U (ja) | 1988-07-16 |
| JPH0520018Y2 JPH0520018Y2 (ja) | 1993-05-26 |
Family
ID=30779705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP162287U Expired - Lifetime JPH0520018Y2 (ja) | 1987-01-09 | 1987-01-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0520018Y2 (ja) |
-
1987
- 1987-01-09 JP JP162287U patent/JPH0520018Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0520018Y2 (ja) | 1993-05-26 |
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