JPS63108238U - - Google Patents

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JPS63108238U
JPS63108238U JP20173986U JP20173986U JPS63108238U JP S63108238 U JPS63108238 U JP S63108238U JP 20173986 U JP20173986 U JP 20173986U JP 20173986 U JP20173986 U JP 20173986U JP S63108238 U JPS63108238 U JP S63108238U
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data
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【図面の簡単な説明】
第１図は本考案の一実施例の構成を示すブロツ
ク図、第２図は同実施例によりパラレルデータに
変換されるべきシリアルデータの一例を示す図、
第３図は同実施例によるデータ変換処理のプロセ
スを示す流れ図である。 Ｍ……ワンチツプマイクロコンピユータ、１…
…入力バツフア、２……ＲＯＭ、３……ＲＡＭ、
４……タイマ、５……ＡＬＵ、６……出力バツフ
ア。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 少なくとも、外部から割り込み入力される
    シリアルデータがセツトされる入力バツフアと、
    前記シリアルデータのパルス間隔を検出するタイ
    マと、このパルス間隔の相違に基づいて前記シリ
    アルデータを所定ビツトのパラレルデータに変換
    する演算処理ユニツトと、前記パラレルデータが
    セツトされる出力バツフアと、前記シリアルデー
    タを前記所定ビツトのパラレルデータに変換する
    際に必要な制御プログラムがフアームウエアとし
    て格納されているメモリとを備えたワンチツプマ
    イクロコンピユータからなることを特徴とする信
    号変換回路。 (2) 赤外線を伝送媒体としたシリアルデータに
    より、各機能選択をリモートコントロールユニツ
    ト側から行なうように構成された電子機器の、前
    記シリアルデータの受信系回路に設けられている
    実用新案登録請求の範囲第１項記載の信号変換回
    路。
JP20173986U 1986-12-27 1986-12-27 Pending JPS63108238U (ja)

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JPS63108238U true JPS63108238U (ja) 1988-07-12

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007195254A (ja) * 2000-03-14 2007-08-02 Altera Corp プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007195254A (ja) * 2000-03-14 2007-08-02 Altera Corp プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路
JP2010172014A (ja) * 2000-03-14 2010-08-05 Altera Corp プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路
JP2011142631A (ja) * 2000-03-14 2011-07-21 Altera Corp プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路
JP2015073313A (ja) * 2000-03-14 2015-04-16 アルテラ コーポレイションＡｌｔｅｒａ Ｃｏｒｐｏｒａｔｉｏｎ プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路

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