JPS6246215Y2 - - Google Patents
Info
- Publication number
- JPS6246215Y2 JPS6246215Y2 JP14360480U JP14360480U JPS6246215Y2 JP S6246215 Y2 JPS6246215 Y2 JP S6246215Y2 JP 14360480 U JP14360480 U JP 14360480U JP 14360480 U JP14360480 U JP 14360480U JP S6246215 Y2 JPS6246215 Y2 JP S6246215Y2
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- signal
- emitting diode
- light emitting
- switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000011159 matrix material Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【考案の詳細な説明】
本考案は、１チツプマイコンのように入・出力
を兼用した信号端子を有する装置において、切替
回路から信号が付与されていないことを示す第１
の状態、切替回路から信号が付与されていること
を示す第２の状態、切替回路からの信号を受付け
たこと、あるいはこれによりある動作が行なわれ
ていること、またはこれによりある動作が行なわ
れたことを示す第３の状態の３状態を切替えて表
示するようにしたマトリクス状の表示切替回路に
関するものである。
を兼用した信号端子を有する装置において、切替
回路から信号が付与されていないことを示す第１
の状態、切替回路から信号が付与されていること
を示す第２の状態、切替回路からの信号を受付け
たこと、あるいはこれによりある動作が行なわれ
ていること、またはこれによりある動作が行なわ
れたことを示す第３の状態の３状態を切替えて表
示するようにしたマトリクス状の表示切替回路に
関するものである。
１チツプマイコンなどにより被制御回路または
機能を予め設定されたタイマー時刻に動作させる
ような場合、タイマー時刻を設定し、そのタイマ
ー時刻に被制御回路または機能を動作または不動
作状態にすることが一般的である。したがつて、
タイマー時刻がすでに設定されているのかまたは
設定されていないか、またタイマー時刻にもとづ
いてある動作が行なわれているかまたは行なわれ
たのかを、表示する必要がある。
機能を予め設定されたタイマー時刻に動作させる
ような場合、タイマー時刻を設定し、そのタイマ
ー時刻に被制御回路または機能を動作または不動
作状態にすることが一般的である。したがつて、
タイマー時刻がすでに設定されているのかまたは
設定されていないか、またタイマー時刻にもとづ
いてある動作が行なわれているかまたは行なわれ
たのかを、表示する必要がある。
本考案はこのような各状態を切替えて表示する
ためのマトリクス状の表示切替回路を提供するも
ので、以下図面にもとづいてその一実施例を説明
する。
ためのマトリクス状の表示切替回路を提供するも
ので、以下図面にもとづいてその一実施例を説明
する。
第１図において、１は１チツプマイコンのよう
な装置で、入・出力を兼用した信号端子Ｘ，Ｙ，
Ｚ，……を有すると共に、時分割信号を出力する
端子Ａ，Ｂ，Ｃ，……を有する。表示切替回路
M1，M2，……、N1，N2，……は端子Ｘ，Ｙ，
Ｚ，……とＡ，Ｂ，Ｃ，……との間でマトリクス
状に接続される。例えば表示切替回路M1は、第
１の電極（エミツタ電極）を接地したトランジス
タ２の第２の電極（ベース電極）を抵抗３を介し
て入・出力兼用信号端子Ｘに接続すると共に、ス
イツチ４および発光ダイオード５を介して時分割
信号出力端子Ａに接続し、その第３の電極（コレ
クタ電極）を抵抗６を介してスイツチ４と発光ダ
イオード５との接続箇所に接続した構成となつて
いる。
な装置で、入・出力を兼用した信号端子Ｘ，Ｙ，
Ｚ，……を有すると共に、時分割信号を出力する
端子Ａ，Ｂ，Ｃ，……を有する。表示切替回路
M1，M2，……、N1，N2，……は端子Ｘ，Ｙ，
Ｚ，……とＡ，Ｂ，Ｃ，……との間でマトリクス
状に接続される。例えば表示切替回路M1は、第
１の電極（エミツタ電極）を接地したトランジス
タ２の第２の電極（ベース電極）を抵抗３を介し
て入・出力兼用信号端子Ｘに接続すると共に、ス
イツチ４および発光ダイオード５を介して時分割
信号出力端子Ａに接続し、その第３の電極（コレ
クタ電極）を抵抗６を介してスイツチ４と発光ダ
イオード５との接続箇所に接続した構成となつて
いる。
このような回路構成において、時分割信号出力
端子Ａ，Ｂ，Ｃ，……は、第２図に示すように、
順次Ｔ期間のみ信号を出力する。一方、入・出力
兼用信号端子Ｘ，Ｙ，Ｚ，……は各Ｔ期間におい
てT1期間では信号を入力し、T2期間では信号を
出力する。したがつて、t0時の初期状態では、表
示切替回路M1において例を挙げると、スイツチ
４はオフであり、端子Ａからの信号が発光ダイオ
ード５およびスイツチ４さらに端子Ｘを介して１
チツプマイコン１のメモリ回路（図示省略）に入
力されずに、トランジスタ２はオフとなつて、発
光ダイオード５は発光しない。
端子Ａ，Ｂ，Ｃ，……は、第２図に示すように、
順次Ｔ期間のみ信号を出力する。一方、入・出力
兼用信号端子Ｘ，Ｙ，Ｚ，……は各Ｔ期間におい
てT1期間では信号を入力し、T2期間では信号を
出力する。したがつて、t0時の初期状態では、表
示切替回路M1において例を挙げると、スイツチ
４はオフであり、端子Ａからの信号が発光ダイオ
ード５およびスイツチ４さらに端子Ｘを介して１
チツプマイコン１のメモリ回路（図示省略）に入
力されずに、トランジスタ２はオフとなつて、発
光ダイオード５は発光しない。
次に、例えばt1時にスイツチ４をオフからオン
に切替えると、端子Ａからの時分割信号はT1期
間に発光ダイオード５、スイツチ４および端子Ｘ
を介して１チツプマイコン１に入力され、記憶さ
れる。このとき、端子Ａからの時分割信号は抵抗
３を介してトランジスタ２のベース電極にも印加
されるので、端子Ａ−発光ダイオード５−抵抗６
−トランジスタ２へと電流が流れ、発光ダイオー
ド５は発光する。
に切替えると、端子Ａからの時分割信号はT1期
間に発光ダイオード５、スイツチ４および端子Ｘ
を介して１チツプマイコン１に入力され、記憶さ
れる。このとき、端子Ａからの時分割信号は抵抗
３を介してトランジスタ２のベース電極にも印加
されるので、端子Ａ−発光ダイオード５−抵抗６
−トランジスタ２へと電流が流れ、発光ダイオー
ド５は発光する。
さらに、１チツプマイコン１に当該信号が記憶
されている場合、１チツプマイコン１により被制
御回路または機能７が動作したときまたは動作し
ているときにはT2′期間にて示すように端子Ｘか
ら信号が出力されるので、トランジスタ２はオン
となり、同様に発光ダイオード５は端子Ａからの
電流により発光する。
されている場合、１チツプマイコン１により被制
御回路または機能７が動作したときまたは動作し
ているときにはT2′期間にて示すように端子Ｘか
ら信号が出力されるので、トランジスタ２はオン
となり、同様に発光ダイオード５は端子Ａからの
電流により発光する。
以上にて述べたように、本考案は簡単な構成に
より種々の状態を切替えて、単一の表示素子にて
表示することができるという実用的かつ有益なる
ものである。
より種々の状態を切替えて、単一の表示素子にて
表示することができるという実用的かつ有益なる
ものである。
第１図は本考案の一実施例を示し、第２図は第
１図の要部波形図、同図中、１は１チツプマイコ
ン、７は被制御回路または機能、Ｘ，Ｙ，Ｚ，…
…は入・出力兼用信号端子、Ａ，Ｂ，Ｃ，……は
時分割信号出力端子である。
１図の要部波形図、同図中、１は１チツプマイコ
ン、７は被制御回路または機能、Ｘ，Ｙ，Ｚ，…
…は入・出力兼用信号端子、Ａ，Ｂ，Ｃ，……は
時分割信号出力端子である。
Claims (1)
- 第１の端子を接地したトランジスタの第２の端
子を入・出力端子を兼用した信号端子に接続する
と共にスイツチおよび発光ダイオードを介して時
分割信号を出力する時分割信号出力端子に接続
し、該トランジスタの第３の端子を該スイツチと
該発光ダイオードとの間に接続してなるマトリク
ス状の表示切替回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14360480U JPS6246215Y2 (ja) | 1980-10-08 | 1980-10-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14360480U JPS6246215Y2 (ja) | 1980-10-08 | 1980-10-08 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5765391U JPS5765391U (ja) | 1982-04-19 |
| JPS6246215Y2 true JPS6246215Y2 (ja) | 1987-12-11 |
Family
ID=29503344
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14360480U Expired JPS6246215Y2 (ja) | 1980-10-08 | 1980-10-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6246215Y2 (ja) |
-
1980
- 1980-10-08 JP JP14360480U patent/JPS6246215Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5765391U (ja) | 1982-04-19 |
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