JPS6235117Y2 - - Google Patents

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JPS6235117Y2
JPS6235117Y2 JP1981074455U JP7445581U JPS6235117Y2 JP S6235117 Y2 JPS6235117 Y2 JP S6235117Y2 JP 1981074455 U JP1981074455 U JP 1981074455U JP 7445581 U JP7445581 U JP 7445581U JP S6235117 Y2 JPS6235117 Y2 JP S6235117Y2
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capacitor
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switch means
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Description

【考案の詳細な説明】 本考案は、例えば電子オルゴールに使用可能な
電子音のエンベロープ付加回路に関するものであ
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an electronic sound envelope adding circuit that can be used, for example, in an electronic music box.

電子音のエンベロープ付加回路として、CR時
定数回路の放電特性を利用したものが既に開発さ
れている。この従来のエンベロープ付加回路は主
として電子オルゴール用として開発されたもので
あつて、オルゴールの音はその音圧レベルが指数
関数的に減衰するため、音の高低に応じた周波数
の定振巾入力を上記CR時定数回路の放電曲線で
減衰させ、これによつてオルゴール音に似せるよ
うにしたものである。
A circuit that utilizes the discharge characteristics of a CR time constant circuit has already been developed as an electronic sound envelope addition circuit. This conventional envelope adding circuit was developed mainly for use in electronic music boxes, and since the sound pressure level of the music box's sound attenuates exponentially, it requires a constant amplitude input of a frequency that corresponds to the pitch of the sound. The sound is attenuated by the discharge curve of the CR time constant circuit, thereby resembling the sound of a music box.

しかし、上記従来のエンベロープ付加回路は、
音の高低に関係なく減衰度が常に同じになるた
め、自然なオルゴール音が出なかつた。即ち、オ
ルゴールの音は高音になるほど減衰度が大きく、
音が伸びないにも拘らず、上記従来のエンベロー
プ付加回路では、高音も低音と同様に伸びてしま
うからである。
However, the conventional envelope addition circuit described above is
Because the degree of attenuation was always the same regardless of the pitch of the sound, natural music box sounds could not be produced. In other words, the higher the pitch of the music box's sound, the greater the degree of attenuation.
This is because even though the sound does not extend, the conventional envelope adding circuit described above extends the high tones in the same way as the low tones.

そこで、所望のエンベロープ波形がデジタル符
号で記憶されたエンベロープ記憶回路と、音信号
を一定の逓倍比で逓倍してなるパルスによつてタ
イミングパルスを発生するタイミングパルス発生
回路とを設け、上記タイミングパルスで上記エン
ベロープ記憶回路の各アドレスを順次指定してデ
ジタルのエンベロープ信号を順次出力させ、これ
をデジタル・アナログ変換させるようにしたもの
が提案されている。特開昭53−3321号公報記載の
ものはその例である。
Therefore, an envelope storage circuit in which a desired envelope waveform is stored as a digital code, and a timing pulse generation circuit that generates a timing pulse by a pulse obtained by multiplying the sound signal by a certain multiplication ratio are provided. A system has been proposed in which each address of the envelope storage circuit is sequentially specified to sequentially output a digital envelope signal, and this signal is converted from digital to analog. The one described in JP-A-53-3321 is an example of this.

上記従来例によれば、音信号の周波数に応じた
エンベロープ信号が得られ、自然な音信号が得ら
れる。しかし、エンベロープ記憶回路やタイミン
グパルス発生回路やデジタル・アナログ変換回路
等を必要とし、回路構成が複雑化するという問題
がある。
According to the above conventional example, an envelope signal corresponding to the frequency of the sound signal can be obtained, and a natural sound signal can be obtained. However, this method requires an envelope storage circuit, a timing pulse generation circuit, a digital-to-analog conversion circuit, etc., and has the problem of complicating the circuit configuration.

本考案の目的は、入力された音信号の周波数に
応じて減衰度が変わるようにし、これを電子オル
ゴールに採用することにより、オルゴール音にき
わめて近似した音を出すことができるようにする
と共に、回路構成を極めて簡単にした電子音のエ
ンベロープ付加回路を提供することにある。
The purpose of the present invention is to change the degree of attenuation according to the frequency of the input sound signal, and by adopting this in an electronic music box, it is possible to produce a sound that closely resembles the sound of a music box. An object of the present invention is to provide an electronic sound envelope adding circuit with an extremely simple circuit configuration.

本考案の特徴は、二つのコンデンサの充電、こ
の二つのコンデンサのうちの一方のコンデンサの
放電、及び他方のコンデンサから一方のコンデン
サへの電荷移動という動作を行なわせることによ
り電圧を指数関数的に減衰させると共に、上記電
荷移動の周期を音高信号の周波数に対応させて変
化させることにより、音の高低に応じた減衰度が
得られるようにしたことにある。
The feature of this invention is to charge two capacitors, discharge one of these two capacitors, and transfer charge from the other capacitor to one capacitor, thereby increasing the voltage exponentially. By attenuating the sound and changing the cycle of the charge movement in accordance with the frequency of the pitch signal, it is possible to obtain a degree of attenuation that corresponds to the pitch of the sound.

以下、図示の実施例によつて本考案を説明す
る。
The present invention will be explained below with reference to illustrated embodiments.

第1図において、メロデイメモリー1は予め記
憶した音高信号、音長信号等からなるメロデイ信
号を順次読み出すものであつて、このメロデイ信
号は音符発生回路2に加えられるようになつてい
る。音符発生回路2は、基準発振器3からの基準
周波数信号を上記メロデイ信号に応じ処理してメ
ロデイ信号に応じた音符信号を出力し、ゲートコ
ントロール回路4に入力するようになつている。
ゲートコントロール回路4は、基準発振器3から
の基準周波数信号を上記音符信号の音高に応じて
処理し、一つの音符毎に、その音符信号のスター
ト時に一つのパルスでなるスタート信号Aを出力
すると共に、上記音符信号の音高に応じた周波数
の信号Bと、この信号Bと同一周波数で、信号B
の立ち下がり時に出力される信号Cとを出力する
ようになつている。上記信号Aは、スイツチング
素子としての電界効果型トランジスタ(以下、
「FET」という)5のゲートに加えられてFET5
をオンにするようになつている。FET5にはコ
ンデンサC1が直列に接続されていて、FETがオ
ンのとき電源VDDによつてコンデンサC1が充電
されるようになつている。コンデンサC1には、
アナログスイツチ6を介して並列的にコンデンサ
C2が接続されている。コンデンサC1は大容量で
あるのに対しコンデンサC2は小容量のものにな
つている。アナログスイツチ6は前記ゲートコン
トロール回路4からの信号Cが加えられることに
よりオンになるようになつている。コンデンサ
C2にはスイツチング素子としてのFET7が並列
的に接続されている。FET7はそのゲートに前
記ゲートコントロール回路4からの信号Bが加え
られることによつてオンするようになつている。
FET7の出力はバツフアアンプ8に加えられ、
バツフアアンプ8の出力は、レベル調整用可変抵
抗器9を介して出力アンプ10に加えられ、出力
アンプ10から音声信号として出力されるように
なつている。
In FIG. 1, a melody memory 1 sequentially reads out a melody signal consisting of a pitch signal, a pitch signal, etc. stored in advance, and this melody signal is applied to a note generating circuit 2. The musical note generating circuit 2 processes the reference frequency signal from the reference oscillator 3 in accordance with the melody signal, outputs a musical note signal corresponding to the melody signal, and inputs the signal to the gate control circuit 4.
The gate control circuit 4 processes the reference frequency signal from the reference oscillator 3 according to the pitch of the note signal, and outputs a start signal A consisting of one pulse at the start of the note signal for each note. At the same time, there is a signal B having a frequency corresponding to the pitch of the note signal, and a signal B having the same frequency as this signal B.
A signal C is output at the falling edge of the signal C. The above signal A is a field effect transistor (hereinafter referred to as a field effect transistor) as a switching element.
FET 5 is added to the gate of 5 (referred to as "FET")
is now turned on. A capacitor C 1 is connected in series to the FET 5, and the capacitor C 1 is charged by the power supply V DD when the FET is on. Capacitor C1 has
Capacitor in parallel via analog switch 6
C 2 is connected. Capacitor C 1 has a large capacity, while capacitor C 2 has a small capacity. The analog switch 6 is turned on by applying the signal C from the gate control circuit 4. capacitor
FET7 as a switching element is connected in parallel to C2 . The FET 7 is turned on by applying a signal B from the gate control circuit 4 to its gate.
The output of FET7 is added to buffer amplifier 8,
The output of the buffer amplifier 8 is applied to an output amplifier 10 via a level adjustment variable resistor 9, and is outputted from the output amplifier 10 as an audio signal.

次に、上記実施例の作用を第2図を参照しなが
ら説明する。前記スタート信号Aは第2図Aに示
されているように、一つの音符信号毎に一つのパ
ルス信号として出力され、かつ、一つの音符信号
が開始されると同時に出力されるものである。ま
た、信号Bは第2図Bに示されているように、音
符信号に基く音高を決定する周波数のパルス信号
列で構成されている。さらに信号Cは第2図Cに
示されているように、信号Bと同じ周波数のパル
ス信号列でなるが、信号Bの立ち下がりと同時に
立ち上がるようになつていて信号Bと重なること
がなく、かつ、信号Cを成す一連のパルス列のう
ち最初のパルス信号は信号Aと同期して出力され
るようになつている。
Next, the operation of the above embodiment will be explained with reference to FIG. As shown in FIG. 2A, the start signal A is output as one pulse signal for each note signal, and is output at the same time as one note signal is started. Further, as shown in FIG. 2B, the signal B is composed of a pulse signal train having a frequency that determines the pitch based on the musical note signal. Furthermore, as shown in FIG. 2C, signal C consists of a pulse signal train with the same frequency as signal B, but it rises at the same time as signal B falls and does not overlap with signal B. Furthermore, the first pulse signal of the series of pulses forming the signal C is output in synchronization with the signal A.

まず、ゲートコントロール回路4から一つのス
タート信号Aが出力されると、この信号が出力さ
れている間だけFET5がオンになり、コンデン
サC1が電源VDDによつて充電される。また、こ
れと同時に信号Cの最初のパルスによつてアナロ
グスイツチ6がオンになり、コンデンサC2が同
じくVDDによつて充電される。かかるコンデンサ
C1及びC2の充電は短時間に行なわれ、FET5及
びアナログスイツチ6は直ちにオフとなる。次に
信号Bの一つのパルスによつてFET7がオンに
なり、それまでVDDで充電されていたコンデンサ
C2の電荷を総て放電させコンデンサC2の端子電
圧をゼロにする。信号Bの一つのパルスが立ち下
げると同時に信号Cの一つのパルスが立ち下がつ
てアナログスイツチ6をオンにし、コンデンサ
C1の充電電荷をコンデンサC2に移そうとする。
しかし、信号Cの各一つのパルス巾は比較的狭
く、かつ、コンデンサC1は大容量であるのに対
しコンデンサC2は小容量であるからコンデンサ
C1の充電電荷の一部だけがコンデンサC2に移さ
れ、このときのコンデンサC1,C2の端子電圧は
DDよりも低いV2となる。次に信号Bのうちの
第2番目のパルスが出力されてFET7がオンに
なるとコンデンサC2の電荷が総て放電され、コ
ンデンサC2の端子電圧がゼロとなる。以後、同
様にしてアナログスイツチ6のオンによりコンデ
ンサC1からコンデンサC2への電荷の一部の移
動、FET7のオンによるコンデンサC2の放電と
いう動作を繰り返えす。以上の動作をする結果コ
ンデンサC1の端子電圧は、第2図Dに示されて
いるように、VDD−V2−V3−V4…というように
順次減衰する。また、コンデンサC2の端子電圧
信号、即ち、バツフアアンプ8の入力電圧信号
は、第2図Eに示されているように、音高信号に
応じた周波数のパルス信号であつて、上記信号D
と同様にVDD−V2−V3−V4…というように順次
減衰する信号となる。この信号Eは二つのアンプ
8,10を介して増巾されたのち、図示されない
スピーカなどから、音声となつて出力される。
First, when one start signal A is output from the gate control circuit 4, the FET 5 is turned on only while this signal is being output, and the capacitor C1 is charged by the power supply VDD . At the same time, analog switch 6 is turned on by the first pulse of signal C, and capacitor C2 is also charged by VDD . capacitor
C 1 and C 2 are charged in a short time, and FET 5 and analog switch 6 are immediately turned off. A single pulse of signal B then turns on FET 7, charging the capacitor previously charged at V DD .
Discharge all the charge in C 2 and make the terminal voltage of capacitor C 2 zero. At the same time as one pulse of signal B falls, one pulse of signal C falls, turning on analog switch 6, and turning on the capacitor.
We try to transfer the charging charge of C 1 to capacitor C 2 .
However, the pulse width of each signal C is relatively narrow, and capacitor C 1 has a large capacity while capacitor C 2 has a small capacity, so the capacitor
Only a portion of the charge on C 1 is transferred to capacitor C 2 , and the terminal voltage of capacitors C 1 and C 2 at this time becomes V 2 which is lower than V DD . Next, when the second pulse of signal B is output and FET 7 is turned on, the charge in capacitor C 2 is completely discharged, and the terminal voltage of capacitor C 2 becomes zero. Thereafter, in the same manner, the operation of moving part of the charge from capacitor C 1 to capacitor C 2 by turning on analog switch 6 and discharging capacitor C 2 by turning on FET 7 is repeated. As a result of the above operation, the terminal voltage of the capacitor C 1 attenuates sequentially as V DD -V 2 -V 3 -V 4 . . . as shown in FIG. 2D. Further, the terminal voltage signal of the capacitor C2 , that is, the input voltage signal of the buffer amplifier 8, is a pulse signal with a frequency corresponding to the pitch signal, as shown in FIG.
Similarly, the signal is sequentially attenuated as V DD -V 2 -V 3 -V 4 . This signal E is amplified via two amplifiers 8 and 10, and then output as audio from a speaker (not shown).

第2図の右がわの部分は音高が高い場合の動作
を示している。これからもわかる通り、音高が高
い場合はコンデンサC1によるコンデンサC2の充
電及びコンデンサC2の放電の周期が短かいか
ら、信号D及び信号Eの減衰度が大きくなる。従
つて、音高が高くなればなるほど早く減衰し、自
然な音に近似した音が得られることになる。
The part on the right side of Figure 2 shows the operation when the pitch is high. As can be seen from this, when the pitch is high, the period of charging capacitor C 2 by capacitor C 1 and discharging capacitor C 2 is short, so the degree of attenuation of signal D and signal E becomes large. Therefore, the higher the pitch, the faster the attenuation occurs, resulting in a sound that approximates a natural sound.

ここで、前記減衰動作を数式によつて説明す
る。信号Dの最初の電圧V1はVDDと同じである
から、 V1=VDD であり、このときの電荷Q1は Q1=(C1+C2)V1 である。次に信号Cの第2パルスの信号Dの電荷
Q2は Q2=C1V1=(C1+C2)V2 従つて、そのときの電圧V2は V2=C/C+CV1 となる。また、信号Cの第3パルスでの信号Dの
電荷Q3は Q3=C1V2=(C1+C2)V3 従つて、そのときの電圧V3は V3=(C/C+C2V1 となる。以下、 Qn=C1Vo-1=(C1+C2)Voo=(C/C+Cn-1V1 となり、指数関数となる。従つて、nの密度(こ
の密度は周波数と対応する)に応じて減衰時間が
変り、この場合、周波数と反比例するように減衰
時間が変化することになる。
Here, the attenuation operation will be explained using a mathematical formula. Since the initial voltage V 1 of the signal D is the same as V DD , V 1 =V DD , and the charge Q 1 at this time is Q 1 =(C 1 +C 2 )V 1 . Next, the charge of signal D of the second pulse of signal C
Q 2 is Q 2 =C 1 V 1 = (C 1 +C 2 )V 2 Therefore, the voltage V 2 at that time is V 2 =C 1 /C 1 +C 2 V 1 . Also, the charge Q 3 of signal D at the third pulse of signal C is Q 3 =C 1 V 2 = (C 1 +C 2 )V 3 Therefore, the voltage V 3 at that time is V 3 = (C 1 / C 1 + C 2 ) 2 V 1 . Hereinafter, Qn=C 1 Vo -1 = (C 1 +C 2 )V o Vo = (C 1 /C 1 +C 2 ) n-1 V 1 , which is an exponential function. Therefore, the decay time changes depending on the density of n (this density corresponds to the frequency), and in this case, the decay time changes in inverse proportion to the frequency.

以上の説明からも明らかな通り、本考案によれ
ば、デジタルによるエンベロープ記憶回路やタイ
ミングパルス発生回路やデジタル・アナログ変換
器というような複雑な回路が不要であり、簡単な
スイツチ手段の組み合わせで足りるため、高い音
になればなる程減衰が早くなるから、初めに述べ
た本考案の目的を達成することができる。また、
本考案によれば、比較的簡易な回路構成によつて
自然な音を得ることができるという効果がある。
As is clear from the above explanation, according to the present invention, complicated circuits such as digital envelope storage circuits, timing pulse generation circuits, and digital-to-analog converters are not required, and a combination of simple switching means is sufficient. Therefore, the higher the sound, the faster the attenuation becomes, so the object of the present invention stated at the beginning can be achieved. Also,
According to the present invention, there is an effect that natural sound can be obtained with a relatively simple circuit configuration.

なお、第1図の実施例では、集積回路とする場
合を考慮して、スイツチ素子をFET及びアナロ
グスイツチとしてあるが、これらの代りに他のス
イツチ素子を用いても差支えない。
In the embodiment shown in FIG. 1, FETs and analog switches are used as switch elements in consideration of the case where the circuit is integrated into an integrated circuit, but other switch elements may be used instead of these elements.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本考案の実施例を示す回路図、第2図
は同上実施例の動作を示すタイミングチヤートで
ある。 4……ゲートコントロール回路、5,7……ス
イツチ手段としてのFET、6……スイツチ手段
としてのアナログスイツチ、C1……大容量コン
デンサ、C2……小容量コンデンサ。
FIG. 1 is a circuit diagram showing an embodiment of the present invention, and FIG. 2 is a timing chart showing the operation of the same embodiment. 4... Gate control circuit, 5, 7... FET as switching means, 6... Analog switch as switching means, C 1 ... Large capacity capacitor, C 2 ... Small capacity capacitor.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 音符信号の入力によつて、音符の始まりに対応
したスタート信号A、音高に応じた周波数の信号
B、信号Bと同じ周波数で信号Bとタイミングが
ずれた信号Cをそれぞれ出力するゲートコントロ
ール回路と、信号Aによつて動作するスイツチ手
段と、このスイツチ手段と直列に接続されていて
このスイツチ手段のオンにより充電される大容量
コンデンサと、このコンデンサと並列的に接続さ
れた小容量コンデンサと、これら両コンデンサ間
に接続され、信号Cにより動作して上記大容量コ
ンデンサの充電電荷を上記小容量コンデンサに移
すスイツチ手段と、信号Bにより動作する小容量
コンデンサの放電用スイツチ手段とを有する電子
音のエンベロープ付加回路。
A gate control circuit that receives a note signal and outputs a start signal A corresponding to the beginning of a note, a signal B having a frequency corresponding to the pitch, and a signal C having the same frequency as signal B but with a timing shift from signal B. , a switch means operated by signal A, a large capacitor connected in series with this switch means and charged when the switch means is turned on, and a small capacitor connected in parallel with this capacitor. , an electronic circuit connected between both capacitors and having switch means operated by a signal C to transfer the charged charge of the large capacity capacitor to the small capacity capacitor, and switch means operated by a signal B for discharging the small capacity capacitor. Sound envelope addition circuit.
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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4968648A (en) * 1972-11-06 1974-07-03
JPS533321A (en) * 1976-06-30 1978-01-13 Kawai Musical Instr Mfg Co Envelope signal generator for electronic instrument

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