JPS6230874B2 - - Google Patents

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JPS6230874B2
JPS6230874B2 JP6760778A JP6760778A JPS6230874B2 JP S6230874 B2 JPS6230874 B2 JP S6230874B2 JP 6760778 A JP6760778 A JP 6760778A JP 6760778 A JP6760778 A JP 6760778A JP S6230874 B2 JPS6230874 B2 JP S6230874B2
Authority
JP
Japan
Prior art keywords
slit light
signal
outline
light pattern
line
Prior art date
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Expired
Application number
JP6760778A
Other languages
Japanese (ja)
Other versions
JPS54159358A (en
Inventor
Masayuki Mishiro
Yoshuki Tajima
Nobuaki Kido
Masakazu Kozono
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Komatsu Ltd
Original Assignee
Komatsu Ltd
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Publication date
Application filed by Komatsu Ltd filed Critical Komatsu Ltd
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Description

【発明の詳細な説明】 本発明は工業用テレビジヨンカメラ(以下ITV
という)により溶接線を検出する方法に関するも
のである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an industrial television camera (hereinafter referred to as ITV).
The present invention relates to a method for detecting weld lines.

自動溶接機において溶接線を検出する方法は
種々あるが、ITVを用いて溶接線を検出する方法
として、スリツトを通した光源からスリツト光を
投射してその像をITVでとらえて溶接線を検出す
る方法が一般に知られている。
There are various methods for detecting weld lines in automatic welding machines, but one method for detecting weld lines using ITV is to project slit light from a light source through a slit, capture the image with ITV, and detect weld lines. A method to do this is generally known.

すなわち、相互に略直交して接合した2つのワ
ークの接合部にスリツト光を投射し、その像を
ITVでとられて画像上に略く字状になつたスリツ
ト光パターンを形成し、各ラインナンバーにおけ
る立上り点(暗部より明部へ変る点)と立下り点
(明部より暗部へ変る点)の位置をそれぞれ求
め、その各位置に基づいてスリツト光パターンの
輪郭を検知すると共に、その輪郭における略く字
状に折曲したラインナンバーによつて溶接線を検
出する方法である。
In other words, a slit light is projected onto the joint of two workpieces that are joined almost orthogonally to each other, and the image is
A slit light pattern is formed on the image taken by ITV in a roughly dogleg shape, and the rising point (the point where the dark area changes to the bright area) and the falling point (the point where the bright area changes to the dark area) at each line number. In this method, the outline of the slit light pattern is detected based on each position, and the welding line is detected based on the line number bent in a substantially doglegged shape on the outline.

しかし、この方法は像の明と暗とによつてスリ
ツ光パターンの輪郭を検知し溶接線を検出する方
法であるから、ワークの表面状態が悪い等の名種
外乱によつてきれいな像が得られずスリツト光パ
ターンの輪郭が崩れてしまい正しい溶接線を検出
できないとの不具合を有する。
However, since this method detects the outline of the slit light pattern based on the brightness and darkness of the image and detects the welding line, a clear image cannot be obtained even if there is a disturbance such as a poor surface condition of the workpiece. The problem is that the outline of the slit light pattern is distorted and the correct welding line cannot be detected.

本発明は上記の事情に鑑みなされたものであつ
て、その目的は各種外乱によつてきれいな像が得
られずスリツト光パターンの輪郭が崩れても正し
い溶接線を検出できるようにした溶接線検出方法
を提供することである。
The present invention has been made in view of the above circumstances, and its purpose is to detect a weld line that can detect the correct weld line even if a clear image cannot be obtained due to various disturbances and the outline of the slit light pattern is distorted. The purpose is to provide a method.

以下図面を参照して本発明の実施例を説明す
る。
Embodiments of the present invention will be described below with reference to the drawings.

2つのワーク1,2を相互に直交するように接
合し、その接合部に光源3よりスリツト光を投射
してITV4でとらえそのITV4のビデオ信号を映
像処理すると第2図に示す如くスリツト光パター
ンイ,ロに対応した部分イ′,ロ′が明るく他が暗
い像が得られる。
When two works 1 and 2 are joined so that they are perpendicular to each other, and a slit light is projected from the light source 3 onto the joint, captured by the ITV 4 and the video signal of the ITV 4 is processed, a slit light pattern is obtained as shown in Figure 2. An image is obtained in which portions A' and B' corresponding to A and B are bright and the rest is dark.

ここで、各ワーク1,2の表面状態が優れて外
乱が生じないとすれば第2図に示す如くきれいな
像が得られスリツト光パターンの輪郭が崩れるこ
とがないが、ワーク1,2の表面状態が悪いと外
乱が生じて第3図に示す如くの像となつてスリツ
ト光パターンの輪郭が第4図のように崩れ正しい
溶接線が検出できないとの不具合を有する。
Here, if the surface condition of each workpiece 1 and 2 is excellent and no disturbance occurs, a clear image as shown in Fig. 2 will be obtained and the outline of the slit light pattern will not collapse, but the surface of workpieces 1 and 2 If the conditions are bad, disturbances will occur, resulting in an image as shown in FIG. 3, and the outline of the slit light pattern will collapse as shown in FIG. 4, resulting in a problem that a correct weld line cannot be detected.

すなわち、明るい部分イ′の中に暗い部分ハが
生じるから、そのレベルナンバTFiにおいては立
上り点a(暗部から明部へ変る点)と立下り点b
(明部から暗部へ変る点)が2度生じてしまい正
しいスリツト光パターンの輪郭が得られず正しい
溶接部を検知できない。
In other words, since a dark part C occurs within a bright part A', the level number TFi has a rising point a (the point where the dark part changes to a bright part) and a falling point b.
(the point where the bright part changes to the dark part) occurs twice, and the correct outline of the slit light pattern cannot be obtained, making it impossible to detect the correct welded part.

そこで、本発明では立上り点から立下り点まで
の距離が所定のスリツト光の幅の範囲内にあるか
否かをチエツクし、良いものだけをデータとして
取り込み正しい輪郭として溶接線を正しく検出で
きるようにした。
Therefore, in the present invention, it is possible to check whether the distance from the rising point to the falling point is within a predetermined width of the slit light, and to capture only the good ones as data so that the weld line can be detected correctly as the correct contour. I made it.

以下その詳細を第5図以降を参照して説明す
る。
The details will be explained below with reference to FIG. 5 and subsequent figures.

ITV4で得られたビデオ信号Rを比較器5と同
期信号分離回路6にそれぞれ入力し、比較器5で
閾値VFによつて2値化信号R′としかつ同期信号
分離回路6で垂直同期信号r1と水平同期信号r2
分離する。
The video signal R obtained by the ITV 4 is input to a comparator 5 and a synchronization signal separation circuit 6, and the comparator 5 converts it into a binary signal R' using a threshold value VF, and the synchronization signal separation circuit 6 converts it into a binary signal R', and the synchronization signal separation circuit 6 converts it into a vertical synchronization signal r. 1 and horizontal synchronization signal r2 .

分離した水平同期信号r2は第1カウンタ(水平
同期信号カウンタ)7のリセツト信号と第2カウ
ンタ(垂直同期信号カウンタ)8のカウントアツ
プ信号として第1・第2カウンタ7,8に夫々入
力され、また垂直同期信号r1は第2カウンタ8の
リセツト信号として入力すると共に、第1カウン
タ7には発信器9よりカウントアツプ信号が入力
される。
The separated horizontal synchronization signal r2 is input to the first and second counters 7 and 8 as a reset signal for the first counter (horizontal synchronization signal counter) 7 and a count-up signal for the second counter (vertical synchronization signal counter) 8, respectively. , the vertical synchronizing signal r1 is input as a reset signal to the second counter 8, and a count-up signal from the oscillator 9 is input to the first counter 7.

これにより、第1カウンタ7では発信器9より
のクロツクをカウントし水平同期信号r2にてリセ
ツトされて水平方向の位置を検出すると共に、第
2カウンタ8は水平同期信号r2をカウントし垂直
同期信号にてリセツトすることでラインナンバを
検出する。
As a result, the first counter 7 counts the clock from the oscillator 9 and is reset by the horizontal synchronizing signal r2 to detect the horizontal position, and the second counter 8 counts the horizontal synchronizing signal r2 and detects the vertical position. The line number is detected by resetting with a synchronization signal.

一方、前記2値化信号R′は微分回路10に送
られて微分されて第1・第2立上りパルスP1,P2
と第1・第2立下りパルスP1′,P2′となる。この
第1・第2立上りパルスP1,P2は第1・第2アン
ド回路11,11の一方の入力側にそれぞれ
送られ、ワンシヨツト遅延回路12を経て第1ア
ンド回路11の他方の入力側にかつインバータ
13を経て第2アンド回路11の他方の入力側
に送られる。また、第1・第2立下りパルス
P1′,P2′は同様に第3・第4アンド回路11
11の一方の入力側にそれぞれ送られ、ワンシ
ヨツト遅延回路14を経て第3アンド回路11
の他方の入力側のフインバータ15を経て第4ア
ンド回路11の他方の入力側に送られこれによ
り第1・第4アンド回路11〜11の出力側
には第6図に示すタイミングでTR1,TR2
TF1,TF2の信号が出力される。そして、第1・
第2・第3・第4アンド回路11〜11の出
力TR1,TR2,TF1,TF2は第1〜第4ラツチ1
〜16にそれぞれ入力され、該第1〜第4
ラツチ16〜16は前記第1カウンタ7の出
力信号(水平位置)によつてラツチされて所定の
ラインナンバにおける第1・第2立上り点a1,a2
の水平位置R1,R2及び第1・第2立下り点b1
b2の水平位置F1,F2を出力する。
On the other hand, the binarized signal R' is sent to the differentiating circuit 10 and differentiated into first and second rising pulses P 1 , P 2
and the first and second falling pulses P 1 ′ and P 2 ′. The first and second rising pulses P 1 and P 2 are sent to one input side of the first and second AND circuits 11 1 and 11 2 , respectively, and are passed through the one-shot delay circuit 12 to the other input side of the first AND circuit 11 1 . and is sent to the other input side of the second AND circuit 112 via the inverter 13. In addition, the first and second falling pulses
Similarly, P 1 ′ and P 2 ′ are the third and fourth AND circuits 11 3 ,
11 to one input side of 4 , and are sent to one input side of the third AND circuit 11 to 3 through the one-shot delay circuit 14 .
The timing shown in FIG . TR 1 , TR 2 ,
TF 1 and TF 2 signals are output. And the first
The outputs TR 1 , TR 2 , TF 1 , TF 2 of the second, third and fourth AND circuits 11 1 to 11 4 are the outputs of the first to fourth latches 1
6 1 to 16 4 , respectively, and the first to fourth
The latches 16 1 to 16 4 are latched by the output signal (horizontal position) of the first counter 7 to determine the first and second rising points a 1 , a 2 at a predetermined line number.
horizontal positions R 1 , R 2 and the first and second falling points b 1 ,
Outputs the horizontal positions F 1 and F 2 of b 2 .

この第1立上り点a1の水平位置R1は第1・第2
引算器17,17に入力され、第2立上り点
a2の水平位置R2は第3引算器17に入力される
とともに、第1立下りb1の水平位置F1は第1引
算器17に、第2立下り点b2の水平位置F2
第2・第3引算器17,17に入力され、第
1引算器17では(R1〜F2)、第2引算器17
では(R1−F2)、第3引算器17では(R2
F2)をそれぞれ演算し、その演算結果(すなわち
第1立上り点a1から第1立下り点b1までの距離
L1、第1立上り点a1から第2立下り点b2までの距
離L2、第2立上り点a2から第2立下り点b2までの
距離L3)は第1・第2・第3比較器18,18
,18に入力されて設定器19で設定された
所定のスリツ光幅Bと比較され、Bよりも大きい
場合には信号が出力される。
The horizontal position R 1 of this first rising point a 1 is the first and second
The second rising point is input to the subtracters 17 1 and 17 2 .
The horizontal position R 2 of a 2 is input to the third subtractor 17 3 , and the horizontal position F 1 of the first falling point b 1 is input to the first subtractor 17 1 of the second falling point b 2. The horizontal position F 2 is input to the second and third subtracters 17 2 , 17 3 , and in the first subtracter 17 1 (R 1 to F 2 ), the second subtracter 17
2 is (R 1 − F 2 ), and the third subtractor 17 is (R 2 − F 2 ).
F 2 ), and calculate the calculation result (i.e., the distance from the first rising point a 1 to the first falling point b 1
L 1 , distance L 2 from the first rising point a 1 to the second falling point b 2 , distance L 3 from the second rising point a 2 to the second falling point b 2 Third comparator 18 1 , 18
2 , 183 and is compared with a predetermined slit light width B set by the setting device 19, and if it is larger than B, a signal is output.

そして、第1比較器18の出力は第1・第2
データセレクト19,19の第1スイツチ2
にON信号T1として直接出力されかつインバ
ータ21を経て第1アンド回路22および第2
アンド回路22に入力され、第2比較器18
の出力は第1アンド回路22に入力に入力され
かつインバータ23を介して第2アンド回路222
に入力され、第3比較器18の出力は第2アン
ド回路22に入力されており、各第1比較器1
が信号を出力{(R1−F1)≧B}すると第
1・第2アンド回路22,22は出力せず、
第1比較器18が信号を出力せず{(R1−F1
<B}に第2・第3比較器18,18が信号
を出力する{(R1−F2)≧B、(R2−F2)≧B}と
第1アンド回路22が信号を出力しその信号は
第1・第2データセレクタ19,19の第
1・第2スイツチ20,20のON信号T2
して入力され、第3比較器18のみが信号を出
力する{(R2−F2)≧B}と第2アンド回路22
が信号を出力しその信号は第1・第2データセ
レクタ19,19の第2スイツチ20,2
のON信号T3として入力される。
Then, the output of the first comparator 181 is the first and second
First switch 2 of data select 19 1 , 19 2
0 1 directly as an ON signal T 1 and passes through the inverter 21 to the first AND circuit 22 1 and the second
is input to the AND circuit 222 , and the second comparator 181
The output of
The output of the third comparator 183 is input to the second AND circuit 222, and the output of each first comparator 183 is inputted to the second AND circuit 222.
When 81 outputs a signal {(R 1 −F 1 )≧B}, the first and second AND circuits 22 1 and 22 2 do not output,
The first comparator 18 1 does not output a signal {(R 1 −F 1 )
<B}, the second and third comparators 18 2 and 18 3 output signals {(R 1 −F 2 )≧B, (R 2 −F 2 )≧B} and the first AND circuit 22 1 The signal is inputted as the ON signal T2 of the first and second switches 201 and 202 of the first and second data selectors 191 and 192 , and only the third comparator 183 receives the signal. Output {(R 2 −F 2 )≧B} and the second AND circuit 22
2 outputs a signal, and the signal is sent to the second switch 20 2 , 2 of the first and second data selector 19 1 , 19 2
It is input as the ON signal T3 of 02 .

そして、前記第1データセレクタ19
R1,R2のどちらか一方をライズデータR1として
演算機24に入力し、第2データセレクタ19
はF1,F2のどちらか一方をフオールデータF1
して演算機24に入力して実際像における立上り
点、立下り点を演算して第7図に示す如くの補正
したスリツト光パターンの輪郭を描くことができ
る。
The first data selector 191 is
Either one of R 1 and R 2 is input to the computing device 24 as rise data R 1 and the second data selector 19 2
Input either F 1 or F 2 as full data F 1 to the computer 24 and calculate the rising and falling points of the actual image to create a corrected slit light pattern as shown in FIG. You can draw an outline.

以上の様であるから、各種外乱によつてきれい
な像が得られずスリツト光パターンの輪郭が崩れ
ても正しい溶接線を検出できる。
As described above, even if a clear image cannot be obtained due to various disturbances and the outline of the slit light pattern is distorted, the correct weld line can be detected.

本発明は前述のように構成したので、各種外乱
によつてきれいな像が得られずスリツト光パター
ンの輪郭が崩れても正しい溶接線を検出できる。
Since the present invention is constructed as described above, even if a clear image cannot be obtained due to various disturbances and the outline of the slit light pattern is distorted, the correct weld line can be detected.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は溶接線検出装置の概略斜視図、第2
図、第3図はその像の説明図であり、第4図は外
乱が生じた場合の従来のスリツト光パターン輪郭
説明図、第5図は本発明の実施例を示す線図的構
成説明図、第6図はその動作タイミング表図、第
7図は本発明によるスリツト光パターン輪郭説明
図である。 1,2はワーク、3は光源、4はITV、5は比
較器、6は同期信号分離回路、7,8は第1・第
2カウンタ、9は発振器、10は微分回路、11
はアンド回路、16はラツチ、17は引算器、1
8は比較器、19は設定器、19はデータセレク
ト、20はスイツチ、22はアンド回路、Rはビ
デオ信号。
Figure 1 is a schematic perspective view of the weld line detection device, Figure 2 is a schematic perspective view of the weld line detection device;
3 are explanatory diagrams of the image, FIG. 4 is an explanatory diagram of the conventional slit light pattern outline when disturbance occurs, and FIG. 5 is a diagrammatic configuration explanatory diagram showing an embodiment of the present invention. , FIG. 6 is an operation timing chart, and FIG. 7 is an explanatory diagram of the outline of the slit light pattern according to the present invention. 1 and 2 are workpieces, 3 is a light source, 4 is an ITV, 5 is a comparator, 6 is a synchronizing signal separation circuit, 7 and 8 are first and second counters, 9 is an oscillator, 10 is a differential circuit, 11
is an AND circuit, 16 is a latch, 17 is a subtracter, 1
8 is a comparator, 19 is a setting device, 19 is a data select, 20 is a switch, 22 is an AND circuit, and R is a video signal.

Claims (1)

【特許請求の範囲】[Claims] 1 相互に所定の角度で接合した2つのワーク
1,2における接合部にスリツト光を投射し、そ
の像をITV4でとられて溶接線を検出する方法に
おいて、前記ITV4のビデオ信号Rの各ラインナ
ンバにおける立上り点、立下り点をそれぞれ検出
し、その各立上り点から立下り点までの距離をそ
れぞれ演算すると共に、その各距離と所定のスリ
ツト光幅Bとを比較してスリツト光幅Bよりも大
きな値であるラインナンバのみを選出し、その選
出したラインナンバにおけるスリツト光パターン
の立上り点、立下り点に基づいてスリツト光パタ
ーンの輪郭を決定し、そのスリツト光パターンの
輪郭の折曲位置によつて溶接線を検出するように
したことを特徴とする溶接線検出方法。
1 In a method in which a slit light is projected onto the joint of two works 1 and 2 that are joined at a predetermined angle to each other, and an image thereof is taken by an ITV 4 to detect a welding line, each line of the video signal R of the ITV 4 is Detect the rising and falling points in the number, calculate the distance from each rising point to the falling point, and compare each distance with a predetermined slit light width B to calculate the distance from the slit light width B. Select only the line numbers with a large value, determine the outline of the slit light pattern based on the rising and falling points of the slit light pattern at the selected line number, and determine the bending position of the outline of the slit light pattern. A weld line detection method, characterized in that the weld line is detected by.
JP6760778A 1978-06-07 1978-06-07 Detectining welding line Granted JPS54159358A (en)

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JPS54159358A JPS54159358A (en) 1979-12-17
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JP (1) JPS54159358A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01130374U (en) * 1988-02-24 1989-09-05

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JPH01130374U (en) * 1988-02-24 1989-09-05

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