JPS62287163A - Resolver speed detecting circuit - Google Patents

Resolver speed detecting circuit

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Publication number
JPS62287163A
JPS62287163A JP13122986A JP13122986A JPS62287163A JP S62287163 A JPS62287163 A JP S62287163A JP 13122986 A JP13122986 A JP 13122986A JP 13122986 A JP13122986 A JP 13122986A JP S62287163 A JPS62287163 A JP S62287163A
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JP
Japan
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circuit
signal
resolver
sine wave
counting
Prior art date
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Application number
JP13122986A
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Japanese (ja)
Inventor
Akihiro Hoshino
昭広 星野
Hiroshi Kuromaru
黒丸 広志
Takatoshi Kogure
小暮 孝敏
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Mitsubishi Heavy Industries Ltd
Original Assignee
Mitsubishi Heavy Industries Ltd
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Publication date
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  • Transmission And Conversion Of Sensor Element Output (AREA)

Abstract

PURPOSE:To perform speed detection with high accuracy by detecting the rotating speed of an electric motor, etc., by using the output of a resolver. CONSTITUTION:A reference signal generating circuit 1 generates exciting signal generating clock pulses for resolver exciting signal generation and count pulses for a counter circuit 61. The exciting signal generating clock pulses are inputted to an exciting circuit 2, which generates sine wave signals V1sinomegat and V1cosomegat to excite the resolver 3. A sine wave KV1sin(omegat-thetar) corresponding to the position thetar of the rotor of the resolver 3 is induced at the rotor winding. A zero-cross circuit 41 generates the zero-cross pulse signal t1 of the leading edge of the sine wave signal, the circuit 61 count the counting pulses with the signal t1 to generate a sample pulse when counting up to a counted value corresponding to time t0=pi/omega, and its counting contents are reset. The sine signal is sampled and held 51 with this sample pulse to obtain an output proportional to speed information.

Description

【発明の詳細な説明】 3、発明の詳細な説明 〔産業上の利用分野〕 本発明は、電動サーボ装置における[動機等の回転速度
をレゾルバの出力によシ検出することのできるレゾルバ
速度検出回路に関する。
Detailed Description of the Invention 3. Detailed Description of the Invention [Industrial Application Field] The present invention relates to a resolver speed detection system in which the rotational speed of a motive device, etc. can be detected by the output of a resolver in an electric servo device. Regarding circuits.

〔従来の技術〕[Conventional technology]

一般に、例えば電動機を速度制御するためには、その電
動機の回転速度を検出する必要がある。従来は、このよ
うに電動機の回転速度を検出するには、タコジェネレー
タや、光学式エンコーf等が用いられて来た。
Generally, for example, in order to control the speed of an electric motor, it is necessary to detect the rotational speed of the electric motor. Conventionally, a tacho generator, an optical encoder f, etc. have been used to detect the rotational speed of an electric motor in this way.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

しかしながら、上記のタコジェネレータは、一種の発電
機であるからプラノ寺の摩耗部品で溝、成され、経年変
化が生じるとともに火花等によってノイズが発生すると
いう欠点がある。又、光学式エンコーグにおいても、例
えばフォトダイオード等の経年変化する部品を用いてい
るためその信頼性が充分でない。
However, since the above-mentioned tachogenerator is a type of generator, it has the disadvantage that it is made up of a variety of wear parts, which causes deterioration over time and generates noise due to sparks and the like. Also, optical encoders do not have sufficient reliability because they use components that change over time, such as photodiodes.

このため、経年変化に対しても充分な信頼性が得られる
速度検出方式が望まれていた。
For this reason, there has been a desire for a speed detection method that can provide sufficient reliability even against changes over time.

従って、本発明の目的は、上記従来の問題点を解消し、
位置検出器として用いられる信頼性の高いレゾルバの出
力を用いて電動機等の回転速度を検出しうろ高信頼性の
レゾルバ速度検出回路を提供することにある。
Therefore, an object of the present invention is to solve the above-mentioned conventional problems,
An object of the present invention is to provide a highly reliable resolver speed detection circuit that detects the rotational speed of an electric motor or the like using the output of a highly reliable resolver used as a position detector.

〔問題点を解決するための手段〕[Means for solving problems]

本発明によるレゾルバ速度検出回路は、(1)、レゾル
バ励磁信号生成りロックパルスおよび計数・セル7を発
生する基準信号発生回路と、前記励磁信号生成りロック
・マルスを入力し、レゾルバ励磁用の第1の2相正弦波
信号を出力する励磁回路と、レゾルバの2次側に誘起さ
れる第2の正弦波信号の立上り、または立下りの零りロ
ス気を検出し、零クロスパルス信号を発生する岑クロス
回路と、前記零りロス/?ルス傷゛号により、前記計数
・セル7を計数開始し、所定の計数値・でなった時点で
、サンプルパルス信号を発生し、かつ計数内容をリセッ
トする’Bt4eを有するカウンタ回路と、前記サンプ
ル・ぐルス信号にて、前記第2の正弦波信号ヲサンプル
ホールドし、速度情報を出力するサンプルホールド回路
とを具備してなることを特徴とする。
The resolver speed detection circuit according to the present invention includes (1) a reference signal generation circuit that generates a resolver excitation signal generation lock pulse and a counting cell 7; An excitation circuit that outputs a first two-phase sine wave signal and a second sine wave signal induced on the secondary side of the resolver detect the rising or falling zero loss and generate a zero cross pulse signal. The generated cross circuit and the above-mentioned spill loss/? A counter circuit having a 'Bt4e that starts counting the counting cell 7 based on the pulse damage signal and generates a sample pulse signal and resets the counting contents when a predetermined count value is reached; - A sample and hold circuit is provided which samples and holds the second sine wave signal using the signal and outputs speed information.

さらに本発明によるレゾルバ速度検出回路は、(2)、
レゾルバ励磁信号生成りロック・セル7および計数・母
ルスを発生する基準信号発生回路と、前記励磁信号生成
りロック・セル7を入力し、レゾルバ励磁用の第1の2
相正弦波信号を出力する励磁回路と、レゾルバの2次側
に誘起される第2の正弦波信号の零クロス点を検出し、
立上り岑クロスパルス信号と立下り岑りロスノ臂ルス信
号を発生する零クロス回路と、前記立上り苓クロス・母
ルス信号により、前記計数・臂ルスを計数開始し、所定
の計数値になった時点で、第1のサンプルパルス信号を
発生し、かつ計数内容をリセットする機能を有する第1
のカウンタ回路と、前記立下9岑クロスパルス信号によ
り、前記計数・2ルスを計数開始し、所定の計数値にな
った時点で、第2のサンプル・2ルス信号を発生し、か
つ計数内容をリセットする機能を有する第2のカウンタ
回路と、前記W。
Furthermore, the resolver speed detection circuit according to the present invention includes (2):
A resolver excitation signal generation lock cell 7 and a reference signal generation circuit that generates a count/base pulse are inputted to the excitation signal generation lock cell 7.
An excitation circuit that outputs a phase sine wave signal and a zero cross point of a second sine wave signal induced on the secondary side of the resolver are detected,
A zero cross circuit that generates a rising cross pulse signal and a falling pulse signal, and the rising cross/mother pulse signal are used to start counting the count and pulse, and when a predetermined count value is reached. and a first sample pulse signal having a function of generating a first sample pulse signal and resetting counting contents.
The counter circuit and the falling 9-pulse cross pulse signal start counting the count and 2 pulses, and when a predetermined count value is reached, a second sample and 2 pulse signal is generated, and the counting contents are a second counter circuit having a function of resetting the W;

lのサンプルパルス信号にて、前記第2の正弦波信号を
サンプルホールドする第1のサンプルホールド回路と、
前記第2のサンプル・2ルス信号にて、前記第2の正弦
波信号をサンプルホールドする第2のサンプルホールド
回路と、前記第1のサンプルホールド値から前記第2の
サンプルホールド11Jを減算し、速度情報を出力する
加算回路とを具備してなることを特徴とする。
a first sample and hold circuit that samples and holds the second sine wave signal using a sample pulse signal of l;
a second sample and hold circuit that samples and holds the second sine wave signal using the second sample and two pulse signals, and subtracts the second sample and hold 11J from the first sample and hold value; It is characterized by comprising an addition circuit that outputs speed information.

〔作用〕[Effect]

本発明によるレゾルバ速度検出回路の作用を説明するに
当り、まず本発明の基礎をなす理論を説明する。
In explaining the operation of the resolver speed detection circuit according to the present invention, the theory underlying the present invention will first be explained.

レゾルバには、第3図に示すような2相励磁1相出力の
ものを用いる。第3図において、レゾルバの励Ti1i
信号を、固定位相ωtなる2相正弦波信号V1slnω
t、VIQ)Sωtとすると、レゾルバの出力X?i、
X = K V I(sinωt’czθ、一部ωし・
s’mθ、)=KV1 sln  (ωを一〇r)(K
:巻数比)・・・・・!1)となる。レゾルバーの出力
巻、腺の位置イ青報であろθ。
The resolver used is one with two-phase excitation and one-phase output as shown in FIG. In Fig. 3, the resolver excitation Ti1i
The signal is converted into a two-phase sine wave signal V1slnω with a fixed phase ωt.
t, VIQ) Sωt, resolver output X? i,
X = K V I (sinωt'czθ, some ω and
s'mθ, )=KV1 sln (ω is 10r) (K
: turns ratio)...! 1). The output winding of the resolver and the position of the gland are θ.

は、必ずしもレゾルバ励磁位相ωtが零の時、零とは限
らず。
is not necessarily zero when the resolver excitation phase ωt is zero.

θ、=ωr1+δ (ω、:レゾルパ出力角周速度δ:
?、7ノ期値)・(2)となる。
θ, = ωr1 + δ (ω,: Resolper output angular circumferential velocity δ:
? , 7th period value) (2).

次に上記(1)の発明について説明すると、(3)式に
おいて、 (ω−ωr)11−δ=2nπ(n:整数)     
 ・・・・・(4)となるtlからTo(=  )後の
X11求める。(4)式よシ、 (6)式を(3)式に代入すると、 =KV1sin (2nπ−1−−r rr )ω =KV1s1rl(π−」π) ω =KV、他二π                  
    ・・・・・(7)(7)式で、レゾルバ励磁角
速度ωが、レゾルバ出力角速度得よシ光分大きい。すな
わち、ω〉ω、とすれば、’sm二π;”となり、(7
)式は、ω       ω xt  =KV1−ω。
Next, to explain the invention of (1) above, in equation (3), (ω-ωr)11-δ=2nπ (n: integer)
...(4) Find X11 after To (=) from tl. According to equation (4), substituting equation (6) into equation (3), = KV1sin (2nπ-1--r rr )ω = KV1s1rl(π-''π) ω = KV, other 2π
(7) In equation (7), the resolver excitation angular velocity ω is larger by the amount of the resolver output angular velocity obtained. That is, if ω〉ω, 'sm2π;'' becomes (7
) formula is ω ω xt =KV1−ω.

=KV、 TOUr−・・・・<8) となる。このXlば、速度情報に比例したものとなる。=KV, TOURr-...<8) becomes. This Xl is proportional to the speed information.

?:Kに上記(2)の発明について説明すると、(3)
式において、 (ω−or)t2−δ=(2n+1)π (n:整数)
・・・・・・(9)となるt2からTo(”)佐のXl
を求める。(9)ω 式より、 t2=襲〜もに戸 ・・・・・・見q t2+To =■ヅセゼー1       ・・・・俳
ω−ωr  ω q〃弐分(3)式に代入すると、 =−KV1地二π                ・
・壷・・りaω (8)式と同様に、(勢式においてω〉ω、とすると、
X2=−KVIToω、             ・
・・−・U:+ここで、Xl とXlを減算し7之もの
をXo とすると、 Xo=X1−X、=2KVl’roω、       
 ・・−・・a−Oすることにより、上記(1)の発明
の牛周ル1で速度情報が得られることになる。
? :When explaining the invention of (2) above to K, (3)
In the formula, (ω-or)t2-δ=(2n+1)π (n: integer)
......(9) from t2 to To('') Xl
seek. (9) From the ω formula, t2 = attack~monido...seeq t2+To =■zuseseee1...haiω-ωr ω q〃2 Substituting into the equation (3), =- KV1 earth two pi ・
・Purn・・riaω Similarly to equation (8), if we set ω〉ω in the equation (8), then
X2=-KVIToω, ・
...-U:+Here, if we subtract Xl and Xl and set 7 as Xo, then Xo=X1-X, =2KVl'roω,
... By performing a-O, speed information can be obtained in the cow wheel 1 of the invention (1) above.

〔実施例〕 第1図は上記(1)の発明の一実施例を示す図であり、
1は基準信号発生回路、2は励磁回路、3はレゾルバ、
4ノは零クロス回路、42はギクロス回路、51はサン
プルホールド回路、52はサンプルホールド回路、53
はサンプルホールド回路、r   +Ir+ +++y
  J riM     g   25−hh   y
第1E1!     6 .7はカウンタ回路、7は加
算回路を示す。基準信号発生回路lば、レゾルバ励磁信
号生成のだめの励磁信号生成りロック・9ルスと後述す
るカウンタ回路61の計数パルスを発生する。励磁信号
生成りロック・9ルスは励磁回路2に入力され、励磁回
路2ではレゾルバ励磁のための第1の正弦波信号vls
tnωt、 vICO5ω【が生成され、レゾルバ3を
励磁する。レゾルバ3の回転子巻線には、回転子位置情
報θ、に対応した信号、すなわち第2の正弦波信号KV
t地(ωを一θ、)が誘起される。零クロス回路4ノは
、前記第2の正弦波信号の立上りの零クロスパルス信号
t1を発生する。カウンタ回路6ノは、前記零クロスパ
ルス信号1.により、前記計数・9ルスを計数開始し、
時1′¥1To=  ’tc相当するω 計数値になった時点で、サンダルパルス信号を発生し、
かつ計数内容をリセットする。サンプルホールド回路5
1は、前記サンプル・ゼルス信号にで、前記第2の正弦
波信号をサンプルホールドすることによりx、 =KV
I TaO2なる速度情報に比例した出力を得る。
[Example] FIG. 1 is a diagram showing an example of the invention of (1) above,
1 is a reference signal generation circuit, 2 is an excitation circuit, 3 is a resolver,
4 is a zero cross circuit, 42 is a gicross circuit, 51 is a sample hold circuit, 52 is a sample hold circuit, 53
is a sample hold circuit, r +Ir+ +++y
J ri M g 25-hh y
1st E1! 6. 7 represents a counter circuit, and 7 represents an adder circuit. The reference signal generating circuit 1 generates a lock pulse for generating an excitation signal for generating a resolver excitation signal and a counting pulse for a counter circuit 61 to be described later. The excitation signal generation lock 9 pulse is input to the excitation circuit 2, and the excitation circuit 2 generates the first sine wave signal vls for excitation of the resolver.
tnωt, vICO5ω[ are generated and the resolver 3 is excited. The rotor winding of the resolver 3 receives a signal corresponding to the rotor position information θ, that is, a second sine wave signal KV.
t ground (ω - θ) is induced. A zero cross circuit 4 generates a zero cross pulse signal t1 at the rising edge of the second sine wave signal. The counter circuit 6 receives the zero cross pulse signal 1. Start counting the 9th ruth,
When the count value of ω corresponding to 1'\1To = 'tc is reached, a sandal pulse signal is generated,
And reset the counting contents. Sample hold circuit 5
1 is by sampling and holding the second sine wave signal using the sample zero signal, x, =KV
An output proportional to the speed information of I TaO2 is obtained.

第2図は上記(2)の発明の一実施例を示し、第1図に
示すものと同一部分には同一符号を付して説明する。1
は基準信号発生回路であり、レゾルバ励磁信号生成のた
めの励磁信号生成りロック・ぐルスと後述するカウンタ
回路62.63の計数・マルスを発生する。励磁信号生
成りロック・9ルスは励磁回路2に入力され、励磁回路
2ではし/ルパ励磁のための第1の正弦波信号V1s+
nωt、V1CQSωtが生成されレゾルバ3を励磁す
る。レゾルバ3の回転子巻線には、回転子位置情報θ、
に対応した信号、すなわち第2の正弦波信号KV1sj
n(ωt−科襖;誘起される。零クロス回路42は、前
記第2の正弦波信号の立上りの零クロス・マルス信号t
1 と立下りの零りロスノ!ルス信号t2を発生する。
FIG. 2 shows an embodiment of the invention (2) above, and the same parts as those shown in FIG. 1 are given the same reference numerals and will be described. 1
1 is a reference signal generating circuit which generates an excitation signal generation lock signal for generating a resolver excitation signal and a count signal for counter circuits 62 and 63 to be described later. The excitation signal generation lock 9 pulse is input to the excitation circuit 2, and the excitation circuit 2 generates the first sine wave signal V1s+ for excitation of the laser/lupa.
nωt and V1CQSωt are generated to excite the resolver 3. The rotor winding of the resolver 3 contains rotor position information θ,
, that is, the second sine wave signal KV1sj
The zero cross circuit 42 receives the zero cross malus signal t at the rising edge of the second sine wave signal.
1 and falling spill Rossno! A pulse signal t2 is generated.

カウンタ回路62ば、前記立上り零クロスパルス信号1
゜により、前記計数)4ルスを計数開始し、時間T0=
−に相当する計数値になった時点でサンプルパルス信号
を発生し、かつ3」数内容をリセットする。同様に、カ
ウンタ回路63は、前記立下り零クロスパルス信号t2
により、前記計数・9ルスを計数開始し、時間To= 
に相当する計数値になりωω た時点でサンプル・マルス信号を発生し、かつ計数内容
とリセットする。サンプルホールド回路52は、カウン
タ回路62から出力されるサンプル・ぜルス信号にて、
前記第2の正弦波信号をサンプルホールドすることによ
りxl”KVI TOω、なる出力を得る。同様に、サ
ンプルホールド回路53(i、カウンタ回路63から出
力されるサンプルパルス信号にて、前記第2の正弦波信
号をサンプルホールドすることによりX、=−KVIT
0ω、な乙出方を得る。そして加算回路7にてX、−X
2を実行することによりxo =2KV、 T2O,な
る速度情報に比例した出力を得る。
The counter circuit 62 receives the rising zero cross pulse signal 1.
According to ゜, counting of the above-mentioned counting) 4 ruses is started, and the time T0=
When the count value corresponds to -, a sample pulse signal is generated and the contents of the count are reset. Similarly, the counter circuit 63 receives the falling zero cross pulse signal t2.
Accordingly, the above-mentioned counting starts counting the 9th pulse, and the time To=
When a count value corresponding to ωω is reached, a sample malus signal is generated and the count contents are reset. The sample hold circuit 52 uses the sample/zero signal output from the counter circuit 62 to
By sampling and holding the second sine wave signal, an output of xl''KVI TOω is obtained.Similarly, the second sine wave signal is By sampling and holding the sine wave signal, X, = -KVIT
0ω, I got a good idea. Then, in the adder circuit 7,
By executing step 2, an output proportional to the speed information xo = 2KV, T2O, is obtained.

以上述べたように本発明の各実施しくjでは久のような
特徴を灯している。
As described above, each implementation of the present invention has the following characteristics.

(1)  位置検出器として用いられるレゾルバと1j
単な回路構成によって速度情報が得られる。
(1) Resolver and 1j used as position detectors
Speed information can be obtained by a simple circuit configuration.

(2)  前記(2)の発明の実施例によれば、前記(
1)の発明の2倍の出力で、かつ牛周期で速度情報が得
られる。
(2) According to the embodiment of the invention of (2) above, the above (
Speed information can be obtained in cow cycles with twice the output as in the invention of 1).

〔発明の効果口 以上により、本発明によれば、従来のタフソエネレータ
や、光学式エンコーグ等を用いることなしに、電動機等
の回転速度を位置検出器であるレゾルバの出力を利用す
ることによって得ることができ、高信頼性の速度検出を
得ることができる等の優れた効果が奏せられる。
[Advantageous Effects of the Invention] As described above, according to the present invention, the rotational speed of an electric motor, etc. can be obtained by using the output of a resolver, which is a position detector, without using a conventional tough generator, optical encoder, etc. This provides excellent effects such as highly reliable speed detection.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図および第2図は、それぞれ不発明の一実施例の構
成を示すプコック図、第3図は本発明において用いるレ
ゾルバの原理図でおる。 1・・・基準信号発生回路、2・・・励磁回路、3・・
・レゾルバ、4)・・・零クロス回路、42・・・零ク
ロス回路、5ノ・・・サンプルホールド回路、52・・
・サンプルホールド回路、53・・・サンプルホールド
回路、61・・・カウンタ回路、62・・・カウンタ回
路、63・・・カウンタ回路、7・・・加算回路。
1 and 2 are Pcock diagrams showing the configuration of an embodiment of the present invention, and FIG. 3 is a diagram showing the principle of a resolver used in the present invention. 1... Reference signal generation circuit, 2... Excitation circuit, 3...
・Resolver, 4)... Zero cross circuit, 42... Zero cross circuit, 5... Sample hold circuit, 52...
- Sample hold circuit, 53... Sample hold circuit, 61... Counter circuit, 62... Counter circuit, 63... Counter circuit, 7... Adder circuit.

Claims (2)

【特許請求の範囲】[Claims] (1)励磁信号生成クロックパルスおよび計数パルスを
発生する基準信号発生回路と、前記励磁信号生成クロッ
クパルスを入力し、レゾルバ励磁用の第1の2相正弦波
信号を出力する励磁回路と、レゾルバの2次側に誘起さ
れる第2の正弦波信号の立上り、または立下りの零クロ
ス点を検出し、零クロスパルス信号を発生する零クロス
回路と、前記零クロスパルス信号により、前記計数パル
スを計数開始し、所定の計数値になった時点で、サンプ
ルパルス信号を発生し、かつ計数内容をリセットする機
能を有するカウンタ回路と、前記サンプルパルス信号に
て、前記第2の正弦波信号をサンプルホールドし、速度
情報を出力するサンプルホールド回路とを具備してなる
ことを特徴とするレゾルバ速度検出回路。
(1) A reference signal generation circuit that generates excitation signal generation clock pulses and counting pulses; an excitation circuit that receives the excitation signal generation clock pulses and outputs a first two-phase sine wave signal for excitation of the resolver; a zero cross circuit that detects the rising or falling zero cross point of the second sine wave signal induced on the secondary side of the second sine wave signal and generates a zero cross pulse signal; a counter circuit that starts counting and has a function of generating a sample pulse signal and resetting the counting contents when a predetermined count value is reached; A resolver speed detection circuit comprising a sample and hold circuit that samples and holds and outputs speed information.
(2)励磁信号生成クロックパルスおよび計数パルスを
発生する基準信号発生回路と、前記励磁信号生成クロッ
クパルスを入力し、レゾルバ励磁用の第1の2相正弦波
信号を出力する励磁回路と、レゾルバの2次側に誘起さ
れる第2の正弦波信号の零クロス点を検出し、立上り零
クロスパルス信号と立下り零クロスパルス信号を発生す
る零クロス回路と、前記立上り零クロスパルス信号によ
り、前記計数パルスを計数開始し、所定の計数値になっ
た時点で第1のサンプルパルス信号を発生し、かつ計数
内容をリセットする機能を有する第1のカウンタ回路と
、前記立下り零クロスパルス信号により、前記計数パル
スを計数開始し、所定の計数値になった時点で、第2の
サンプルパルス信号を発生し、かつ計数内容をリセット
する機能を有する第2のカウンタ回路と、前記第1のサ
ンプルパルス信号にて、前記第2の正弦波信号をサンプ
ルホールドする第1のサンプルホールド回路と、前記第
2のサンプルパルス信号にて、前記第2の正弦波信号を
サンプルホールドする第2のサンプルホールド回路と、
前記第1のサンプルホールド値から前記第2のサンプル
ホールド値を減算し、速度情報を出力する加算回路とを
具備してなることを特徴とするレゾルバ速度検出回路。
(2) a reference signal generation circuit that generates excitation signal generation clock pulses and counting pulses; an excitation circuit that receives the excitation signal generation clock pulses and outputs a first two-phase sine wave signal for excitation of the resolver; A zero cross circuit that detects a zero cross point of a second sine wave signal induced on the secondary side of the sine wave signal and generates a rising zero cross pulse signal and a falling zero cross pulse signal, and the rising zero cross pulse signal, a first counter circuit having a function of starting counting the counting pulses, generating a first sample pulse signal when a predetermined count value is reached, and resetting the counting contents; and the falling zero cross pulse signal. a second counter circuit that starts counting the counting pulses, generates a second sample pulse signal when a predetermined count value is reached, and resets the counting contents; a first sample and hold circuit that samples and holds the second sine wave signal using the sample pulse signal; and a second sample and hold circuit that samples and holds the second sine wave signal using the second sample pulse signal. a hold circuit;
A resolver speed detection circuit comprising: an addition circuit that subtracts the second sample hold value from the first sample hold value and outputs speed information.
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