JPS62283715A - Load control circuit apparatus - Google Patents

Load control circuit apparatus

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JPS62283715A
JPS62283715A JP61238178A JP23817886A JPS62283715A JP S62283715 A JPS62283715 A JP S62283715A JP 61238178 A JP61238178 A JP 61238178A JP 23817886 A JP23817886 A JP 23817886A JP S62283715 A JPS62283715 A JP S62283715A
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    • H03ELECTRONIC CIRCUITRY
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    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/04Modifications for accelerating switching
    • H03K17/041Modifications for accelerating switching without feedback from the output circuit to the control circuit
    • H03K17/0412Modifications for accelerating switching without feedback from the output circuit to the control circuit by measures taken in the control circuit
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    • H03K17/60Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
    • H03K17/64Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors having inductive loads

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 3、発明の詳細な説明 産業上の利用分野 本発明は特許請求の範囲第1項の上位概念に記載の誘導
リアクタンス成分をもつ負荷を電気的に制御する回路装
置に関する。
Detailed Description of the Invention 3. Detailed Description of the Invention Industrial Application Field The present invention relates to a circuit device for electrically controlling a load having an inductive reactance component as defined in the generic concept of claim 1. .

従来の公知技術とその問題点 この種の回路装置はたとえば西独特許出願公告第201
3012号公報から公知である。
Conventional known technology and its problems This type of circuit device is described, for example, in West German Patent Application Publication No. 201.
It is known from the publication No. 3012.

誘導成分をもつ前記の負荷はたとえば電磁石とかに電磁
石弁である。この種の電磁弁の制御のさいにはその吸引
時間にとって決定的なのは電磁弁に印加されている電圧
である。たとえば自動車に電磁弁を使用するばあいには
搭載電源電圧が強い変動を伴う。
Such loads with an inductive component are, for example, electromagnets or electromagnetic valves. In controlling this type of solenoid valve, the voltage applied to the solenoid valve is decisive for the suction time. For example, when a solenoid valve is used in an automobile, the on-board power supply voltage is subject to strong fluctuations.

それゆえこのような用途では回路を改良して、電圧が制
限されるにもかかわらず電磁弁がより迅速に動作するか
、ないしは切換時間が同じ場合電磁弁の設計が変更でき
るようにすることが重要である。これは同様に他の負荷
にも適用される。
Therefore, in such applications, the circuit may be modified to allow the solenoid valve to operate more quickly despite the voltage limitations, or to allow the design of the solenoid valve to be changed for the same switching time. is important. This applies to other loads as well.

、発明の構成 このような改良は特許請求の範囲第1項の特徴部分の記
載の構成によって達成される。本発明の他の構成および
その有利な使用は特許請求の範囲第2項以下に記載され
ている。その他の利点は以下の図に基づく説明から明ら
かである。
, Structure of the Invention Such an improvement is achieved by the structure described in the characterizing part of claim 1. Other developments of the invention and advantageous uses thereof are described in the subclaims. Further advantages are clear from the description based on the figures below.

実施例 第1図において1で使用電源(たとえば搭載電源)の一
方の電源端子が、2で電磁弁が示されている。電磁弁2
に直列に電力トランジスタT2のエミッタ・コレクタ区
間および接電した測定抵抗が接続されている。
Embodiment In FIG. 1, reference numeral 1 indicates one power supply terminal of a power source used (for example, an on-board power supply), and reference numeral 2 indicates a solenoid valve. Solenoid valve 2
The emitter-collector section of the power transistor T2 and the electrically connected measuring resistor are connected in series.

電力トランジスタT2はPライ・々トランジスタT1と
共にいわゆるダーリントン回路を形成する。トラン・ジ
スタT1がそのベースに印加される切換信号で制御され
ることによって電磁弁2が作動される。本実施例では端
子6に印加される信号Eによって制御が行なわれ、それ
によって制御コンパレータ生が能動化され、それが次に
制御増幅器5およびトランジスタT1を介して電力トラ
ンジスタT2を電導過制御する0電磁弁2を流れる電流
の立上りはたとえば第2図aの曲線20に対応して行な
われる。測定抵抗3、制御:I ンパレータ4および制
御増幅器5は、電磁弁2を流れる所定の動作電流に到達
するとその都度制御2oが電磁弁2が吸引状態に保持さ
れる程度に短時間中断される。
The power transistor T2 forms a so-called Darlington circuit with the P-type transistor T1. The solenoid valve 2 is operated by controlling the transistor T1 with a switching signal applied to its base. Control is provided in this example by a signal E applied to terminal 6, which activates a control comparator output, which in turn controls the conduction of power transistor T2 via control amplifier 5 and transistor T1. The rise of the current flowing through the solenoid valve 2 takes place, for example, in accordance with the curve 20 in FIG. 2a. Measuring resistor 3, control: I The comparator 4 and the control amplifier 5 are such that when a predetermined operating current through the solenoid valve 2 is reached, the control 2o is interrupted for such a short time that the solenoid valve 2 is held in the suction state.

本発明に己たがって電源端子1と電力トランジスタT2
のベース(ないしはT1のエミッタ)との間にさらに別
のトランジスタT3のエミツJ −−+ +/力JマF
−!! L翻IR巨堆桔7レハ右万IITFi牧h−挿
入されている。このトランジスタを制御するため反転素
子8および9、双安定素子1oおよび論理積ゲート11
が設けられている。
According to the invention, the power terminal 1 and the power transistor T2
Further, between the base of (or the emitter of T1) and the emitter of transistor T3,
-! ! L translation IR large collection 7 reha right man IITFi maki h- has been inserted. To control this transistor, inverting elements 8 and 9, bistable element 1o and AND gate 11
is provided.

端子6への制御信号Eの印加によって反転素子8を介し
て双安定素子10の切換が生じ、その結果Q出力側に信
号が送出される(第2図すおよびCの信号変化参照)。
The application of the control signal E to the terminal 6 causes a switching of the bistable element 10 via the inverting element 8, so that a signal is delivered to the Q output (see signal changes in FIGS. 2 and 2C).

反転素子9によって信号はまた論理積ゲート11の第2
の入力側にも印加され、トランジスタT3が制御される
By means of the inverting element 9 the signal is also passed to the second of the AND gate 11.
It is also applied to the input side of the transistor T3 to control the transistor T3.

それによってトランジスタ下20ベースに通常のダーリ
ントン回路のばあいよりも相当大きな電流が流れる。こ
の電流は抵抗7によって制限される。そこでトランジス
タT2のコレクタのに 電圧は次のよ5曳なる。
This causes a considerably larger current to flow in the base of the transistor 20 than in a normal Darlington circuit. This current is limited by resistor 7. Therefore, the voltage at the collector of transistor T2 is as follows.

U↑2= Ucg 5atl −1−Ig2°RMその
結果トランジスタT2は飽和に達する。しかしベース電
流およびコレクタ電流の関数としての飽和電圧は標準ダ
ーリントンのばあいよりも相当低い。第2図aに電磁弁
2を流れる電流IMVの変化は曲線21で示されている
。電流立上りが通常よりも大きく、到達可能な最終値も
(PLで)より高いことがわかる。それによって電磁弁
はまたより早期に切換わる。
U↑2=Ucg 5atl −1−Ig2°RM As a result, transistor T2 reaches saturation. However, the saturation voltage as a function of base and collector currents is considerably lower than in the standard Darlington case. In FIG. 2a, the variation of the current IMV flowing through the solenoid valve 2 is shown by a curve 21. It can be seen that the current rise is larger than usual and the reachable final value is also higher (at PL). The solenoid valve thereby also switches earlier.

電流値E #”−P 3に到達すると(これはコン・ぞ
レータ4によって検出される)、まず制御増幅器5から
のトランジスタT1の制御が所定の時間中断されるが、
しかし制御コン・ξレータ牛の出力信号によって双安定
素子10もリセットされ、それによってトランジスタT
3は作動しないようにされる。それと共に電磁弁2はも
はや制御されず、電磁弁の電圧は徐々に降下する(P3
以後の曲線を参照)。しかし電磁弁2の復旧が起こる前
に、制御回路を介して新たな制御が行なわれる。双安定
素子10は新たに到来するE信号によってはじめて再セ
ツト可能なので、トランジスタT3はしゃ断されたまま
である。
When the current value E#"-P3 is reached (which is detected by the converter 4), the control of the transistor T1 from the control amplifier 5 is first interrupted for a predetermined time, but
However, the output signal of the control controller ξ regulator also resets the bistable element 10, thereby causing the transistor T
3 is made inactive. At the same time, the solenoid valve 2 is no longer controlled, and the voltage of the solenoid valve gradually drops (P3
(see subsequent curves). However, before the solenoid valve 2 is restored, new control is performed via the control circuit. Since bistable element 10 can only be reset by a newly arriving E signal, transistor T3 remains switched off.

つまりトランジスタT3は常に電磁弁2の制御が開始し
たばあいにのみ作動するようになる。
In other words, the transistor T3 always operates only when control of the solenoid valve 2 is started.

第3図の実施例では部分1′から11’およびTI’か
ら73’までは第1図の相応する部分1から11および
T1からT3までに対応するが、ただし制御コン、5レ
ータギはここでは2つの比較閾値に切換え可能であり、
5′は制御クリップ・フロップであり、電磁弁2は3つ
の切換位置を有する。
In the embodiment of FIG. 3, sections 1' to 11' and TI' to 73' correspond to the corresponding sections 1 to 11 and T1 to T3 in FIG. switchable between two comparison thresholds;
5' is a control clip-flop, and the solenoid valve 2 has three switching positions.

しかしこのばあいにはさらに端子6“から11′までに
よって構成されるトランジスタT 3’の第2の制御回
路が設けられている。両制御回路は論理和ゲート30を
介してトランジスタT 3’に作用する。端子σおよび
げに印加される信号Eな゛ およびAは電磁弁2′をれ作用位置にもたらす。
However, in this case a second control circuit for the transistor T3' is also provided, which is constituted by the terminals 6" to 11'. Both control circuits are connected via an OR gate 30 to the transistor T3'. The signals E and A applied to the terminals σ and A bring the solenoid valve 2' into the active position.

これは、制御器3’ 、 5’によって電流の立上りが
ミー電流値で中断されることによって実現される。これ
は第4図に示されており、同図にはE信号によって電磁
弁電流が増加し、次に制御器3′から5′までによって
平均しである値に保持され(0〜6m5ec)、A信号
が発生すると電流がさらに増加し、次に(約14m5e
c以降)ふたたび制御によって平均して一定に保たれる
ということが示されている。またこの図で0信号(論理
和ゲート30)のためT3が立上り期にのみ作動するこ
とがわかる。破線で記入された変化はT3の作用のない
立上りを示す。クロック制御は次のように動作する。抵
抗3′を流れる電流が入力側6′またはげにあらかじめ
与えられた値に達すると、コン・ぞレータlによって・
ぞルスが制御フリップ・フロップ5′ならびにクリップ
・フロップ1σおよび1σに与えられる。制御フリップ
・フロップ5′はクロック入力側を介してリセット・ξ
ルスが与えられ、その結果電流がふたたび測定抵抗3′
を流れるまで、トランジスタT1およびT2をしゃ断す
る。
This is achieved by interrupting the rise of the current at the Me current value by the controllers 3', 5'. This is shown in Figure 4, where the solenoid valve current is increased by the E signal and then maintained at an average value (0 to 6 m5ec) by the controllers 3' to 5'. When the A signal occurs, the current increases further and then (approximately 14m5e
(c onwards) It is shown that the control once again keeps it constant on average. It can also be seen from this figure that T3 operates only during the rising phase due to the 0 signal (OR gate 30). The change marked with a dashed line indicates the rise without the effect of T3. Clock control operates as follows. When the current flowing through the resistor 3' reaches a predetermined value at the input side 6', the converter l
signal is applied to control flip-flop 5' and clip-flops 1σ and 1σ. The control flip-flop 5' is reset and ξ via the clock input side.
is applied, so that the current flows again through the measuring resistor 3'
Transistors T1 and T2 are cut off until the current flows through the transistors T1 and T2.

所望の電流に到達することによってT3がその都度しゃ
断されるようにすることはトランプが スタの機能が使用されるばあいのみ電力損能じるという
利点を有する。同じ理由から、搭載電源電圧は瞬間的に
低くなりすぎることがあるためより迅速な電流の立上り
がとくに必要なばあいのみトラン・ノスタT3が作動す
るようにすることも考えられる。
Having T3 cut off each time by reaching the desired current has the advantage that the tramp only loses power if the star function is used. For the same reason, it is also conceivable that the trans-nostar T3 is activated only when a more rapid rise in current is particularly required, since the on-board power supply voltage may momentarily become too low.

発明の効果 本発明によれば第3のトラン・ジスタT3を用いること
により電流立上り特性を改善できると共に、負荷にかか
る電圧を迅速に制御でき、電力損失も少ないと云う利点
がある。
Effects of the Invention According to the present invention, by using the third transistor T3, the current rise characteristics can be improved, the voltage applied to the load can be quickly controlled, and power loss is also small.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の第1実施例の回路図、第2図は第1図
の説明に供する線図、第3図は本発明の第2実施例の回
路図、第4図は第3図の説明に供する線図である。 l、1′・・・電源端子、2,2′・・・電磁弁、3,
3′・・・測定抵抗、4,4°・・・制御コン・ξレー
タ、5・・・制御増幅器、6 、6’ 、σ・・・端子
、7,7′・・・制限抵抗、8 、8’、 8′、 9
 、9’、 (7・・・反転素子、10゜1σ、1σ・
・・双安定素子、11 、11’ 、 11”・・・論
理積ゲート、5・・・制御フリップ・フロップ、3o・
・・論理和ゲート 2、発明の名称 負荷制御回路装置 3、補正針する者 事件との関係特許出願人 4、代理人 昭和62年 2月24日  (発送日)別紙の通り
FIG. 1 is a circuit diagram of a first embodiment of the present invention, FIG. 2 is a diagram for explaining FIG. 1, FIG. 3 is a circuit diagram of a second embodiment of the present invention, and FIG. It is a line diagram provided for explanation of a figure. l, 1'...Power terminal, 2,2'...Solenoid valve, 3,
3'...Measuring resistance, 4, 4°...Control converter/ξ regulator, 5...Control amplifier, 6, 6', σ...Terminal, 7, 7'...Limiting resistor, 8 , 8', 8', 9
,9', (7...inversion element, 10°1σ, 1σ・
...Bistable element, 11, 11', 11"...AND gate, 5...Control flip-flop, 3o...
...OR gate 2, name of the invention load control circuit device 3, relation to the amendment needle case Patent applicant 4, agent February 24, 1988 (Shipping date) As shown in the attached sheet

Claims (1)

【特許請求の範囲】 1、ドライバトランジスタT1および後置の電力トラン
ジスタT2を具備するダーリントン回路を有し、両トラ
ンジスタのコレクタと使用電圧の一方の極との間に負荷
が接続されている、誘導リアクタンス成分をもつ負荷を
電気的に制御する回路装置において、使用電源の同じ極
(1)と後置の電力トランジスタ(T2)のベースとの
間にさらに第3のトランジスタ(T3)のエミッタ・コ
レクタ区間が挿入されており、このトランジスタ(T3
)が、そのベースを介して負荷(2)の投入接続と同時
に開始し少なくともある時間、後置のトランジスタ(T
2)のベースに大きな電流を供給するため通電に切換え
られることを特徴とする負荷制御回路装置。 2、第3のトランジスタ(T3)が制限抵抗(7)に直
列に挿入されている特許請求の範囲第1項記載の負荷制
御回路装置。 3、負荷抵抗を表わす電磁石(2)を流れる電流が所定
の動作電流量に到達すると、電力トランジスタ(T2)
の通電が制御器(3、4、5)によって瞬間的に中断さ
れる制御回路に使用される特許請求の範囲第1項または
第2項に記載の負荷制御回路装置。 4、動作電流に最初に到達すると同時に第3トランジス
タ(T3)が、電磁石(2)の新たな断路まで作動しな
いようにされる、特許請求の範囲第3項記載の負荷制御
回路装置。 5、負荷抵抗を表わし、2つの動作位置に制御可能な電
磁石(2)を流れる電流が所定の2つの異なる動作電流
値に到達すると、2つの異なる制御信号(E、A)に基
づき、電力トランジスタ(T2)の制御がその都度に制
御器(3′、4′、5′)によって瞬間的に中断される
制御回路に使用され、前記の異なる動作電流に到達する
とその都度第3のトランジスタ(T3)が作動しないよ
うにされ、新たな制御信号(E、A)が発生するとはじ
めてふたたび作動するようにされる、特許請求の範囲第
1項または第2項記載の負荷制御回路装置。 6、第3のトランジスタが作動するようにされるのが所
定の値以下に作動電圧が低下したばあいのみである、特
許請求の範囲第3項から第5項までのいずれか1項に記
載の負荷制御回路装置。
[Claims] 1. An inductive circuit comprising a Darlington circuit comprising a driver transistor T1 and a downstream power transistor T2, with a load connected between the collectors of both transistors and one pole of the working voltage. In a circuit device for electrically controlling a load having a reactive component, an emitter-collector of a third transistor (T3) is connected between the same pole (1) of the power supply used and the base of a downstream power transistor (T2). A section is inserted, and this transistor (T3
) starts at the same time as the input connection of the load (2) via its base and for at least some time the downstream transistor (T
2) A load control circuit device characterized in that it can be switched to energization in order to supply a large current to the base of item 2). 2. The load control circuit device according to claim 1, wherein the third transistor (T3) is inserted in series with the limiting resistor (7). 3. When the current flowing through the electromagnet (2) representing the load resistance reaches a predetermined amount of operating current, the power transistor (T2)
The load control circuit device according to claim 1 or 2, which is used in a control circuit whose energization is momentarily interrupted by a controller (3, 4, 5). 4. Load control circuit arrangement according to claim 3, wherein as soon as the operating current is first reached, the third transistor (T3) is made inoperable until a new disconnection of the electromagnet (2). 5. When the current flowing through the electromagnet (2), which represents a load resistance and is controllable in two operating positions, reaches two predetermined different operating current values, based on two different control signals (E, A), the power transistor (T2) is used in a control circuit whose control is momentarily interrupted by the controller (3', 4', 5'), and the third transistor (T3 3. Load control circuit arrangement according to claim 1, wherein the load control circuit arrangement (1) is deactivated and is only activated again when a new control signal (E, A) occurs. 6. According to any one of claims 3 to 5, the third transistor is activated only when the operating voltage drops below a predetermined value. load control circuit device.
JP61238178A 1985-10-08 1986-10-08 Load control circuit device Expired - Lifetime JP2545372B2 (en)

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Application Number Priority Date Filing Date Title
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