JPS62272167A - Testing device for printed board - Google Patents

Testing device for printed board

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JPS62272167A
JPS62272167A JP11644486A JP11644486A JPS62272167A JP S62272167 A JPS62272167 A JP S62272167A JP 11644486 A JP11644486 A JP 11644486A JP 11644486 A JP11644486 A JP 11644486A JP S62272167 A JPS62272167 A JP S62272167A
Authority
JP
Japan
Prior art keywords
probe
contact
probes
width
flat
Prior art date
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Pending
Application number
JP11644486A
Other languages
Japanese (ja)
Inventor
Masashi Takada
高田 正志
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Publication of JPS62272167A publication Critical patent/JPS62272167A/en
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Abstract

PURPOSE:To preclude wrong decision making due to a defect in the contacting between a flat lead and a probe by providing contact probes which differ in width to a probe which is made to abut on flat leads of the semiconductor element of a printed board. CONSTITUTION:The 1st contact probes 3A which have wide width B1 and the 2nd contact probes 3B which have narrow width B2 are arrayed alternately in all directions of the probe 3 fixed to an elevation mechanism 12 conveyed by a conveying mechanism 13. Then when the probes 3A and 3B contact flat leads 2A (2A-1-2A-4) and the probe 3 shifts in position as shown by an arrow A, leads 2A-2 and 2A-3 are short-circuited by the probes 3A and the probes 3B are open. Therefore, the direction of the position shift is detected from the position of the lead 2A in the short-circuited state. For the purpose, the probe 3 is moved finely by the mechanism 13 to make a check, and wrong decision making due to a defect in the contacting between the flat lead and contact probe is precluded.

Description

【発明の詳細な説明】 3、発明の詳細な説明 〔概 要〕 プリント基板に実装されたLSI素子などの半導体素子
のフラットリードに当接されるプローブに幅の異なった
コンタクトプローブを配設することにより、当接に際し
てのプローブの位置ずれが検出され、該フラットリード
と該コンタクトプローブとの接触不良による誤判定を防
止するように形成したものである。
[Detailed Description of the Invention] 3. Detailed Description of the Invention [Summary] Contact probes of different widths are arranged on probes that come into contact with flat leads of semiconductor elements such as LSI elements mounted on a printed circuit board. As a result, positional deviation of the probe during contact is detected, and erroneous determination due to poor contact between the flat lead and the contact probe is prevented.

〔産業上の利用分野〕[Industrial application field]

本発明はプリント基板に実装された半導体素子のフラッ
トリードに測定器が接続されたプローブを当接させるこ
とにより試験を行うプリント板試験装置に係り、特に、
該当接に際して、位置ずれが検出されるように形成した
プリン日展試験装置に関する。
The present invention relates to a printed circuit board testing device that performs testing by bringing a probe connected to a measuring device into contact with the flat lead of a semiconductor element mounted on a printed circuit board, and in particular,
The present invention relates to a Pudding Nitten test device configured to detect positional deviation when the contact occurs.

LSI素子などの半導体素子が実装されて形成されたプ
リント板は、一般的に、その製造工程において誤実装が
ないか、または、実装されたそれぞれの半導体素子に異
常がないかをチェックする試験が行われる。
Printed boards formed by mounting semiconductor elements such as LSI elements are generally tested during the manufacturing process to check whether there are any incorrect mountings or whether there are any abnormalities in each mounted semiconductor element. It will be done.

このような試験は半導体素子のそれぞれのフラットリー
ドに当接されるコンタクトプローブが配列されたプロー
ブを用いプローブを所定の個所に移動させ、該当接によ
ってそれぞれのフラットリードを測定器に接続し、測定
器による抵抗値などの測定結果により半導体素子の誤実
装または異常の検出が行われる。
Such tests use a probe with an array of contact probes that come into contact with each flat lead of the semiconductor device, move the probes to a predetermined location, connect each flat lead to a measuring device through the corresponding contact, and perform the measurement. Mismounting or abnormality of semiconductor elements is detected based on the results of measurements such as resistance values by the device.

一方、このような半導体素子は高密度実装化によりフラ
ットリードは微細な幅とピンチで配列されているため、
プローブとの当接には精度の高い駆動を行わなければ接
触不良または誤接続によって所定のフラットリードの測
定が行われなくなる。
On the other hand, due to the high-density packaging of such semiconductor devices, the flat leads are arranged with minute widths and pinches.
If the contact with the probe is not driven with high precision, the specified flat lead will not be measured due to poor contact or incorrect connection.

したがって、このようなプローブの当接に際しては接触
不良または誤接続による誤判定が生じるることのないこ
とが望まれている。
Therefore, it is desired that erroneous judgments due to poor contact or erroneous connections do not occur when such probes are brought into contact.

〔従来の技術〕[Conventional technology]

従来は第3図の従来の説明図に示すように構成されてい
た。第3図の(a)は構成図、  (bl)(b2)は
要部拡大図である。
Conventionally, the configuration was as shown in the conventional explanatory diagram of FIG. FIG. 3(a) is a configuration diagram, and FIG. 3(b2) is an enlarged view of the main parts.

第3図の(a)に示すように、半導体素子2が実装され
たプリント基板1はテーブル11に積載され、制御部1
4の制御によって駆動される移動機構13と昇降機構1
2とでX、 Y (図示されていない)、z方向に移動
れるプローブ10が設けられ、試験すべき半導体素子2
の直上にプローブ10が位置され、測定器4による所定
の測定が行われるように構成されている。
As shown in FIG. 3(a), the printed circuit board 1 on which the semiconductor element 2 is mounted is placed on the table 11, and the control unit 1
The moving mechanism 13 and the lifting mechanism 1 driven by the control of 4.
A probe 10 movable in the X, Y (not shown), and Z directions is provided with the semiconductor device 2 to be tested.
A probe 10 is positioned directly above the probe 10, and the measuring device 4 is configured to perform a predetermined measurement.

また、このような移動機構13には光学系の位置検出器
(図示されていない)などによって精度の高い移動が行
えるように配慮されている。
Further, such a moving mechanism 13 is designed to be able to move with high precision using an optical position detector (not shown) or the like.

そこで、制御部14の制御によって測定器4による測定
データDと、予め出力部5に格納されたテストデータT
Dとが判定部6によって照合され照合結果によって良否
の判定Sが出力される。
Therefore, under the control of the control unit 14, the measurement data D by the measuring instrument 4 and the test data T stored in the output unit 5 in advance are
D is collated by the determination unit 6, and a pass/fail determination S is output based on the collation result.

したがって、半導体素子2が誤実装されている場合、ま
たは、半導体素子2に異常が生じた場合は照合によって
判断することができるため、プリント板の良否の判定を
行うことができる。
Therefore, if the semiconductor element 2 is incorrectly mounted or if an abnormality occurs in the semiconductor element 2, it can be determined by comparison, so that it is possible to determine whether the printed board is good or bad.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

このような構成では、プローブ10と半導体素子2との
接続は第2図の(b 1)  (b 2)に示すように
、プローブ10に設けられたコンタクトプローブIOA
、IOBが半導体素子2のフラットリード2Aに当接さ
れることで行われる。
In such a configuration, the connection between the probe 10 and the semiconductor element 2 is made using the contact probe IOA provided on the probe 10, as shown in (b1) and (b2) in FIG.
, is performed by the IOB being brought into contact with the flat lead 2A of the semiconductor element 2.

この当接は互いの位置が合致される場合は良いが、プリ
ント基板1の歪などにより、位置ずれが生じた場合、(
bl)のようにコンタクトプローブl0AO幅b1が小
さい時はいづれのフラットリード2Aに接続されないた
めオーブン状態になる。
This abutment is good if the mutual positions match, but if a positional deviation occurs due to distortion of the printed circuit board 1, etc.
When the contact probe 10AO width b1 is small as shown in bl), it is not connected to any flat lead 2A, resulting in an oven state.

また、(b2)のようにコンタクトプローブ10Bの幅
b2が大きい時はいづれのフラットリード2Aにも接続
され、ショート状態になる。
Further, when the width b2 of the contact probe 10B is large as shown in (b2), it is connected to any flat lead 2A, resulting in a short-circuit state.

このようなオープン状態、またはショート状態が生じた
場合は測定ができなくなるため、不良と判定される。
If such an open state or short-circuit state occurs, measurement cannot be performed, and therefore it is determined to be defective.

したがって、このような不良の場合は再トライによって
チェックを再度行わなければならない問題を有していた
Therefore, in the case of such a defect, there is a problem in that the check must be performed again by retrying.

〔問題点を解決するための手段〕[Means for solving problems]

第1図は本発明の原理説明図である。 FIG. 1 is a diagram explaining the principle of the present invention.

第1図に示すように、プローブ(3)には所定の幅(B
1)の第1のコンタクトプローブ(3A)と、該幅(B
1)より小さい幅(B2)の第2のコンタクトプローブ
(3B)とが混在されるように構成したものである。
As shown in Figure 1, the probe (3) has a predetermined width (B
1) of the first contact probe (3A) and the width (B
1) A second contact probe (3B) having a smaller width (B2) is mixed.

このように構成することによって前述の問題点は解決さ
れる。
With this configuration, the above-mentioned problems are solved.

〔作 用〕[For production]

即ち、プローブには幅の広いコンタクトプローブと、幅
の狭いコンタクトプローブとを混在して設けることによ
り、フラットリードとの位置ずれが生じた場合はその位
置ずれ方向を検知することができるようにしたものであ
る。
In other words, by providing a mixture of wide contact probes and narrow contact probes in the probe, it is possible to detect the direction of positional deviation when it occurs with the flat lead. It is something.

したがって、従来のように再トライなどを行うことなく
、検知した位置ずれ方向によってプローブを移動させる
ことで試験作業を継続させることができる。
Therefore, the test work can be continued by moving the probe according to the direction of the detected positional deviation without having to retry as in the conventional case.

〔実施例〕〔Example〕

以下本発明を第2図を参考に詳細に説明する。 The present invention will be explained in detail below with reference to FIG.

第2図は本発明による一実施例の説明図で、(a)は要
部側面図、  (bl)(b2)は要部拡大図である。
FIG. 2 is an explanatory diagram of an embodiment according to the present invention, in which (a) is a side view of the main part, and (bl) and (b2) are enlarged views of the main part.

企図を通じて、同一符合は同一対象物を示す。Throughout the design, like numbers refer to like objects.

第2図の(a)に示すように、移送機構13によって移
送される昇降機構12に固着されたプローブ30四方に
は幅の広いB1の第1のコンタクトプローブ3Aと、幅
の狭いB2の第2のコンタクトプローブ3Bとを交互に
配列することで設けるように形成したもので、その他は
前述と同じ構成である。
As shown in FIG. 2(a), a probe 30 fixed to the lifting mechanism 12, which is transferred by the transfer mechanism 13, has a first contact probe 3A with a wide width B1 and a first contact probe 3A with a narrow width B2 on all sides. It is formed by alternately arranging two contact probes 3B, and the other structure is the same as that described above.

このように幅の異なった第1と第2のコンタクトプロー
ブ3A、3Bによって構成し、(bl)(b2)に示す
ように、2A−1,2A−2,2A−3,2A−4のよ
−うに配列されたフラットリード2Aに対して当接する
と、例えば、(bl)のようにプローブ3が矢印六方向
にずれた場合は第1のコンタクトプローブ3Aによって
2A−2と2A−3とがショートとなり、第2のコンタ
クトプローブ3Bはオープンとなる。
In this way, the first and second contact probes 3A and 3B having different widths are constructed, and as shown in (bl) and (b2), the contact probes 2A-1, 2A-2, 2A-3, and 2A-4 are used. - When the probe 3 comes into contact with the flat leads 2A arranged in the same manner as shown in FIG. A short circuit occurs, and the second contact probe 3B becomes open.

また、(b2)のようにプローブ3が矢印B方向にずれ
た場合は第1のコンタクトプローブ3Aによって2A−
1と2A−2とがショートとなり、第2のコンタクトプ
ローブ3Bはオープンとなる。
Also, if the probe 3 is displaced in the direction of arrow B as shown in (b2), the first contact probe 3A will move 2A-
1 and 2A-2 become short-circuited, and the second contact probe 3B becomes open.

したがって、ショートとなるフラットリード2Aの位置
によって位置ずれ方向を検知することができる。
Therefore, the direction of misalignment can be detected based on the position of the flat lead 2A that is short-circuited.

そこで、この検知した位置ずれを調整するよう移送機構
13によってプローブ3を矢印Aまたは矢印B方向に微
動させることでチェックを行うことができる。
Therefore, a check can be made by slightly moving the probe 3 in the direction of arrow A or arrow B using the transfer mechanism 13 so as to adjust the detected positional deviation.

また、このような第1と第2のコンタクトプローブ3A
、3Bは交互に配列する必要はなく、いづれかを両端ま
たは中央に配設することで充分に検出を行うことができ
る。
Moreover, such first and second contact probes 3A
, 3B do not need to be arranged alternately, and sufficient detection can be achieved by arranging one of them at both ends or in the center.

〔発明の効果〕〔Effect of the invention〕

以上説明したように、本発明によれば、フラットリード
とコンタクトプローブと位置ずれによって接続不良が生
じた場合はその位置ずれ方向が検出されるため、位置ず
れの調整を行うことが容易となる。
As described above, according to the present invention, when a connection failure occurs due to misalignment between the flat lead and the contact probe, the direction of the misalignment is detected, making it easy to adjust the misalignment.

したがって、従来のような測定不能による不良がなくな
り、再トライなどによる手間が省け、試験工数の削減が
図れ、更に、調整動作を行うことにより、光学系などを
備えた精度の高い移送機構の必要がなくなり、コストダ
ウンが図れ、実用的効果は大である。
Therefore, the conventional failures due to inability to measure are eliminated, the trouble of retrying etc. is eliminated, the number of testing steps can be reduced, and furthermore, by performing adjustment operations, the need for a highly accurate transfer mechanism equipped with an optical system etc. is eliminated. This eliminates this problem, reduces costs, and has great practical effects.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の原理説明図。 第2図は本発明による一実施例の説明図で、(a)は要
部側面図、  (bl)(b2)は要部拡大図。 第3図は従来の説明図で、(a)は構成図。 (b 1)  (b 2)は要部拡大図を示す。 図において、 lはプリント基板。 2は半導体素子。 3はプローブ。 4は測定器。 5は出力部。 6は判定部。 2Aはフラットリード。 3Aは第1のコンタクトプローブ。 3Bは第2のコンタクトプローブを示す。 、1ffi[1J11/At里官teuvつ第 1 図 (a) Δ 木金四1−二う一宴胞例一説明図 第2 図
FIG. 1 is a diagram explaining the principle of the present invention. FIG. 2 is an explanatory diagram of an embodiment according to the present invention, in which (a) is a side view of the main part, and (bl) and (b2) are enlarged views of the main part. FIG. 3 is a conventional explanatory diagram, and (a) is a configuration diagram. (b 1) (b 2) shows enlarged views of the main parts. In the figure, l is a printed circuit board. 2 is a semiconductor element. 3 is a probe. 4 is a measuring device. 5 is the output section. 6 is the judgment section. 2A is a flat lead. 3A is the first contact probe. 3B indicates a second contact probe. , 1ffi [1J11/At Rikan teuvtsu Fig. 1 (a) Δ Mokukin 41-2 U1 banquet example 1 explanatory diagram Fig. 2

Claims (1)

【特許請求の範囲】 プリント基板(1)に実装された半導体素子(2)のそ
れぞれのフラットリード(2A)に当接されるプローブ
(3)と、該プローブ(3)に接続される測定器(4)
と、所定のテストデータ(TD)を送出する出力部(5
)と、該測定器(4)の測定データ(D)と該テストデ
ータ(TD)とを照合し良否を判定する判定部(6)と
を備え、該半導体素子(2)の試験を行うプリント板試
験装置であって、 前記プローブ(3)には所定の幅(B1)の第1のコン
タクトプローブ(3A)と、該幅(B1)より小さい幅
(B2)の第2のコンタクトプローブ(3B)とが混在
されて成ることを特徴とするプリント板試験装置。
[Claims] A probe (3) that comes into contact with each flat lead (2A) of a semiconductor element (2) mounted on a printed circuit board (1), and a measuring instrument connected to the probe (3). (4)
and an output section (5) that sends out predetermined test data (TD).
) and a determination unit (6) that compares the measurement data (D) of the measuring device (4) with the test data (TD) to determine pass/fail, and tests the semiconductor element (2). The probe (3) includes a first contact probe (3A) having a predetermined width (B1) and a second contact probe (3B) having a width (B2) smaller than the width (B1). ).
JP11644486A 1986-05-20 1986-05-20 Testing device for printed board Pending JPS62272167A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6384426B1 (en) * 1997-10-09 2002-05-07 Micron Technology, Inc. System for testing semiconductor chip leads constrained in dielectric media

Cited By (1)

* Cited by examiner, † Cited by third party
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US6384426B1 (en) * 1997-10-09 2002-05-07 Micron Technology, Inc. System for testing semiconductor chip leads constrained in dielectric media

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