JPS6223396A - Stepping motor control circuit - Google Patents
Stepping motor control circuitInfo
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- JPS6223396A JPS6223396A JP16085985A JP16085985A JPS6223396A JP S6223396 A JPS6223396 A JP S6223396A JP 16085985 A JP16085985 A JP 16085985A JP 16085985 A JP16085985 A JP 16085985A JP S6223396 A JPS6223396 A JP S6223396A
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P8/00—Arrangements for controlling dynamo-electric motors rotating step by step
- H02P8/14—Arrangements for controlling speed or speed and torque
- H02P8/18—Shaping of pulses, e.g. to reduce torque ripple
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- Power Engineering (AREA)
- Control Of Stepping Motors (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、例えばステッピングモータの回転速度およ
びステップ数の制御を行うステッピングモータ制御回路
に関するものである。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a stepping motor control circuit that controls, for example, the rotational speed and number of steps of a stepping motor.
従来のステッピングモータの制御は、マイクロプロセサ
を用い、例えば第2図のような相出力をソフトウェアで
作成するのが通常行われている。Conventional stepping motors are generally controlled using a microprocessor, and phase outputs as shown in FIG. 2 are created using software, for example.
その手段としては、まずタイマーの値を設定し、最初の
相出力2例えば(φ1.φ2.φ3.φ4)に(1,1
,0,0)を出力させる。次に、タイマーがあふれた時
に相出力φ1〜φ4に(0,1,1,0)を出力させる
。以下同様にして一定時間間隔で次々に相を変化させて
いくものである。To do this, first set the timer value and set the first phase output 2 (φ1.φ2.φ3.φ4) to (1,1
, 0, 0). Next, when the timer overflows, phase outputs φ1 to φ4 are made to output (0, 1, 1, 0). Thereafter, the phases are changed one after another at regular time intervals in the same manner.
ところで、従来のソフトウェアによるステッピングモー
タ制御においては、以上のように行うが、モータ制御以
外の処理を行いながら割シ込みでモータ制御を行うよう
な場合、上記のモータ制御以外の処理の内で、割シ込み
禁止の場所があると割シ込み禁止状態のときにタイマー
があふれた時、割り込み許可になるまでモータ制御の相
出力を変化させることができないので、相の幅が一定に
ならないことがあるなどの問題点があった。By the way, in conventional software-based stepping motor control, it is performed as described above, but when motor control is performed with interrupts while processing other than motor control is being performed, among the above-mentioned processing other than motor control, If there is a place where interrupts are prohibited, if the timer overflows while interrupts are disabled, the motor control phase output cannot be changed until interrupts are enabled, so the phase width may not be constant. There were some problems.
また、従来の制御方法では、相を一回変えるために一回
割り込みがかかるので、モータ制御以外の処理が遅れる
などの問題点があった。In addition, in the conventional control method, since an interrupt is required once to change the phase once, there is a problem that processes other than motor control are delayed.
この発明は、上記のような問題点を解消するためになさ
れたもので、カウンタがあふれない範囲で相の幅を一定
に保つとともに、モータ制御以外の処理に影響を及ぼさ
ないでステッピングモータを制御することができるステ
ッピングモータ制御回路を提供することを目的とする。This invention was made to solve the above-mentioned problems, and it is possible to keep the phase width constant without overflowing the counter, and to control the stepping motor without affecting processes other than motor control. The object of the present invention is to provide a stepping motor control circuit that can perform the following steps.
この発明に係るステッピングモータ制御回路は、ステッ
プの時間を制御するタイマー、このタイマーがらふれた
回数をカウントするカウンタ、上記タイマーのあふれで
出力される相出力に対応した信号を発生する相カウンタ
および該相カウンタより出力される信号を相出力に変換
するデコーダより構成したものである。A stepping motor control circuit according to the present invention includes a timer that controls step time, a counter that counts the number of times this timer oscillates, a phase counter that generates a signal corresponding to the phase output output when the timer overflows, and It consists of a decoder that converts the signal output from the phase counter into a phase output.
この発明においては、タイマーのあふれた回数をカウン
トするカウンタにより、そのカラ/りがおふれるまで割
シ込みで処理するのをなくすとともに、相カウンタとデ
コーダとのハードウェアで相出力を発生することにより
、その相出力に基いてステッピングモータを制御するこ
とができる。In this invention, a counter that counts the number of times the timer overflows eliminates the need to process interrupts until the timer overflows, and a phase output is generated using hardware consisting of a phase counter and a decoder. Therefore, the stepping motor can be controlled based on the phase output.
また、カウンタおよびタイマーのあふれをマイクロプロ
セサで検出し、このマイクロプロセサに対して割シ込み
信号を発生させるととKより、マイクロプロセサからの
柔軟に、カウント数およびタイマーのインターバル時間
などを制御することもできる。In addition, if the microprocessor detects the overflow of the counter and timer and generates an interrupt signal to the microprocessor, the microprocessor can flexibly control the count number, timer interval time, etc. You can also do that.
以下、この発明の実施例を図について説明する。 Embodiments of the present invention will be described below with reference to the drawings.
第1図はこの発明によるステッピングモータ制御回路の
一実施例を示す概略ブロック図である。FIG. 1 is a schematic block diagram showing one embodiment of a stepping motor control circuit according to the present invention.
同図において、100は図示しないマイクロプロセサの
指令によりステップの時間を制御するタイマ+、200
はこのタイマー100からのあふれ信号1を受けてその
あふれた回数をカウントするカウンタ、300は信号6
を入力するとともに上記タイマー100のあふれ信号1
を検知して、制御信号1によりアツブカウントあるいは
ダウンカウントする相カウンタであり、上記制御信号7
は、相カウンタ300のアップカウント、ダウンカウン
トの切換えを行い、ステッピングモータの正転・逆転を
切換えるだめのものである。また、400は相カウンタ
300より出力される信号3を相出力に変換するデコー
ダであシ、このデコーダ400の相出力4に基いてステ
ッピングモータ(図示せず)を制御するものとなってい
る。なお、21はタイマー100のあふれ信号1と制御
信号5との論理積をとるアンドゲート、22はこのアン
ドゲート21の出力と信号6との論理和をとるオアゲー
トである。In the same figure, 100 is a timer+, which controls step time according to instructions from a microprocessor (not shown), and 200
300 is a counter that receives overflow signal 1 from timer 100 and counts the number of overflows; 300 is signal 6;
At the same time, the overflow signal 1 of the timer 100 is input.
This is a phase counter that detects and counts up or down according to the control signal 1, and the control signal 7
is used to switch the phase counter 300 between up-counting and down-counting, and to switch the stepping motor between forward and reverse rotation. Further, 400 is a decoder that converts the signal 3 outputted from the phase counter 300 into a phase output, and based on the phase output 4 of this decoder 400, a stepping motor (not shown) is controlled. Note that 21 is an AND gate that ANDs the overflow signal 1 of the timer 100 and the control signal 5, and 22 is an OR gate that ORs the output of the AND gate 21 and the signal 6.
次に、上記実施例構成の動作について説明する。Next, the operation of the configuration of the above embodiment will be explained.
タイマー100においてあふれ信号1を発生すると、こ
のあふれ信号1によりカウンタ200はカウントすると
ともに、相カウンタ300もカウント動作する。このと
き、タイマー100からのあふれ信号1をマイクロプロ
セサの割り込み部9に入れることにより、このマイクロ
プロセサでタイマー100のインターバルなどの値を書
き変えることもできる。When the overflow signal 1 is generated in the timer 100, the counter 200 counts based on the overflow signal 1, and the phase counter 300 also performs a counting operation. At this time, by inputting the overflow signal 1 from the timer 100 to the interrupt section 9 of the microprocessor, the values such as the interval of the timer 100 can be rewritten by this microprocessor.
また、上記信号1は制御信号5によってアンドゲート2
1の入力条件を不一致とし相カウンタ300に入らない
ようにすることが可能で、これにより相を変化させない
でおくことができる。Furthermore, the signal 1 is input to the AND gate 2 by the control signal 5.
It is possible to set the input condition of 1 to be a mismatch so that it does not enter the phase counter 300, and thereby the phase can be left unchanged.
一方、信号6は、タイマー100のあふれ信号1の有無
にかかわらず、相カウンタ300をカウントさせるため
の信号である。これによ)、タイマー100およびカウ
ンタ200の動作に関係なく相を変化させることも可能
でおる。よって、カウンタ200に相を変化させるべく
回数をセットしておけば、このカウンタ200は、タイ
マー100からのあふれ信号1をカウントし、目的の回
数をカウントすると、信号2を出力する。この信号2に
より符号10で示す割シ込みを発生させたうえ、次の制
御などの設定等を行うことができる。また、上記信号2
によυ制御信号5をクリアすると、相の状態を次に動作
させるまで保持することになる。そして、相カウンタ3
00からの出力の信号3をデコーダ400で相出力4に
変換することにより、との相出力4に基いてステッピン
グモータを制御することができる。このとき、制御信号
Tは相カウンタ300のアップカウント、ダウンカウン
トの切換えを行うもので、その制御信号7に厄じてステ
ッピングモータの正転・逆転を切換え制御できる。On the other hand, signal 6 is a signal for causing phase counter 300 to count regardless of the presence or absence of overflow signal 1 of timer 100. This makes it possible to change the phase regardless of the operation of the timer 100 and counter 200. Therefore, if the number of times to change the phase is set in the counter 200, the counter 200 will count the overflow signal 1 from the timer 100, and will output the signal 2 when it has counted the desired number of times. This signal 2 generates an interrupt indicated by reference numeral 10, and also allows setting of the next control and the like. In addition, the above signal 2
When the υ control signal 5 is cleared, the state of the phase is held until the next operation. And phase counter 3
By converting the output signal 3 from 00 into phase output 4 by the decoder 400, the stepping motor can be controlled based on the phase output 4 from . At this time, the control signal T switches the phase counter 300 between up-counting and down-counting, and depending on the control signal 7, the stepping motor can be switched between forward and reverse rotation.
また、制御信号8は、デコーダ400のデコード方法を
切換えるためのもので、ステッピングモータの例えば2
相励磁・1−2相励磁の切換えを行うことができる。Further, the control signal 8 is for switching the decoding method of the decoder 400, and is used for switching the decoding method of the stepping motor, for example.
It is possible to switch between phase excitation and 1-2 phase excitation.
このように本発明のステッピングモータ制御回路は、専
用のカウンタ200.相カウンタ300およびデコーダ
400を設け、これらハードウェア構成で相出力を発生
させるようにしたので、ソフトウェアで相出力を作るこ
とがなくなシ、第2図のような相出力φl〜φ4を容易
に作ることができる。In this way, the stepping motor control circuit of the present invention uses a dedicated counter 200. Since the phase counter 300 and decoder 400 are provided and the phase outputs are generated using these hardware configurations, there is no need to create phase outputs using software, and the phase outputs φl to φ4 as shown in FIG. 2 can be easily generated. can be made.
しかも、ステッピングモータのソフトウェアでの制御を
軽減することもできる。なお、第2図中。Moreover, the software control of the stepping motor can be reduced. In addition, in Figure 2.
符号11はタイマー割シ込みが入る間隔を示す。Reference numeral 11 indicates the interval at which a timer interrupt occurs.
以上のようにこの発明によれば、専用のカウンタ、相カ
ウンタおよびデコーダからなるハードウェアで相出力を
制御するので、相の幅を一定に保つことができ、また、
ステッピングモータ制御以外の処理に影響を及ぼすこと
がない等の効果がある0As described above, according to the present invention, since the phase output is controlled by hardware consisting of a dedicated counter, a phase counter, and a decoder, the phase width can be kept constant, and
0 has the effect of not affecting processes other than stepping motor control.
第1図はこの発明の一実施例によるステッピングモータ
制御回路の概略ブロック図、第2図は4相出力の2相励
磁の相出力図である。
100・・拳拳タイマー、200昏・・・カウンタ30
0・崇・・相カウンタ、400−・・・デコーダ。FIG. 1 is a schematic block diagram of a stepping motor control circuit according to an embodiment of the present invention, and FIG. 2 is a phase output diagram of two-phase excitation with four-phase output. 100...Kenken timer, 200 Kou...Counter 30
0--Phase counter, 400--Decoder.
Claims (2)
制御回路において、ステツプの時間を制御するタイマー
、このタイマーがあふれた回数をカウントするカウンタ
、上記タイマーのあふれで出力される相出力に対応した
信号を発生する相カウンタおよび該相カウンタより出力
される信号を相出力に変換するデコーダより構成したこ
とを特徴とするステツピングモータ制御回路。(1) In a stepping motor control circuit using a microprocessor, a timer that controls the step time, a counter that counts the number of times this timer overflows, and a signal that corresponds to the phase output output when the timer overflows are generated. What is claimed is: 1. A stepping motor control circuit comprising: a phase counter that converts signals output from the phase counter; and a decoder that converts signals output from the phase counter into phase outputs.
ロセサで検出し、このマイクロプロセサで上記カウンタ
のカウント数および上記タイマーのインターバル時間を
可変にすることを特徴とする特許請求の範囲第1項記載
のステツピングモータ制御回路。(2) Stepping according to claim 1, characterized in that an overflow of a counter and a timer is detected by a microprocessor, and the microprocessor changes the count number of the counter and the interval time of the timer. Motor control circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16085985A JPS6223396A (en) | 1985-07-19 | 1985-07-19 | Stepping motor control circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16085985A JPS6223396A (en) | 1985-07-19 | 1985-07-19 | Stepping motor control circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6223396A true JPS6223396A (en) | 1987-01-31 |
Family
ID=15723921
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16085985A Pending JPS6223396A (en) | 1985-07-19 | 1985-07-19 | Stepping motor control circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6223396A (en) |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5534830A (en) * | 1978-08-31 | 1980-03-11 | Fuji Photo Film Co Ltd | Speed regulating circuit of step motor |
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JPS5725194A (en) * | 1980-07-17 | 1982-02-09 | Toshiba Corp | Driving device for pulse-motor |
JPS57132797A (en) * | 1981-02-10 | 1982-08-17 | Oki Electric Ind Co Ltd | Speed controlling method for pulse motor |
-
1985
- 1985-07-19 JP JP16085985A patent/JPS6223396A/en active Pending
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