JPS62186527U - - Google Patents

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JPS62186527U
JPS62186527U JP7378686U JP7378686U JPS62186527U JP S62186527 U JPS62186527 U JP S62186527U JP 7378686 U JP7378686 U JP 7378686U JP 7378686 U JP7378686 U JP 7378686U JP S62186527 U JPS62186527 U JP S62186527U
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JP
Japan
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output
output signal
monostable multivibrator
flop
type flip
Prior art date
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Application number
JP7378686U
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  • Manipulation Of Pulses (AREA)

Description

【図面の簡単な説明】
第１図は本考案による単安定マルチバイブレー
タのブロツク図、第２図は第１図の回路の動作説
明図、第３図は本考案の他の実施例ほよる単安定
マルチバイブレータのブロツク図、第４図は本考
案のさらに他の実施例による単安定マルチバイブ
レータのブロツク図、第５図は本考案のさらに他
の実施例による単安定マルチバイブレータのブロ
ツク図、第６図は第５図の回路の動作説明図、第
７図は従来の単安定マルチバイブレータのブロツ
ク図である。 １：Ｄ形フリツプフロツプ、３：排他的論理和
回路、５，７，２，４，６，８，３１：遅延素子
。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) Ｄ形フリツプフロツプの出力信号および出
    力信号を遅延した遅延信号を排他的論理和回路で
    受信すると共に、前記遅延信号を前記Ｄ形フリツ
    プフロツプのＤ端子に帰還し前記排他的論理和回
    路の出力端子より出力信号を得るようにした単安
    定マルチバイブレータ。 (2) 前記出力信号は前記Ｄ形フリツプフロツプ
    の出力である実用新案登録請求の範囲第１項記
    載の単安定マルチバイブレータ。 (3) 前記出力信号は一方がＱ出力であり、他方
    が出力である実用新案登録請求の範囲第１項記
    載の単安定マルチバイブレータ。
JP7378686U 1986-05-16 1986-05-16 Pending JPS62186527U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP7378686U JPS62186527U (ja) 1986-05-16 1986-05-16

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Application Number Priority Date Filing Date Title
JP7378686U JPS62186527U (ja) 1986-05-16 1986-05-16

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Publication Number Publication Date
JPS62186527U true JPS62186527U (ja) 1987-11-27

Family

ID=30918424

Family Applications (1)

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JP7378686U Pending JPS62186527U (ja) 1986-05-16 1986-05-16

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JP (1) JPS62186527U (ja)

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