JPS62177147U - - Google Patents

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JPS62177147U
JPS62177147U JP1986063329U JP6332986U JPS62177147U JP S62177147 U JPS62177147 U JP S62177147U JP 1986063329 U JP1986063329 U JP 1986063329U JP 6332986 U JP6332986 U JP 6332986U JP S62177147 U JPS62177147 U JP S62177147U
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JP
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circuit
signal
demodulator
input
modulator
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Landscapes

  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例の回路ブロツク図、
第2図はその各部の信号波形である。 1,2……増幅器、3……差分回路、4……変
調器、5……M系列符号発生器、6……クロツク
発振器、7……AND回路、8……低域通過フイ
ルタ、9……累算回路、10……結合回路、31
……遅延回路、32……加算回路、91,93…
…ラツチ回路、92……EX―OR回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 情報信号を電灯線を介してスペクトラム拡散伝
    送を行なう方式の変復調器において、 復調部には、変復調器に備えたM系列符号発生
    器の符号周期にひとしい最小ビツトを有する情報
    信号が拡散変調信号として、電灯線から結合回路
    を経て入力し、前記復調部は、入力拡散変調信号
    を前記符号周期だけ遅延した信号と、現入力拡散
    変調信号とをEX―OR回路で加算する差分回路
    と、該差分回路の出力を低域通過フイルタを経て
    入力し、EX―OR回路で累算を行ない、受信信
    号として出力する累算回路とを有し、該累算回路
    におけるEX―OR回路の入力信号と累算信号と
    は、前記符号周期の特定の一時点において符号周
    期ごとに発生させたパルスによつてラツチされ、
    累算されることを特徴とする変復調器。
JP1986063329U 1986-04-28 1986-04-28 Pending JPS62177147U (ja)

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JPS62177147U true JPS62177147U (ja) 1987-11-10

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ID=30898450

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