JPS62158937U - - Google Patents

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JPS62158937U
JPS62158937U JP4543886U JP4543886U JPS62158937U JP S62158937 U JPS62158937 U JP S62158937U JP 4543886 U JP4543886 U JP 4543886U JP 4543886 U JP4543886 U JP 4543886U JP S62158937 U JPS62158937 U JP S62158937U
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JP
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circuit
oscillation
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output signal
oscillation circuit
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図は本考案による発振回路の一実施例を示
すブロツク図、第２図はそのｎ段縦続接続構成の
発振回路のブロツク図、第３図はＰＬＬ回路の基
本構成を示すブロツク図、第４図及び第５図は従
来のＰＬＬ回路の縦続接続からなる発振回路のブ
ロツク図である。 １，１１，１２，１６，１ｍ……位相比較回路
、２，２１，２２，２ｍ……ローパスフイルタ、
３，３１，３２，３ｍ……ＶＣＯ、４，５，４１
，４２，４３，４４，４６，４ｍ，５１，５２，
５６，５ｍ……分周回路、６，６１，６２，６３
，６４，６５，６６，６ｍ……ＰＬＬ回路（発振
回路）、７……基準信号発振回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 分周回路の出力信号及び基準信号との位相比較
    出力信号に基づいて、出力信号の周波数を制御す
    るようになされた複数の発振回路と南 原基準信号を発振する基準信号発振回路と を具え、上記発振回路の出力信号を他の上記発振
    回路の基準信号として出力すると共に上記基準信
    号を出力した上記発振回路の分周回路に、上記基
    準信号を受けた上記発振回路の分周回路の出力信
    号を受けるように上記複数の発振回路を縦続接続
    し、当該縦続接続された発振回路の一端の発振回
    路の基準信号として上記原基準信号を入力し、他
    端の発振回路の出力信号を上記各発振回路の分周
    回路に帰還するようにしたことを特徴とする発振
    回路。
JP1986045438U 1986-03-27 1986-03-27 Expired - Lifetime JPH0528830Y2 (ja)

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JPS62158937U true JPS62158937U (ja) 1987-10-08
JPH0528830Y2 JPH0528830Y2 (ja) 1993-07-23

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008099097A (ja) * 2006-10-13 2008-04-24 Mitsubishi Electric Corp クロック位相シフト装置

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Publication number Publication date
JPH0528830Y2 (ja) 1993-07-23

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