JPS62121648U - - Google Patents

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JPS62121648U
JPS62121648U JP19617686U JP19617686U JPS62121648U JP S62121648 U JPS62121648 U JP S62121648U JP 19617686 U JP19617686 U JP 19617686U JP 19617686 U JP19617686 U JP 19617686U JP S62121648 U JPS62121648 U JP S62121648U
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JP
Japan
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microinstruction
microprogram
retry
address
timing specified
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【図面の簡単な説明】
第1図は本考案にかかるチエツクポイント・セ
ーブ方式の構成回路例を示す図、第2図はそのマ
イクロプログラムの処理フローを示す説明図であ
る。 図中、1はコントロールストレツジ、2はアド
レスレジスタ、3はセーブレジスタ、4,5は制
御ゲート、6はエラー検出回路、7はCSアドレ
ス制御回路、8はフラグレジスタである。

Claims (1)

    【実用新案登録請求の範囲】
  1. マイクロプログラムの制御システムにおいて、
    マイクロ命令により指定されたタイミングでその
    マイクロ命令が格納されているコントロールスト
    レツジのアドレスをセーブする手段と、マイクロ
    命令により指定されたタイミングでシステム制御
    ルーチンが再試行可能か否かのフラグをセツトす
    る手段と、ハードエラーの発生時に上記フラグの
    状態に応じて再試行可能と判定されたとき上記セ
    ーブされているコントロールストレツジのアドレ
    スからマイクロプログラムの再試行を開始する手
    段とを備えたことを特徴とするチエツクポイント
    ・セーブ回路。
JP19617686U 1986-12-18 1986-12-18 Pending JPS62121648U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP19617686U JPS62121648U (ja) 1986-12-18 1986-12-18

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Application Number Priority Date Filing Date Title
JP19617686U JPS62121648U (ja) 1986-12-18 1986-12-18

Publications (1)

Publication Number Publication Date
JPS62121648U true JPS62121648U (ja) 1987-08-01

Family

ID=31154755

Family Applications (1)

Application Number Title Priority Date Filing Date
JP19617686U Pending JPS62121648U (ja) 1986-12-18 1986-12-18

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JP (1) JPS62121648U (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5178149A (ja) * 1974-12-28 1976-07-07 Mitsubishi Electric Corp

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5178149A (ja) * 1974-12-28 1976-07-07 Mitsubishi Electric Corp

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