JPS6177089A - Display control system - Google Patents
Display control systemInfo
- Publication number
- JPS6177089A JPS6177089A JP59200071A JP20007184A JPS6177089A JP S6177089 A JPS6177089 A JP S6177089A JP 59200071 A JP59200071 A JP 59200071A JP 20007184 A JP20007184 A JP 20007184A JP S6177089 A JPS6177089 A JP S6177089A
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- JP
- Japan
- Prior art keywords
- register
- screen
- contents
- display control
- display
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】 本発明は、スクロールの表示制御方式に関する。[Detailed description of the invention] The present invention relates to a scroll display control method.
従来表示すべき情報を記憶しているメモリMEMの内容
をCRTで表示しているとき、CRTの画面上の情報を
左右方向にスムーズスクロール(1ドツト単位)する場
合、以下のように行なう。コントローラ(不図示)より
メモリMEMの表示開始アドレスを指定し、その内容を
メモリMEMより読み出してレジスタρiSOヘロード
する。レジスタPiSOに記憶された内容はシリアルシ
フトでレジスタPiSOに記憶される。Conventionally, when the contents of a memory MEM that stores information to be displayed are displayed on a CRT, the information on the screen of the CRT can be smoothly scrolled in the horizontal direction (in units of one dot) as follows. A controller (not shown) specifies the display start address of the memory MEM, and its contents are read from the memory MEM and loaded into the register ρiSO. The contents stored in register PiSO are stored in register PiSO by serial shifting.
レジスタ5iPOの内容はパラレルにセレクタSELに
入る。セレクタSELはレジスタREGの内容に従って
レジスタ5iPOの内容の1つをCRTに送る。The contents of register 5iPO are input to selector SEL in parallel. Selector SEL sends one of the contents of register 5iPO to the CRT according to the contents of register REG.
メモリMEMのデータ(並列)をレジスタPiSOで直
列に変更し、セレクタSELでレジスタ5iPOの内容
を先頭から順にCRTに転送するとメモリMEMの内容
はCRT上で表示される。しかし、セレクタSELでC
RTに送る制御を例えば左ヘシフトしたい量(ドツト単
位)だけ後のデータよりCRTに転送することで画面は
左ヘシフトされる。The data (parallel) in the memory MEM is changed to serial data using the register PiSO, and the contents of the register 5iPO are sequentially transferred from the beginning to the CRT using the selector SEL, so that the contents of the memory MEM are displayed on the CRT. However, with selector SEL
The screen is shifted to the left by transmitting the control sent to the RT to the CRT, for example, by the desired amount (in dot units) of data that is later than the data to be shifted to the left.
従来この種の表示装置はCRTコントローラの表示開始
アドレスを指定すると共にシリアルパラレル変換のレジ
スタ5iPOとデータセレクタSELよりなるビット単
位スムーズスクロール回路のスクロール値SDを指定す
ることにより縦横両方向のビット単位のスムーズスクロ
ールが可能なように構成されていたので、全画面同時に
スフミールされ表示画面を分割し分割画面毎のスクロー
ルを行なうことは出来なかった。Conventionally, this type of display device can achieve bit-by-bit smoothness in both the vertical and horizontal directions by specifying the display start address of the CRT controller and the scroll value SD of the bit-by-bit smooth scroll circuit consisting of the serial-parallel conversion register 5iPO and the data selector SEL. Since it was configured to allow scrolling, it was not possible to divide the display screen and scroll each divided screen because the entire screen was displayed simultaneously.
本発明は、画面分割した画面毎に独立にスクロール値を
指定し、独立にスクロールを行うことが可能となる表示
制御方式を提供するものである。The present invention provides a display control method that makes it possible to independently specify a scroll value for each divided screen and to perform scrolling independently.
第3図は本発明による一実施例を説明するブロック図で
ある。同図に於いて第1図と同じものには同符号を付す
。FIG. 3 is a block diagram illustrating an embodiment according to the present invention. In this figure, the same parts as in FIG. 1 are given the same reference numerals.
本実施例では画面を第2図に示す如く2分割し、おのお
のを独立的にスクロールさせる例で説明する。In this embodiment, an example will be explained in which the screen is divided into two parts as shown in FIG. 2, and each part is scrolled independently.
REG lは分割する位置を指定するレジスタで、RE
G2 、REG3は各分割画面のスクロール値を格納す
るレジスタである。REG l is a register that specifies the dividing position, and RE
G2 and REG3 are registers that store scroll values for each divided screen.
C0tlNTは分割値をカウントするカウンタで、レジ
スタREG 1の内容をVSYNC:毎にロードし、H
SYNCC行)の数をカウントする゛、カウンタの値が
(COUNT= O)になったら、フリップフロップF
Fをセットする。FF=1にてレジスタREG2 。C0tlNT is a counter that counts the division value, loads the contents of register REG 1 every VSYNC:, and
SYNCC line). When the counter value reaches (COUNT=O), the flip-flop F
Set F. Register REG2 when FF=1.
3を切り換える。フリップフロップFFはVSYNCに
てクリアされ、初期化される。Switch 3. The flip-flop FF is cleared and initialized by VSYNC.
SELはセレクタで、フリップフロップFFの信号でR
EG lかREG2を出力する。SEL is a selector, and R is the signal of flip-flop FF.
Outputs EG1 or REG2.
上述の構成から成る実施例の作動を説明する。The operation of the embodiment configured as described above will be explained.
レジスタREGIの内容は画面の上部よりXライン目に
て分割する場合、Xの値を入れる。The contents of the register REGI contain the value of X when the screen is divided at the X-th line from the top.
各レジスタの設定は全体を制御するコントローラの指示
により指定される。The settings of each register are specified by instructions from a controller that controls the entire system.
データバスDATA Busを介して分割値をレジスタ
REG 1に例えばカーソル(カーソルカウンタ)によ
って定めた位置をレジスタREGIに入れる。The divided value is input to the register REG 1 via the data bus DATA Bus, and the position determined by, for example, a cursor (cursor counter) is input to the register REGI.
レジスタREG 1 、REG2はキーボード上のスク
ロールキーによってレジスタに入れる。Registers REG 1 and REG2 are entered into the registers by using the scroll keys on the keyboard.
レジスタREG lはVSYNC毎に分割値例えばXが
ロードされ、HSYNCによりカウントグランされる。The register REG1 is loaded with a division value, for example, X every VSYNC, and is counted and grounded by HSYNC.
その間フリップフロップFFはリセット状態にあるので
、レジスタREG2の内容S D カセレクタ5ELL
に印加され、レジスタREG2により画面1がスクロー
ルされる。During that time, flip-flop FF is in the reset state, so the contents of register REG2 are
is applied to the screen 1, and the screen 1 is scrolled by the register REG2.
一方カウンタがXつまり0になったとき、キャリーCA
が出力され、フリップフロップFFがセットされる。On the other hand, when the counter reaches X, that is, 0, carry CA
is output, and the flip-flop FF is set.
従ってセレクタSELはレジスタREG2からREG
3に切り換わり、今度はレジスタREG3によるスクロ
ールつまり画面2がスクロールされる。Therefore, selector SEL selects registers REG2 to REG.
3, and this time the register REG3 scrolls, that is, the screen 2 is scrolled.
本発明では2分割であるが、カウンタおよび分割毎のス
クロール値(REG2.3)をN個使用する事によりN
分割に対応する事は容易である。In the present invention, it is divided into two, but by using N counters and scroll values (REG2.3) for each division, N
It is easy to deal with division.
表示画面を分割しその一つをメニュー(コマンド)画面
とし他の画面を普通表示画面とし表示内容だけのスクロ
ールがソフトからの指示のみで行う事が出来、スムーズ
なスクロール機能を実現出来る。従来例ではソフトにて
表示MEMのデータを移動しなければ実現する事が不可
能で処理スピードの向上がはかれる。The display screen is divided, one screen is set as a menu (command) screen, the other screen is set as a normal display screen, and only the display contents can be scrolled by instructions from the software, thereby achieving a smooth scrolling function. In the conventional example, this cannot be achieved without moving the display MEM data using software, and the processing speed can be improved.
第1図は従来の表示制御ブロック図。 第2図は分割画面を説明する図、 第3図は本発明によるブロック図。 RE G 1−−−−−レジスタ RE G 2−=−レジスタ RE G 3−−−一−レジスタ C0UNT−−−カウンタ SEL −−−−−セレクタ 第3円 FIG. 1 is a conventional display control block diagram. Figure 2 is a diagram explaining the split screen, FIG. 3 is a block diagram according to the present invention. RE G 1------Register RE G 2-=-register RE G 3---1-Register COUNT---Counter SEL ----- Selector 3rd yen
Claims (1)
割画面毎にスクロール値を記憶する手段を有する表示制
御方式。A display control method, in a display device capable of dividing a display screen, that has means for storing a scroll value for each divided screen.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59200071A JPS6177089A (en) | 1984-09-25 | 1984-09-25 | Display control system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59200071A JPS6177089A (en) | 1984-09-25 | 1984-09-25 | Display control system |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6177089A true JPS6177089A (en) | 1986-04-19 |
Family
ID=16418359
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59200071A Pending JPS6177089A (en) | 1984-09-25 | 1984-09-25 | Display control system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6177089A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61241790A (en) * | 1985-04-19 | 1986-10-28 | 日本電気株式会社 | Display unit |
-
1984
- 1984-09-25 JP JP59200071A patent/JPS6177089A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61241790A (en) * | 1985-04-19 | 1986-10-28 | 日本電気株式会社 | Display unit |
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