JPS6155224U - - Google Patents

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JPS6155224U
JPS6155224U JP13940384U JP13940384U JPS6155224U JP S6155224 U JPS6155224 U JP S6155224U JP 13940384 U JP13940384 U JP 13940384U JP 13940384 U JP13940384 U JP 13940384U JP S6155224 U JPS6155224 U JP S6155224U
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tape recorder
rotational pulse
cassette
microcomputer
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JP13940384U
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Description

【図面の簡単な説明】
第1図は本考案テープレコーダの一実施例のブ
ロツク系統図、第2図及び第3図は第1図の動作
説明用フローチヤートである。 1…フリツプフロツプ、2…トランジスタ、3
…イジエクト検出回路、4…メモリ、5…リセツ
ト信号発生回路、6…状態検出回路、7…スイツ
チ回路、8…回転パルス発生回路、9…回転パル
スカウンタ、S…カセツトスイツチ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 諸動作をマイクロコンピユータにて制御される
    構成のテープレコーダにおいて、動作中のみ該マ
    イクロコンピユータの制御端子をアースに接続し
    、非動作中は該制御端子の開放にするスイツチ手
    段と、テープレコーダの起動時リールの回転パル
    ス発生回路を動作可能状態にした該回転パルスカ
    ウンタをオンにする一方、停止時該回転パルスカ
    ウンタをオフにした後該回転パルス発生回路を動
    作不可能状態にする手段と、上記マイクロコンピ
    ユータの動作モード、スリープモードに無関係に
    カセツトの有無を検出してこれを記憶する手段と
    、上記テープレコーダの起動により該記憶手段の
    出力を供給されて該カセツトの無の時カウンタメ
    モリ等のメモリ及び該記憶手段を夫々クリアする
    手段とを設けてなるテープレコーダ。
JP13940384U 1984-09-17 1984-09-17 Expired JPH0445136Y2 (ja)

Priority Applications (1)

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JP13940384U JPH0445136Y2 (ja) 1984-09-17 1984-09-17

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Application Number Priority Date Filing Date Title
JP13940384U JPH0445136Y2 (ja) 1984-09-17 1984-09-17

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Publication Number Publication Date
JPS6155224U true JPS6155224U (ja) 1986-04-14
JPH0445136Y2 JPH0445136Y2 (ja) 1992-10-23

Family

ID=30697782

Family Applications (1)

Application Number Title Priority Date Filing Date
JP13940384U Expired JPH0445136Y2 (ja) 1984-09-17 1984-09-17

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JP (1) JPH0445136Y2 (ja)

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Publication number Publication date
JPH0445136Y2 (ja) 1992-10-23

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