JPS6134788Y2 - - Google Patents
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- JPS6134788Y2 JPS6134788Y2 JP7094580U JP7094580U JPS6134788Y2 JP S6134788 Y2 JPS6134788 Y2 JP S6134788Y2 JP 7094580 U JP7094580 U JP 7094580U JP 7094580 U JP7094580 U JP 7094580U JP S6134788 Y2 JPS6134788 Y2 JP S6134788Y2
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Landscapes
- Fax Reproducing Arrangements (AREA)
- Facsimile Image Signal Circuits (AREA)
Description
【考案の詳細な説明】
本考案はフアクシミリ信号再生装置、特に副走
査方向の変化点を中間調で記録する装置に関す
る。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a facsimile signal reproducing device, and particularly to a device for recording change points in the sub-scanning direction in halftones.
従来、フアクシミリ信号の再生速度を高速化す
る為、第4図に示す如く、主走査方向の1ライン
分の画素を同時に再生する装置が開発されてい
る。かかる装置は、主走査方向1ライン分の画素
数に対応した数の記録素子94と、該記録素子9
4と同数のフリツプフロツプ93を具えたシフト
レジスタ92と、各フリツプフロツプ93の出力
側に繋がれて対応する記録素子94に記憶内容を
送るANDゲート95から構成され、クロツク信
号81によりシフトレジスタ92内に主走査方向
1ライン分の画信号82を記憶させた後、AND
ゲート95の一方の入力端子に制御信号96を印
加することにより、1度に主走査1ライン分ずつ
画像再生可能としている。 Conventionally, in order to increase the reproduction speed of facsimile signals, an apparatus has been developed that simultaneously reproduces one line of pixels in the main scanning direction, as shown in FIG. Such a device includes a number of recording elements 94 corresponding to the number of pixels for one line in the main scanning direction;
It consists of a shift register 92 with the same number of flip-flops 93 as 4, and an AND gate 95 connected to the output side of each flip-flop 93 to send the stored contents to the corresponding recording element 94. After storing the image signal 82 for one line in the main scanning direction, AND
By applying a control signal 96 to one input terminal of the gate 95, images can be reproduced one main scanning line at a time.
ところが上記装置に於いて、受信した画信号8
2中に、第3図dの3の如くジツタが発生した
場合、該ジツタは第3図fの3の様にそのまま
再生され、再生画像の画質は著しく損なわれる問
題があつた。 However, in the above device, the received image signal 8
When a jitter occurs in 2, as shown in 3 in FIG. 3d, the jitter is reproduced as is, as shown in 3 in FIG. 3f, and the quality of the reproduced image is significantly impaired.
本考案は、再生画像は副走査方向に相関関係が
あること及び再生画像の変化点を中間調で再生し
た場合、例えば再生画像が文字情報の場合、了解
度が15乃至20%も上昇することを利用したもので
あつて、少なくとも副走査方向2ライン分を同時
に記憶する記憶部を具え、隣接ラインの各画素中
に於ける画信号の有無を検出して、両ライン共に
画信号がある場合は黒色で、又どちらか一方だけ
に画信号がある場合は中間調で再生することによ
り、再生画像の鮮明度を高めることが出来るフア
クシミリ信号再生装置を提供するものである。 The present invention is based on the fact that the reproduced image has a correlation in the sub-scanning direction, and that when the changing points of the reproduced image are reproduced in halftones, for example, when the reproduced image is text information, the intelligibility increases by 15 to 20%. is equipped with a storage unit that simultaneously stores at least two lines in the sub-scanning direction, detects the presence or absence of an image signal in each pixel of an adjacent line, and when there is an image signal on both lines. The object of the present invention is to provide a facsimile signal reproducing device that can improve the clarity of the reproduced image by reproducing the image signal in black, or in halftone if there is an image signal in only one of them.
以下図面に示す実施例に基づき、本考案を具体
的に説明する。 The present invention will be specifically described below based on embodiments shown in the drawings.
本考案にかかるフアクシミリ信号再生装置は、
第1図及び第2図に示す如く、サンプリング回路
1に於いて、受信した画信号80をクロツク信号
81でサンプリングして量子化した後、主走査1
ライン毎に、ゲート回路2により該量子化画信号
82を記憶するシフトレジスタ3,3aを変更す
る。 The facsimile signal reproducing device according to the present invention includes:
As shown in FIGS. 1 and 2, in the sampling circuit 1, the received image signal 80 is sampled and quantized using the clock signal 81, and then the main scanning signal 80 is quantized.
The shift registers 3 and 3a that store the quantized image signal 82 are changed for each line by the gate circuit 2.
ゲート回路2は、4組のANDゲート21,2
2,23,24から構成され、第1及び第2AND
ゲート21,22の一方の入力端に、サンプリン
グ回路1の出力信号82を入力し、他方の入力端
には、切換信号発生回路6から出力される切換信
号83,84を入力する。切換信号発生回路6
は、位相信号85が1回入力される毎に両出力端
に交互に信号が出力されるものであり、従つて1
回の主走査毎に、画信号82は第1又は第2AND
ゲート21,22の何れか一方から交互に出力さ
れる。前記切換信号83,84は、同時に第3及
び第4ゲート23,24にも夫々入力され、他端
に入力したクロツク信号81を両ゲート23,2
4から1走査ライン毎に交互に出力させる。 The gate circuit 2 includes four sets of AND gates 21, 2
Consisting of 2, 23, 24, 1st and 2nd AND
The output signal 82 of the sampling circuit 1 is input to one input terminal of the gates 21 and 22, and the switching signals 83 and 84 output from the switching signal generation circuit 6 are input to the other input terminal. Switching signal generation circuit 6
is one in which signals are output alternately to both output terminals each time the phase signal 85 is inputted once, and therefore 1
For each main scan, the image signal 82 is the first or second AND
The signals are output alternately from either gate 21 or 22. The switching signals 83 and 84 are simultaneously input to the third and fourth gates 23 and 24, respectively, and the clock signal 81 input to the other end is input to both gates 23 and 2.
4 to 1 scanning line alternately.
前記画信号82を記憶するシフトレジスタは2
組あつて、各レジスタ3,3aは、主走査方向の
再生画素数nに一致する数のフリツプフロツプ3
1から構成される。 The number of shift registers storing the image signal 82 is 2.
Each register 3, 3a has a number of flip-flops 3 corresponding to the number n of reproduced pixels in the main scanning direction.
Consists of 1.
第1シフトレジスタ3には、第1ANDゲート2
1から出力される画信号及び第3ANDゲート23
からのクロツク信号を入力し、第2シフトレジス
タ3aには、第2ゲート22から出力される画信
号及び第4ゲート24から出力されるクロツク信
号を夫々入力することにより、1ライン毎に、画
信号を第1及び第2シフトレジスタ3,3a内へ
交互に切り換えて記憶させている。第1及び第2
シフトレジスタ3,3a内の同一番地のフリツプ
フロツプ31,31からの出力は、同時に制御回
路4に印加され、有意信号の有無に応じて、記録
素子5に長短2種類の制御信号86,87を印加
可能としている。 The first shift register 3 includes a first AND gate 2
1 and the third AND gate 23
The image signal output from the second gate 22 and the clock signal output from the fourth gate 24 are respectively input to the second shift register 3a. The signals are alternately switched and stored in the first and second shift registers 3, 3a. 1st and 2nd
The outputs from the flip-flops 31 and 31 at the same location in the shift registers 3 and 3a are simultaneously applied to the control circuit 4, and two types of control signals 86 and 87, long and short, are applied to the recording element 5 depending on the presence or absence of a significant signal. It is possible.
各制御回路4は全て同一の構成であつて、第2
図の如く、第1シフトレジスタ3及び第2シフト
レジスタ3aから夫々出力された画信号は、入力
側を並列接続したANDゲート41及びイクスク
ルーシブORゲート42に入力し、従つて両レジ
スタ3,3a内の同一ビツトに共に信号が記憶さ
れている場合はANDゲート41から信号が出力
され、一方にだけ入力があるとイクスクルーシブ
ORゲート42から信号が出る。更にANDゲート
41からの出力信号は、記録素子5の黒色再生に
対応するパルス巾の長パルス信号86と共に
ANDゲート43に印加し、イクスクルーシブOR
ゲート42の出力は、記録素子5の中間調再生に
対応するパルス巾の短パルス信号87と共に
ANDゲート44に印加する。両ANDゲート4
3,44の出力は、更ORゲート45に加え、該
ORゲート45の出力側に記録素子5を繋ぐこと
により、位相期間中に記録素子5へ長短何れか一
方のパルス86,87を印加して黒ばかりでな
く、半黒状態も再生可能としている。 Each control circuit 4 has the same configuration, and the second
As shown in the figure, the image signals output from the first shift register 3 and the second shift register 3a are input to an AND gate 41 and an exclusive OR gate 42 whose input sides are connected in parallel. If both signals are stored in the same bit in 3a, the signal is output from the AND gate 41, and if only one is input, it is an exclusive signal.
A signal is output from the OR gate 42. Further, the output signal from the AND gate 41 is combined with a pulse signal 86 having a long pulse width corresponding to black reproduction of the recording element 5.
Apply to AND gate 43, exclusive OR
The output of the gate 42 is combined with a short pulse signal 87 having a pulse width corresponding to halftone reproduction of the recording element 5.
applied to AND gate 44. Both AND gate 4
In addition to the additional OR gate 45, the outputs of 3 and 44 are
By connecting the recording element 5 to the output side of the OR gate 45, one of the long and short pulses 86 and 87 is applied to the recording element 5 during the phase period, thereby making it possible to reproduce not only black but also a half-black state.
然して、送信側に於いて、第3図aの如く、原
稿90を1,2……と順次各ラインを走査し
て行くと、第3図bの様に原稿90の白地及び黒
部分に対応した画信号80が送信される。 However, when the transmitting side sequentially scans each line 1 , 2 , etc. of the original 90 as shown in Fig. 3a, the lines correspond to the white and black parts of the original 90 as shown in Fig. 3b. The image signal 80 is transmitted.
一方受信側では、第3図cの様なクロツク信号
81を用いてサンプリング回路1で画信号を量子
化することにより、第3図dの如く、記録素子5
の数に対応した形状の量子化画信号82を得る。
この画信号82はゲート回路2により、例えば
1の画信号は第1シフトレジスタ3へ、2の画
信号は第2シフトレジスタ3aという様に、記憶
するレジスタを主走査1ライン毎に変更しながら
記憶する。 On the receiving side, on the other hand, by quantizing the image signal in the sampling circuit 1 using the clock signal 81 as shown in FIG. 3c, the recording element 5 as shown in FIG.
A quantized image signal 82 having a shape corresponding to the number of is obtained.
This image signal 82 is processed by the gate circuit 2, for example.
The image signal No. 1 is stored in the first shift register 3, the image signal No. 2 is stored in the second shift register 3a, and so on, while changing the storage register for each main scanning line.
ここで、1及び2の画信号82,82は
h,i,jの3ビツトが「ハイ」状態の同一波形
であるから、h,i,j番目の制御回路4では長
パルス86を記録信号として選び、第3図eの
2の如く、記録素子5は3ビツト分黒色で印字す
る。 Here, since the first and second image signals 82 and 82 have the same waveform with the three bits h, i, and j in the "high" state, the h, i, and jth control circuits 4 use the long pulse 86 as the recording signal. In Fig. 3e,
2 , the recording element 5 prints in black for 3 bits.
次に例えば第3図bの3の如く、伝送路中で
ジツタが発生すると、ゲート回路2を通つて第1
シフトレジスタ3に記憶された画信号82aは、
j,k,番目のビツトにのみ有意信号が存在す
る。2及び3の信号は、制御回路4に於いて
各ビツト毎に比較される。即ちh,i,k及び
ビツトには、2又は3の何れか一方しか有意
信号がないので、制御回路4に於いて短パルス8
7を選んで第3図eの3の如く中間調で表示
し、第jビツトは両ライン共に有意信号があるの
で、黒色で表示する。従つて、従来の装置では、
第3図fの3の如く欠落或いははみ出して再生
されていた部分が中間調で表示され、ジツタ、ノ
イズ或いは量子化誤差等による再生時の欠陥が目
立たなくなるのである。 Next, when jitter occurs in the transmission line, as shown in 3 in FIG.
The image signal 82a stored in the shift register 3 is
Significant signals exist only at the j, k-th bits. The signals No. 2 and No. 3 are compared bit by bit in the control circuit 4. That is, since h, i, k and bits only have a significant signal of either 2 or 3 , the control circuit 4 outputs a short pulse 8.
7 is selected and displayed in an intermediate tone as shown in 3 in FIG. 3e, and the j-th bit is displayed in black since both lines have significant signals. Therefore, in conventional equipment,
As shown in 3 in FIG. 3F, the reproduced portions that are missing or protrude are displayed in halftones, and defects during reproduction due to jitter, noise, quantization errors, etc. become less noticeable.
なお上記実施例では、記録素子5へ信号を印加
する時間を変えて中間調を再生する様にしたが、
記録素子の種類によつては、電圧或は電流値を変
化する等、適宜変更出来る。 In the above embodiment, the time for applying the signal to the recording element 5 is changed to reproduce the halftone.
Depending on the type of recording element, the voltage or current value can be changed as appropriate.
又シフトレジスタ3の数を3以上に増加し、1
ラインのみに有意信号がある場合は第1の階調、
2ラインに信号がある場合は第2の階調という如
く、3以上の階調で再生することも、上記実施例
を拡張して同様に実施出来ることは勿論である。 In addition, the number of shift registers 3 is increased to 3 or more, and 1
If there is a significant signal only on the line, the first gradation,
It goes without saying that the above embodiment can be extended to perform reproduction at three or more gradations, such as a second gradation when there is a signal on two lines.
本考案は上記の如く、1ライン分の画信号を記
憶するシフトレジスタ3を複数組具え、主走査1
回毎に記憶するレジスタ3を変更すると共に、各
レジスタの記憶内容を各ビツト毎に比較し、有意
信号の有無に応じて黒色から白色まで複数階調で
再生する様に構成したので、ジツタ等の影響が軽
減され、再生画像の画質向上が図れる優れた効果
を有する。 As mentioned above, the present invention is equipped with a plurality of shift registers 3 that store image signals for one line, and
In addition to changing the register 3 stored each time, the contents of each register are compared bit by bit and reproduced in multiple gradations from black to white depending on the presence or absence of a significant signal, so jitter, etc. This has an excellent effect of reducing the influence of the image and improving the quality of the reproduced image.
第1図は本考案にかかる装置の概略を示すブロ
ツク図、第2図は第1図に於ける信号選択回路の
詳細を示す電気回路図、第3図a乃至fは送信原
稿の走査から再生までの状況を示す説明図、第4
図は従来例を示すブロツク図である。
2……ゲート回路、3,3a……シフトレジス
タ、4……制御回路、5……記録素子、6……切
換信号発生回路。
Fig. 1 is a block diagram showing an outline of the device according to the present invention, Fig. 2 is an electric circuit diagram showing details of the signal selection circuit in Fig. 1, and Figs. 3 a to f are reproductions from scanning of a transmitted original. Explanatory diagram showing the situation up to 4th
The figure is a block diagram showing a conventional example. 2... Gate circuit, 3, 3a... Shift register, 4... Control circuit, 5... Recording element, 6... Switching signal generation circuit.
Claims (1)
力してデジタル的に記憶した後、各ビツトの記
憶内容を並列的に取り出して、1ライン分の画
信号を同時に再生する装置に於いて、記憶部を
複数組設け、各記憶部の入力側には、記憶部を
主走査1ライン毎に切換えるゲート回路2を具
え、各記憶部の出力側には、各記憶部の同一番
地の記憶内容を比較し有意信号の有無に応じて
印字濃度を決める制御信号を出力する制御部を
設け、更に制御部の出力側には、制御信号の種
類に応じて印字濃度を複数段階に変化出来る記
録素子5を記憶部の各ビツトに対して具えてお
り、前記制御部は同一番地に有意信号を記憶し
ている記憶部が多いときは記録素子5の印字を
濃く、又有意信号を記憶している記憶部が少な
いときは印字を薄くする制御信号を出力するこ
とを特徴とするフアクシミリ信号再生装置。 記憶部は、シフトレジスタである実用新案登
録請求の範囲第1項に記載の再生装置。[Claims for Utility Model Registration] Image signals for one line of main scanning are serially input into a storage unit and stored digitally, and then the stored contents of each bit are retrieved in parallel to generate image signals for one line. In an apparatus for simultaneous reproduction, a plurality of sets of memory sections are provided, and the input side of each memory section is provided with a gate circuit 2 for switching the memory section for each main scanning line, and the output side of each memory section is provided with a gate circuit 2 for switching the memory section for each main scanning line. A control unit is provided that outputs a control signal that compares the memory contents at the same address in the storage unit and determines the print density depending on the presence or absence of a significant signal. A recording element 5 is provided for each bit in the storage section, and the control section prints the recording element 5 darker when there are many storage sections storing significant signals at the same location. Further, a facsimile signal reproducing device is characterized in that when there is a small number of storage units storing significant signals, a control signal is outputted to make printing lighter. The playback device according to claim 1, wherein the storage unit is a shift register.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7094580U JPS6134788Y2 (en) | 1980-05-22 | 1980-05-22 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7094580U JPS6134788Y2 (en) | 1980-05-22 | 1980-05-22 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS56172059U JPS56172059U (en) | 1981-12-18 |
JPS6134788Y2 true JPS6134788Y2 (en) | 1986-10-09 |
Family
ID=29664777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP7094580U Expired JPS6134788Y2 (en) | 1980-05-22 | 1980-05-22 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6134788Y2 (en) |
-
1980
- 1980-05-22 JP JP7094580U patent/JPS6134788Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS56172059U (en) | 1981-12-18 |
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