JPS61275923A - 端末装置とキ−ボ−ドを含むコンピユ−タシステム - Google Patents
端末装置とキ−ボ−ドを含むコンピユ−タシステムInfo
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- JPS61275923A JPS61275923A JP61020036A JP2003686A JPS61275923A JP S61275923 A JPS61275923 A JP S61275923A JP 61020036 A JP61020036 A JP 61020036A JP 2003686 A JP2003686 A JP 2003686A JP S61275923 A JPS61275923 A JP S61275923A
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- keyboard
- signal
- interface
- computer system
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M11/00—Coding in connection with keyboards or like devices, i.e. coding of the position of operated keys
- H03M11/20—Dynamic coding, i.e. by key scanning
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Input From Keyboards Or The Like (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
り糺ＬＬ
この発明はコンピュータシステムにおけるサブシステム
間の通信に関し、特にキーボードと端末装置との間の通
信に関するものである。
間の通信に関し、特にキーボードと端末装置との間の通
信に関するものである。
１１Ｌ
従来のコンピュータシステムは、システムのサブシステ
ム間の通信を可能にするために種々の装置と技術を採用
している。一般に、コンピュータシステムは、中央処理
ユニット、ビデオ表示装置。
ム間の通信を可能にするために種々の装置と技術を採用
している。一般に、コンピュータシステムは、中央処理
ユニット、ビデオ表示装置。
キーボード、および一般に端末装置として言及される他
のユニットなどのサブシステムを含む。
のユニットなどのサブシステムを含む。
第１図に示されているような第１の技術は、キーボード
と端末装置との間でデータを送受信するためにＵＡＲＴ
を用いる。ＵＡＲＴは°゛ユニバーサル非同期レシーバ
とトランスミッタ”の頭文字である。それは、直列デー
タを送受信してそのデータを並列データに変換またはそ
の逆を行なうことができる￥＆置である。キーボードを
端末装置にインターフェイスするために与えられた４つ
のワイヤのワイヤ１と２は、キーボードと端末装置との
間の通信を可能にする。残りの２つの接続は、それぞれ
キーボードと端末装置を電源とアースに接続するために
用いられる。動作において、キーボードマイクロプロセ
ッサはまずキーボードスイッチアレイをスキャンして、
そのアレイのいずれのキーが押し下げられているかを判
断する。一般に、そのとき特定のキーを識別するために
割当てられたコードが、キーボードＵＡＲＴを介してキ
ーボードマイクロプロセッサに伝送される。端末ＵＡＲ
Ｔはこのフードを受取って、それを端末マイクロプロセ
ッサに伝送する。このコードはワイヤ１またはワイヤ２
のようなデータリンクの１つを介して伝送される。次に
、端末マイクロプロセッサはこの情報をストアするか、
またはそれをその端末に接続された他の装置に再伝送す
る。ＭａＣｙは米国特許第４．３４６．３６９号におい
てこの第１の技術のいくつかの態様を開示している。
と端末装置との間でデータを送受信するためにＵＡＲＴ
を用いる。ＵＡＲＴは°゛ユニバーサル非同期レシーバ
とトランスミッタ”の頭文字である。それは、直列デー
タを送受信してそのデータを並列データに変換またはそ
の逆を行なうことができる￥＆置である。キーボードを
端末装置にインターフェイスするために与えられた４つ
のワイヤのワイヤ１と２は、キーボードと端末装置との
間の通信を可能にする。残りの２つの接続は、それぞれ
キーボードと端末装置を電源とアースに接続するために
用いられる。動作において、キーボードマイクロプロセ
ッサはまずキーボードスイッチアレイをスキャンして、
そのアレイのいずれのキーが押し下げられているかを判
断する。一般に、そのとき特定のキーを識別するために
割当てられたコードが、キーボードＵＡＲＴを介してキ
ーボードマイクロプロセッサに伝送される。端末ＵＡＲ
Ｔはこのフードを受取って、それを端末マイクロプロセ
ッサに伝送する。このコードはワイヤ１またはワイヤ２
のようなデータリンクの１つを介して伝送される。次に
、端末マイクロプロセッサはこの情報をストアするか、
またはそれをその端末に接続された他の装置に再伝送す
る。ＭａＣｙは米国特許第４．３４６．３６９号におい
てこの第１の技術のいくつかの態様を開示している。
先行技術による通信の代わり得る技術は、第２図に示さ
れているように複数のデータワイヤを用いる。その場合
、たとえば１０ワイヤインターフエイスがキーボード内
に与えられ、同様な１０ワイヤインターフエイスが端末
装置１４内に与えられる。この例において、７つのワイ
ヤは本質的に端末装置のマイクロプロセッサがキーボー
ドスイッチアレイをアドレスするためにその端末装置に
よって用いられる。８番目のワイヤはキーボードから端
末装置へデータを伝送するために用いられる。残りの２
つのワイヤは電力とアースのワイヤである。ＵＡＲＴは
この代わり得る技術において除去されている。Ｆｏｗｌ
ｅｒ ＩＩＩの米国特許第４，４０８．１９１号とＡ
１ａｎｏ達の米国特許第４，４７０．０３８号はこの第
２の技術のいくつかの態様を述べている。
れているように複数のデータワイヤを用いる。その場合
、たとえば１０ワイヤインターフエイスがキーボード内
に与えられ、同様な１０ワイヤインターフエイスが端末
装置１４内に与えられる。この例において、７つのワイ
ヤは本質的に端末装置のマイクロプロセッサがキーボー
ドスイッチアレイをアドレスするためにその端末装置に
よって用いられる。８番目のワイヤはキーボードから端
末装置へデータを伝送するために用いられる。残りの２
つのワイヤは電力とアースのワイヤである。ＵＡＲＴは
この代わり得る技術において除去されている。Ｆｏｗｌ
ｅｒ ＩＩＩの米国特許第４，４０８．１９１号とＡ
１ａｎｏ達の米国特許第４，４７０．０３８号はこの第
２の技術のいくつかの態様を述べている。
しかし、これらの先行技術の各々はいくつかの態様にお
いて欠点を有している。第１の先行技術については、比
較的高価な装置であるＵＡＲＴのみならずマイクロプロ
セッサがキーボードにおいて必要とされる。第２の先行
技術については、１０のワイヤケーブルは比較的高価で
あるとともに煩雑である。
いて欠点を有している。第１の先行技術については、比
較的高価な装置であるＵＡＲＴのみならずマイクロプロ
セッサがキーボードにおいて必要とされる。第２の先行
技術については、１０のワイヤケーブルは比較的高価で
あるとともに煩雑である。
１１匹１１
先行技術の欠点に鑑み、本発明の主な目的は、キーボー
ドと端末装置の間の通信のためのキーボードインターフ
ェイスであって比較的安価でかつ簡略なものを提供する
ことである。
ドと端末装置の間の通信のためのキーボードインターフ
ェイスであって比較的安価でかつ簡略なものを提供する
ことである。
本発明のもう１つの目的は、並直列データ変換Ｖｔ［を
用いる必要なしに最小数のデータラインを利用するキー
ボードインターフェイスを提供することである。
用いる必要なしに最小数のデータラインを利用するキー
ボードインターフェイスを提供することである。
上記の目的およびさらにその他の目的を達成づるために
、本発明はキーボードと端末装置の間の通信を可能にす
る４ワイヤキーボードインターフェイス手段を提供する
。キーボードと端末装置はコンピュータシステムのサブ
システムである。端末装置はキーボードの動作を制御す
るための中央ｌ１ｉＩＪＩＩ１１手段と、端末中央１ｌ
ｌｌＩＩ１手段からコマンド信号を伝送するためのデー
タ出力ポートと、キーボードからデータ信号を受取るた
めのデータ入力ポートを含む。コマンド信号はキーボー
ド初期設定信号とキーボードインクリメント信号を含む
。本発明のインターフェイス手段に加えて、キーボード
はスイッチアレイを含み、そのスイッチアレイは複数の
行と複数の列を有する。４ワイヤキーボードインターフ
ェイス手段はキーボードクリア信号の受取りの後のスイ
ッチアレイのスキャニングシーケンスの初期設定と、キ
ーボードインクリメント信号の受取りの後のスイッチア
レイの位置の活性化を検知するためのスイッチアレイの
スキャニングと、スイッチアレイの位置の活性化を検知
した後のデータ信号の伝送とを容易にする。
、本発明はキーボードと端末装置の間の通信を可能にす
る４ワイヤキーボードインターフェイス手段を提供する
。キーボードと端末装置はコンピュータシステムのサブ
システムである。端末装置はキーボードの動作を制御す
るための中央ｌ１ｉＩＪＩＩ１１手段と、端末中央１ｌ
ｌｌＩＩ１手段からコマンド信号を伝送するためのデー
タ出力ポートと、キーボードからデータ信号を受取るた
めのデータ入力ポートを含む。コマンド信号はキーボー
ド初期設定信号とキーボードインクリメント信号を含む
。本発明のインターフェイス手段に加えて、キーボード
はスイッチアレイを含み、そのスイッチアレイは複数の
行と複数の列を有する。４ワイヤキーボードインターフ
ェイス手段はキーボードクリア信号の受取りの後のスイ
ッチアレイのスキャニングシーケンスの初期設定と、キ
ーボードインクリメント信号の受取りの後のスイッチア
レイの位置の活性化を検知するためのスイッチアレイの
スキャニングと、スイッチアレイの位置の活性化を検知
した後のデータ信号の伝送とを容易にする。
本発明の他の目的と特徴と長所は、添付された図面と関
連する好ましい実施例の以下の詳細な説明から明らかと
なろう。
連する好ましい実施例の以下の詳細な説明から明らかと
なろう。
大１０ｑｏ＊ｍ
第１図を参照して、キーボード１２と端末装置１４との
間で情報とデータを交換するための従来の通信システム
が示されている。キーボード１２は英数字を入力するこ
とができる任意の数の装置の１つでよい。同様に、端末
装置ｉ１４は中央処理ユニットやビデオディスプレイ装
置などのような任意の数の装置の１つでよい。基本的に
は、キーボード１２はキーボードスイッチアレイ１６．
マイクロプロセッサ１８．およびＵＡＲＴ２０を含Ｉυ
でいる。“°ユニバーサル非同期レシーバとトランスミ
ツラダ′の頭文字であるＵＡＲＴは、直列データを送受
信してそのデータを並列データに変換することができ、
またはその逆を行なうことができる装置である。図中の
端末装置１４はマイクロプロセッサ２２とＵＡＲＴ２４
を含む中央処理ユニットである。
間で情報とデータを交換するための従来の通信システム
が示されている。キーボード１２は英数字を入力するこ
とができる任意の数の装置の１つでよい。同様に、端末
装置ｉ１４は中央処理ユニットやビデオディスプレイ装
置などのような任意の数の装置の１つでよい。基本的に
は、キーボード１２はキーボードスイッチアレイ１６．
マイクロプロセッサ１８．およびＵＡＲＴ２０を含Ｉυ
でいる。“°ユニバーサル非同期レシーバとトランスミ
ツラダ′の頭文字であるＵＡＲＴは、直列データを送受
信してそのデータを並列データに変換することができ、
またはその逆を行なうことができる装置である。図中の
端末装置１４はマイクロプロセッサ２２とＵＡＲＴ２４
を含む中央処理ユニットである。
キーボード１２を端末装置１４にインターフェイスする
ために４つのワイヤが設けられており、したがって“４
″ワイヤインターフエイスと称される。たとえば、ワイ
ヤ１と２はキーボード１２と端末装置ｆ１４との間の通
信を可能にするために与えられている。さらに、ワイヤ
３はキーボード１２と端末装置２１４の両方を電源に接
続し、ワイヤ４はその両方の装置をアースに接続する。
ために４つのワイヤが設けられており、したがって“４
″ワイヤインターフエイスと称される。たとえば、ワイ
ヤ１と２はキーボード１２と端末装置ｆ１４との間の通
信を可能にするために与えられている。さらに、ワイヤ
３はキーボード１２と端末装置２１４の両方を電源に接
続し、ワイヤ４はその両方の装置をアースに接続する。
動作において、キーボードマイクロプロセッサ１８はキ
ーボードスイッチアレイ１６をスキャンして、そのアレ
イのいずれのキーが押されたかを判断する。一般に、そ
の特定のキーを識別するために割当てられたコードが、
キーボードＬＩＡＲＴ２０によって、その相手である端
末ＵＡＲＴ２４に伝送される。このコードはワイヤ１ま
たはワイヤ２のようなデータリンクの１つを介して伝送
される。
ーボードスイッチアレイ１６をスキャンして、そのアレ
イのいずれのキーが押されたかを判断する。一般に、そ
の特定のキーを識別するために割当てられたコードが、
キーボードＬＩＡＲＴ２０によって、その相手である端
末ＵＡＲＴ２４に伝送される。このコードはワイヤ１ま
たはワイヤ２のようなデータリンクの１つを介して伝送
される。
そして、端末マイクロプロセッサ２２はこの情報をスト
アするか、または端末袋［１４に接続された他の装置に
それを伝送する。
アするか、または端末袋［１４に接続された他の装置に
それを伝送する。
これに代わり得る従来技術における通信のための技術は
、第２図に示されているように、複数のデータワイヤを
用いる。そのような場合、たとえば１０ワイヤインター
フエイス２６と１０ワイヤインターフエイス２８が、そ
れぞれキーボード１２と端末袋！１１１４に与えられて
いる。この例において、７本のワイヤはスイッチアレイ
１６をアドレスするために端末装置１１１４またはその
マイクロプロセッサ２２によって用いられ、８番目のワ
イヤはキーボード１２から端末装ａ１４ヘデータを転送
するたれに用いられる。ＩＪＡＲＴはこの代わり得る技
術において除去されている。
、第２図に示されているように、複数のデータワイヤを
用いる。そのような場合、たとえば１０ワイヤインター
フエイス２６と１０ワイヤインターフエイス２８が、そ
れぞれキーボード１２と端末袋！１１１４に与えられて
いる。この例において、７本のワイヤはスイッチアレイ
１６をアドレスするために端末装置１１１４またはその
マイクロプロセッサ２２によって用いられ、８番目のワ
イヤはキーボード１２から端末装ａ１４ヘデータを転送
するたれに用いられる。ＩＪＡＲＴはこの代わり得る技
術において除去されている。
これらのいずれの先行技術も不都合を含んでいる。最初
の先行技術に関して、ＬＩＡＲＴは比較的高価な装置で
あるのみならず、マイクロプロセッサがキーボードにお
いて必要とされる。第２の先行技術に関して、１０本の
ワイヤケーブルは比較的高価であるとともに煩雑である
。
の先行技術に関して、ＬＩＡＲＴは比較的高価な装置で
あるのみならず、マイクロプロセッサがキーボードにお
いて必要とされる。第２の先行技術に関して、１０本の
ワイヤケーブルは比較的高価であるとともに煩雑である
。
第３図に示されているように、本発明はコンピュータシ
ステム２９のキーボード３０を与え、それはスイッチア
レイ３２と４ワイヤインタ一フエイス手段３４を有して
いる。ベルまたはライトのようなインジケータ４４がイ
ンターフェイス手段３４に接続されている。さらに、コ
ンピュータシステム２９の端末袋ｗ１３６が設けられて
おり、それはマイクロプロセッサ３８．出力ポート４０
゜および入力ポート４２を有している。キーボード３０
を端末装置１３６にリンクするために４ワイヤが設けら
れているが、ＵＡＲＴとキーボードマイクロプロセッサ
が除去されている。それらのワイヤの２つはキーボード
３０と端末装置３６の間の通信のために用いられる。残
りのワイヤの１つはそれら２つの装置をＭ源に接続し、
最後のワイヤはそれら２つの装置をアースに接続する。
ステム２９のキーボード３０を与え、それはスイッチア
レイ３２と４ワイヤインタ一フエイス手段３４を有して
いる。ベルまたはライトのようなインジケータ４４がイ
ンターフェイス手段３４に接続されている。さらに、コ
ンピュータシステム２９の端末袋ｗ１３６が設けられて
おり、それはマイクロプロセッサ３８．出力ポート４０
゜および入力ポート４２を有している。キーボード３０
を端末装置１３６にリンクするために４ワイヤが設けら
れているが、ＵＡＲＴとキーボードマイクロプロセッサ
が除去されている。それらのワイヤの２つはキーボード
３０と端末装置３６の間の通信のために用いられる。残
りのワイヤの１つはそれら２つの装置をＭ源に接続し、
最後のワイヤはそれら２つの装置をアースに接続する。
一般に、本発明の動作はコマンド信＠ＣＭＤを送出する
端末マイクロプロセッサ３８によって開始される。コマ
ンド信号はキーボード初期設定信号とキーボードインク
リメント信号を含んでいる。
端末マイクロプロセッサ３８によって開始される。コマ
ンド信号はキーボード初期設定信号とキーボードインク
リメント信号を含んでいる。
キー動作のシーケンス′はキーボード初期設定信号の存
在によって始まる。この信号はキーボードインターフェ
イス手段３４の初期設定を生じさせ、スイッチアレイの
スキャニングのために用意させる。キーボードインター
フェイス手段３４が初期設定された後に、キーボードイ
ンクリメント信号は端末マイクロプロセッサ３８によっ
てシーケンシャルに送られる。各キーボードインクリメ
ント信号の後に、端末マイクロプロセッサ３８はキーボ
ードインターフェイス手段３４によってアドレスされた
スイッチアレイの或る特定の位置またはキーの状態を感
知する。これは、その特定のキーがオペレータによって
活性化または押し下げられたか否かを検知することであ
る。そして、インターフェイス手段３４は、データ信号
ラインＤＡＴＡを介して、そのキーのステータスを端末
マイクロプロセッサ３８に伝送する。キーボードインタ
ーフェイス手段３４からのこの応答は、単なる肯定応答
すなわちスイッチアレイ３２の問われているキーが押し
下げられているか否かの応答である。
在によって始まる。この信号はキーボードインターフェ
イス手段３４の初期設定を生じさせ、スイッチアレイの
スキャニングのために用意させる。キーボードインター
フェイス手段３４が初期設定された後に、キーボードイ
ンクリメント信号は端末マイクロプロセッサ３８によっ
てシーケンシャルに送られる。各キーボードインクリメ
ント信号の後に、端末マイクロプロセッサ３８はキーボ
ードインターフェイス手段３４によってアドレスされた
スイッチアレイの或る特定の位置またはキーの状態を感
知する。これは、その特定のキーがオペレータによって
活性化または押し下げられたか否かを検知することであ
る。そして、インターフェイス手段３４は、データ信号
ラインＤＡＴＡを介して、そのキーのステータスを端末
マイクロプロセッサ３８に伝送する。キーボードインタ
ーフェイス手段３４からのこの応答は、単なる肯定応答
すなわちスイッチアレイ３２の問われているキーが押し
下げられているか否かの応答である。
この応答であるＤＡＴＡ信号はコード化されたメツセー
ジではない。
ジではない。
具体的には、４ワイヤインタ一フエイス手段３４とスイ
ッチアレイ３２は、第４図においてさらに十分に′述べ
られる。スイッチアレイ３２は１１×８のアレイであり
、すなわち１１行と８列を備えた従来のアレイである。
ッチアレイ３２は、第４図においてさらに十分に′述べ
られる。スイッチアレイ３２は１１×８のアレイであり
、すなわち１１行と８列を備えた従来のアレイである。
スイッチアレイ３２は１１×８アレイに限定されず、そ
の特定の寸法は単なる例示である。
の特定の寸法は単なる例示である。
インターフェイス手段３４は行選択器手段５０を含み、
ｉの出力はスイッチアレイ３２の行に接続されており、
インターフェイス手段３４はさらに列選択器手段５２を
含み、その入力はスイッチアレイ５２の列に接続されて
いる。その好ましい実施例における行選択器手段５０は
２つのデマルチプレクサ５０Ａと５０８を含み、それら
の各々はテキサス州ダラスのテキサスインスツルメンツ
社によって製造されたタイプＳＮ５４ＬＳ１５６のデマ
ルチプレクサである。第４図に示されているように、デ
マルチプレクサ５０Ａの３つの出力のみが用いられ、そ
れらは出力２Ｙ２．２Ｙ１゜および２ＹＯである。残り
の出力は、非接続（ｎ／Ｃ）状態のままにされる。行選
択器手段５０はインバータ６６をも含んでいる。その好
ましい実施例における列選択番手段５２は、カリフォル
ニア州すンタクラブのナショナルセミコンダクター社に
よって製造されたＭＭ７４ＨＣ４５０１マルチブロクサ
５３を含んでいる。列の各々は抵抗を介して５ボルトの
電源に接続されている。これらのスイッチアレイ抵抗は
ＲｃｏからＲＣ７で示されている。列選択番手段５２は
ドライバ手段６８をも含んでいる。
ｉの出力はスイッチアレイ３２の行に接続されており、
インターフェイス手段３４はさらに列選択器手段５２を
含み、その入力はスイッチアレイ５２の列に接続されて
いる。その好ましい実施例における行選択器手段５０は
２つのデマルチプレクサ５０Ａと５０８を含み、それら
の各々はテキサス州ダラスのテキサスインスツルメンツ
社によって製造されたタイプＳＮ５４ＬＳ１５６のデマ
ルチプレクサである。第４図に示されているように、デ
マルチプレクサ５０Ａの３つの出力のみが用いられ、そ
れらは出力２Ｙ２．２Ｙ１゜および２ＹＯである。残り
の出力は、非接続（ｎ／Ｃ）状態のままにされる。行選
択器手段５０はインバータ６６をも含んでいる。その好
ましい実施例における列選択番手段５２は、カリフォル
ニア州すンタクラブのナショナルセミコンダクター社に
よって製造されたＭＭ７４ＨＣ４５０１マルチブロクサ
５３を含んでいる。列の各々は抵抗を介して５ボルトの
電源に接続されている。これらのスイッチアレイ抵抗は
ＲｃｏからＲＣ７で示されている。列選択番手段５２は
ドライバ手段６８をも含んでいる。
さらに、行選択器手段５０と列選択番手段５２は各々カ
ウンタ５４を共用する。その好ましい実施例におけるカ
ウンタ５４は、テキサスインスツルメンツによって製造
されたタイプＳＮ ５４ ＬＳ３９３カウンタである。
ウンタ５４を共用する。その好ましい実施例におけるカ
ウンタ５４は、テキサスインスツルメンツによって製造
されたタイプＳＮ ５４ ＬＳ３９３カウンタである。
カウンタ５４は複数の出力を有し、それらの各々は２進
数のピットに対応する。これら２進数はカウンタ５４に
よって与えられるカウントを表わす。２進数の４つの最
上桁ビットに対応するカウンタ５４の４つのカウントは
行選択器手段５０の動作を制御するために与えられ、２
進数の３つの最小桁ピットに対応するカウンタ５４の３
つの出力は列選択番手段５２の動作を制御するために与
えられる。
数のピットに対応する。これら２進数はカウンタ５４に
よって与えられるカウントを表わす。２進数の４つの最
上桁ビットに対応するカウンタ５４の４つのカウントは
行選択器手段５０の動作を制御するために与えられ、２
進数の３つの最小桁ピットに対応するカウンタ５４の３
つの出力は列選択番手段５２の動作を制御するために与
えられる。
さらに、インターフェイス手段３４はコマンド微分回路
手段５６を含む。コマンド微分回路手段５６は、端末マ
イクロプロセッサ３８によってキーボード３０に転送さ
れるコマンドを径路指定するために設けられている。
手段５６を含む。コマンド微分回路手段５６は、端末マ
イクロプロセッサ３８によってキーボード３０に転送さ
れるコマンドを径路指定するために設けられている。
微分回路手段５６はオーブンコレクタインバータ５８を
含み、次にそれは電圧コンパレータ６０゜抵抗器６２．
およびキャパシタ６４に接続されている。端末マイクロ
プロセッサ３８からのコマンド信＠ＣＭＯはカウンタ５
４のりＯツク入力とインバータ５８とに与えられる。も
しＣＭＤ信号が微分回路手段５６を活性化しなければ、
カウンタ５４の入力に現われるその信号はキーボードイ
ンクリメントまたはクロック信号ＣＬＫであると判断さ
れる。しかし、もし微分回路手段５６が活性化されてコ
ンパレータ６０に高レベルの出力を生じさせれば、その
コマンド信号はキーボード初期設定またはクリア信号Ｃ
ＬＫであると判断される。
含み、次にそれは電圧コンパレータ６０゜抵抗器６２．
およびキャパシタ６４に接続されている。端末マイクロ
プロセッサ３８からのコマンド信＠ＣＭＯはカウンタ５
４のりＯツク入力とインバータ５８とに与えられる。も
しＣＭＤ信号が微分回路手段５６を活性化しなければ、
カウンタ５４の入力に現われるその信号はキーボードイ
ンクリメントまたはクロック信号ＣＬＫであると判断さ
れる。しかし、もし微分回路手段５６が活性化されてコ
ンパレータ６０に高レベルの出力を生じさせれば、その
コマンド信号はキーボード初期設定またはクリア信号Ｃ
ＬＫであると判断される。
好ましい実施例におけるコンパレータ６０は、ナショナ
ルセミコンダクタによって製造された１Ｍ３３９電圧コ
ンパレータである。オープンコレクタインバータ５８は
その出力が高レベルのときに非活性出力特性を有する。
ルセミコンダクタによって製造された１Ｍ３３９電圧コ
ンパレータである。オープンコレクタインバータ５８は
その出力が高レベルのときに非活性出力特性を有する。
すなわち、この条件において、それは抵抗６２とキャパ
シタ６４から電気的に分離されている。そのような状態
において、インバータ５８の出力はキャパシタ６４を充
電する電流に影響を及ぼさない。すなわち、キャパシタ
６４は、抵抗６２とキャパシタ６４の値の積である選択
された時定数ＲＣで抵抗器６２を介して単独に充電する
。
シタ６４から電気的に分離されている。そのような状態
において、インバータ５８の出力はキャパシタ６４を充
電する電流に影響を及ぼさない。すなわち、キャパシタ
６４は、抵抗６２とキャパシタ６４の値の積である選択
された時定数ＲＣで抵抗器６２を介して単独に充電する
。
さらに、コンパレータ６０の出力であるＣＬＲ信号はカ
ウンタ５４のクリア入力に接続される。
ウンタ５４のクリア入力に接続される。
カウンタ５４の出力は行選択器手段５０と列選択番手段
５２に接続され。４つの最上桁バイナリピットは行選択
器手段５０に接続され、３つの最小桁は列選択番手段５
２に接続される。行選択器手段５０のデマルチプレクサ
５０Ａと５０８は１０の出力を含み、その上３つすなわ
ちデマルチブレク７５ＯＡの出力の動作はインバータ６
６によって制御される。カウンタ５４の下３つの出力は
マルチプレクサ５３に接続されており、その８つの入力
を能動化する。データ信号ＤＡＴＡとして割当てられた
マルチプレクサ５３の出力はドライバ６８に接続されて
いる。ドライバ６８の出力は第３図のＤＡＴＡワイヤま
たはワイヤ２に接続されている。電源とアースは第４図
に示されているように従来の方法で与えられている。
５２に接続され。４つの最上桁バイナリピットは行選択
器手段５０に接続され、３つの最小桁は列選択番手段５
２に接続される。行選択器手段５０のデマルチプレクサ
５０Ａと５０８は１０の出力を含み、その上３つすなわ
ちデマルチブレク７５ＯＡの出力の動作はインバータ６
６によって制御される。カウンタ５４の下３つの出力は
マルチプレクサ５３に接続されており、その８つの入力
を能動化する。データ信号ＤＡＴＡとして割当てられた
マルチプレクサ５３の出力はドライバ６８に接続されて
いる。ドライバ６８の出力は第３図のＤＡＴＡワイヤま
たはワイヤ２に接続されている。電源とアースは第４図
に示されているように従来の方法で与えられている。
動作において、端末マイクロプロセッサ３８は出力ポー
ト４０を介してＣＭＤ信号を送ることによってシーケン
スを開始する。第３図に示されているようにＣＭＤワイ
ヤまたはワイヤ１を介して伝送することによって、この
信号は第４１！ｌに示されているようにカウンタ５４と
コマンド微分回路手段５６の両方に受取られる。キーボ
ード３０と端末装置２３６の間の相互接続の数を最小に
するために、ＣＭＤラインは持続時間の異なる２つの信
号を伝送することができる。第５図に示されているよう
に、もしＣＭＤ信号が短い持続時間のパルスであれば、
それはクロックσＬＫ信号として指定されており、それ
はスイッチアレイ３２のインクリメントするスキャニン
グのためにカウンタ５６をインクリメントするように用
いられる。ＣＬ【信号は一般に０．５から５．０マイク
ロ秒の持続時間のパルスである。もしＣＭＤ信号がより
長い持続時間のパルスであれば、コマンド微分回路手段
５６が活性化されて第２の信号であるクリアＣＬＡ信号
を生じる。ＣＬＡ信号は行選択器手段５０と列選択器手
段５２を初期設定する。スキャンシーケンスを初期設定
するために用いられるＣＬＲａｉ＠を生じるために、Ｃ
ＭＤ信号は少なくともＣＬＫパルスの２倍の持続時間の
パルスでなければならず、その持続時間はたとえば２０
マイクロ秒である。σＴＶ−とＣＬＲの信号に関するそ
れらの値は、限定的ではなくて例示的なものである。
ト４０を介してＣＭＤ信号を送ることによってシーケン
スを開始する。第３図に示されているようにＣＭＤワイ
ヤまたはワイヤ１を介して伝送することによって、この
信号は第４１！ｌに示されているようにカウンタ５４と
コマンド微分回路手段５６の両方に受取られる。キーボ
ード３０と端末装置２３６の間の相互接続の数を最小に
するために、ＣＭＤラインは持続時間の異なる２つの信
号を伝送することができる。第５図に示されているよう
に、もしＣＭＤ信号が短い持続時間のパルスであれば、
それはクロックσＬＫ信号として指定されており、それ
はスイッチアレイ３２のインクリメントするスキャニン
グのためにカウンタ５６をインクリメントするように用
いられる。ＣＬ【信号は一般に０．５から５．０マイク
ロ秒の持続時間のパルスである。もしＣＭＤ信号がより
長い持続時間のパルスであれば、コマンド微分回路手段
５６が活性化されて第２の信号であるクリアＣＬＡ信号
を生じる。ＣＬＡ信号は行選択器手段５０と列選択器手
段５２を初期設定する。スキャンシーケンスを初期設定
するために用いられるＣＬＲａｉ＠を生じるために、Ｃ
ＭＤ信号は少なくともＣＬＫパルスの２倍の持続時間の
パルスでなければならず、その持続時間はたとえば２０
マイクロ秒である。σＴＶ−とＣＬＲの信号に関するそ
れらの値は、限定的ではなくて例示的なものである。
ＣＭＤ信号が低レベルのとき、それが長い持続時間か短
い持続時間かにかかわらず、インバータ５８はキャパシ
タ６４の充電を可能にする。もしで１［Ｄ−信号が長い
持続時間の信号であれば、キャパシタ６４はしきいレベ
ルの２．５ボルトを越えてチャージアップする。キャパ
シタ６４が２．５ボルトのレベルに到達したとき、コン
パレータ６０は即座に高レベルとなり、それはクリアＣ
ＬＲ信号として指定されたものである。ＣＬＲパルスは
カウンタ５４をリセットして、スイッチアレイスキャニ
ング手順を開始させる。コンパレータ６０の他の入力は
、従来の電圧分割器７０の出力である２、５ボルトの一
定の基準電圧に接続される。
い持続時間かにかかわらず、インバータ５８はキャパシ
タ６４の充電を可能にする。もしで１［Ｄ−信号が長い
持続時間の信号であれば、キャパシタ６４はしきいレベ
ルの２．５ボルトを越えてチャージアップする。キャパ
シタ６４が２．５ボルトのレベルに到達したとき、コン
パレータ６０は即座に高レベルとなり、それはクリアＣ
ＬＲ信号として指定されたものである。ＣＬＲパルスは
カウンタ５４をリセットして、スイッチアレイスキャニ
ング手順を開始させる。コンパレータ６０の他の入力は
、従来の電圧分割器７０の出力である２、５ボルトの一
定の基準電圧に接続される。
電圧分割器７０は等しい値の２つの抵抗器ＲｔｉニーＲ
ｊ２を含み、それらの抵抗は５ボルトの１！源に接続さ
れている。
ｊ２を含み、それらの抵抗は５ボルトの１！源に接続さ
れている。
次に現われるＣＭＤ信号はクロックパルスＣＬＫとして
機能する短い持続時間のパルスである。
機能する短い持続時間のパルスである。
この例において、インバータ５８はキャパシタ６４が充
電することを許すが、抵抗６２によって制御される充電
時間定数はその信号が前の状態に戻る前に２．５ボルト
のレベルにキャパシタ６４が到達することを許さない。
電することを許すが、抵抗６２によって制御される充電
時間定数はその信号が前の状態に戻る前に２．５ボルト
のレベルにキャパシタ６４が到達することを許さない。
すなわち、コンパレータ６０はＣＬＲパルスを送出する
ように能動化され得ない。したがって、ＣＬＫパルスと
して働く短い持続時間のパルスはカウンタ５４をインク
リメントする。その結果、カウンタ５４は、押し下げら
れたスイッチアレイ３２のキーがあればそれを検知する
ために、行選択器手段５０と列選択器手段５２の動作を
制御することが可能になる。スイッチアレイ３２の残り
のキーの各々は同様に感知される。
ように能動化され得ない。したがって、ＣＬＫパルスと
して働く短い持続時間のパルスはカウンタ５４をインク
リメントする。その結果、カウンタ５４は、押し下げら
れたスイッチアレイ３２のキーがあればそれを検知する
ために、行選択器手段５０と列選択器手段５２の動作を
制御することが可能になる。スイッチアレイ３２の残り
のキーの各々は同様に感知される。
スイッチアレイ３２のキーの押し下げを感知するために
、全スイッチアレイがスキャンされなければならない。
、全スイッチアレイがスキャンされなければならない。
スキャニングのシーケンスは行Ｏ−列０の位置から行〇
−列７の位置に至り、このように一時に１つの行を続け
、そして行１〇−列７の位置で終了する。たとえば、最
初のＣＬＫパルスの受信の後に、行〇−列Ｏの位置が感
知される。次のＣＬＫパルスがキーボード３０に送られ
る前に、端末マイクロプロセッサ３８はＤＡＴＡ信号が
端末入力ポート４２によって受取られたか否かを感知す
る。ＣＬＫパルス間には十分な時間が与えられているの
で、もしその列〇−行Ｏの位置が活性化されているかま
たはその位置に対応するキーが押し下げられていれば、
キーボード回路は応答してデータ信号ＤＡＴＡを送り返
すことができる。すなわち、低レベルのりＸＴＴ信号は
、そのキーがアドレスされるときに、オペレータによる
キーの押し下げを表示する。マイクロプロセッサ３８は
この特定のキーを感知するためにコマンド信号ＣＭＤを
開始させるので、それはどのキーが押し下げられたかを
知る。この確認は簡単であって、単なる押し下げの存在
と不存在である。
−列７の位置に至り、このように一時に１つの行を続け
、そして行１〇−列７の位置で終了する。たとえば、最
初のＣＬＫパルスの受信の後に、行〇−列Ｏの位置が感
知される。次のＣＬＫパルスがキーボード３０に送られ
る前に、端末マイクロプロセッサ３８はＤＡＴＡ信号が
端末入力ポート４２によって受取られたか否かを感知す
る。ＣＬＫパルス間には十分な時間が与えられているの
で、もしその列〇−行Ｏの位置が活性化されているかま
たはその位置に対応するキーが押し下げられていれば、
キーボード回路は応答してデータ信号ＤＡＴＡを送り返
すことができる。すなわち、低レベルのりＸＴＴ信号は
、そのキーがアドレスされるときに、オペレータによる
キーの押し下げを表示する。マイクロプロセッサ３８は
この特定のキーを感知するためにコマンド信号ＣＭＤを
開始させるので、それはどのキーが押し下げられたかを
知る。この確認は簡単であって、単なる押し下げの存在
と不存在である。
それは、従来の装置の場合のように、押し下げられたキ
ーを表示するコード化されたメツセージが受取られるこ
とを必要としない。次のＣＬＫパルスはインターフェイ
ス手段３４が行〇−列１の位置の状態を感知するように
させる。このシーケンシャルな様式において、全スイッ
チアレイは約１０ミリ秒以内にスキャンされ、それは人
間のオペレータによる次のキーの押し下げより早い。ベ
ルまたは灯のような従来のインジケータ４４がインター
フェイス手段３４に接続されてもよい。
ーを表示するコード化されたメツセージが受取られるこ
とを必要としない。次のＣＬＫパルスはインターフェイ
ス手段３４が行〇−列１の位置の状態を感知するように
させる。このシーケンシャルな様式において、全スイッ
チアレイは約１０ミリ秒以内にスキャンされ、それは人
間のオペレータによる次のキーの押し下げより早い。ベ
ルまたは灯のような従来のインジケータ４４がインター
フェイス手段３４に接続されてもよい。
インターフェイス手段３４の動作を説明するために、言
葉” Ｗ Ｙ Ｓ Ｅ ”の文字１１ ＶＶ ＩＩを表
わすキーが押し下げられたと仮定しよう。その動作のシ
ーケンスは第９図のフローチャートによって示されてい
る。端末マイクロプロセッサ３８はまずインターフェイ
ス手段３４をクリアし、そして行０−列Ｏの位置から始
めてスイッチアレイ３２のシーケンシャルなスキャニン
グを開始する。伝送されたコマンド信号ＣＭＤはカウン
タ５４をインクリメントし、スイッチアレイ３２のスキ
ャニングにおいて行選択器手段５０と列選択器手段６２
をシーケンシャルに動作させる。この様式において、行
８−列４の位置を含んでそこまでのすべての位置の状態
が感知される。これらのキーのいずれも押し下げられて
いないので、応答ＤＡＴＡの各々は高レベル信号である
。
葉” Ｗ Ｙ Ｓ Ｅ ”の文字１１ ＶＶ ＩＩを表
わすキーが押し下げられたと仮定しよう。その動作のシ
ーケンスは第９図のフローチャートによって示されてい
る。端末マイクロプロセッサ３８はまずインターフェイ
ス手段３４をクリアし、そして行０−列Ｏの位置から始
めてスイッチアレイ３２のシーケンシャルなスキャニン
グを開始する。伝送されたコマンド信号ＣＭＤはカウン
タ５４をインクリメントし、スイッチアレイ３２のスキ
ャニングにおいて行選択器手段５０と列選択器手段６２
をシーケンシャルに動作させる。この様式において、行
８−列４の位置を含んでそこまでのすべての位置の状態
が感知される。これらのキーのいずれも押し下げられて
いないので、応答ＤＡＴＡの各々は高レベル信号である
。
スキャンの次の２進数“１０００１０１”において、カ
ウンタ５４の上４つの出力は選択器手段５０へ径路指定
される。カウンタ５４の最上桁は数値“１”であるので
、それは下側のデマルチプレクサ５０Ｂを不能化する。
ウンタ５４の上４つの出力は選択器手段５０へ径路指定
される。カウンタ５４の最上桁は数値“１”であるので
、それは下側のデマルチプレクサ５０Ｂを不能化する。
デマルチプレクサ５０Ｂの入力丁百と７百は、もしそれ
らが低レベルまたは０のビットを受取れば活性になるよ
うに指定されている。最上桁のビットはインバータ６６
に入力され、それは上側のデマルチプレクサ５０Ａを能
動化する低レベルの信号を生じる。上側のデマルチプレ
クサ５０Ａが能動化されれば、入力１Ｇ／２Ｃ，Ｂ、お
よびＡにおける低レベルまたはＯのビットの存在は上側
のデマルチプレクサ５０Ａが出力２ＹＯにおいて低レベ
ルまたは０の信号を出力することを可能にする。出力２
ＹＯは行ＲＯＷ８に接続されている。行８−列５のアレ
イ位置はその対応するキーの押し下げによってショート
されているので、列Ｃ０Ｌ５に接続されているマルチプ
レクサ５３の入力である入力Ｙ５は行ＲＯＷＢ上の信号
の存在によって低レベルに維持される。
らが低レベルまたは０のビットを受取れば活性になるよ
うに指定されている。最上桁のビットはインバータ６６
に入力され、それは上側のデマルチプレクサ５０Ａを能
動化する低レベルの信号を生じる。上側のデマルチプレ
クサ５０Ａが能動化されれば、入力１Ｇ／２Ｃ，Ｂ、お
よびＡにおける低レベルまたはＯのビットの存在は上側
のデマルチプレクサ５０Ａが出力２ＹＯにおいて低レベ
ルまたは０の信号を出力することを可能にする。出力２
ＹＯは行ＲＯＷ８に接続されている。行８−列５のアレ
イ位置はその対応するキーの押し下げによってショート
されているので、列Ｃ０Ｌ５に接続されているマルチプ
レクサ５３の入力である入力Ｙ５は行ＲＯＷＢ上の信号
の存在によって低レベルに維持される。
２進数は’１０００１０１”であるので、カウンタ５４
の下３つのビットはマルチプレクサ５３に出力される。
の下３つのビットはマルチプレクサ５３に出力される。
マルチプレクサ５３のビンＡ、Ｂ。
およびＣにおけるピッド’ １０１ ”の存在は入力Ｙ
５を活性化し、列Ｃ０Ｌ５上の電流を感知することを可
能にする。そして、マルチプレクサ５３は出力ビンＯＵ
Ｔに信号を出力する。ドライバ６８によって増幅された
後のこの信号はＤＡＴＡ信号であって、それはＤＡＴＡ
ワイヤまたはワイヤ２を介して端末マイクロプロセッサ
３８に転送される。スイッチアレイの残りの位置の各々
が感知されるまでスキャンはこのようにして続けられる
。
５を活性化し、列Ｃ０Ｌ５上の電流を感知することを可
能にする。そして、マルチプレクサ５３は出力ビンＯＵ
Ｔに信号を出力する。ドライバ６８によって増幅された
後のこの信号はＤＡＴＡ信号であって、それはＤＡＴＡ
ワイヤまたはワイヤ２を介して端末マイクロプロセッサ
３８に転送される。スイッチアレイの残りの位置の各々
が感知されるまでスキャンはこのようにして続けられる
。
もちろん、これらのキーの各々の状態は押し下げられて
いないものである。
いないものである。
前述のように、スイッチアレイ全体が約１０ミリ秒でス
キャンされ、それは人間のオペレータによる次のキーの
押し下げより早い。この様式において、ワード°’ＷＹ
ＳＥ”の残りの文字の各々は統（スキャンの間に感知さ
れる。たとえば、スイッチアレイ３２の続くスキャンの
２進数″゛０１０１１００”において、行５−列４のア
レイ位置または“Ｙ”を表わすキーが感知される。この
場合、カウンタ５４の最上桁ビットの出力における数値
“０”の存在はインバータ６６に高レベル信号を生じさ
せ、それによって上側のデマルチプレクサ５０Ａを不活
性化する。これに対して、下側のデマルチプレクサ５０
Ｂの入力１石とΣてにおける低レベル信号の存在はその
装置を活性化する。入力ＩＣ／２ＣとＡにおける高レベ
ル信号の存在はデマルチプレクサ５０Ｂが出力１Ｙ１に
低レベル信号を出力するようにさせ、その出力は行ＲＯ
Ｗ５に接続されている。マルチプレクサ５３における下
３つの数値” ｉ ｏ ｏ”の存在は入力Ｙ４を活性化
する。すなわち、ＤＡＴＡ信号は端末装置３６に転送さ
れて、“Ｙ”キーの押し下げを知らせる。同様に、“Ｓ
”キーは第３のスキャンのバイナリ“００１０１００’
”で感知され、１１ Ｅ ＩＩ主キー第４のスキャンの
”１００１１０１”で感知される。
キャンされ、それは人間のオペレータによる次のキーの
押し下げより早い。この様式において、ワード°’ＷＹ
ＳＥ”の残りの文字の各々は統（スキャンの間に感知さ
れる。たとえば、スイッチアレイ３２の続くスキャンの
２進数″゛０１０１１００”において、行５−列４のア
レイ位置または“Ｙ”を表わすキーが感知される。この
場合、カウンタ５４の最上桁ビットの出力における数値
“０”の存在はインバータ６６に高レベル信号を生じさ
せ、それによって上側のデマルチプレクサ５０Ａを不活
性化する。これに対して、下側のデマルチプレクサ５０
Ｂの入力１石とΣてにおける低レベル信号の存在はその
装置を活性化する。入力ＩＣ／２ＣとＡにおける高レベ
ル信号の存在はデマルチプレクサ５０Ｂが出力１Ｙ１に
低レベル信号を出力するようにさせ、その出力は行ＲＯ
Ｗ５に接続されている。マルチプレクサ５３における下
３つの数値” ｉ ｏ ｏ”の存在は入力Ｙ４を活性化
する。すなわち、ＤＡＴＡ信号は端末装置３６に転送さ
れて、“Ｙ”キーの押し下げを知らせる。同様に、“Ｓ
”キーは第３のスキャンのバイナリ“００１０１００’
”で感知され、１１ Ｅ ＩＩ主キー第４のスキャンの
”１００１１０１”で感知される。
第６図に示されているように、行選択器手段５０、列選
択器手段５２．カウンタ５４．およびコマンド微分回路
手段５６の大部分は、単一の注文半導体チップ１４６に
よって置換えられる。第４図におけるそれらの対応物と
同一のそれらのエレメントは、第４図における対応する
エレメントを識別する数字に数字゛１”を加えて識別さ
れている。たとえば、スイッチアレイ３２の対応物は第
６図においてスイッチアレイ１３２で示されている。
択器手段５２．カウンタ５４．およびコマンド微分回路
手段５６の大部分は、単一の注文半導体チップ１４６に
よって置換えられる。第４図におけるそれらの対応物と
同一のそれらのエレメントは、第４図における対応する
エレメントを識別する数字に数字゛１”を加えて識別さ
れている。たとえば、スイッチアレイ３２の対応物は第
６図においてスイッチアレイ１３２で示されている。
チップ１４６は１０の出力ビンを含み、それらはアレイ
１３２の１０の行に接続されたビン９から１６およびビ
ン２７と２８である。ビン１から８は、アレイ１３２の
８つの列に接続されている。
１３２の１０の行に接続されたビン９から１６およびビ
ン２７と２８である。ビン１から８は、アレイ１３２の
８つの列に接続されている。
スイッチアレイ１３２はこの実施例において１０×８の
行列であるが、この寸法も例示的である。
行列であるが、この寸法も例示的である。
さらに、ビン１９はコマンド微分回路手段１５６の抵抗
器１６２とキャパシタ１６４に接続されている。さらに
、ビン１８はＣＭＤ信号に接続され、ビン２２はＤＡＴ
Ａ信号に接続され、ビン２３は電源に接続され、ビン１
７はアースに接続されている。最後に、ビン２０はＩＣ
ＬＫ信号であって、ビン２１はＩ ＣＬＲ信号であり、
どちらもインジケータ装置１４４に接続される。第６図
に示されているように、インジケータ装置１４４は大文
字のロックＣＡＰＳ ＬＯＣＫまたは数値のロックＮ
ＵＭ ＬＯＣＫのような種々のキ゛−ボード機能に関
する表示を与えることができるカウンタである。４つの
表示機能の各々のための可視ディスプレイは、複数の発
光ダイオード（ＬＥＤ）１４３ａから１４３ｄの１つで
ある。これらのＬＥＤの各々は抵抗を介して５ボルトの
電源に接続されている。この実施例におけるディスプレ
イ手段は可視ディスプレイであるが、可聴または他の形
態のディスプレイも可能である。たとえば、信号音発生
器または他の表示の手段である。
器１６２とキャパシタ１６４に接続されている。さらに
、ビン１８はＣＭＤ信号に接続され、ビン２２はＤＡＴ
Ａ信号に接続され、ビン２３は電源に接続され、ビン１
７はアースに接続されている。最後に、ビン２０はＩＣ
ＬＫ信号であって、ビン２１はＩ ＣＬＲ信号であり、
どちらもインジケータ装置１４４に接続される。第６図
に示されているように、インジケータ装置１４４は大文
字のロックＣＡＰＳ ＬＯＣＫまたは数値のロックＮ
ＵＭ ＬＯＣＫのような種々のキ゛−ボード機能に関
する表示を与えることができるカウンタである。４つの
表示機能の各々のための可視ディスプレイは、複数の発
光ダイオード（ＬＥＤ）１４３ａから１４３ｄの１つで
ある。これらのＬＥＤの各々は抵抗を介して５ボルトの
電源に接続されている。この実施例におけるディスプレ
イ手段は可視ディスプレイであるが、可聴または他の形
態のディスプレイも可能である。たとえば、信号音発生
器または他の表示の手段である。
チップ１４６の内部エレメントは第７図に示されている
。チップ１４６は行選択器手段１５０と列選択器手段１
５２を含む。この実施例における行選択器手段１５０は
シフトレジスタであって、その出力はアレイ１３２の１
０の行に接続されている。シフトレジスタ１５０は１５
０ａから１５Ｏｆで示された６つのフリップ７０ツブを
含んでいる。
。チップ１４６は行選択器手段１５０と列選択器手段１
５２を含む。この実施例における行選択器手段１５０は
シフトレジスタであって、その出力はアレイ１３２の１
０の行に接続されている。シフトレジスタ１５０は１５
０ａから１５Ｏｆで示された６つのフリップ７０ツブを
含んでいる。
この実施例における列選択器手段１５２はカウンタとし
て働くシフトレジスタ１５４．複数のＡＮＤゲート１５
３ａ −１５３ｈ 、ｖメタＯＲゲート１５３１．およ
び複数の活性なプルアップ抵抗器ＲｃＯＲｃ７とそれに
関連するシュミットトリガＳＣＱ ＳＣ２を含んでい
る。この実施例において、シフトレジスタ１５４は１５
４ａ−１５４ｅで示された５つのフリップフロップを含
む。
て働くシフトレジスタ１５４．複数のＡＮＤゲート１５
３ａ −１５３ｈ 、ｖメタＯＲゲート１５３１．およ
び複数の活性なプルアップ抵抗器ＲｃＯＲｃ７とそれに
関連するシュミットトリガＳＣＱ ＳＣ２を含んでい
る。この実施例において、シフトレジスタ１５４は１５
４ａ−１５４ｅで示された５つのフリップフロップを含
む。
列Ｃ０ＬＯからＣ０Ｌ７を表わす列のビン１−８と複数
のＡＮＤゲート１５３ａ −１５３ｈの間に配置された
プルアップ抵抗器の各々は、抵抗、Ｉｉｆ！解効果トラ
ンジスタ（ＦＥＴ）、およびインバータを含んでいる。
のＡＮＤゲート１５３ａ −１５３ｈの間に配置された
プルアップ抵抗器の各々は、抵抗、Ｉｉｆ！解効果トラ
ンジスタ（ＦＥＴ）、およびインバータを含んでいる。
さらに、シュミットトリガ１８０はＣＭＤ信号を受信す
るために設けられている。シュミットトリガ１８０は雑
音裕度すなわち外部からの干渉信号の減少のために与え
られている。シュミットトリガ１８０は次にインバータ
１８２に接続されており、その出力はクロックＣＬＫ信
号である。さらに、ＣＭＤ信号はコマンド微分回路手段
１５６に接続されている。この実施例における微分回路
手段１５６は、トリステートドライバ１５８．シュミッ
トトリガ１６０．抵抗１６２．およびキャパシタ１６４
を含んでいる。
るために設けられている。シュミットトリガ１８０は雑
音裕度すなわち外部からの干渉信号の減少のために与え
られている。シュミットトリガ１８０は次にインバータ
１８２に接続されており、その出力はクロックＣＬＫ信
号である。さらに、ＣＭＤ信号はコマンド微分回路手段
１５６に接続されている。この実施例における微分回路
手段１５６は、トリステートドライバ１５８．シュミッ
トトリガ１６０．抵抗１６２．およびキャパシタ１６４
を含んでいる。
さらに具体的には、インバータ１８２の出力はトリステ
ートドライバ１５８の制御入力に接続されており、ドラ
イバ１５８の出力は抵抗１６２とキャパシタ１６４から
なるタイミング回路に接続されている。ドライバ１５８
の出力はシュミットトリガ１６０にも接続されており、
シュミットトリガ１６０はその入力が２．５ボルトを越
えれば低レベル信号を出力するように構成されている。
ートドライバ１５８の制御入力に接続されており、ドラ
イバ１５８の出力は抵抗１６２とキャパシタ１６４から
なるタイミング回路に接続されている。ドライバ１５８
の出力はシュミットトリガ１６０にも接続されており、
シュミットトリガ１６０はその入力が２．５ボルトを越
えれば低レベル信号を出力するように構成されている。
したがって、シュミットトリガ１６０は電圧コンパレー
タとして働く。シュミットトリガ１６０の出力はＣＬＲ
信号である。トリステートドライバ１５８は高インピー
ダンス出力装置であって、ＣＬＫ信号が高レベルのとき
にその出力は低レベルであって、キャパシタ１６４の電
圧を放電させる。
タとして働く。シュミットトリガ１６０の出力はＣＬＲ
信号である。トリステートドライバ１５８は高インピー
ダンス出力装置であって、ＣＬＫ信号が高レベルのとき
にその出力は低レベルであって、キャパシタ１６４の電
圧を放電させる。
もしＣＬＫ信号が低レベルであれば、その持続時間が長
いか短いかにかかわらず、トリステートドライバ１５８
は抵抗１６２とキャパシタ１６４から分離され、そして
キャパシタ１６４の充電を可能にする。さらに、インバ
ータ１８４，１８６゜および１８８が与えられている。
いか短いかにかかわらず、トリステートドライバ１５８
は抵抗１６２とキャパシタ１６４から分離され、そして
キャパシタ１６４の充電を可能にする。さらに、インバ
ータ１８４，１８６゜および１８８が与えられている。
動作において、ＣＭＤ信号はシュミットトリガ１８０に
よって受取られ、その出力は次にインバータ１８２によ
って反転される。もしＣＭＤ信号が長い持続時間のパル
スであれば、キャパシタ１６４は５ボルトに向かって充
電する。キャパシタの電圧が２．５ボルトを越えるとき
、シュミットトリガ１６０が活性化され、両方のシフト
レジスタ１５０と１５４にＣＬＲ信号を生じる。この信
号がシフトレジスタによって受取られる前に、ＣＬＲ信
号はインバータ１８４と１８６によって反転される。も
しＣＭＤ信号が短い持続時間のパルスであれば、インバ
ータ１８２の出力はクロックＣＬＫ信号として働く。
よって受取られ、その出力は次にインバータ１８２によ
って反転される。もしＣＭＤ信号が長い持続時間のパル
スであれば、キャパシタ１６４は５ボルトに向かって充
電する。キャパシタの電圧が２．５ボルトを越えるとき
、シュミットトリガ１６０が活性化され、両方のシフト
レジスタ１５０と１５４にＣＬＲ信号を生じる。この信
号がシフトレジスタによって受取られる前に、ＣＬＲ信
号はインバータ１８４と１８６によって反転される。も
しＣＭＤ信号が短い持続時間のパルスであれば、インバ
ータ１８２の出力はクロックＣＬＫ信号として働く。
両方のシフトレジスタの最初のフリップフロップである
フリップ７０ツブ１５０ａとフリップ７０ツブ１５４ａ
を除いて、残りのフリップフロップはＣＬＲ信号によっ
てクリアされる。フリップフロップ１５０ａと１５４８
はセットダイレクト（ＳＤ）フリップフロップであり、
すなわちそれらはＣＬＲ信号を受取ったときにそれらの
出力に高レベル信号を生じる。残りのフリップフロップ
はクリアダイレクト（ＣＤ）フリップフロップであって
、ＣＬＲ信号を受取ったときに低レベル信号を生じる。
フリップ７０ツブ１５０ａとフリップ７０ツブ１５４ａ
を除いて、残りのフリップフロップはＣＬＲ信号によっ
てクリアされる。フリップフロップ１５０ａと１５４８
はセットダイレクト（ＳＤ）フリップフロップであり、
すなわちそれらはＣＬＲ信号を受取ったときにそれらの
出力に高レベル信号を生じる。残りのフリップフロップ
はクリアダイレクト（ＣＤ）フリップフロップであって
、ＣＬＲ信号を受取ったときに低レベル信号を生じる。
これらのフリップフロップの出力の各々はオーブンコレ
クタドライバを含む。
クタドライバを含む。
ここで、フリップフロップ１５０ａの負の出力０は負の
信号を行ＲＯＷＯに送り、行ＲＯＷＯに接続されている
アレイ１３２のすべてのキーの感知を可能にする。フリ
ップ７０ツブ１５４ａの出力Ｑに存在する高レベル信号
はＡＮＤゲート１５３ａとプルアップ抵抗器Ｒｃｏに入
力される。各プルアップ抵抗器の動作は以下のようであ
る。インバータはまず受取られた高レベル信号を反転し
てＦＥＴを活性化する。次に、これは５ボルトの電源か
ら抵抗器への電流を許す。もし行〇−列Ｏの位置のキー
が押し下げられていたならば、行ＲＯＷＯ上の低レベル
信号は列Ｃ０ＬＯ上で感知され、次にそれは関連するシ
ュミットトリガによって高レベル信号として出力される
。すなわち、列Ｃ０ＬＯに接続されたその特定のキーの
みが感知される。或る特定の行のすべてのキーが不注意
に押し下げられた場合には、その行に関する列Ｃ０１０
位置のみが活性化される。
信号を行ＲＯＷＯに送り、行ＲＯＷＯに接続されている
アレイ１３２のすべてのキーの感知を可能にする。フリ
ップ７０ツブ１５４ａの出力Ｑに存在する高レベル信号
はＡＮＤゲート１５３ａとプルアップ抵抗器Ｒｃｏに入
力される。各プルアップ抵抗器の動作は以下のようであ
る。インバータはまず受取られた高レベル信号を反転し
てＦＥＴを活性化する。次に、これは５ボルトの電源か
ら抵抗器への電流を許す。もし行〇−列Ｏの位置のキー
が押し下げられていたならば、行ＲＯＷＯ上の低レベル
信号は列Ｃ０ＬＯ上で感知され、次にそれは関連するシ
ュミットトリガによって高レベル信号として出力される
。すなわち、列Ｃ０ＬＯに接続されたその特定のキーの
みが感知される。或る特定の行のすべてのキーが不注意
に押し下げられた場合には、その行に関する列Ｃ０１０
位置のみが活性化される。
押し下げられたキーを通って流れている電流のすべてを
受入れる能力を有するために、各行のビンに関係付けら
れたドライバを必要とする代わりに、チップ１４６の行
のビンの各々はただ１つの電流を受取る能力を有する必
要があるだけである。
受入れる能力を有するために、各行のビンに関係付けら
れたドライバを必要とする代わりに、チップ１４６の行
のビンの各々はただ１つの電流を受取る能力を有する必
要があるだけである。
これは、高電流を受入れることができる出力ドライバを
用いる必要性を排除してコストを最小にする。なぜなら
ば、低電流のドイイバが必要とされるだけだからである
。
用いる必要性を排除してコストを最小にする。なぜなら
ば、低電流のドイイバが必要とされるだけだからである
。
フリップフロップ１５４ａの高レベル信号に接続された
シュミットトリガＳｅａの高レベル信号は、ＡＮＤゲー
ト１５３ａに高レベル信号を出力させる。したがって、
マスタＯＲゲート１５３１によって高レベル信号が生ぜ
られ、次にそれは百ＡＴＡ信号として転送される前にイ
ンバータ１６８によって反転される。
シュミットトリガＳｅａの高レベル信号は、ＡＮＤゲー
ト１５３ａに高レベル信号を出力させる。したがって、
マスタＯＲゲート１５３１によって高レベル信号が生ぜ
られ、次にそれは百ＡＴＡ信号として転送される前にイ
ンバータ１６８によって反転される。
この様式において、続＜ＣＬＫ信号はシフトレジスタ１
５４をインクリメントし、すなわちフリップフロップ１
５４ａの高レベル信号がシフトレジスタ１５４を通って
伝播するようにさせる。フリップフロップ１５４ａ −
１５４ｄは一時に１つのパルスを伝播させることができ
る従来のＤタイプのフリップフロップ（ＤＦＦ）である
が、フリップ７０ツブ１５４ｅは本質的には従来のシフ
トレジスタであって、それはアレイ１３２の列Ｃ０Ｌ４
からＣ０Ｌ７を活性化することができる。シフトレジス
タ１５４の最上のビットすなわちフリップフロップ１５
４ｅの出力Ｑｏの最上ビットが高レベル信号のとき、そ
の信号はインバータ１８８によって反転されてクロック
パルスとしてシフトレジスタ１５０へ送られる。これは
シフトレジスタ１５０にシフトさせ、すなわちフリップ
フロップ１５０ａの高レベル信号を７リツプフロツプ１
５０ｂに伝播させ、フリップ７０ツブ１５０ｂは次にア
レイ１３２の行ＲＯＷ１を活性化する低レベル信号を生
じる。さらに、シフトレジスタ１５４の最上ビットはフ
リップフロップ１５４ａにリサイクルされて戻され、シ
フトレジスタ１５４が再びアレイ１３２の列のスキャニ
ングのシーケンスを開始するようにさせる。さらに、シ
フトレジスタ１５０と１５４のすべてのフリップ７０ツ
ブはそれらが前述の機能を実行する限り他のタイプのフ
リップ７０ツブによって置き換えられ得る。
５４をインクリメントし、すなわちフリップフロップ１
５４ａの高レベル信号がシフトレジスタ１５４を通って
伝播するようにさせる。フリップフロップ１５４ａ −
１５４ｄは一時に１つのパルスを伝播させることができ
る従来のＤタイプのフリップフロップ（ＤＦＦ）である
が、フリップ７０ツブ１５４ｅは本質的には従来のシフ
トレジスタであって、それはアレイ１３２の列Ｃ０Ｌ４
からＣ０Ｌ７を活性化することができる。シフトレジス
タ１５４の最上のビットすなわちフリップフロップ１５
４ｅの出力Ｑｏの最上ビットが高レベル信号のとき、そ
の信号はインバータ１８８によって反転されてクロック
パルスとしてシフトレジスタ１５０へ送られる。これは
シフトレジスタ１５０にシフトさせ、すなわちフリップ
フロップ１５０ａの高レベル信号を７リツプフロツプ１
５０ｂに伝播させ、フリップ７０ツブ１５０ｂは次にア
レイ１３２の行ＲＯＷ１を活性化する低レベル信号を生
じる。さらに、シフトレジスタ１５４の最上ビットはフ
リップフロップ１５４ａにリサイクルされて戻され、シ
フトレジスタ１５４が再びアレイ１３２の列のスキャニ
ングのシーケンスを開始するようにさせる。さらに、シ
フトレジスタ１５０と１５４のすべてのフリップ７０ツ
ブはそれらが前述の機能を実行する限り他のタイプのフ
リップ７０ツブによって置き換えられ得る。
インジケータカウンタ１４４の活性化については、フリ
ップフロップ１７０．第２のＤタイプフリップフロップ
１７２．およびＡＮＤゲート１７４が与えられている。
ップフロップ１７０．第２のＤタイプフリップフロップ
１７２．およびＡＮＤゲート１７４が与えられている。
これらの装置は第７図に示されているようにインジケー
タクロック信号「て［又とインジケータクリア信号Ｉ
ＣＬＲを生じる。
タクロック信号「て［又とインジケータクリア信号Ｉ
ＣＬＲを生じる。
これらの信号はスイッチアレイのスキャンシーケンスの
終わりに活性化されるように設計されている。動作にお
いて、シフトレジスタ１５０はスイッチアレイ１３２の
最後の行がスキャンされた後においてもインクリメント
され続ける。シフトレジスタ１５０がスイッチアレイの
最後のスキャンを越えて３２回インクリメントされた後
に、或る信号が出力０．に生ぜられ、それはクロックパ
ルスとしてＤＦＦＩ ７２内に入力される。これはＤＦ
Ｆｌ ７２の出力に高レベル信号を生じ、それは次にＡ
ＮＤゲート１７４内に入力される。ＡＮＤゲート１７４
の低レベルの出力は結果として生じるＩＣＬＫ信号であ
る。同時に、フリップ７０ツブ１７０の出力−は低レベ
ル信号であるｒでＴπ信号を生じる。これら２つの信号
が同時に存在すればカウンタ１４４をクリアする。さら
に９つのりＯツクパルスの後に、ＩＣＬＲ信号は不能化
される。
終わりに活性化されるように設計されている。動作にお
いて、シフトレジスタ１５０はスイッチアレイ１３２の
最後の行がスキャンされた後においてもインクリメント
され続ける。シフトレジスタ１５０がスイッチアレイの
最後のスキャンを越えて３２回インクリメントされた後
に、或る信号が出力０．に生ぜられ、それはクロックパ
ルスとしてＤＦＦＩ ７２内に入力される。これはＤＦ
Ｆｌ ７２の出力に高レベル信号を生じ、それは次にＡ
ＮＤゲート１７４内に入力される。ＡＮＤゲート１７４
の低レベルの出力は結果として生じるＩＣＬＫ信号であ
る。同時に、フリップ７０ツブ１７０の出力−は低レベ
ル信号であるｒでＴπ信号を生じる。これら２つの信号
が同時に存在すればカウンタ１４４をクリアする。さら
に９つのりＯツクパルスの後に、ＩＣＬＲ信号は不能化
される。
クリア信号がカウンタ１４４から除去された瞬間に、カ
ウンタ１４４はバイナリシーケンスを介して前進または
カウントを進める。たとえば、ＣＡＰＳ ＬＯＣＫ能
力が２進数“’１１１０”によって表わされていると仮
定して、カウンタ１４４はＬＥＤ１４３ａが活性化され
る前に１４回インクリメントされることが必要である。
ウンタ１４４はバイナリシーケンスを介して前進または
カウントを進める。たとえば、ＣＡＰＳ ＬＯＣＫ能
力が２進数“’１１１０”によって表わされていると仮
定して、カウンタ１４４はＬＥＤ１４３ａが活性化され
る前に１４回インクリメントされることが必要である。
「σ］：π信号はカウンタ１４４が８回インクリメント
した後に消失するが、ＩＣＬＫ信号はカウンタ１４４を
インクリメントするために依然として存在する。
した後に消失するが、ＩＣＬＫ信号はカウンタ１４４を
インクリメントするために依然として存在する。
カウンタ１４４の１４番目のカウントの後の長い持続時
間のＣＭＤ信号の存在によって、ＬＥＤ１４３ａがター
ンオンされる。さらに、ＣＬＲ信号がシュミットトリガ
１６０によって生ぜられ、それはＤＦＦ１７２をクリア
し、そしてＩＣＬＫ信号を不能化する。ＩＣＬＫ信号の
不存在はＣＡＰＳ ＬＯＣＫインジケータであるＬＥ
Ｄ１４３ａを正しい位置にロックする。この表示は、続
くスキャンシーケンスの終わりに向けｔクリアされるま
で正しい位置にロックされる。この様式において、ＮＵ
Ｍ ＬＯＣＫまたは５ＨＩＦＴ ＬＯＧＫのような
他の表示機能が選択され得る。たとえば、ＮＵＭ Ｌ
ＯＣＫは２進数” １０１１″であり得て、５ＨＩＦＴ
ＬＯＣＫは’ １１０１ ”であり得る。さらに、
カウンタ１４４はたとえばＣＡＰＳ ＬＯＣＫとＮＬ
ＩＭ ＬＯＣＫなどの信号シーケンスの間に多重の表
示を活性化することができる。
間のＣＭＤ信号の存在によって、ＬＥＤ１４３ａがター
ンオンされる。さらに、ＣＬＲ信号がシュミットトリガ
１６０によって生ぜられ、それはＤＦＦ１７２をクリア
し、そしてＩＣＬＫ信号を不能化する。ＩＣＬＫ信号の
不存在はＣＡＰＳ ＬＯＣＫインジケータであるＬＥ
Ｄ１４３ａを正しい位置にロックする。この表示は、続
くスキャンシーケンスの終わりに向けｔクリアされるま
で正しい位置にロックされる。この様式において、ＮＵ
Ｍ ＬＯＣＫまたは５ＨＩＦＴ ＬＯＧＫのような
他の表示機能が選択され得る。たとえば、ＮＵＭ Ｌ
ＯＣＫは２進数” １０１１″であり得て、５ＨＩＦＴ
ＬＯＣＫは’ １１０１ ”であり得る。さらに、
カウンタ１４４はたとえばＣＡＰＳ ＬＯＣＫとＮＬ
ＩＭ ＬＯＣＫなどの信号シーケンスの間に多重の表
示を活性化することができる。
第３図と第８図において、端末装置３６の出力ポートの
詳細な図解が示されている。出力ポート４０はフリップ
フロップ１９０とＡＮＤゲート１９２を含む。従来のＯ
ＦＦであるフリップ７０ツブ１９０は、マイクロプロセ
ッサ３８の出力ポート能動化信号とマイクロプロセッサ
３８の内部データラインとに接続された入力を有してい
る。ＡＮＤゲート１９２は、ＤＦＦ１９０の出力Ｑとマ
イクロプロセッサ３８の出かポート能動化信号とに接続
された入力を有している。ＡＮＤゲート１９２の出力は
ＣＭＡ信号であって、それはキーボードインターフェイ
ス手段３４に送られる。
詳細な図解が示されている。出力ポート４０はフリップ
フロップ１９０とＡＮＤゲート１９２を含む。従来のＯ
ＦＦであるフリップ７０ツブ１９０は、マイクロプロセ
ッサ３８の出力ポート能動化信号とマイクロプロセッサ
３８の内部データラインとに接続された入力を有してい
る。ＡＮＤゲート１９２は、ＤＦＦ１９０の出力Ｑとマ
イクロプロセッサ３８の出かポート能動化信号とに接続
された入力を有している。ＡＮＤゲート１９２の出力は
ＣＭＡ信号であって、それはキーボードインターフェイ
ス手段３４に送られる。
動作において、信号が端末マイクロプロセッサ３８によ
って出力されるべきとき、データラインが能動化されて
ＤＦＦ１９０がその信号にラッチするようにさせる。す
なわち、ＤＦＦ１９０の出力Ｑに信号が現われる。出力
ポート４０を活性化してキーボード３０への信号の伝送
を可能にするために、マイクロプロセッサ３８は出力ポ
ート能動化信号を生じる。高レベルの出力ポート能動化
信号とＯＦＦ出力ポートの高レベル信号の組合わされた
存在は、ＣＭＤ信号をキーボード３０に伝送させる。対
照的に、マイクロプロセッサ３日からのデータラインが
低レベルであってＤＦＦ１９０が低レベル信号を出力す
るとき、ＡＮＤゲート１９２によって低レベル信号が送
られる。好ましい実施例において、ＡＮＤゲート１９２
によって生ぜられる短い持続時間のＣＭＤ信号はそれが
キーボードインターフェイス３４に到達したときにＣＬ
Ｋ信号として働き、そのＣＭＤ信号はマイクロプロセッ
サ３８からの出力ポート能動化信号の持続時間と同一の
持続時間を有している。０ＦＦ１９０が低レベルである
期間は長持続時間のＣＭＤ信号の持続時間と同一であっ
て、キーボードインターフェイス手段３４においてＣＬ
Ｒ信号になる。
って出力されるべきとき、データラインが能動化されて
ＤＦＦ１９０がその信号にラッチするようにさせる。す
なわち、ＤＦＦ１９０の出力Ｑに信号が現われる。出力
ポート４０を活性化してキーボード３０への信号の伝送
を可能にするために、マイクロプロセッサ３８は出力ポ
ート能動化信号を生じる。高レベルの出力ポート能動化
信号とＯＦＦ出力ポートの高レベル信号の組合わされた
存在は、ＣＭＤ信号をキーボード３０に伝送させる。対
照的に、マイクロプロセッサ３日からのデータラインが
低レベルであってＤＦＦ１９０が低レベル信号を出力す
るとき、ＡＮＤゲート１９２によって低レベル信号が送
られる。好ましい実施例において、ＡＮＤゲート１９２
によって生ぜられる短い持続時間のＣＭＤ信号はそれが
キーボードインターフェイス３４に到達したときにＣＬ
Ｋ信号として働き、そのＣＭＤ信号はマイクロプロセッ
サ３８からの出力ポート能動化信号の持続時間と同一の
持続時間を有している。０ＦＦ１９０が低レベルである
期間は長持続時間のＣＭＤ信号の持続時間と同一であっ
て、キーボードインターフェイス手段３４においてＣＬ
Ｒ信号になる。
本発明の特許請求の範囲内において種々の変更がなされ
得ることが当業者にとって明らかであろう。
得ることが当業者にとって明らかであろう。
第１図はキーボードと端末装置の間の通信のための従来
の技術の実施例である。 第２図はキーボードと端末装置との間の通信のための従
来の技術のもう１つの実施例である。 第３図は本発明の４ワイヤキーボードインターフェイス
手段の簡略化されたブロック図を示すとともに、コンピ
ュータシステムの他のサブシステムとの関係を示してい
る。 第４図は第３図の４ワイヤキーボードインターフェイス
手段の概略図を示すとともに、キーボードスイッチアレ
イとの関係を示している。 第５図は第４図の４ワイヤキーボードインターフェイス
手段の簡略化されたタイミング図である。 第６図は第３図の４ワイヤキーボードインターフェイス
手段のもう１つの実施例の概略図を示すとともに、キー
ボードスイッチアレイおよびインジケータ手段との関係
を示している。 第７図は第６図の４ワイヤキーボードインターフェイス
手段の詳細な図である。 第８図は第３図の端末装置の出力ポートの詳細なブロッ
ク図である。 第９図は本発明の４ワイヤキーボードインターフェイス
手段のためのソフトウェアのフローチャートである。 図において、２９はコンピュータシステム、３０はキー
ボード、３２はスイッチアレイ、３４は４ワイヤインタ
一フエイス手段、３６は端末装置、３８はマイクロプロ
セッサ、４０は出力ポート、４２は入力ポート、４４は
インジケータを示す。 図面の浄書（重言に変更なし） ＦＩＧ、 Ｉ ＦＩＧ、２ ＦＩＧ、３ Ｄｉｒ−：＝：台Ｎ ：： ＋ ； ご ；
：ＦＩＧ、 ８ ＦＩＧ、 ９ 手続補正塵（方式） ％式％ １、事件の表示 昭和６１年特許願第２００３６号 ２、発明の名称 端末ｌｉｔとキーボードを含むコンピュータシステム３
、補正をする者 事件との関係 特許出願人 住 所 アメリカ合衆国、カリフォルニア州、サン・
ホセエヌ・ファースト・ストリート、３５４１名 称
ワイズ・テクノロジー 代表者 ヘンリー・ヴイ・モーガン ４、代理人 住 所 大阪市東区平野町２丁目８番地の１ 平野町八
千代ピル６、補正の対象 図面企図 ７、補正の内容 ａ墨で描いた図面企図を別紙のとおり。なお、内容につ
いての変更はない。 以上
の技術の実施例である。 第２図はキーボードと端末装置との間の通信のための従
来の技術のもう１つの実施例である。 第３図は本発明の４ワイヤキーボードインターフェイス
手段の簡略化されたブロック図を示すとともに、コンピ
ュータシステムの他のサブシステムとの関係を示してい
る。 第４図は第３図の４ワイヤキーボードインターフェイス
手段の概略図を示すとともに、キーボードスイッチアレ
イとの関係を示している。 第５図は第４図の４ワイヤキーボードインターフェイス
手段の簡略化されたタイミング図である。 第６図は第３図の４ワイヤキーボードインターフェイス
手段のもう１つの実施例の概略図を示すとともに、キー
ボードスイッチアレイおよびインジケータ手段との関係
を示している。 第７図は第６図の４ワイヤキーボードインターフェイス
手段の詳細な図である。 第８図は第３図の端末装置の出力ポートの詳細なブロッ
ク図である。 第９図は本発明の４ワイヤキーボードインターフェイス
手段のためのソフトウェアのフローチャートである。 図において、２９はコンピュータシステム、３０はキー
ボード、３２はスイッチアレイ、３４は４ワイヤインタ
一フエイス手段、３６は端末装置、３８はマイクロプロ
セッサ、４０は出力ポート、４２は入力ポート、４４は
インジケータを示す。 図面の浄書（重言に変更なし） ＦＩＧ、 Ｉ ＦＩＧ、２ ＦＩＧ、３ Ｄｉｒ−：＝：台Ｎ ：： ＋ ； ご ；
：ＦＩＧ、 ８ ＦＩＧ、 ９ 手続補正塵（方式） ％式％ １、事件の表示 昭和６１年特許願第２００３６号 ２、発明の名称 端末ｌｉｔとキーボードを含むコンピュータシステム３
、補正をする者 事件との関係 特許出願人 住 所 アメリカ合衆国、カリフォルニア州、サン・
ホセエヌ・ファースト・ストリート、３５４１名 称
ワイズ・テクノロジー 代表者 ヘンリー・ヴイ・モーガン ４、代理人 住 所 大阪市東区平野町２丁目８番地の１ 平野町八
千代ピル６、補正の対象 図面企図 ７、補正の内容 ａ墨で描いた図面企図を別紙のとおり。なお、内容につ
いての変更はない。 以上
Claims (28)
- （１）端末装置とキーボードを含むコンピュータシステ
ムであって、前記端末装置は前記キーボードの動作を制
御する中央制御手段を含み、前記キーボードはスイッチ
アレイを含み、前記スイッチアレイは複数の行と複数の
列を有するコンピュータシステムにおいて、 前記端末装置は前記端末中央制御手段からコマンド信号
を伝送するためのデータ出力ポートと前記キーボードか
らデータ信号を受信するためのデータ入力ポートを含み
、前記端末コマンド信号はキーボード初期設定信号とキ
ーボードインクリメント信号を含み、 前記キーボードは前記端末装置と通信するための４ワイ
ヤキーボードインターフェイス手段を含み、前記インタ
ーフェイス手段は前記キーボード初期設定信号の受信の
後に前記スイッチアレイをスキャンするためのシーケン
スの初期設定と、前記キーボードインクリメント信号の
受信の後に前記スイッチアレイの或る位置の活性化を検
知するための前記スイッチアレイの前記スキャニングと
、前記スイッチアレイの前記位置の活性化を検知した後
に前記データ信号の伝送とを容易にすることを特徴とす
る端末装置とキーボードを含むコンピュータシステム。 - （２）前記４ワイヤキーボードインターフェイス手段は
さらに、 前記スイッチアレイの前記位置の行位置を検知するため
の行選択器手段と、 前記スイッチアレイの前記位置の列位置を検知するため
の列選択器手段と、 前記４ワイヤキーボードインターフェイス手段によつて
受取られる前記コマンド信号を微分するためのコマンド
微分回路手段を含み、前記微分回路手段は前記コマンド
信号と、前記スイッチアレイをスキャンするために前記
行選択器手段と前記列選択器手段をインクリメントする
前記キーボードインクリメント信号と、前記スキャニン
グシーケンスを初期設定するための前記キーボード初期
設定信号のそれぞれの２つのタイプの信号を微分するこ
とができることを特徴とする特許請求の範囲第１項記載
のコンピュータシステム。 - （３）前記行選択器手段は、 前記スイッチアレイ位置の行位置を検知するための少な
くとも１つのデマルチプレクサ手段を含み、前記デマル
チプレクサ手段は複数の出力を有し、それらの出力の各
々は前記スイッチアレイの前記行の１つと通じており、 前記行選択器手段はさらに、 前記デマルチプレクサ手段の動作を制御するためのカウ
ンタ手段を含み、前記カウンタ手段は前記コマンド信号
の両方のタイプの信号を受取るようにされていることを
特徴とする特許請求の範囲第２項記載のコンピュータシ
ステム。 - （４）前記列選択器手段は、 前記スイッチアレイ位置の列位置を検知するための少な
くとも１つのマルチプレクサ手段を含み、前記マルチプ
レクサ手段は複数の入力を有し、それらの入力の各々は
前記スイッチアレイの前記列の１つと通じており、前記
マルチプレクサ手段は前記データ信号を生じるようにさ
れており、前記列選択器手段はさらに、 前記マルチプレクサ手段の動作を制御するためのカウン
タ手段を含み、前記カウンタ手段は前記コマンド信号の
両方のタイプの信号を受取るようにされていることを特
徴とする特許請求の範囲第２項記載のコンピュータシス
テム。 - （５）前記コマンド微分回路手段は、 前記コマンド信号の持続時間を微分するための信号持続
時間微分手段を含み、前記コマンド信号の２つのタイプ
の信号の持続時間は異なっており、前記コマンド微分回
路手段はさらに、 前記スキャニングシーケンスを初期設定するための初期
設定手段を含むことを特徴とする特許請求の範囲第２項
記載のコンピュータシステム。 - （６）前記行選択器手段は、 前記スイッチアレイ位置の行位置を検知するための少な
くとも１つのデマルチプレクサ手段を含み、前記デマル
チプレクサ手段は複数の出力を有し、それらの出力の各
々は前記スイッチアレイの前記行の１つと通じており、
前記行選択器手段はさらに前記デマルチプレクサ手段の
動作を制御するためのカウンタ手段を含み、前記カウン
タ手段は前記コマンド信号の両方のタイプを受取るよう
にされており、前記行選択器手段はさらに前記デマルチ
プレクサ手段を能動化するためのインバータ手段を含み
、 前記列選択器手段は、 前記スイッチアレイ位置の列位置を検知するための少な
くとも１つのマルチプレクサ手段を含み、前記マルチプ
レクサ手段は複数の入力を有し、それらの入力の各々は
前記スイッチアレイの前記列の１つに通じており、前記
マルチプレクサ手段は前記データ信号を生じるようにさ
れており、前記カウンタ手段は前記マルチプレクサ手段
の動作を制御するようにされており、前記列選択器手段
はさらに前記データ信号を増幅するためのドライバ手段
を含み、 前記コマンド微分回路手段は、 インバータ手段、抵抗器手段、キャパシタ手段、および
前記キーボード初期設定信号を伝送するためのコンパレ
ータ手段を含むことを特徴とする特許請求の範囲第２項
記載のコンピュータシステム。 - （７）前記キーボードはさらに、 インジケータ手段を含むことを特徴とする特許請求の範
囲第１項、第２項、または第６項のいずれかの項に記載
されたコンピュータシステム。 - （８）前記行選択器手段は、 シフトレジスタ手段を含み、前記シフトレジスタ手段は
前記スイッチアレイの行をシーケンシャルにスキャンす
るようにされていることを特徴とする特許請求の範囲第
２項記載のコンピュータシステム。 - （９）前記シフトレジスタ手段は、 複数のフリップフロップ手段を含み、前記フリップフロ
ップ手段の１つは前記キーボード初期設定信号を受取つ
たときに１つのタイプの出力を生じる特性を有し、前記
フリップフロップ手段の残りのものは前記キーボード初
期設定信号を受取ったときにもう１つのタイプの出力を
生じる特性を有していることを特徴とする特許請求の範
囲第８項記載のコンピュータシステム。 - （１０）前記列選択器手段は、 複数のＡＮＤ機能装置を含み、前記装置は前記スイッチ
アレイの列をシーケンシャルにスキャンするようにされ
ており、 前記列選択器手段はさらに、 前記データ信号を生じるためのマスタＯＲ機能装置含む
ことを特徴とする特許請求の範囲第２項記載のコンピュ
ータシステム。 - （１１）前記４ワイヤキーボードインターフェイス手段
はさらに、 前記行選択器手段と前記列選択器手段の動作を制御する
ためのカウンタ手段を含むことを特徴とする特許請求の
範囲第２項、第８項、第９項、または第１０項のいずれ
かの項に記載されたコンピュータシステム。 - （１２）前記カウンタ手段は、 複数のフリップフロップ手段を含み、前記フリップフロ
ップ手段の１つは前記キーボード初期設定信号を受取っ
たときに１つのタイプの出力を生じる特性を有し、前記
フリップフロップ手段の残りのものは前記キーボード初
期設定信号を受取ったときにもう１つのタイプの出力を
生じる特性を有していることを特徴とする特許請求の範
囲第１１項記載のコンピュータシステム。 - （１３）前記４ワイヤキーボードインターフェイス手段
はさらに、 複数の電流保護手段を含み、それらの各々は前記列選択
器手段の前記ＡＮＤ機能装置の１つと通じており、前記
電流保護手段は抵抗器手段、インバータ手段、およびト
ランジスタ手段を含み、前記４ワイヤキーボードインタ
ーフェイス手段はさらに、 伝送手段を含むことを特徴とする特許請求の範囲第２項
または第１０項記載のコンピュータシステム。 - （１４）前記行選択器手段は、 前記スイッチアレイの行をシーケンシャルにスキャンす
るためのシフトレジスタ手段を含み、前記シフトレジス
タ手段は複数のフリップフロップ手段を含み、前記フリ
ップフロップ手段の１つは前記キーボード初期設定信号
を受取ったときに１つのタイプの出力を生じる特性を有
し、前記フリップフロップ手段の残りのものは前記キー
ボード初期設定信号を受取つたときにもう１つのタイプ
の出力を生じる特性を有し、 前記列選択器手段は、 前記スイッチアレイの列をシーケンシャルにスキャンす
るための複数のＡＮＤ機能装置と、前記データ信号を生
じるためのマスタＯＲ機能装置を含み、 前記コマンド微分回路手段は、 前記コマンド信号の持続時間を微分するための信号持続
時間微分手段を含み、前記コマンド信号の２つのタイプ
の持続時間は異なっており、前記信号持続時間微分手段
は抵抗器手段、キャパシタ手段、およびドライバ手段を
含み、前記コマンド微分回路手段はさらに前記キーボー
ド初期設定信号を伝送するための初期設定手段を含み、
前記初期設定手段はコンパレータ手段を含み、 前記４ワイヤキーボードインターフェイス手段はさらに
、 前記行選択器手段と前記列選択器手段の動作を制御する
ためのカウンタ手段を含み、前記カウンタ手段は複数の
フリップフロップ手段を含み、前記フリップフロップ手
段の１つは前記キーボード初期設定信号を受取ったとき
に１つのタイプの出力を生じる特性を有し、前記フリッ
プフロップ手段の残りのものは前記キーボード初期設定
信号を受取つたときにもう１つのタイプの出力を生じる
特性有し、前記４ワイヤキーボードインターフェイス手
段はさらに複数の電流保護手段を含み、それらの保護手
段の各々は前記列選択器手段の前記ＡＮＤ機能装置の１
つと通じており、前記電流保護手段は抵抗器手段、イン
バータ手段、トランジスタ手段、および伝送手段を含む
ことを特徴とする特許請求の範囲第２項記載のコンピュ
ータシステム。 - （１５）前記４ワイヤキーボードインターフェイス手段
はさらに、 前記キーボードの特定の特徴を表示するためのインジケ
ータ手段と、 前記インジケータ手段を制御するためのインジケータ制
御手段を含むことを特徴とする特許請求の範囲第１項、
第２項、または第１４項のいずれかの項に記載されたコ
ンピュータシステム。 - （１６）前記インジケータ制御手段は、 複数のフリップフロップ手段とＡＮＤ機能装置を含み、
前記フリップフロップ手段と前記ＡＮＤ機能装置はイン
ジケータ初期設定信号とインジケータ動作信号を生じる
ようにされていることを特徴とする特許請求の範囲第１
５項記載のコンピュータシステム。 - （１７）前記インジケータ手段は、 前記特定の特徴を作動させるためのカウンタ手段と、 複数の表示手段を含み、それらの表示手段の各々は前記
特定の特徴の１つの活性化を確認し、前記インジケータ
手段はさらに、 複数の抵抗器手段を含むことを特徴とする特許請求の範
囲第１５項記載のコンピュータシステム。 - （１８）前記インジケータ制御手段は、 複数のフリップフロップ手段とＡＮＤ機能装置を含み、
前記フリップフロップ手段と前記ＡＮＤ機能装置はイン
ジケータ初期設定信号とインジケータ動作信号を生じる
ようにされていることを特徴とする特許請求の範囲第１
７項記載のコンピュータシステム。 - （１９）前記端末装置の前記データ出力ポートは、 前記コマンド信号の前記２つのタイプを生じるためのフ
リップフロップ手段とＡＮＤ機能手段を含むことを特徴
とする特許請求の範囲第１項、第２項、第６項、または
第１４項のいずれかの項に記載されたコンピュータシス
テム。 - （２０）キーボードと端末装置との間の通信に用いられ
るインターフェイスであって、キーボードと端末装置は
多くても４つのワイヤで接続されており、キーボードは
マイクロプロセッサと並直列データ変換装置のいずれを
も含まないインターフェイスにおいて、前記インターフ
ェイスは、行と列のアレイとして配列された複数のスイ
ッチを有するスイッチアレイと、 キーボード初期設定信号のシーケンスを生じるためのコ
マンド信号手段と、 スイッチアレイにおいて選択されたスイッチの活性化を
検知するために、キーボード初期設定信号のシーケンス
に応答してスイッチアレイ内の各スイッチをシーケンシ
ャルにスキャンするためのスキャニング手段を含むこと
を特徴とするキーボードと端末装置との間の通信に用い
られるインターフェイス。 - （２１）キーボードとホストとの間の通信のためのキー
ボードインターフェイスであって、それはホスト内にイ
ンターフェイスの第１の部分を有するとともにキーボー
ド内にインターフェイスの第２の部分を有し、そして４
以下のワイヤによって接続されており、その１つのワイ
ヤは電力を供給してもう１つのワイヤはアースに接続し
ているが、並列データの直列形態への変換のためのＵＡ
ＲＴまたは他の装置を必要としないとともにインターフ
ェイスの第２の部分においてマイクロプロセッサを必要
としないキーボードインターフェイスにおいて、前記キ
ーボードインターフェイスは、 スキャンシーケンスを生じるためのホスト内のコマンド
信号手段と、 行と列に配列されたキーボード内のキースイッチのアレ
イと、 アレイの各キーをアドレスするためにスキャンシーケン
スに応答するキーボード内のスキャンシーケンス手段を
含み、スキャンシーケンス手段はカウンタ手段を含み、 前記キーボードインターフェイスはさらに、スキャンさ
れたキーが押し下げられていたときに信号をホストに与
えるための出力手段を含むことを特徴とするキーボード
とホストとの間の通信のためのキーボードインターフェ
イス。 - （２２）端末装置との通信のために４以下のワイヤを必
要とするが、ＵＡＲＴまたは他の直並列データ変換装置
あるいはキーボード内のマイクロプロセッサを必要とし
ないキーボード構成であって、ワイヤの２つは電源とア
ースに接続しているキーボード構成において、前記キー
ボード構成は、 端末装置内に存在するインターフェイスの第１の部分を
含み、その第１の部分は少なくとも２つのタイプのコマ
ンド信号を生じることができるコマンドシーケンス手段
を含み、 前記キーボード構成はさらに、 キーボード内に存在するインターフェイスの第２の部分
を含み、その第２の部分は、 複数のキースイッチと、 少なくとも或るコマンド信号に応答するコマンド微分回
路手段と、 選択されたキースイッチが押し下げられているか否かを
判断するために各キースイッチをシーケンシャルにモニ
タするためにコマンド微分回路手段に応答するスキャン
シーケンス手段と、 選択されたキースイッチが押し下げられているか否かを
知らせるための出力手段とを含み、前記キーボード構成
はさらに、 インターフェイスの第２の部分へインターフェイスの第
１の部分を接続する接続手段を含み、その接続手段はコ
マンド信号をインターフェイスの第２の部分に送るため
と出力手段から信号を受取るために多くとも４つのワイ
ヤを含むことを特徴とするキーボード構成。 - （２３）接続手段の４つのワイヤの２つはインターフェ
イスの第２の部分に電力とアースを与えることを特徴と
する特許請求の範囲第２２項記載のキーボード構成。 - （２４）キーボードとホストとの間の通信のためのキー
ボードインターフェイスであって、前記キーボードイン
ターフェイスは、 ホスト内に存在するインターフェイスの第１の部分を含
み、その第１の部分はコマンド信号を生じるとともにデ
ータ信号を受取るためにマイクロプロセッサを含み、 前記キーボードインターフェイスはさらに、キーボード
内に存在するインターフェイスの第２の部分を含み、そ
の第２の部分は、 スイッチのアレイと、 スイッチが閉じられているかまたは開いているかを判断
するために、アレイの少なくとも１つの選択されたスイ
ッチを問いただすためにインターフェイスの第１の部分
からのコマンド信号に応答するコマンド信号手段と、 もし少なくとも１つの選択されたスイッチが閉じられて
いたならばデータ信号を生じるデータ出力手段を含み、
前記データ信号は少なくとも１つの選択されたスイッチ
が閉じられているか開いているかを表わす信号の印を含
み、 前記キーボードインターフェイスはさらに、データ出力
手段からインターフェイスの第１の部分へデータ信号を
通信するために、ホストからキーボードへの４以下のワ
イヤを有する接続手段を含み、それらのワイヤの２つは
電力とアースを与えることを特徴とするキーボードとホ
ストとの間の通信のためのキーボードインターフェイス
。 - （２５）インターフェイスの第１の部分は少なくとも２
つのタイプのコマンド信号を生じることができ、コマン
ド信号手段は２つのタイプのコマンド信号間で微分する
とともに、第１のタイプのコマンド信号に応答して少な
くとも１つの選択されたスイッチを問いただし、かつ第
２のタイプのコマンド信号に応答してインターフェイス
の第２の部分をクリアすることを特徴とする特許請求の
範囲第２４項記載のキーボードインターフェイス。 - （２６）インターフェイスの第１の部分はコマンド信号
手段が第２のタイプのコマンド信号を生じる前にアレイ
の各スイッチを問い正すようにさせることを特徴とする
特許請求の範囲第２５項記載のキーボードインターフェ
イス。 - （２７）キーボードとホストを有するコンピュータシス
テムであって、キーボードは各々が固有のスイッチに関
係付けられた複数のキーを含むがマイクロプロセッサを
含まずかつホストはマイクロプロセッサを含み、そして
ホストは最大で４のワイヤを介してキーボードに接続さ
れているコンピュータシステムにおいて、キーボード上
のキーストロークをホストに通信する方法であって、前
記方法は、 ホストからスキャンシーケンスを生じ、 スキャンシーケンスに応答して、選択されたキーに関係
付けられたスイッチが閉じられているか否かを判断する
ためにキーボード上の複数のキーの各々を問いただし、 選択されたキーに関係付けられたスイッチが閉じられて
いいたか否かを表わす信号を１つのワイヤでホストに与
えるステップを含むことを特徴とするキーボード上のキ
ーストロークをホストに通信する方法。 - （２８）キーボードと端末装置との間の通信のために用
いられるインターフェイスであって、多くとも４つのワ
イヤがキーボードを端末装置に接続するインターフェイ
スにおいて、前記インターフェイスは、 端末装置内のコマンド信号発生手段を含み、それはキー
ボード内に含まれる複数のキーを問いただすためにクロ
ック手段を含み、 前記インターフェイスはさらに、 複数のキーの最後のものが問いただされたときを確認す
るためのクロック手段に応答して、その後に１以上のイ
ンジケータ手段を作動させるためにクロック手段に応答
するカウンタ手段を含むことを特徴とするキーボードと
端末装置との間の通信のために用いられるインターフェ
イス。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US06/696,261 US4706068A (en) | 1985-01-30 | 1985-01-30 | Four wire keyboard interface |
| US696261 | 1985-01-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61275923A true JPS61275923A (ja) | 1986-12-06 |
Family
ID=24796343
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61020036A Pending JPS61275923A (ja) | 1985-01-30 | 1986-01-30 | 端末装置とキ−ボ−ドを含むコンピユ−タシステム |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4706068A (ja) |
| EP (1) | EP0190887B1 (ja) |
| JP (1) | JPS61275923A (ja) |
| AU (1) | AU595496B2 (ja) |
| CA (1) | CA1264095A (ja) |
| DE (1) | DE3683168D1 (ja) |
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