JPS61195636U - - Google Patents
Info
- Publication number
- JPS61195636U JPS61195636U JP8027685U JP8027685U JPS61195636U JP S61195636 U JPS61195636 U JP S61195636U JP 8027685 U JP8027685 U JP 8027685U JP 8027685 U JP8027685 U JP 8027685U JP S61195636 U JPS61195636 U JP S61195636U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- resistor
- voltage
- turned
- power supply
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 5
Landscapes
- Electronic Switches (AREA)
Description
第１図及び第２図は夫々本考案回路の一実施例
の回路図及びその信号波形図、第３図は本考案回
路の他の実施例の回路図、第４図及び第５図は夫
々従来回路の一例の回路図及びその信号波形図で
ある。 ３，４……リセツトパルス出力端子、Ｔｒ１，
Ｔｒ２……トランジスタ、Ｒ１〜Ｒ５……抵抗、
ＺＤ……ツエナーダイオード。
の回路図及びその信号波形図、第３図は本考案回
路の他の実施例の回路図、第４図及び第５図は夫
々従来回路の一例の回路図及びその信号波形図で
ある。 ３，４……リセツトパルス出力端子、Ｔｒ１，
Ｔｒ２……トランジスタ、Ｒ１〜Ｒ５……抵抗、
ＺＤ……ツエナーダイオード。
Claims (1)
- 電源端子間に第１の抵抗と定電圧素子と第２の
抵抗とをこの順で直列に接続し、該第１の抵抗と
該定電圧素子との接続点に第１のトランジスタの
ベースを接続し、該第１のトランジスタのコレク
タに第２のトランジスタのベースを接続し、該第
２のトランジスタのコレクタにリセツトパルス出
力端子を接続すると共に第３の抵抗を介して上記
第２の抵抗と上記定電圧素子との接続点を接続し
、上記第２のトランジスタのベース及びコレクタ
に夫々第４の抵抗を介して上記電源端子の一方を
接続し、上記第１及び第２のトランジスタのエミ
ツタに夫々上記電源端子の他方を接続してなり、
電源オンにより上記電源端子間電圧が第１の電圧
に達した時上記第１のトランジスタをオン、電源
オフにより上記電源端子間電圧が該第１の電圧よ
りも低い電圧に至つた時上記第１のトランジスタ
をオフするように構成したリセツトパルス発生回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8027685U JPS61195636U (ja) | 1985-05-29 | 1985-05-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8027685U JPS61195636U (ja) | 1985-05-29 | 1985-05-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61195636U true JPS61195636U (ja) | 1986-12-05 |
Family
ID=30625973
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8027685U Pending JPS61195636U (ja) | 1985-05-29 | 1985-05-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61195636U (ja) |
-
1985
- 1985-05-29 JP JP8027685U patent/JPS61195636U/ja active Pending