JPS61182325A - Transistor switch circuit - Google Patents

Transistor switch circuit

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Publication number
JPS61182325A
JPS61182325A JP60021615A JP2161585A JPS61182325A JP S61182325 A JPS61182325 A JP S61182325A JP 60021615 A JP60021615 A JP 60021615A JP 2161585 A JP2161585 A JP 2161585A JP S61182325 A JPS61182325 A JP S61182325A
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JP
Japan
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transistor
emitter
base
supply source
resistor
Prior art date
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Pending
Application number
JP60021615A
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Japanese (ja)
Inventor
Toshio Nishino
西野 寿雄
Hatsuo Matsumoto
初男 松本
Ginya Ishiguro
石黒 銀矢
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Nippon Telegraph and Telephone Corp
Tokin Corp
Original Assignee
Nippon Telegraph and Telephone Corp
Tohoku Metal Industries Ltd
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Publication date
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Abstract

PURPOSE:To protect a main switch element of a transistor (TR) switch circuit even when any DC voltage supply source is connected or any load is connected by forming a constant current drooping protection circuit with a resistor and a PNP TR and setting properly the resistor. CONSTITUTION:The constant current drooping protection circuit 7 consists of the resistor R1 and the PNP TR Q2. The resistor R1 is connected in series between the emitter of the TR Q1 and a positive side input terminal 1. The emitter of the TR Q2 is connected to the positive side input terminal 1, the base is connected to the emitter of the TR Q1 and the collector is connected to the base of the TR Q1. In setting properly the resistance value of the resistor R1, an output current I0 does not exceed the current rating of the TR Q1 in any load state.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、直流電圧供給源と負荷との電源ライン間に設
けられて、直流電圧供給源より負荷に供給される直流電
圧をオン・オフするトランジスタスイッチ回路に関する
[Detailed Description of the Invention] [Field of Industrial Application] The present invention is provided between a power supply line between a DC voltage supply source and a load, and is capable of turning on and off the DC voltage supplied from the DC voltage supply source to the load. The present invention relates to a transistor switch circuit.

〔従来の技術〕[Conventional technology]

電子機器内の直流回路においては、電源ラインをシーケ
ンス制御したり、駆動信号により直流電圧出力をオン・
オフしたりする場合がしばしば発生する。この場合、リ
レー接点もしくはトランジスタ等の半導体スイッチ素子
によりスイッチ回路を構成する必要がある。ここで、リ
レー接点を用いたスイッチ回路の場合、動作時間の遅れ
やバウンドタイム及び接点ノイズなど、電子回路内に設
けるのに望ましくない点が多々ある。一方、トランジス
タスイッチ回路は、コレクタ、エミッタ間の電圧損失が
小さく、かつオン・オフ制御が容易なだめ、現在多用さ
れている。
In DC circuits in electronic equipment, power lines are sequence-controlled and DC voltage output is turned on and off using drive signals.
It often happens that it turns off. In this case, it is necessary to configure a switch circuit using a semiconductor switch element such as a relay contact or a transistor. Here, in the case of a switch circuit using relay contacts, there are many disadvantages such as delay in operation time, bounce time, and contact noise, which are undesirable when installed in an electronic circuit. On the other hand, transistor switch circuits are currently widely used because they have low voltage loss between the collector and emitter and are easy to control on and off.

第5図は、従来のトランジスタスイッチ回路の構成を示
した回路図である。図において、1,2は直流電圧供給
源(図示せず)と接続される直流入力端子で、1がプラ
ス側入力端子、2がマイナス側入力端子である。3,4
は負荷(図示せず)と接続される直流出力端子で、3が
プラス側出力端子。
FIG. 5 is a circuit diagram showing the configuration of a conventional transistor switch circuit. In the figure, 1 and 2 are DC input terminals connected to a DC voltage supply source (not shown), 1 is a positive input terminal, and 2 is a negative input terminal. 3,4
is the DC output terminal connected to the load (not shown), and 3 is the positive output terminal.

4がマイナス側出力端子である。QlはPNP型のトラ
ンジスタで、エミッタがプラス側入力端子1に、コレク
タがプラス側出力端子3に接続されている。トランジス
タQlのベースは、駆動回路6を介してマイナス側入力
端子2及びマイナス側出力端子4に接続されている。駆
動回路6は、抵抗RcとNPN型のトランジスタQ。と
を有している。
4 is the negative output terminal. Ql is a PNP type transistor, and its emitter is connected to the positive input terminal 1 and the collector is connected to the positive output terminal 3. The base of the transistor Ql is connected to the negative input terminal 2 and the negative output terminal 4 via the drive circuit 6. The drive circuit 6 includes a resistor Rc and an NPN transistor Q. It has

トランジスタQは、エミッタがマイナス側入力端子2及
びマイナス側出力端子4に、ベースが駆動信号入力端子
5に、コレクタが抵抗Rcを介してトランジスタQlの
ベースに接続されている。又。
The transistor Q has an emitter connected to the negative input terminal 2 and the negative output terminal 4, a base connected to the drive signal input terminal 5, and a collector connected to the base of the transistor Ql via a resistor Rc. or.

トランジスタQ1のベース、エミッタ間に抵抗Rbが接
続されている。
A resistor Rb is connected between the base and emitter of the transistor Q1.

このような構成において、駆動信号入力端子5に駆動信
号が入力すると、トランジスタQのベースミ流が流れて
、トランジスタQ0は導通状態となり、トランジスタQ
lのエミッタ、コレクタ及び抵抗Rを介してトランジス
タQ1のベース電流が流れ、トランジスタQlは導通状
態となる。このトランジスタQ1の導通状態は、入力及
び出力に対しエミッタ接地形での導通であるので、極め
て低い飽和電圧となり、コレクタ、エミッタ間の電圧損
失を軽減できる。一方、駆動信号入力端子5に駆動信号
が供給されない場合、トランジスタQcは遮断状態とな
り、トランジスタQ1も遮断状態となる。
In such a configuration, when a drive signal is input to the drive signal input terminal 5, the base current of the transistor Q flows, the transistor Q0 becomes conductive, and the transistor Q
The base current of the transistor Q1 flows through the emitter and collector of L and the resistor R, and the transistor Q1 becomes conductive. Since the conduction state of the transistor Q1 is such that the emitter is grounded to the input and output, the saturation voltage is extremely low, and the voltage loss between the collector and the emitter can be reduced. On the other hand, when the drive signal is not supplied to the drive signal input terminal 5, the transistor Qc is in a cut-off state, and the transistor Q1 is also in a cut-off state.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

しかしながら、第5図に示したトランジスタスイッチ回
路において、トランジスタQlが導通状態、す、なわち
オンのとき、直流出力端子3,4間を短絡した場合、ト
ランジスタQ1の直流電流増幅率をり、。4.直流入力
端子1,2間の電圧をvinとすれば、トランジスタQ
1のベース電流はv1n/Rcで表わされ、トランジス
タQ1のコレクタ電流。
However, in the transistor switch circuit shown in FIG. 5, when the transistor Ql is in a conductive state, that is, on, and the DC output terminals 3 and 4 are short-circuited, the DC current amplification factor of the transistor Q1 is reduced. 4. If the voltage between DC input terminals 1 and 2 is vin, the transistor Q
1's base current is expressed as v1n/Rc, which is the collector current of transistor Q1.

すなわち出力電流工oがhFE1×(vin/Rρとな
る時点でトランジスタQlは飽和動作状態からリニア動
作状態へと移行し、第6図に示される如く、直流出力端
子3.4間に現われる出力電圧voが降下しはじめる。
That is, at the point when the output current 0 becomes hFE1×(vin/Rρ), the transistor Ql shifts from the saturated operating state to the linear operating state, and as shown in FIG. 6, the output voltage appearing between the DC output terminals 3 and 4 vo begins to fall.

この時点でコレクタ損失が急増したりコレクタ電流定格
をオーバーして、トランジスタQ1は永久破損してしま
う。
At this point, the collector loss increases rapidly or exceeds the collector current rating, and the transistor Q1 is permanently damaged.

そのため、上記破損を防止するために、トランジスタス
イッチ回路の給電側に出力電流I。がhF8.×(vi
n/Rc)以下となるような電子的な電流制限回路を具
備して、トランジスタQ1が常に安全動作領域(以下、
 ASOと略す)内で動作するようにする必要があった
Therefore, in order to prevent the above damage, an output current I is applied to the power supply side of the transistor switch circuit. is hF8. ×(vi
The transistor Q1 is always kept within a safe operating area (hereinafter referred to as
It was necessary to make it work within the ASO (abbreviated as ASO).

しかし、直流電圧供給源がパシテリーの場合には、給電
電流能力が半導体の定格に比較して十分に大きいため、
上記電子的な電流制限回路を給電側に設けることは不可
能であった。又、バッテリーとトランジスタスイッチ回
路の間に直列に保護用ヒユーズを設けたとしても、電源
インピーダンスが十分に低いため、保護用ヒユーズが各
所する前に、トランジスタQ1はASOをオーバーし永
久破損してしまう。
However, if the DC voltage supply source is passive, the power supply current capacity is sufficiently large compared to the semiconductor rating, so
It has been impossible to provide the above-mentioned electronic current limiting circuit on the power supply side. Also, even if a protective fuse is installed in series between the battery and the transistor switch circuit, the power impedance is sufficiently low that transistor Q1 will exceed the ASO and be permanently damaged before the protective fuses are installed. .

このように、従来のトランジスタスイッチ回路では、出
力短絡や過負荷時に、トランジスタのASOが狭いこと
と相まって、トランジスタの永久破損が起ってしまうと
いう欠点があった。
As described above, the conventional transistor switch circuit has the disadvantage that, in the event of an output short circuit or overload, the transistor is permanently damaged due to the narrow ASO of the transistor.

〔問題点を解決するための手段及び作用〕本発明による
トランジスタスイッチ回路の1つは、直流電圧供給源と
負荷との電源ライン間に設けられて、前記直流電圧供給
源のプラス側にエミッタが、前記負荷側のプラス側にコ
レクタが接続されるPNP型の第1のトランジスタを有
し、該第1のトランジスタのベースが、該第1のトラン
ジスタをオン・オフ制御するための駆動回路を介して、
前記直流電圧供給源及び前記負荷側のマイナス側に接続
され、前記直流電圧供給源より前記負荷に供給される直
流電圧をオン・オフするようにしたトランジスタスイッ
チ回路において・、前記直流電圧供給源のプラス側と前
記第1のトランジスタのエミッタ間に直列に挿入接続さ
れた抵抗器と。
[Means and effects for solving the problems] One of the transistor switch circuits according to the present invention is provided between a power supply line between a DC voltage supply source and a load, and has an emitter on the positive side of the DC voltage supply source. , has a PNP type first transistor whose collector is connected to the positive side of the load side, and the base of the first transistor is connected to the drive circuit for controlling on/off of the first transistor. hand,
In a transistor switch circuit connected to the negative side of the DC voltage supply source and the load side and configured to turn on/off the DC voltage supplied from the DC voltage supply source to the load, a resistor inserted and connected in series between the positive side and the emitter of the first transistor;

前記直流電圧供給源のプラス側にエミッタが、前記第1
のトランジスタのエミッタ側にベースが。
an emitter on the positive side of the DC voltage supply source;
The base is on the emitter side of the transistor.

かつ前記第1のトランジスタのベース側にコレクタがそ
れぞれ接続されたPNP型の第2のトランジスタを有す
ることを特徴とする。
The device is characterized in that it includes a PNP type second transistor whose collector is connected to the base side of the first transistor.

このような構成において、抵抗器の抵抗値を適当に選ぶ
ことにより、出力電流が増加すると、第1のトランジス
タがASOをオーバーする前に、第2のトランジスタが
能動状態となって第1のトランジスタのベース電流が抑
制され、定電流垂下特性を呈して第1のトランジスタが
その電流定格を越えないようにできる。
In such a configuration, by appropriately selecting the resistance value of the resistor, when the output current increases, the second transistor becomes active and the first transistor becomes active before the first transistor exceeds the ASO. The base current of the first transistor is suppressed and exhibits constant current droop characteristics to prevent the first transistor from exceeding its current rating.

本発明によるトランジスタスイッチ回路の他の1つは、
直流電圧供給源と負荷との電源ライン間に設けられて、
前記直流電圧供給源のプラス側にエミッタが、前記負荷
側のプラス側にコレクタが接続されるPNP型の第1の
トランジスタを有し。
Another transistor switch circuit according to the present invention is
Provided between the power line between the DC voltage supply source and the load,
A PNP type first transistor has an emitter connected to the positive side of the DC voltage supply source and a collector connected to the positive side of the load side.

該第1のトランジスタのベースが、該第1のトランジス
タをオン・オフ制御するための、駆動回路を介して、前
記直流電圧供給源及び前記負荷側のマイナス側に接続さ
れ、前記直流電圧供給源より前記負荷に供給される直流
電圧をオン・オフするようにしたトランジスタスイッチ
回路において、前記直流電圧供給源のプラス側と前記第
1のトランジスタのエミッタ間に直列に挿入接続された
第1の抵抗器と、前記直流電圧供給源のプラス側にエミ
ッタが、前記第1のトランジスタのエミッタに第1のダ
イオードを介してベースが、かつ前記第1のトランジス
タのベース側に第2のダイオードを介してコレクタがそ
れぞれ接続されたPNP型の第2のトランジスタと、前
記直流電圧供給源のマイナス側にエミッタが、前記第2
のトランジスタのコレクタに第2の抵抗器を介してベー
スが、かつ前記第2のトランジスタのベースに第3の抵
抗器を介してコレクタがそれぞれ接続されたNPN型の
第3のトランジスタを有することを特徴とする。
The base of the first transistor is connected to the DC voltage supply source and the negative side of the load side via a drive circuit for controlling on/off of the first transistor, and the DC voltage supply source In the transistor switch circuit configured to turn on and off the DC voltage supplied to the load, a first resistor inserted and connected in series between the positive side of the DC voltage supply source and the emitter of the first transistor; an emitter connected to the positive side of the DC voltage supply source, a base connected to the emitter of the first transistor via a first diode, and a base connected to the base side of the first transistor via a second diode. a PNP type second transistor having collectors connected to each other, and an emitter connected to the negative side of the DC voltage supply source;
a third transistor of an NPN type, the base of which is connected to the collector of the transistor through a second resistor, and the collector of which is connected to the base of the second transistor through a third resistor; Features.

このような構成において、第1の抵抗器の抵抗値を適当
に選ぶことにより、出力電流が増加すると、第1のトラ
ンジスタがASOをオーバーする前に、第2のトランジ
スタが能動状態となって第1のトランジスタのベース電
流が抑制され、かつ第2のトランジスタが能動状態にな
ると第3のトランジスタが導通状態となって第2のトラ
ンジスタを導通状態にし、第1のトランジスタを遮断状
態にすることができる。
In such a configuration, by appropriately selecting the resistance value of the first resistor, when the output current increases, the second transistor becomes active and the second transistor becomes active before the first transistor exceeds the ASO. When the base current of the first transistor is suppressed and the second transistor becomes active, the third transistor becomes conductive, making the second transistor conductive and turning the first transistor off. can.

〔実施例〕〔Example〕

以下1本発明の実施例を図面を参照しながら詳細に説明
する。
Hereinafter, one embodiment of the present invention will be described in detail with reference to the drawings.

第1図は本発明による定電流垂下保護機能を有したトラ
ンジスタスイッチ回路の一実施例の構成を示した回路図
であシ、第5図と同じ機能を有するものには同一の符号
を付しである。この実施例は、第5図の回路に更に定電
流垂下保護回路7が付加されている。この定電流垂下保
護回路7は。
FIG. 1 is a circuit diagram showing the configuration of an embodiment of a transistor switch circuit having a constant current droop protection function according to the present invention. Components having the same functions as those in FIG. 5 are given the same reference numerals. It is. In this embodiment, a constant current droop protection circuit 7 is further added to the circuit shown in FIG. This constant current droop protection circuit 7.

抵抗R,とPNP型のトランジスタQ2とからなる。It consists of a resistor R, and a PNP type transistor Q2.

抵抗R1はトランジスタQ1のエミッタとプラス側入力
端子1との間に直列に接続されている。トランジスタQ
2は、エミッタがプラス側入力端子lに、ベースがトラ
ンジスタQsのエミッタに。
The resistor R1 is connected in series between the emitter of the transistor Q1 and the positive input terminal 1. transistor Q
2, the emitter is connected to the positive input terminal l, and the base is connected to the emitter of the transistor Qs.

コレクタがトランジスタQ1のベースに接続されている
The collector is connected to the base of transistor Q1.

このような構成において、駆動信号入力端子5に駆動信
号が印加されると、トランジスタQ0は導通し、抵抗R
cを介してトランジスタQ1のベース電流を引き込み、
主スィッチ素子なるトランジスタQ1は入力及び出力に
対しエミッタ接地形にテ導通し、トランジスタスイッチ
回路は導通状態となる。
In such a configuration, when a drive signal is applied to the drive signal input terminal 5, the transistor Q0 becomes conductive and the resistor R
The base current of transistor Q1 is drawn through c,
The transistor Q1, which is the main switch element, is electrically connected to the grounded emitter for the input and output, and the transistor switch circuit is in a conductive state.

この状態において、負荷インピーダンスが低下し、出力
電流工0が増加したとする。このとき。
In this state, it is assumed that the load impedance decreases and the output current factor 0 increases. At this time.

電流検出用抵抗R1を流れる電流は、はぼIOと見做す
ことができる。ここで、電流制限用PNP型トランジス
タQ2は、そのエミッタ及びベースを抵抗R1の両端に
接続し、そのコレクタをトランジスタQ1のベースに接
続しているので、出力電流IOの増加により、抵抗R1
の電圧降下がトランジスタQzのベースエミッタレベル
vBつ2と等しくなる点、つまりvBE2”Io XR
1となる時点で。
The current flowing through the current detection resistor R1 can be regarded as IO. Here, since the current limiting PNP transistor Q2 has its emitter and base connected to both ends of the resistor R1, and its collector to the base of the transistor Q1, an increase in the output current IO causes the resistor R1 to
The point where the voltage drop of is equal to the base-emitter level vB2 of transistor Qz, that is, vBE2''Io XR
At the point when it becomes 1.

トランジスタQ2のエミッタ、コレクタ間は能動状態と
なり、トランジスタQ1のベース電流が抑制される。こ
のため、出力電流工0がvBE。XR1に達し、さらに
負荷インピーダンスが低下すると。
The emitter and collector of transistor Q2 become active, and the base current of transistor Q1 is suppressed. Therefore, the output current factor 0 is vBE. When XR1 is reached and the load impedance further decreases.

第2図に示されるような、定電流垂下特性を呈する。従
って、抵抗R1の抵抗値を適尚に設定することにより、
いかなる負荷状態でも出力電流IOをトランジスタQ1
の電流定格を越えないようにできる。
It exhibits constant current drooping characteristics as shown in FIG. Therefore, by appropriately setting the resistance value of resistor R1,
Under any load condition, the output current IO is
The current rating can be prevented from being exceeded.

、ここで、第1図に示したような、定電流垂下保護機能
のみを有するトランジスタスイッチ回路においては、直
流出力端子3.4間を連続短絡すると。
, Here, in a transistor switch circuit having only a constant current droop protection function as shown in FIG. 1, if the DC output terminals 3 and 4 are continuously short-circuited.

V、xI(1のコレクタ損失が連続的に発生することn になるので、何らかの対応処置を必要とする。V, xI (1 collector loss occurs continuously n Therefore, some kind of countermeasure is required.

第3図は本発明による定電流垂下保護機能に加えて定電
流垂下開始点にて主スィッチ素子を遮断せしめる機能を
も有するトランジスタスイッチ回路の一実施例の構成を
示した回路図で、第1図と同じ機能を有するものには同
一の符号を付しである。第1図と相違する点は、定電流
垂下保護回路7′が、抵抗R1、トランジスタQ2の他
に、ダイオードDI+D2を有していることである。本
実施例のトランジスタQ2は、エミッタがプラス側入力
端子1に、ベースがダイオードDIを介してトランジス
タQ1のエミッタに、コレクタがダイオードD2を介し
てトランジスタQlのベース側に接続されている。又2
本実施例では、遮断回路8をも有している。この遮断回
路8は、 NPN型のトランジスタQ3及び抵抗R2t
 R3* R4を有している。トランジスタQ3は、エ
ミッタがマイナス側入力端子2に、ベースが抵抗R2を
介してトランジスタQ2のコレクタに、コレクタが抵抗
R3を介してトランジスタQ2のベースに接続されてい
る。抵抗R4はトランジスタQ3のベース、エミッタ間
に接続されている。更に、トランジスタQ!のべ−I−
灰とダイオードD2及び抵抗R8との間にダイオードD
3が直列に接続され、トランジスタQ3のベース、エミ
ッタ間に、抵抗R4と並列にコンデンサC1が接続され
ている。
FIG. 3 is a circuit diagram showing the configuration of an embodiment of a transistor switch circuit which has a constant current droop protection function according to the present invention and also has a function of cutting off the main switch element at the constant current droop starting point. Components having the same functions as those in the figures are given the same reference numerals. The difference from FIG. 1 is that the constant current droop protection circuit 7' includes a diode DI+D2 in addition to a resistor R1 and a transistor Q2. The transistor Q2 of this embodiment has its emitter connected to the positive input terminal 1, its base connected to the emitter of the transistor Q1 via the diode DI, and its collector connected to the base side of the transistor Ql via the diode D2. Also 2
In this embodiment, a cutoff circuit 8 is also provided. This cutoff circuit 8 includes an NPN type transistor Q3 and a resistor R2t.
It has R3*R4. The transistor Q3 has an emitter connected to the negative input terminal 2, a base connected to the collector of the transistor Q2 via a resistor R2, and a collector connected to the base of the transistor Q2 via a resistor R3. Resistor R4 is connected between the base and emitter of transistor Q3. Furthermore, transistor Q! Nobe-I-
A diode D is connected between the ashes and the diode D2 and the resistor R8.
3 are connected in series, and a capacitor C1 is connected in parallel with a resistor R4 between the base and emitter of the transistor Q3.

このような構成において、駆動信号入力端子5て以下に
説明する。
In such a configuration, the drive signal input terminal 5 will be explained below.

この場合、ダイオードD!の順方向電圧をvF1トスる
と、トランジスタQ2のベースエミッタレベルvBE2
が、 VB、 = I oX R1−VFlとなる時点
で。
In this case, the diode D! When the forward voltage of vF1 is tossed, the base emitter level of transistor Q2 vBE2
At the point in time when VB, = I oX R1 - VFl.

トランジスタQ2は能動状態となり、プラス側入力端子
1からの入力電流の一部はトランジスタQ2のエミッタ
、コレクタ及びダイオードD2を流れるので、トランジ
スタQ1は負荷インピーダンスの低下に対し定電流垂下
機能を呈する。
Transistor Q2 becomes active and part of the input current from positive input terminal 1 flows through the emitter, collector and diode D2 of transistor Q2, so transistor Q1 exhibits a constant current drooping function with respect to a decrease in load impedance.

と同時に、トランジスタQ2が能動状態になると、トラ
ンジスタQ2のコレクタから抵抗R2を介してトランジ
スタQ3のぺLスを駆動し、トランノスタQ3は、抵抗
R3を介してトランジスタQ2のベース電流を引き込む
。これにより、トランジスタQ2及びQ3は完全に導通
を継続し、抵抗Rcを流れる電流は、全てトランジスタ
Q2のエミッタ、コレクタ及びダイオードD2からの電
流となり、主スィッチ素子Q1のベース電流は遮断され
る。従って9本トランジスタスイッチ回路は。
At the same time, when the transistor Q2 becomes active, the transistor Q3's pin is driven from the collector of the transistor Q2 through the resistor R2, and the transistor Q3 draws the base current of the transistor Q2 through the resistor R3. As a result, transistors Q2 and Q3 continue to be completely conductive, and all current flowing through resistor Rc becomes current from the emitter and collector of transistor Q2 and diode D2, and the base current of main switch element Q1 is cut off. Therefore, the 9 transistor switch circuit is.

第4図に示される如く、遮断される。As shown in FIG. 4, it is shut off.

このように1本実施例においては、直流出力端子3,4
間が短絡された場合、定電流垂下開始点において出力電
流IOが遮断されるため、トランジスタQ1のコレクタ
損失が極めて小さくてすむ。
In this embodiment, the DC output terminals 3, 4
If a short circuit occurs between them, the output current IO is cut off at the point where the constant current droop starts, so that the collector loss of the transistor Q1 can be extremely small.

又9本実施例では、トランジスタQ3のベース。9 In this embodiment, the base of the transistor Q3.

エミッタ間にコンデンサC1が接続されている。A capacitor C1 is connected between the emitters.

従って、負荷側が容量性もしくはピーク電流を有するも
のの場合、抵抗R2とコンデンサC1によって決まる時
定数の遅れ分だけ、トランジスタQ1を定電流垂下動作
せしめ、これが異常に継続した場合のみトランジスタQ
1を遮断せしめることができる。
Therefore, if the load side is capacitive or has a peak current, the transistor Q1 is operated at a constant current by the delay of the time constant determined by the resistor R2 and the capacitor C1, and only if this continues abnormally, the transistor Q
1 can be blocked.

〔発明の効果〕〔Effect of the invention〕

以上説明した如く9本発明によれば、どのような直流電
圧供給源が入力端子に接続されても、又どのような負荷
が出力端子に接続されても、トランジスタスイッチ回路
の主スィッチ素子を保護することができ、産業上極めて
有益である。特に。
As explained above, according to the present invention, the main switch element of the transistor switch circuit can be protected no matter what kind of DC voltage supply source is connected to the input terminal or what kind of load is connected to the output terminal. It is extremely useful industrially. especially.

直流電圧供給源がバッテリーの場合に使用すると。When used when the DC voltage supply source is a battery.

本発明のトランジスタスイッチ回路は十分な効果を発揮
できる。
The transistor switch circuit of the present invention can exhibit sufficient effects.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明によるトランジスタスイッチ回路の一実
施例の構成を示した回路図、第2図は第1図の出力電流
−出力電圧特性例を示した図、第3図は本発明によるト
ランジスタスイッチ回路の他の一実施例の構成を示した
回路図、第4図は第3図の出力電流−出力電圧特性例を
示した図、第5図は従来のトランジスタスイッチ回路の
構成を示した回路図、第6図は第5図の出力電流−出力
電圧特性例を示した図である。 1.2・・・直流入力端子、3,4・・・直流出力端子
、5・・・駆動信号入力端子、6・・・駆動回路、 7
.7’・・・定電流垂下保護回路、8・・・遮断回路。 第1図 第2図 V。 8E2 箒3図 第4図 n −2+Vpt R1 躬5図 第6図 n
FIG. 1 is a circuit diagram showing the configuration of an embodiment of a transistor switch circuit according to the present invention, FIG. 2 is a diagram showing an example of the output current-output voltage characteristics of FIG. 1, and FIG. A circuit diagram showing the configuration of another embodiment of the switch circuit, FIG. 4 is a diagram showing an example of the output current-output voltage characteristics of FIG. 3, and FIG. 5 is a diagram showing the configuration of a conventional transistor switch circuit. The circuit diagram, FIG. 6, is a diagram showing an example of the output current-output voltage characteristics of FIG. 5. 1.2... DC input terminal, 3, 4... DC output terminal, 5... Drive signal input terminal, 6... Drive circuit, 7
.. 7'... Constant current droop protection circuit, 8... Cutoff circuit. Figure 1 Figure 2 Figure V. 8E2 Broom 3 Figure 4 Figure n -2+Vpt R1 Tsuji 5 Figure 6 Figure n

Claims (1)

【特許請求の範囲】 1、直流電圧供給源と負荷との電源ライン間に設けられ
て、前記直流電圧供給源のプラス側にエミッタが、前記
負荷側のプラス側にコレクタが接続されるPNP型の第
1のトランジスタを有し、該第1のトランジスタのベー
スが、該第1のトランジスタをオン・オフ制御するため
の駆動回路を介して、前記直流電圧供給源及び前記負荷
側のマイナス側に接続され、前記直流電圧供給源より前
記負荷に供給される直流電圧をオン・オフするようにし
たトランジスタスイッチ回路において、前記直流電圧供
給源のプラス側と前記第1のトランジスタのエミッタ間
に直列に挿入接続された抵抗器と、前記直流電圧供給源
のプラス側にエミッタが、前記第1のトランジスタのエ
ミッタ側にベースが、かつ前記第1のトランジスタのベ
ース側にコレクタがそれぞれ接続されたPNP型の第2
のトランジスタを有することを特徴とするトランジスタ
スイッチ回路。 2、直流電圧供給源と負荷との電源ライン間に設けられ
て、前記直流電圧供給源のプラス側にエミッタが、前記
負荷側のプラス側にコレクタが接続されるPNP型の第
1のトランジスタを有し、該第1のトランジスタのベー
スが、該第1のトランジスタをオン・オフ制御するため
の駆動回路を介して、前記直流電圧供給源及び前記負荷
側のマイナス側に接続され、前記直流電圧供給源より前
記負荷に供給される直流電圧をオン・オフするようにし
たトランジスタスイッチ回路において、前記直流電圧供
給源のプラス側と前記第1のトランジスタのエミッタ間
に直列に挿入接続された第1の抵抗器と、前記直流電圧
供給源のプラス側にエミッタが、前記第1のトランジス
タのエミッタに第1のダイオードを介してベースが、か
つ前記第1のトランジスタのベース側に第2のダイオー
ドを介してコレクタがそれぞれ接続されたPNP型の第
2のトランジスタと、前記直流電圧供給源のマイナス側
にエミッタが、前記第2のトランジスタのコレクタに第
2の抵抗器を介してベースが、かつ前記第2のトランジ
スタのベースに第3の抵抗器を介してコレクタがそれぞ
れ接続されたNPN型の第3のトランジスタを有するこ
とを特徴とするトランジスタスイッチ回路。
[Claims] 1. A PNP type provided between a power line between a DC voltage supply source and a load, with an emitter connected to the positive side of the DC voltage supply source and a collector connected to the positive side of the load side. The base of the first transistor is connected to the negative side of the DC voltage supply source and the load side through a drive circuit for controlling on/off of the first transistor. In the transistor switch circuit connected to turn on/off a DC voltage supplied to the load from the DC voltage supply source, a transistor is connected in series between the positive side of the DC voltage supply source and the emitter of the first transistor. a PNP type including a resistor inserted and connected, an emitter connected to the positive side of the DC voltage supply source, a base connected to the emitter side of the first transistor, and a collector connected to the base side of the first transistor. the second of
A transistor switch circuit comprising a transistor. 2. A PNP type first transistor is provided between a power line between a DC voltage supply source and a load, and has an emitter connected to the positive side of the DC voltage supply source and a collector connected to the positive side of the load side. The base of the first transistor is connected to the DC voltage supply source and the negative side of the load side through a drive circuit for controlling on/off of the first transistor, and the base of the first transistor is connected to the negative side of the DC voltage supply source and the load side, and In a transistor switch circuit configured to turn on and off a DC voltage supplied from a supply source to the load, a first transistor is inserted and connected in series between the positive side of the DC voltage supply source and the emitter of the first transistor. a resistor, an emitter connected to the positive side of the DC voltage supply source, a base connected to the emitter of the first transistor via a first diode, and a second diode connected to the base side of the first transistor. a second transistor of PNP type, the collector of which is connected through the transistor, the emitter of which is connected to the negative side of the DC voltage supply source, the base of which is connected to the collector of the second transistor through a second resistor; A transistor switch circuit comprising a third NPN transistor whose collector is connected to the base of the second transistor via a third resistor.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0348927U (en) * 1989-09-14 1991-05-13

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4222834Y1 (en) * 1965-07-02 1967-12-25

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