JPS61173069U - - Google Patents

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JPS61173069U
JPS61173069U JP5665685U JP5665685U JPS61173069U JP S61173069 U JPS61173069 U JP S61173069U JP 5665685 U JP5665685 U JP 5665685U JP 5665685 U JP5665685 U JP 5665685U JP S61173069 U JPS61173069 U JP S61173069U
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JP
Japan
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gates
frequency
differential amplifier
outputs
period
Prior art date
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JP5665685U
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  • Manipulation Of Pulses (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例を示す図、第２図
は入力信号の周波数とＦＶＣの設定周波数が等し
い時のタイムチヤートを示す図、第３図は入力信
号の周波数が設定周波数に比べて低い時のタイム
チヤートを示す図。第４図は入力信号の周波数が
設定周波数に比べて高い時のタイムチヤートを示
す図。第５図は従来のＦＶＣの一例を示す図であ
る。 図において、８，９は単安定マルチバイブレー
タ、１０，１１はＮＯＲゲート、１２は差動増幅
器、１３は不感帯回路、１４は電圧振幅制限器、
１５は低域周波数通過フイルタである。またＳｉ
ｎは入力信号、Ｓｏｕｔは出力電圧を示す。なお
、各図中同一符号は同一または相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 設定周波数の周期の１／２の周期のパルスを発
    生する２つの基準パルス発生器と、上記基準パル
    ス発生器の出力の各々正論理どうしあるいは負論
    理どうしを入力する２つのＮＯＲゲートと、上記
    ２つのＮＯＲゲートの出力を入力とする差動増幅
    器と、この差動増幅器出力に対する不感帯回路お
    よび電圧振幅制限器と、これら回路を通過した信
    号に対する低域周波数通過フイルタとを備えたこ
    とを特徴とする周波数電圧変換器。
JP5665685U 1985-04-16 1985-04-16 Pending JPS61173069U (ja)

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JP5665685U JPS61173069U (ja) 1985-04-16 1985-04-16

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JPS61173069U true JPS61173069U (ja) 1986-10-28

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ID=30580460

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JP5665685U Pending JPS61173069U (ja) 1985-04-16 1985-04-16

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