JPS61160549U - - Google Patents
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- Publication number
- JPS61160549U JPS61160549U JP4253685U JP4253685U JPS61160549U JP S61160549 U JPS61160549 U JP S61160549U JP 4253685 U JP4253685 U JP 4253685U JP 4253685 U JP4253685 U JP 4253685U JP S61160549 U JPS61160549 U JP S61160549U
- Authority
- JP
- Japan
- Prior art keywords
- conversion
- latch circuit
- converter
- conversion data
- signal
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims 10
- 238000010586 diagram Methods 0.000 description 2
- 239000013256 coordination polymer Substances 0.000 description 1
Landscapes
- Programmable Controllers (AREA)
- Control By Computers (AREA)
Description
第１図は本考案の実施例のブロツク図、第２図
は同上の定常時のタイミングチヤート、第３図は
同上の読み取り時のタイミングチヤート、第４図
は従来例のブロツク図である。 １はＡ／Ｄ変換器、２はラツチ回路、３はＣＰ
Ｕを示す。
は同上の定常時のタイミングチヤート、第３図は
同上の読み取り時のタイミングチヤート、第４図
は従来例のブロツク図である。 １はＡ／Ｄ変換器、２はラツチ回路、３はＣＰ
Ｕを示す。
Claims (1)
- 変換スタート信号によつてＡ／Ｄ変換を開始す
るとともに、Ａ／Ｄ変換終了後に変換終了信号を
出力するＡ／Ｄ変換器と、Ａ／Ｄ変換器の変換終
了信号を受けてＡ／Ｄ変換器からの変換データを
ラツチするラツチ回路と、ラツチ回路が変換デー
タをラツチした直後にラツチ回路のラツチした変
換データを読み取るリード信号を送出してラツチ
回路への変換データの新たな書き込みを禁止する
とともに、ラツチ回路のラツチしている変換デー
タを読み取るＣＰＵとを具備して成るＡ／Ｄ変換
出力ラツチ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4253685U JPS61160549U (ja) | 1985-03-25 | 1985-03-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4253685U JPS61160549U (ja) | 1985-03-25 | 1985-03-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61160549U true JPS61160549U (ja) | 1986-10-04 |
Family
ID=30553382
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4253685U Pending JPS61160549U (ja) | 1985-03-25 | 1985-03-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61160549U (ja) |
-
1985
- 1985-03-25 JP JP4253685U patent/JPS61160549U/ja active Pending
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