JPS61156692A - El element driving circuit - Google Patents
El element driving circuitInfo
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- JPS61156692A JPS61156692A JP59279787A JP27978784A JPS61156692A JP S61156692 A JPS61156692 A JP S61156692A JP 59279787 A JP59279787 A JP 59279787A JP 27978784 A JP27978784 A JP 27978784A JP S61156692 A JPS61156692 A JP S61156692A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は交流電圧の印加によって発光するEL(エレク
トロルミネセンス)素子に関し、特にEL素子の駆動回
路に関するものである。DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention relates to an EL (electroluminescence) element that emits light by application of an alternating current voltage, and particularly to a drive circuit for an EL element.
一般にEL素子は第3図に示すように、ガラス等の透明
基板1上に蒸着法やスパッタリング法等の適当な方法を
用いてln=0−等の透明導電材料から成る透明電極2
を密着形成し、その上に絶縁破壊を防ぐためY、03等
の絶縁材料から成る第1の誘電体層3を形成し、ざらに
ZnS等の母体性材料内にMn等の発光中心を添加して
成る発光層4を形成し、またその上に第1の誘電体層3
と同様の材質から成る第2の誘電体層5を形成し、その
上に他方の電極としてA1等の導電材料から成る背面電
極6を形成して成るものであり、面光源として使用され
ている。Generally, as shown in FIG. 3, an EL element is manufactured using a transparent electrode 2 made of a transparent conductive material such as ln=0- by using an appropriate method such as vapor deposition or sputtering on a transparent substrate 1 made of glass or the like.
A first dielectric layer 3 made of an insulating material such as Y or 03 is formed on it to prevent dielectric breakdown, and a luminescent center such as Mn is roughly doped into the matrix material such as ZnS. A light emitting layer 4 is formed, and a first dielectric layer 3 is formed thereon.
A second dielectric layer 5 made of the same material is formed, and a back electrode 6 made of a conductive material such as A1 is formed thereon as the other electrode, and is used as a surface light source. .
このEL素子は上記Zn 8等の半導体から成る発光層
4内に発生した電界によって伝導帯に励起されかつ加速
されて充分なエネルギーを得た電子が直接Mn発光セン
ターを励起し、励起されたMn発光センターが基底状態
に戻る際、発光出力を得るものであり、電界を発生させ
るために透明電極2と背面電極6との間に100v程度
の高圧のパルス電圧7を印加しなければならない。通常
このパルス電圧は第4図に示すように交互に極性の異な
るパルスであり、パルスとパルスの間には電圧がOとな
る休止期間tが設定されている。EL素子は常に電圧が
印加されていると素子の寿命が非常に短かくなるが、こ
のように休止期間を有するパルス電圧を印加することに
より、素子の寿命が長くなることが本願発明者等の実験
により知られている。In this EL device, electrons are excited to the conduction band by an electric field generated in the light-emitting layer 4 made of a semiconductor such as Zn 8, and are accelerated to obtain sufficient energy. Electrons directly excite the Mn light-emitting center, and the excited Mn When the luminescent center returns to the ground state, a luminescent output is obtained, and a high pulse voltage 7 of about 100 V must be applied between the transparent electrode 2 and the back electrode 6 to generate an electric field. Normally, this pulse voltage is pulses of alternating polarity as shown in FIG. 4, and a rest period t in which the voltage becomes O is set between the pulses. If a voltage is constantly applied to an EL element, the life of the element will be very short, but the inventors of the present application found that by applying a pulse voltage with a rest period, the life of the element becomes longer. Known through experiment.
ところで、このようなパルス電圧をスイッチング回路を
介してEL素子に印加する従来技術として特公昭52−
45466号公報に記載の発明がある。この従来技術は
2個のスイッチング素子を直列接続した第1.第2のス
イッチング回路を、電源に対して並列接続するとともに
、第1.第2のスイッチング回路における両スイッチン
グ素子の接続点間に薄膜EL素子を接続し、スイッチン
グ素子に前記パルス電圧を印加してEL素子を駆動させ
たものである0しかしながら、前記従来技術においては
、休止期間を有するパルス電圧の生成については充分に
開示されておらず、通常この休止期間を有するパ゛ルス
電圧の生成はEL素子の寿命を左右するため複雑な回路
を有したりして、安定した休止期間を得ることが難しい
と言う技術的R題が残されていた。By the way, as a conventional technique for applying such a pulse voltage to an EL element via a switching circuit,
There is an invention described in Publication No. 45466. This prior art is based on a first switching element in which two switching elements are connected in series. The second switching circuit is connected in parallel to the power supply, and the first switching circuit is connected in parallel to the power supply. A thin film EL element is connected between the connection points of both switching elements in the second switching circuit, and the pulse voltage is applied to the switching element to drive the EL element. The generation of a pulse voltage with a period has not been sufficiently disclosed, and since the generation of a pulse voltage with a rest period usually has a complicated circuit because it affects the life of the EL element, it is not stable. There remained a technical R issue that would make it difficult to obtain a break.
本発明は上記問題点に鑑みてなされたものであり、EL
素子に印加される交流パルス電圧の休止期間を簡単な回
路構成でかつ安定に得ることのできるEL素子の駆動回
路を提供することを目的とする。The present invention has been made in view of the above problems, and
It is an object of the present invention to provide a drive circuit for an EL element that can stably obtain a rest period of an AC pulse voltage applied to the element with a simple circuit configuration.
上記目的を達成するため、本発明はパルス電圧を発生す
る発振器と前記EL素子との間に、前記パルス電圧の位
相を反転させるインバータおよび前記反転されたパルス
電圧を微分する第1の微分回路と、前記パルス電圧を微
分する第2の微分回路とから成る休止時間設定回路を挿
入接続したものであり、パルス電圧を印加してEL発光
させるEL素子の駆動回路において、パルス電圧の微分
により、パルス幅を狭まくして、パルスの間に安定な休
止期間を設けたことを特徴とするものである。In order to achieve the above object, the present invention includes an inverter that inverts the phase of the pulse voltage and a first differentiation circuit that differentiates the inverted pulse voltage, between an oscillator that generates a pulse voltage and the EL element. , and a second differentiating circuit for differentiating the pulse voltage.In the drive circuit for an EL element that applies a pulse voltage to emit EL, the pulse voltage is differentiated by the pulse voltage. It is characterized by narrowing the width and providing a stable pause period between pulses.
以下、図面に基づいて本発明の一実施例を詳述する。 Hereinafter, one embodiment of the present invention will be described in detail based on the drawings.
第1図はEL素子11を駆動する駆動回路を示し、発振
器12は例えば5v程度のパルス電圧を発生し、このパ
ルス電圧は第4図に示すような休止期間tを設定するた
めの休止期間設定回路13へ送られ、これら発振器12
および休止期間設定回路13とはEL素子11駆動用の
パルス電圧を発生する回路を構成している。FIG. 1 shows a drive circuit that drives the EL element 11, and the oscillator 12 generates a pulse voltage of, for example, about 5V, and this pulse voltage is used to set the rest period t as shown in FIG. These oscillators 12
The pause period setting circuit 13 constitutes a circuit that generates a pulse voltage for driving the EL element 11.
休止期間設定回路13はEL素子11に印加される交流
パルス電圧の2つの極性の電圧を発生するために分岐さ
れており、パルス電圧を反転するインバータ14と、波
形整形用のノ々ツファ15A、 15B、 CR微分
回路16A、 16B、及びバッファ17A、 1
7Bとによって構成されている。The rest period setting circuit 13 is branched to generate two polarity voltages of the AC pulse voltage applied to the EL element 11, and includes an inverter 14 for inverting the pulse voltage, a notch buffer 15A for waveform shaping, 15B, CR differentiation circuit 16A, 16B, and buffer 17A, 1
7B.
これらの休止期間を有して位相の異なるパルス電圧は各
々EL素子11に印加されるパルス電圧の立ち上がりを
緩慢にして高周波成分のノイズを除去6するノイズ除去
回路18A、 18Bへ送られる。These pulse voltages having pause periods and different phases are sent to noise removal circuits 18A and 18B which slow the rise of the pulse voltage applied to the EL element 11 to remove high frequency component noise 6.
ノイズ除去回路18A、 18Bは各々CR積分回路
19A、 19Bとスイッチング用トランジスタ2O
A、 20Bとにより構成されている。Noise removal circuits 18A and 18B are CR integration circuits 19A and 19B and switching transistor 2O, respectively.
A, 20B.
パルス電圧を増幅するための2個のトランジスタ21.
22を直列に接続した第1の増幅回路23と、同様に2
個のトランジスタ24.25を直列に接続した第2の増
幅回路26とは電源+Vに対して並列に接続されており
、トランジスタ22.24のベース端子には前記トラン
ジスタ2OAからのパルス電圧が印加され、トランジス
タ21.25にはトランジスタ2OAのパルスとは逆位
相のトランジスタ20Bのパルス電圧が印加される。Two transistors 21 for amplifying the pulse voltage.
22 connected in series, and a first amplifier circuit 23 having two
A second amplifier circuit 26, which has transistors 24 and 25 connected in series, is connected in parallel to the power supply +V, and a pulse voltage from the transistor 2OA is applied to the base terminal of the transistor 22 and 24. , the pulse voltage of the transistor 20B having the opposite phase to the pulse of the transistor 2OA is applied to the transistors 21 and 25.
トランジスタ21.22の接続点と、トランジスタ24
.25の接続点との間には前記EL11とこのEL素子
11に印加されるパルス電圧の立ち上がりを緩慢にする
抵抗27の直列回路が挿入接続されている。さらに、E
L素子11にはトランジスタ21.24の非導通抵抗よ
りも十分に小さい抵抗値を有する抵抗28が並列に接続
されている。The connection point of transistors 21 and 22 and the transistor 24
.. A series circuit of a resistor 27 that slows down the rise of the pulse voltage applied to the EL element 11 and the EL element 11 is inserted and connected between the connection point 25 and the EL element 11. Furthermore, E
A resistor 28 having a resistance value sufficiently smaller than the non-conducting resistance of the transistors 21 and 24 is connected in parallel to the L element 11.
29は電源電圧+Vを供給する電源回路であり、商用電
源30と4個のダイオード31 、32゜33.34と
による全波整流回路35で構成されている。A power supply circuit 29 supplies a power supply voltage +V, and is composed of a commercial power supply 30, four diodes 31, and a full-wave rectifier circuit 35 formed by 32°33.34.
以上によって構成される本発明の実施例の作用を第2図
の波形図を基に詳述する。The operation of the embodiment of the present invention constructed as described above will be explained in detail based on the waveform diagram of FIG.
先ず5v程度のパルス電圧(第2図A)が発振器12よ
り出力され、2分岐されて休止期間設定回路13へ送ら
れる。EL素子11を駆動する交流パルス電圧の一方の
極性を得るため、インバータ14で位相反転されたパル
ス電圧はバッファ15Aを介してCRI分回路16Aで
微分される。微分された後再びバッファ17Aを通すこ
とにより発振器12で出力されたパルス電圧よりパルス
幅の狭いパルス電圧(第2図B)が発生する。同様に他
方の極性のパルス電圧を得るため、発振器12から出力
されたパルス電圧はバッファ15Bを介してCR微分回
路16Bで微分されバッフ717Bを通すことにより発
振器12で出力されたパルス電圧よりパルス幅の狭いパ
ルス電圧(第2図C)が発生する。このようにして位相
が異なり同時にOFF状態となる休止期間tを有するパ
ルス電圧が発生する。尚、休止期間tはCR時定数を変
化させることにより可変できる。First, a pulse voltage of about 5V (FIG. 2A) is output from the oscillator 12, branched into two, and sent to the pause period setting circuit 13. In order to obtain one polarity of the AC pulse voltage that drives the EL element 11, the pulse voltage whose phase is inverted by the inverter 14 is differentiated by the CRI dividing circuit 16A via the buffer 15A. After being differentiated, the voltage is passed through the buffer 17A again to generate a pulse voltage (FIG. 2B) having a narrower pulse width than the pulse voltage output by the oscillator 12. Similarly, in order to obtain a pulse voltage of the other polarity, the pulse voltage output from the oscillator 12 is differentiated by the CR differentiation circuit 16B via the buffer 15B, and then passed through the buffer 717B to obtain the pulse voltage output from the oscillator 12. A narrow pulse voltage (FIG. 2C) is generated. In this way, pulse voltages are generated which have different phases and have a pause period t in which they are simultaneously in the OFF state. Note that the pause period t can be varied by changing the CR time constant.
これらの位相の異なるパルス電圧は各々゛後段のノイズ
除去回路18A、 18Bへ送られる。ノイズ除去回
路18A、 18BはCR積分回路19A、19B。These pulse voltages having different phases are sent to the subsequent noise removal circuits 18A and 18B, respectively. Noise removal circuits 18A and 18B are CR integration circuits 19A and 19B.
とトランジスタ2OA、 20Bにより構成されており
、パルス電圧の立ち上り時にはコンデンサをトランジス
タ20A、 20Bのスイッチング電圧にまで充電する
のに時間を要し、また立ち上がり時にはコンデンサの放
電によりパルス電圧が完全にOFFするのに時間を要し
、その結果パルス電圧の急峻な立ち上がりと立ち下がり
が緩慢となるパルス電圧(第2図り、E)を出力する。When the pulse voltage rises, it takes time to charge the capacitor to the switching voltage of the transistors 20A and 20B, and when the pulse voltage rises, the capacitor discharges and the pulse voltage is completely turned off. As a result, a pulse voltage (E in the second diagram) with a steep rise and a slow fall is output.
D点がONの時にはトランジスタ22.24が導通しF
点での電位がほぼ0となりG点での電位がほぼ+Vにな
り、EL素子11にはVの電圧が印加される。EL素子
11は一種のコンデンサと考えることができ抵抗27が
直列に接続されているため、EL素子11にはパルス電
圧が積分されて印加される。このため、パルス電圧の立
ち上がりと立ち下がりが緩慢となる。When point D is ON, transistors 22 and 24 are conductive and F
The potential at the point becomes approximately 0, the potential at the point G becomes approximately +V, and a voltage of V is applied to the EL element 11. Since the EL element 11 can be considered as a kind of capacitor and the resistor 27 is connected in series, the pulse voltage is integrated and applied to the EL element 11. Therefore, the pulse voltage rises and falls slowly.
一方、E点がONの時にはトランジスタ21゜25が導
通され、同様にF−G間の電位がほぼ■になるが、この
場合極性が反対である。このようにしてEL素子11に
は高圧の交流パルス電圧(第2図F−G)が印加される
。On the other hand, when the point E is ON, the transistors 21 and 25 are conductive, and similarly the potential between F and G becomes approximately -, but in this case, the polarity is opposite. In this way, a high AC pulse voltage (FIG. 2, FG) is applied to the EL element 11.
尚、高圧の電源電圧子■は電源回路29から供給される
が、全波整流回路とすることにより、商用電源30の余
波整流した波形を発振器12が発生するパルス電圧の周
波数でチョップして・EL素子11に必要な高圧の駆動
電圧を供給している。このため、トランス等を必要とせ
ずに商用電源30から100v程度の高圧の電源電圧を
作り出せる。The high-voltage power supply voltage element (2) is supplied from the power supply circuit 29, and by using a full-wave rectifier circuit, the rectified waveform of the commercial power supply 30 is chopped at the frequency of the pulse voltage generated by the oscillator 12. A necessary high driving voltage is supplied to the EL element 11. Therefore, a high power supply voltage of about 100V can be generated from the commercial power supply 30 without requiring a transformer or the like.
このように、パルス電圧を発生する発振器12と・、こ
のパルス電圧を2つに分岐して一方の位相を反転するイ
ンバータ14と、各々のパルス電圧を微分するCR微分
回路16A、 16Bを備えた簡単な構成により発振
器12が発生したパルス電圧のパルス幅よりも狭いパル
ス幅を有する各々位相の異なるパルス電圧を生成し、こ
れらをEL素子11駆動用の増幅回路23.26に与え
ることによって、EL素子11の両端には第2図で示す
ような休止期間tを有する高圧なパルス電圧が印加され
る。尚、このパルス電圧の立ち下がりは、EL素子11
に並列に接続された抵抗28がEL素子11に充電され
た電荷を放電するため、より確実に急峻に立ち下がり、
休止期間tの安定を図ることができる。このため、安定
した休止期間【を得ることができ、増幅回路23.26
内のトランジスタが同時に導通することがなくなり、E
L素子11の長寿命化を図るとともにトランジスタの破
壊を防止できる。In this way, it is equipped with an oscillator 12 that generates a pulse voltage, an inverter 14 that branches this pulse voltage into two and inverts one phase, and CR differentiation circuits 16A and 16B that differentiate each pulse voltage. With a simple configuration, pulse voltages having different phases each having a pulse width narrower than that of the pulse voltage generated by the oscillator 12 are generated, and these pulse voltages are applied to the amplifier circuits 23 and 26 for driving the EL element 11. A high pulse voltage having a rest period t as shown in FIG. 2 is applied to both ends of the element 11. Note that the fall of this pulse voltage is caused by the EL element 11
Since the resistor 28 connected in parallel with the EL element 11 discharges the electric charge stored in the EL element 11, the voltage falls more reliably and steeply.
It is possible to stabilize the downtime period t. Therefore, a stable rest period can be obtained, and the amplifier circuit 23.26
The transistors within the E
It is possible to extend the life of the L element 11 and prevent destruction of the transistor.
また、EL素子11に印加されるパルスの立ち上がりは
ノイズ除去回路18A、 18Bと抵抗27との積分
回路により緩慢となっているため、高調波成分のノイズ
が除去され、EL素子駆動回路やEL素子との接続コー
ドから発生するノイズが低減される。In addition, since the rise of the pulse applied to the EL element 11 is slow due to the integration circuit of the noise removal circuits 18A and 18B and the resistor 27, harmonic component noise is removed and the pulse applied to the EL element drive circuit and EL element Noise generated from the connection cord is reduced.
前記実施例は薄膜型EL素子、について示しであるが、
分散型EL素子も同様に発光時にノイズを発生すること
から、分級型EL素子にも本発明を適用できる。Although the above embodiments are about thin film type EL elements,
Since a distributed type EL element similarly generates noise when emitting light, the present invention can also be applied to a classified type EL element.
以上詳述したように本発明によれば、パルス電圧を発生
する発振器と前記EL素子との間に、前記パルス電圧の
位相を反転させるインバータおよび前記反転されたパル
ス電圧を微分する第1の微分回路と、前記パルス電圧を
微分する第2の微分回路とから成る休止時間設定回路を
挿入接続したものであり、前記第1.第2の微分回路で
微分されたパルス電圧を増幅回路を介してEL素子に印
加させることにより、EL素子の両端には安定した休止
期間を有する交流パルス電圧が供給され、EL素子の長
寿命化が図れるとともに、増幅回路のトランジスタの破
壊を防止できる。As detailed above, according to the present invention, an inverter that inverts the phase of the pulse voltage and a first differential that differentiates the inverted pulse voltage are provided between an oscillator that generates a pulse voltage and the EL element. A pause time setting circuit consisting of a circuit and a second differentiation circuit for differentiating the pulse voltage is inserted and connected to the first differentiation circuit. By applying the pulse voltage differentiated by the second differentiating circuit to the EL element via the amplifier circuit, an AC pulse voltage with a stable rest period is supplied to both ends of the EL element, extending the life of the EL element. In addition, it is possible to prevent the transistors of the amplifier circuit from being destroyed.
第1図は本発明の一実施例を示す回路図、第2図は第1
図回路図における要部の電圧波形図、第3図は一般のE
L素子の断面図、第4図は一般のEL素子駆動用パルス
電圧の波形図である。
11・・EL素子 12・・発振器
13・・休止期間設定回路 14・・インバータ 16
A、 16B・・微分回路 18A、 18B・・ノ
イズ除去回路 19A、 19B・・積分回路23.
26・・増幅回路 27・・積分用抵抗28・・微分用
抵抗 29・・電源回路特 許 出 願 人
日本精機株式会社第2図
第3図Fig. 1 is a circuit diagram showing one embodiment of the present invention, and Fig. 2 is a circuit diagram showing an embodiment of the present invention.
Figure 3 is a voltage waveform diagram of the main parts in the circuit diagram, and Figure 3 is a general E
A cross-sectional view of the L element, and FIG. 4 is a waveform diagram of a general pulse voltage for driving an EL element. 11... EL element 12... Oscillator 13... Shutdown period setting circuit 14... Inverter 16
A, 16B...differentiation circuit 18A, 18B...noise removal circuit 19A, 19B...integration circuit 23.
26... Amplifier circuit 27... Integrating resistor 28... Differentiating resistor 29... Power supply circuit patent applicant
Nippon Seiki Co., Ltd. Figure 2 Figure 3
Claims (1)
EL素子の駆動回路において、パルス電圧を発生する発
振器と前記EL素子との間に、前記パルス電圧の位相を
反転させるインバータおよび前記反転されたパルス電圧
を微分する第1の微分回路と、前記パルス電圧を微分す
る第2の微分回路とから成る休止時間設定回路を挿入接
続したことを特徴とするEL素子の駆動回路。In an EL element drive circuit that applies a pulse voltage to both ends of the EL element to emit EL, an inverter that inverts the phase of the pulse voltage is provided between an oscillator that generates the pulse voltage and the EL element, and an inverter that inverts the phase of the pulse voltage. 1. A driving circuit for an EL element, characterized in that a rest time setting circuit comprising a first differentiating circuit for differentiating a pulse voltage and a second differentiating circuit for differentiating the pulse voltage is inserted and connected.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59279787A JPS61156692A (en) | 1984-12-27 | 1984-12-27 | El element driving circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59279787A JPS61156692A (en) | 1984-12-27 | 1984-12-27 | El element driving circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61156692A true JPS61156692A (en) | 1986-07-16 |
Family
ID=17615908
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59279787A Pending JPS61156692A (en) | 1984-12-27 | 1984-12-27 | El element driving circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61156692A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0280992U (en) * | 1988-12-09 | 1990-06-21 | ||
JPH03176992A (en) * | 1989-04-26 | 1991-07-31 | Nec Kansai Ltd | Electro-luminescent lighting circuit |
JPH0499656A (en) * | 1990-08-20 | 1992-03-31 | Tokyo Electric Co Ltd | Driving method for end face light emission type el element |
-
1984
- 1984-12-27 JP JP59279787A patent/JPS61156692A/en active Pending
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