JPS6082816U - サイン波発生回路 - Google Patents

サイン波発生回路

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Publication number
JPS6082816U
JPS6082816U JP17583983U JP17583983U JPS6082816U JP S6082816 U JPS6082816 U JP S6082816U JP 17583983 U JP17583983 U JP 17583983U JP 17583983 U JP17583983 U JP 17583983U JP S6082816 U JPS6082816 U JP S6082816U
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JP
Japan
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sine wave
output
frequency dividing
wave generating
circuit
Prior art date
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Pending
Application number
JP17583983U
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English (en)
Inventor
康宣 大石
Original Assignee
株式会社東芝
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Publication date
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  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のサイン波発生回路を示す回路図、第２図
は第１図の回路の各部信号波形図、第　　３図はこの考
案の一実施例を示す回路図、第４図は、第３図の回路の
各部信号波形図、第５図、第一６図はそれぞれこの考案
の他の実施例を示す回路図である。 ２２・・・分周器、２５・・・アンド回路、２６・・・
オア回路、２７・・・帯域フィルタ、３４・・・出力信
号レベル指定回路、ＧＡ１〜ＧＡｒＩ、ＣＢ１〜ＧＢｎ
・・・アンド回路、ＯＲ１〜ＯＲｎ・・・オア回路、Ｅ
Ｘ１〜ＥＸｎ・・・イクスクルーシブオア回路。

Claims (3)

    【実用新案登録請求の範囲】
  1. （１）　　クロックを分周する分周手段と、この分周手
    段の出力が入力される遅延手段と、前記遅延手段の出力
    と前記分周手段の出力が入力され論理的組み合せにより
    、各種のデユーティのパルス列を発生する論理回路手段
    と、前記パルス列の各種を周期的に選択して導出し、こ
    れを帯域フィルタに入力する制御手段とを具備したこと
    を特徴とするサイン波発生回路。
  2. （２）前記遅延手段は、複数のＤタイプフリップフロッ
    プ回路から成り、前記論理回路手段は、各Ｄタイプフリ
    ップフロップ回路の各出力がそれぞれ加えられる複数の
    論理回路から成ることを特徴とする実用新案登録請求の
    範囲第１項記載のサイン波発生回路。
  3. （３）前記制御手段は、ＦＳＫ信号に応じて前記周期的
    選択の周期が可変されることを特徴とする実用新案登録
    請求の範囲第１項記載のサイン波発生回路。
JP17583983U 1983-11-14 1983-11-14 サイン波発生回路 Pending JPS6082816U (ja)

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JP17583983U JPS6082816U (ja) 1983-11-14 1983-11-14 サイン波発生回路

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JPS6082816U true JPS6082816U (ja) 1985-06-08

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