JPS6066535A - ステ−タスビット保護方式 - Google Patents

ステ−タスビット保護方式

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Publication number
JPS6066535A
JPS6066535A JP17463983A JP17463983A JPS6066535A JP S6066535 A JPS6066535 A JP S6066535A JP 17463983 A JP17463983 A JP 17463983A JP 17463983 A JP17463983 A JP 17463983A JP S6066535 A JPS6066535 A JP S6066535A
Authority
JP
Japan
Prior art keywords
frame
status bit
circuit
pattern
status
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP17463983A
Other languages
English (en)
Inventor
Tsunetoshi Mizusawa
水沢 常利
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP17463983A priority Critical patent/JPS6066535A/ja
Publication of JPS6066535A publication Critical patent/JPS6066535A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04JMULTIPLEX COMMUNICATION
    • H04J3/00Time-division multiplex systems
    • H04J3/02Details
    • H04J3/14Monitoring arrangements

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Time-Division Multiplex Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はステータスビット保護方式に関し、特にディジ
タルデータ通信網に適用される64kb/Sのディジタ
ルO次群信号上のステータスビット保護方式に関する。
ディジタル通信網においては、端末からのデータ及び制
御信号はディジタルザービスユニットにおいてフレーム
ビットを付加され、時分割多重化されてエンベロープを
組み加入者線上を伝送される。詔1図はこのエンベロー
プを示した図であり、Fが7レーミングピツト、D!〜
D6がデータビット、Sが制御信号を多重化したステー
タスビットである。
局間を伝送される場合には、3.2kb/sの信号であ
れば20チヤンネル、6.4kb/sの信号であれば1
0チヤンネル、12.8kb/sの信号ならば5チヤン
ネルが夫々64 k b / sのディジタル0次群信
号に多重化されて伝送される。
ディジタルデータ通信網における制御1キ号であるステ
ータスビットは、データ通信の有無す々わち発呼や終話
の制御に用いられ、発呼の場合11′。
終話の場合lO″となる。仮に、伝送路エラー等によシ
スデータスビットが111から101に誤ると、この時
データ通信は途中で打切られて再変始めから通信文を送
シなおす必要が生じる。この様にステータスビットはデ
ィジタルデータ通信網における重要な信号となっている
のである。
第2図はO次群伝送路の多重化の様子を示すもので、1
、(b)が64 k b / sの0次群フレーム構成
であってここでは(C) 、 (d)に夫々示す3.2
kb/sのチャンネルが20チャンネル多重化されるよ
うになっている。(C) 、 (d)におけるF′は加
入者線上を伝送されるときの7レーミングピツトであJ
、0次群伝送路に多重化される場合には、第3図に示f
X−50フレームパターンに付は替えられる。
第2図(a)は多重化されたチャンネルのビット配列を
示すもので6D、Fが7レーミングピツトであってここ
に第3図に示したフレーム番号と対応したX−50フレ
ームパターンが挿入される。尚、第3図のAはハウスキ
ーピング用ビットである。
従来のO次群伝送路上でのステータスビットの保護は、
受信側においてフレーム同期回路のフレーム同期ハズレ
信号によって、多重化されているすべてのチャンネルの
ステータスビットに対し、111であったものを101
に変換することによシ行われている。すなわち、0次群
伝送路エラーの情報はフレーム同期回路の状態である同
期・・ズレ信号によシ得ており、これによシ通信中のス
テータスビットを終話状態に変換して誤ったデータが受
信端末に流れるのを防止するようになっている0 ここで、フレーム同期回路の特性はフレーム同期を確立
するに最適なように設定されており、ある程度の伝送路
エラーでは同期ハズレ状態とはならない。すなわち、フ
レーム同期回路が前号保護状態にあるうちは、同期ハズ
レ状態とはならないようになっているから、伝送路が誤
っているにもかかわらずステータスビットは保護されて
おらず誤っている可能1生が筒いことになる。この様に
従来のステータスビット保護方式では、フレーム同期が
ハズレきらない程度の伝送路エラーに対してはステータ
スビットを保護することができない欠点がある。
本発明の目的は、伝送路誤シに対してよシ適切な保護を
ステータスビットに与えて品質の良いディジタルデータ
通信網用のO次群伝送路を可能としたステータスピント
保護力式を提供することでろる〇 一般に、伝送路誤りは、大きく分けでランダム誤りとバ
ースト誤シとがあるが、前者は散発的なビット単位のM
、Dであシ、後者は2ビツトから数十ビットに亘る集団
的誤シでろる。本発明は、この後者のバースト誤シに対
しフレーム同期回路が同期状態にあってもステータスビ
ットの所属するフレームパターンの誤りを使用して1フ
レーム前の自チャンネルのステータスビットと買、換す
ることによシ、ステータスビット誤9を防止するように
したことを特徴としている。
次に図面を参照し−C本発明の実施例について詳細に説
明する。
第4図は本発明の実施例を示したものである0この実施
VIjは、ディジタルデータ通信網における0次群伝送
路において、3.2 k b it/ sのチャンネル
を20チャンネル多重し、フレームパターンには、X−
50フレームパターンを用いたものであシ、フレーム構
成ハ第2図にフレームパターンは第3図に夫々示したも
のである。このO次群伝送路は8kHzセントラライズ
されているため、エンベロープ内のビット位置は既知で
める。
第4図において、4−1が伝送路からの人力信号で’)
’)、8b Itシフトレジスタ4−iによりエンペロ
ーブ単位に並列展開され、フレーミングビット4−4は
4−aのフレーム同期回路に人力され、フレーム同期を
確立される。ステータスビット4−6は4−gのセレク
タによシ現在のステータスビットと、20ビットシフト
レジスタ4−fによシ遅らされた1フレーム前の自チャ
ンイ・ルのステータスビットとを選択され、4−5のデ
ータビットと共に分離回路4−hに人力され、チャンネ
ル単位の信号に分離されて4−3や4−4で示す各チャ
ンネルとなって出力される。
4−aのフレーム同期回路は、4−bのフォーミングパ
ターン検出回路と、4−Cのフレームノくターン発生回
路と、4−dの保護回路と、4−jのパターン比較ゲー
ト及び4−k及び4−fのアンドゲートとより成る。
フレーム同期回路は、同期ハズレ状態においては入力さ
れた4−4のフレームパターンを用いてフォーシングパ
ターン検出回路にょカフレームパターンを検出し、フレ
ームパターン発生回路に入力フレームパターン、!= 
In] 期したフレームパターンを設定し、後方保護状
態にうつる。4−7は同期ハズレ状態を示す信号である
後方保護状態においては、フレームパターン発生回路の
出カバターン4−8と入力フレームパターン4−4とを
比較し、その結果を保護回路4−dに入力する。保護回
路4−dでは、パターンを比較した結果から、正しい結
果がある個数連続した場合同期状態となシ、4−7はf
ilとなって同期状態となる。同期状態において、人力
のフレームパターンが誤まった場合、4−Jによって比
較した結果の正、誤の比率があるしきい値に達した時に
、保護回路4−dはフレーム同期ハズレと判断して4−
7を111とする。この同期状態からフレーム同期ハズ
レとなる間7%MiJ方保護状態である。同期状態とは
この前方保護状態も含み、4−7が101にある間をい
う。4−10は同期状態でかつ前方保護状態でない状態
、すなわち真の同期状態を示す信号で必る。4−9はフ
レームの頭を示す信号で1真の同期状態の時に、フレー
ムカウンタ4−eに初期値を設定する。このフレームカ
ウンタの出力4−11は4−hの分離回路にチャンネル
識別の情報として与えられる。
ステータスビット4−6は、フレーム同期回路が真の同
期状態にある時には、セレクタ4−gによシ選択され分
離回路4−hにそのまま入力される。しかし、同期状態
になって、フレームパターンが誤まった場合、4−12
の信号によってセレクタ4−gによJ4−fでおくらさ
れた1フレーム前の自チャンネルのステータスビットを
選択されて分離回路4−hに人力され、ステータスビッ
トは保護される。
フレームパターン中のハウスキーピングピットのチャン
ネルについては保保を行なえないため、ステータスビッ
トの置き変化をインヒビットするためのゲー) 4−m
が設けられている。4−nはフレーム同期ハズレ時にス
テータスビットを“olに変換するためのゲートである
以上述べた如く、本発明によれば、伝送路上で発生した
バーストエラーに対してステータスビットの誤シを少く
することができるので高品質の伝送路を提供することが
可能となる利点を有する。
【図面の簡単な説明】 第1図はエンベロープの説明をする図、第2図は時分割
多重伝送路上の多重化を説明する図、第3図はフレーム
パターンの説明図、第4図は本発明の実施例のブロック
図である。 主要部分の符号の説明

Claims (1)

    【特許請求の範囲】
  1. 端末からの発呼及び終話を示す制御信号とデータとがエ
    ンベロープを組み伝送されかつ複数チャンネルが分散配
    置のフレームパターンを用いて時分割伝送される伝送路
    におけるステータスビット保藤方式で心って、フレーム
    同期回路が同期状態にある場合にフレームパターンが誤
    ったことを検出してそのフレームパターンの新稿するチ
    ャンネルのステータスビットを1フレーム前の自チャン
    ネルのステータスビットと置換するようにしたことを特
    徴とするステータスビット保護方式。
JP17463983A 1983-09-21 1983-09-21 ステ−タスビット保護方式 Pending JPS6066535A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17463983A JPS6066535A (ja) 1983-09-21 1983-09-21 ステ−タスビット保護方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17463983A JPS6066535A (ja) 1983-09-21 1983-09-21 ステ−タスビット保護方式

Publications (1)

Publication Number Publication Date
JPS6066535A true JPS6066535A (ja) 1985-04-16

Family

ID=15982104

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17463983A Pending JPS6066535A (ja) 1983-09-21 1983-09-21 ステ−タスビット保護方式

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JP (1) JPS6066535A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1244235A2 (en) * 2001-03-23 2002-09-25 Kabushiki Kaisha Toshiba Node unit and state notice information acquiring method

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1244235A2 (en) * 2001-03-23 2002-09-25 Kabushiki Kaisha Toshiba Node unit and state notice information acquiring method
EP1244235A3 (en) * 2001-03-23 2006-03-08 Kabushiki Kaisha Toshiba Node unit and state notice information acquiring method
US7103042B2 (en) 2001-03-23 2006-09-05 Kabushiki Kaisha Toshiba Node unit and state notice information acquiring method
EP1780919A1 (en) * 2001-03-23 2007-05-02 Kabushiki Kaisha Toshiba Node unit and state notice information acquiring method

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