JPS6027947B2 - バツテリ−チエツク回路 - Google Patents
バツテリ−チエツク回路Info
- Publication number
- JPS6027947B2 JPS6027947B2 JP52114365A JP11436577A JPS6027947B2 JP S6027947 B2 JPS6027947 B2 JP S6027947B2 JP 52114365 A JP52114365 A JP 52114365A JP 11436577 A JP11436577 A JP 11436577A JP S6027947 B2 JPS6027947 B2 JP S6027947B2
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- battery
- circuit
- terminal
- sampling
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- Y02E60/12—
Landscapes
- Tests Of Electric Status Of Batteries (AREA)
- Protection Of Static Devices (AREA)
- Secondary Cells (AREA)
Description
【発明の詳細な説明】
本発明は例えばバッテリーで駆動するような小形のテー
プレコーダに使用されるバッテリーチェック回路に関す
る。
プレコーダに使用されるバッテリーチェック回路に関す
る。
従来のバッテリーチェック回路のひとつとしてバッテリ
ーの端子電圧がある基準電圧より低下した場合、電源ス
イッチがオンしていても電源が切れてしまうようにされ
たものがある。
ーの端子電圧がある基準電圧より低下した場合、電源ス
イッチがオンしていても電源が切れてしまうようにされ
たものがある。
この基準電圧はバッテリーの繰り返し充電可能な範囲を
考慮して定められ、バッテリーが過放電しないようにさ
れていた。ところが、バッテリーのバラツキが多く、こ
のバラッキを考慮して上述の基準電圧を設定したときに
は、まだ使用可能にも拘らず使用不可能と判定してしま
う欠点があった。本発明は、かかる欠点を除去せんとす
るものである。
考慮して定められ、バッテリーが過放電しないようにさ
れていた。ところが、バッテリーのバラツキが多く、こ
のバラッキを考慮して上述の基準電圧を設定したときに
は、まだ使用可能にも拘らず使用不可能と判定してしま
う欠点があった。本発明は、かかる欠点を除去せんとす
るものである。
即ち、本発明はバッテリーが放電して放電末期に近づく
と、その端子電圧の低下が急激になることに着目し、端
子電圧の所定時間当りの電圧降下量が基準量を越えたと
きに制御信号を発生させ、この制御信号によりバッテリ
ーと負荷の接続を断ったり、警報を発するなどしてバッ
テリーの過放電を防止するようにしたものである。
と、その端子電圧の低下が急激になることに着目し、端
子電圧の所定時間当りの電圧降下量が基準量を越えたと
きに制御信号を発生させ、この制御信号によりバッテリ
ーと負荷の接続を断ったり、警報を発するなどしてバッ
テリーの過放電を防止するようにしたものである。
第１図は本発明の基本的構成を示すもので、１はバッテ
リーの端子電圧の加えられる入力端子である。
リーの端子電圧の加えられる入力端子である。
この端子電圧はサンプリングホールド回路２ａ及び２ｂ
に供Ｖ給され、端子３からの所定周期のサンプリングパ
ルスによりサンプリングされる。この場合、遅延回路４
が設けられており、サンプリングホールド回路２ａでバ
ッテリーの端子電圧がサンプリングされる時点に対して
サンプリングホールド回路２ｂでこの端子電圧がサンプ
リングされる時点が所定時間遅延されるようになされる
。そしてサンプリングホールド回路２ａ及び２ｂの夫々
の出力が電圧比較回路５に供給され、この電圧比較回路
５からサンプリングホールド回路２ａの出力電圧とサン
プリングホールド回路２ｂの出力電圧との差、又はこれ
に比例した電圧が出力される。この電圧比較回路５の出
力電圧はしベル判別回路６に供給されて基準電圧と比較
され、基準電圧を越えると出力端子７に制御信号が発生
するようになされる。今、第２図の曲線で示すように入
力端子１からのバッテリーの端子電圧が低下した場合に
ついて説明すると、一方のサンプリングホールド回路２
ａにおいて端子電圧が時点Ｌ，ｔ２，ら，ｔ４でサンプ
リングされ、これより、Ｅ，，Ｅ２，Ｅ３，Ｅ４の出力
電圧が発生し、他方のサンプリングホールド回路２ｂに
おいては、時点ｔ，〜ｔ４の夫々に対し所定時間遅延さ
れた時点ｔ′，〜ｔ′４で端子電圧がサンプリングされ
、これより第２図において破線で示すようにＥ′，〜Ｅ
′４の出力電圧が発生する。
に供Ｖ給され、端子３からの所定周期のサンプリングパ
ルスによりサンプリングされる。この場合、遅延回路４
が設けられており、サンプリングホールド回路２ａでバ
ッテリーの端子電圧がサンプリングされる時点に対して
サンプリングホールド回路２ｂでこの端子電圧がサンプ
リングされる時点が所定時間遅延されるようになされる
。そしてサンプリングホールド回路２ａ及び２ｂの夫々
の出力が電圧比較回路５に供給され、この電圧比較回路
５からサンプリングホールド回路２ａの出力電圧とサン
プリングホールド回路２ｂの出力電圧との差、又はこれ
に比例した電圧が出力される。この電圧比較回路５の出
力電圧はしベル判別回路６に供給されて基準電圧と比較
され、基準電圧を越えると出力端子７に制御信号が発生
するようになされる。今、第２図の曲線で示すように入
力端子１からのバッテリーの端子電圧が低下した場合に
ついて説明すると、一方のサンプリングホールド回路２
ａにおいて端子電圧が時点Ｌ，ｔ２，ら，ｔ４でサンプ
リングされ、これより、Ｅ，，Ｅ２，Ｅ３，Ｅ４の出力
電圧が発生し、他方のサンプリングホールド回路２ｂに
おいては、時点ｔ，〜ｔ４の夫々に対し所定時間遅延さ
れた時点ｔ′，〜ｔ′４で端子電圧がサンプリングされ
、これより第２図において破線で示すようにＥ′，〜Ｅ
′４の出力電圧が発生する。
そして電圧比較回路６から、（Ｅ，一Ｅ′，）、（Ｅ２
−Ｅ′２）、（Ｅ３一Ｅ′３）の夫々又は夫々に応じた
レベルの出力電圧が発生する。そして、（Ｅ３一８３）
のように差が大きくなって基準電圧を越えると、出力端
子７に制御信号が発生する。この制御信号により、バッ
テリーと負荷の接続が断たれたり、警報が発せられるな
どしてバッテリーの過放電が防止される。第３図は上述
の本発明の一実施例を示すもので、１１はバッテリーで
ある。バッテリー１１はスイッチ回路８を介して定電圧
回路９に接続され、定電圧回路９の出力に一定の直流電
圧が発生するようになされ、この安定化された直流電圧
が負荷１０に供給される。また、一方のサンプリングホ
ールド回路２ａは抵抗器１２及び１３で分圧されたバッ
テリー１１の端子電圧がそのコレクタに供給されるスイ
ッチングトランジスタ１４ａとホールド用コンデンサ１
５ａとＦＥＴ１６ａとから構成され、同様に他方のサン
プリングホールド回路２ｂはスイッチングトランジスタ
１４ｂとホールド用コンデンサ１５ｂとＦＥＴ１６ｂと
から構成される。このスイッチングトランジスタ１４ａ
のベースに端子３から正のサンプリングパルスが加えら
れ、サンプリングパルスによってトランジスター４ａが
オンし、コンデンサ１５ａはそのときの抵抗器１２及び
１３の後続点の電圧に充電又は放電される。サンプリン
グホールド回路２ｂのスイッチングトランジスタ１４ｂ
のベースにはサンプリングパルスが時定数回路の構成の
遅延回路４を介して供給される。また、ＦＥＴ１６ａ及
び１６ｂのソースは抵抗器を介して接地され、このドレ
ィンは抵抗器を介して定電圧回路９の出力端子に接続さ
れる。このＦＥＴ１６ｂのドレインに例えばホトカプラ
１７の入力端子の一端が接続され、その他端が可変抵抗
器１３を介してＦＥＴ１６ａのドレィンに接続される。
ホトカプラ１７は、ＦＥＴ１６ｂのドレインからＦＥＴ
１６ａのドレィンの方向を順方向とする発光ダイオード
１９ａとこれに近接して設けられたホトダィオードＩ９
ｂとを有し、ホトダィオード１９ｂの両端が出力端子と
して導出され、この出力端子が増幅器２０の入力端子と
接続される。増幅器２０はホトダィオード１９ｂを流れ
る電流によってスイッチ回路８をオフとする制御信号を
形成するものである。このホトカプラ１７及び可変抵抗
器１８は第１図における電圧比較回路５及びレベル判別
回路６を構成するものである。かかる本発明の−実施例
の動作は、第２図により説明できる。
−Ｅ′２）、（Ｅ３一Ｅ′３）の夫々又は夫々に応じた
レベルの出力電圧が発生する。そして、（Ｅ３一８３）
のように差が大きくなって基準電圧を越えると、出力端
子７に制御信号が発生する。この制御信号により、バッ
テリーと負荷の接続が断たれたり、警報が発せられるな
どしてバッテリーの過放電が防止される。第３図は上述
の本発明の一実施例を示すもので、１１はバッテリーで
ある。バッテリー１１はスイッチ回路８を介して定電圧
回路９に接続され、定電圧回路９の出力に一定の直流電
圧が発生するようになされ、この安定化された直流電圧
が負荷１０に供給される。また、一方のサンプリングホ
ールド回路２ａは抵抗器１２及び１３で分圧されたバッ
テリー１１の端子電圧がそのコレクタに供給されるスイ
ッチングトランジスタ１４ａとホールド用コンデンサ１
５ａとＦＥＴ１６ａとから構成され、同様に他方のサン
プリングホールド回路２ｂはスイッチングトランジスタ
１４ｂとホールド用コンデンサ１５ｂとＦＥＴ１６ｂと
から構成される。このスイッチングトランジスタ１４ａ
のベースに端子３から正のサンプリングパルスが加えら
れ、サンプリングパルスによってトランジスター４ａが
オンし、コンデンサ１５ａはそのときの抵抗器１２及び
１３の後続点の電圧に充電又は放電される。サンプリン
グホールド回路２ｂのスイッチングトランジスタ１４ｂ
のベースにはサンプリングパルスが時定数回路の構成の
遅延回路４を介して供給される。また、ＦＥＴ１６ａ及
び１６ｂのソースは抵抗器を介して接地され、このドレ
ィンは抵抗器を介して定電圧回路９の出力端子に接続さ
れる。このＦＥＴ１６ｂのドレインに例えばホトカプラ
１７の入力端子の一端が接続され、その他端が可変抵抗
器１３を介してＦＥＴ１６ａのドレィンに接続される。
ホトカプラ１７は、ＦＥＴ１６ｂのドレインからＦＥＴ
１６ａのドレィンの方向を順方向とする発光ダイオード
１９ａとこれに近接して設けられたホトダィオードＩ９
ｂとを有し、ホトダィオード１９ｂの両端が出力端子と
して導出され、この出力端子が増幅器２０の入力端子と
接続される。増幅器２０はホトダィオード１９ｂを流れ
る電流によってスイッチ回路８をオフとする制御信号を
形成するものである。このホトカプラ１７及び可変抵抗
器１８は第１図における電圧比較回路５及びレベル判別
回路６を構成するものである。かかる本発明の−実施例
の動作は、第２図により説明できる。
つまり、ＦＥＴ１６ａのゲートにＥ，なる電圧が発生し
、ＦＥＴ１６ｂのゲートにＥ，より４・さし、Ｅ′，な
る電圧が発生したときは、ＦＥＴ１６ｂのドレイン電圧
がＦＥＴ１６ａのドレイン電圧より高くなるが、可変抵
抗器１８の電圧降下のためにホトカプラ１７の発光ダイ
オード１９ａは発光せず、ホトダィオード１９ｂには電
流が流れない。そしてＦＥＴ１６ａのゲートにＥ３なる
電圧が発生し、ＦＥＴ１６ｂのゲートにＥ３より小さい
Ｅ′３なる電圧が発生したときは、（Ｅ３−Ｅ′３）の
差が大きいために、発光ダイオード１９ａが発光してホ
トダィオード１９ｂに電流が流れ、これによって増幅器
２０の出力にスイッチ回路８をオフとする制御信号が発
生する。ＦＥＴ１６ａ及び１６ｂの動作電圧として定電
圧回路９の出力を用いているのは、バッテリー１１の端
子電圧の大きさによってスイッチ回路８をオフにする動
作点が影響されないようにするためであり、また可変抵
抗器１８によりこの動作点を調整することができる。
、ＦＥＴ１６ｂのゲートにＥ，より４・さし、Ｅ′，な
る電圧が発生したときは、ＦＥＴ１６ｂのドレイン電圧
がＦＥＴ１６ａのドレイン電圧より高くなるが、可変抵
抗器１８の電圧降下のためにホトカプラ１７の発光ダイ
オード１９ａは発光せず、ホトダィオード１９ｂには電
流が流れない。そしてＦＥＴ１６ａのゲートにＥ３なる
電圧が発生し、ＦＥＴ１６ｂのゲートにＥ３より小さい
Ｅ′３なる電圧が発生したときは、（Ｅ３−Ｅ′３）の
差が大きいために、発光ダイオード１９ａが発光してホ
トダィオード１９ｂに電流が流れ、これによって増幅器
２０の出力にスイッチ回路８をオフとする制御信号が発
生する。ＦＥＴ１６ａ及び１６ｂの動作電圧として定電
圧回路９の出力を用いているのは、バッテリー１１の端
子電圧の大きさによってスイッチ回路８をオフにする動
作点が影響されないようにするためであり、また可変抵
抗器１８によりこの動作点を調整することができる。
上述した所から明らかなように、本発明は遅延回路４に
よって定まる所定時間当りのバッテリーの端子電圧の降
下量の大きさによりバッテリーが使用不可能に至ったこ
とを検出するものであるから、従来のようにバッテリー
の端子電圧を単に基準電圧と比較するものとは異なり、
バッテリーの放電特性等のバラッキに影響されないよう
にできる。
よって定まる所定時間当りのバッテリーの端子電圧の降
下量の大きさによりバッテリーが使用不可能に至ったこ
とを検出するものであるから、従来のようにバッテリー
の端子電圧を単に基準電圧と比較するものとは異なり、
バッテリーの放電特性等のバラッキに影響されないよう
にできる。
第１図は本発明の基本的構成のブロック図、第２図は本
発明の説明に用いる略線図、第３図は本発明の一実施例
の接続図である。 １はバッテリーの端子電圧の加わる端子、２ａ，２ｂは
サンプリングホールド回路、５は電圧比較回路、６はし
ベル判別回路である。 第１図 第２図 第３図
発明の説明に用いる略線図、第３図は本発明の一実施例
の接続図である。 １はバッテリーの端子電圧の加わる端子、２ａ，２ｂは
サンプリングホールド回路、５は電圧比較回路、６はし
ベル判別回路である。 第１図 第２図 第３図
Claims (1)
- １ バツテリーの端子電圧をサンプルホールドする第１
及び第２の手段と、これら第１及び第２の手段のサンプ
リング位相を異ならせる手段と、上記第１及び第２の手
段の出力を比較することにより上記端子電圧の所定時間
当りの電圧降下量を検出する手段と、上記電圧降下量が
基準量を超えたときに制御信号を発生する判別手段とを
備え、上記制御信号により上記バツテリーの過放電を防
止するようにしたバツテリーチエツク回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52114365A JPS6027947B2 (ja) | 1977-09-22 | 1977-09-22 | バツテリ−チエツク回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52114365A JPS6027947B2 (ja) | 1977-09-22 | 1977-09-22 | バツテリ−チエツク回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5448043A JPS5448043A (en) | 1979-04-16 |
| JPS6027947B2 true JPS6027947B2 (ja) | 1985-07-02 |
Family
ID=14635883
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52114365A Expired JPS6027947B2 (ja) | 1977-09-22 | 1977-09-22 | バツテリ−チエツク回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6027947B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07302620A (ja) * | 1994-05-10 | 1995-11-14 | Masatoshi Ishimaru | 放電停止方法及び装置 |
-
1977
- 1977-09-22 JP JP52114365A patent/JPS6027947B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5448043A (en) | 1979-04-16 |
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